JPH0322437A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は半導体装置の製造方法に関し、特にはんだバン
プ電極を有する半導体装置の製造方法に関する。
プ電極を有する半導体装置の製造方法に関する。
従来、バンプ電極を有する半導体装置は、第2図に示す
ように、シリコン基板1の上にAffl電極3を設け、
A.&電極3の上に単層あるいは多層からなる障壁金属
層4を形成し、しかる後半球状のはんだ電極8を形成す
る。はんだ電極8のはんだ供給方法としては、めっき法
、蒸着法、はんだボール法、はんだディップ法が代表的
な方法として挙げられるが、所謂フリップチップにはめ
っき法が多用されている。
ように、シリコン基板1の上にAffl電極3を設け、
A.&電極3の上に単層あるいは多層からなる障壁金属
層4を形成し、しかる後半球状のはんだ電極8を形成す
る。はんだ電極8のはんだ供給方法としては、めっき法
、蒸着法、はんだボール法、はんだディップ法が代表的
な方法として挙げられるが、所謂フリップチップにはめ
っき法が多用されている。
近年、超音波を利用したディップ法によりAg電極上に
直接はんだ電極を形成する方法が提案されているが、は
んだの均一な供給が困難であり、また十分なはんだ量の
供給が困難であるとされている。
直接はんだ電極を形成する方法が提案されているが、は
んだの均一な供給が困難であり、また十分なはんだ量の
供給が困難であるとされている。
上述した従来のはんだバンプ電極の形成方法は、はんだ
めっき法を用いた場合、はんだめっきを行なうための障
壁金属層をはんだめっき終了後にエッチング除去する際
、はんだを劣化させない様にエッチング液とエッチング
方法を工夫しなければならない。また、絶縁膜2を厚く
形威した上で障壁金属層を電極としたはんだめっきを行
なうことは、障壁金属層の段差切れが発生し実現が困難
である。一方、はんだを超音波はんだディップにより供
給する方法を行なった場合、はんだの供給量にばらつき
が発生し易く、これを制御することができない。また、
供給される半田量が少なく、電極の高さは30μm前後
あるいはそれ以下となり、従来行なわれていたフリップ
チップと同様の実装を行なうことはできない。
めっき法を用いた場合、はんだめっきを行なうための障
壁金属層をはんだめっき終了後にエッチング除去する際
、はんだを劣化させない様にエッチング液とエッチング
方法を工夫しなければならない。また、絶縁膜2を厚く
形威した上で障壁金属層を電極としたはんだめっきを行
なうことは、障壁金属層の段差切れが発生し実現が困難
である。一方、はんだを超音波はんだディップにより供
給する方法を行なった場合、はんだの供給量にばらつき
が発生し易く、これを制御することができない。また、
供給される半田量が少なく、電極の高さは30μm前後
あるいはそれ以下となり、従来行なわれていたフリップ
チップと同様の実装を行なうことはできない。
本発明の半導体装置の製造方法は、能動領域が形成され
ている半導体基板の前記能動領域に接触体を形成する工
程と、前記接触体に障壁金属層を形成する工程と、前記
接触体の情報に開口部を有するように前記障壁金属層上
にレジストのマスクを形成する工程と、前記マスクを利
用してめっき法により前記開口部を埋める金属層を形成
する工程と、前記レジストを除去して露出した前記障壁
金属層を除去する工程と、前記金属層の上面は薄くその
他の表面には前記金属層の厚さの半分程度の厚さに耐熱
性樹脂を被覆する工程と、ドライエッチングにより前記
金属層の上面及び上半分の側面を露出させる工程と、は
んだディップ法によりはんだバンプ電極を形成する工程
とを含んで楕或される。
ている半導体基板の前記能動領域に接触体を形成する工
程と、前記接触体に障壁金属層を形成する工程と、前記
接触体の情報に開口部を有するように前記障壁金属層上
にレジストのマスクを形成する工程と、前記マスクを利
用してめっき法により前記開口部を埋める金属層を形成
する工程と、前記レジストを除去して露出した前記障壁
金属層を除去する工程と、前記金属層の上面は薄くその
他の表面には前記金属層の厚さの半分程度の厚さに耐熱
性樹脂を被覆する工程と、ドライエッチングにより前記
金属層の上面及び上半分の側面を露出させる工程と、は
んだディップ法によりはんだバンプ電極を形成する工程
とを含んで楕或される。
次に、本発明の実施例について図面を参照して説明する
。
。
第1図(a)〜(f)は本発明の一実施例を説明するた
めの工程順に示した断面図である。
めの工程順に示した断面図である。
まず、第1図(a)に示すように、シリコン基板1の上
にA.R電極3を設け、絶縁膜2で周囲を保護する。こ
のように形成されたウェーハ全面に障壁金属層4をスパ
ッタ法あるいは蒸着法により形成する。障壁金属層4は
単層あるいは多層からなり、Ti/Cu,N iCr/
Cu等の構成により、例えばTiを0.1μm.Cuを
1μmの厚さに形成する。
にA.R電極3を設け、絶縁膜2で周囲を保護する。こ
のように形成されたウェーハ全面に障壁金属層4をスパ
ッタ法あるいは蒸着法により形成する。障壁金属層4は
単層あるいは多層からなり、Ti/Cu,N iCr/
Cu等の構成により、例えばTiを0.1μm.Cuを
1μmの厚さに形成する。
次に、第1図(b)に示すように、レジスト5を障壁金
属層4の上に形成し、露光現像してA1電極3上に開口
部を形成する。ここで、レジストとしてドライフィルム
レジストを使用すると容易に50μm厚以上の膜厚を得
ることが可能である。次に、障壁金属層4を電極として
金属めっきを行なう。めっき材としてはCu,Niなど
のはんだ濡れ性の良好な材料を使用し、電解めっきによ
り少なくとも10μmの厚い金属層を形成する。ここで
はCu層6を形成するものとする。前述したドライフィ
ルムレジストを使用し、厚さを50〜100μmにする
ことにより金層柱に近い金属層を得ることが可能である
。
属層4の上に形成し、露光現像してA1電極3上に開口
部を形成する。ここで、レジストとしてドライフィルム
レジストを使用すると容易に50μm厚以上の膜厚を得
ることが可能である。次に、障壁金属層4を電極として
金属めっきを行なう。めっき材としてはCu,Niなど
のはんだ濡れ性の良好な材料を使用し、電解めっきによ
り少なくとも10μmの厚い金属層を形成する。ここで
はCu層6を形成するものとする。前述したドライフィ
ルムレジストを使用し、厚さを50〜100μmにする
ことにより金層柱に近い金属層を得ることが可能である
。
次に、第1図(c)に示すように、レジストを除去し、
電極周囲の障壁金属層4をエッチング除去する。障壁金
属層にT i / C uを用い、Cuをスパッタ法で
形成した場合、そのCu層はめっきによるCu層6に比
べて非常に薄いので、特にレジスト等による保護を行な
わなくとも、電極部のCu層を残すことができる。Cu
エッチャントとしてはH2SO4とH202の水溶液が
、また、TiのエッチャントとしてはHFの水溶液が適
用可能である。この様にして、AjI電極3上にCuの
柱状電極を形成する。
電極周囲の障壁金属層4をエッチング除去する。障壁金
属層にT i / C uを用い、Cuをスパッタ法で
形成した場合、そのCu層はめっきによるCu層6に比
べて非常に薄いので、特にレジスト等による保護を行な
わなくとも、電極部のCu層を残すことができる。Cu
エッチャントとしてはH2SO4とH202の水溶液が
、また、TiのエッチャントとしてはHFの水溶液が適
用可能である。この様にして、AjI電極3上にCuの
柱状電極を形成する。
次に、第1図(d)に示すように、比較的粘度の低いポ
リイミド等の耐熱性樹脂を1000rpm以下の低速回
転でスピン塗布し、スムージングを行なってポリイミド
膜7を形成する。ポリイミド膜中はCu層6の上では周
囲よりも薄く形成される。このように形威されたポリイ
ミド膜7をドライエッチングして、第1図(e)に示す
ように、Cu層6表面のポリイミド膜は除去されるが、
Cu層6の周囲のポリイミド膜は残る条件に5 −6 て%浬して、柱状のCu層6の下部周囲を覆う。
リイミド等の耐熱性樹脂を1000rpm以下の低速回
転でスピン塗布し、スムージングを行なってポリイミド
膜7を形成する。ポリイミド膜中はCu層6の上では周
囲よりも薄く形成される。このように形威されたポリイ
ミド膜7をドライエッチングして、第1図(e)に示す
ように、Cu層6表面のポリイミド膜は除去されるが、
Cu層6の周囲のポリイミド膜は残る条件に5 −6 て%浬して、柱状のCu層6の下部周囲を覆う。
次に、第1図(f)に示すように、はんだディップを行
なう事によりCu層6上部にはんだ電極8を形成する。
なう事によりCu層6上部にはんだ電極8を形成する。
以上説明したように、本発明によれば、充分な高さのは
んだバンプ電極が得られ、半導体素子と実装基板との間
の熱膨張係数差によって発生する応力を吸収し、オープ
ン不良を低減することができ、また、電極以外の半導体
素子表面は耐熱性樹脂により覆われているために、はん
だディップ後の工程において半導体素子表面が保護され
、不良の発生率が大幅に低減されているという効果があ
る。
んだバンプ電極が得られ、半導体素子と実装基板との間
の熱膨張係数差によって発生する応力を吸収し、オープ
ン不良を低減することができ、また、電極以外の半導体
素子表面は耐熱性樹脂により覆われているために、はん
だディップ後の工程において半導体素子表面が保護され
、不良の発生率が大幅に低減されているという効果があ
る。
1・・・シリコン基板、2・・・絶縁膜、3・・・AJ
電極、4・・・障壁金属層、5・・・レジスト、6・・
・Cu層、7・・・ポリイミド膜、8・・・はんだ電極
。
電極、4・・・障壁金属層、5・・・レジスト、6・・
・Cu層、7・・・ポリイミド膜、8・・・はんだ電極
。
Claims (1)
- 能動領域が形成されている半導体基板の前記能動領域に
接触体を形成する工程と、前記接触体に障壁金属層を形
成する工程と、前記接触体の情報に開口部を有するよう
に前記障壁金属層上にレジストのマスクを形成する工程
と、前記マスクを利用してめっき法により前記開口部を
埋める金属層を形成する工程と、前記レジストを除去し
て露出した前記障壁金属層を除去する工程と、前記金属
層の上面は薄くその他の表面には前記金属層の厚さの半
分程度の厚さに耐熱性樹脂を被覆する工程と、ドライエ
ッチングにより前記金属層の上面及び上半分の側面を露
出させる工程と、はんだディップ法によりはんだバンプ
電極を形成する工程とを含むことを特徴とする半導体装
置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1157692A JP2785338B2 (ja) | 1989-06-19 | 1989-06-19 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1157692A JP2785338B2 (ja) | 1989-06-19 | 1989-06-19 | 半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0322437A true JPH0322437A (ja) | 1991-01-30 |
JP2785338B2 JP2785338B2 (ja) | 1998-08-13 |
Family
ID=15655299
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1157692A Expired - Lifetime JP2785338B2 (ja) | 1989-06-19 | 1989-06-19 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2785338B2 (ja) |
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TWI313507B (en) | 2002-10-25 | 2009-08-11 | Megica Corporatio | Method for assembling chips |
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US8294279B2 (en) | 2005-01-25 | 2012-10-23 | Megica Corporation | Chip package with dam bar restricting flow of underfill |
-
1989
- 1989-06-19 JP JP1157692A patent/JP2785338B2/ja not_active Expired - Lifetime
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