JPH0318966Y2 - - Google Patents
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- Publication number
- JPH0318966Y2 JPH0318966Y2 JP1980084572U JP8457280U JPH0318966Y2 JP H0318966 Y2 JPH0318966 Y2 JP H0318966Y2 JP 1980084572 U JP1980084572 U JP 1980084572U JP 8457280 U JP8457280 U JP 8457280U JP H0318966 Y2 JPH0318966 Y2 JP H0318966Y2
- Authority
- JP
- Japan
- Prior art keywords
- display
- input
- sequence control
- control device
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 238000010586 diagram Methods 0.000 description 6
- 238000001514 detection method Methods 0.000 description 1
- 230000035945 sensitivity Effects 0.000 description 1
Description
【考案の詳細な説明】
この考案は、工作機などのシ−ケンス制御に用
いられるシ−ケンス制御装置に関するもので、特
に入力機器の動作状態を表示するシ−ケンス制御
装置の入力表示回路の改良に関するものである。
いられるシ−ケンス制御装置に関するもので、特
に入力機器の動作状態を表示するシ−ケンス制御
装置の入力表示回路の改良に関するものである。
第１図は従来のシ−ケンス制御回路の入力表示
回路の一例を示し、第２図は従来の別のシ−ケン
ス制御回路の入力表示回路において、特にシ−ケ
ンス制御回路を除去した入力表示回路の部分を主
体にして１回路分を示したものである。この第１
図、第２図の両図において、１はシ−ケンス制御
装置で、１０はそのシ−ケンス制御回路、１３ａ
〜１３ｎは入力端子群、１４ａ〜１４ｎは出力端
子群、１５ａ，１５ｂは電源端子であり、第１図
では、入力端子群１３ａ〜１３ｎと電源正極端子
１５ａ間には抵抗１１ａ〜１１ｎと発光ダイオ−
ドなどの表示素子１２ａ〜１２ｎの直列回路が接
続されている。２は直流電源でシ−ケンス制御装
置１の電源端子１５ａ，１５ｂに接続され、直流
電源を供給する。
回路の一例を示し、第２図は従来の別のシ−ケン
ス制御回路の入力表示回路において、特にシ−ケ
ンス制御回路を除去した入力表示回路の部分を主
体にして１回路分を示したものである。この第１
図、第２図の両図において、１はシ−ケンス制御
装置で、１０はそのシ−ケンス制御回路、１３ａ
〜１３ｎは入力端子群、１４ａ〜１４ｎは出力端
子群、１５ａ，１５ｂは電源端子であり、第１図
では、入力端子群１３ａ〜１３ｎと電源正極端子
１５ａ間には抵抗１１ａ〜１１ｎと発光ダイオ−
ドなどの表示素子１２ａ〜１２ｎの直列回路が接
続されている。２は直流電源でシ−ケンス制御装
置１の電源端子１５ａ，１５ｂに接続され、直流
電源を供給する。
また、３ａ〜３ｎは、入力端子１３ａ〜１３ｎ
と直流電源２の負極端子１５ｂ間に接続される外
部入力機器で、マイクロスイツチ３ａ、押ボタン
スイツチ３ｎなどにより構成される。さらに、４
ａ〜４ｎは出力端子１４ａ〜１４ｎと直流電源２
の正極端子１５ａ間に接続される外部負荷で、ソ
レノイド４ａ、ランプ４ｎなどにより構成され
る。
と直流電源２の負極端子１５ｂ間に接続される外
部入力機器で、マイクロスイツチ３ａ、押ボタン
スイツチ３ｎなどにより構成される。さらに、４
ａ〜４ｎは出力端子１４ａ〜１４ｎと直流電源２
の正極端子１５ａ間に接続される外部負荷で、ソ
レノイド４ａ、ランプ４ｎなどにより構成され
る。
次に動作について説明する。第１図のシ−ケン
ス制御装置１に直流電源２から電源が供給される
と、シ−ケンス制御回路１０が動作を始め、この
シ−ケンス制御回路のプログラムメモリには、あ
らかじめ工作機などのシ−ケンスを実現すべき命
令がプログラムされており、入力機器３ａ〜３ｎ
の入力を受け、外部負荷４ａ〜４ｎはそのシ−ケ
ンスに応じ適宜、開閉制御される。
ス制御装置１に直流電源２から電源が供給される
と、シ−ケンス制御回路１０が動作を始め、この
シ−ケンス制御回路のプログラムメモリには、あ
らかじめ工作機などのシ−ケンスを実現すべき命
令がプログラムされており、入力機器３ａ〜３ｎ
の入力を受け、外部負荷４ａ〜４ｎはそのシ−ケ
ンスに応じ適宜、開閉制御される。
この動作状態において、いまマイクロスイツチ
３ａが閉となると、直流電源２の正極端子１５ａ
から抵抗１１ａ、表示素子１２ａ、マイクロスイ
ツチ３ａ、直流電源２の負極端子１５ｂよりなる
径路で電流が流れ、シ−ケンス制御回路１０が入
力を取り込むと同時に表示素子１２ａによりマイ
クロスイツチ３ａが、閉となつたことを表示す
る。
３ａが閉となると、直流電源２の正極端子１５ａ
から抵抗１１ａ、表示素子１２ａ、マイクロスイ
ツチ３ａ、直流電源２の負極端子１５ｂよりなる
径路で電流が流れ、シ−ケンス制御回路１０が入
力を取り込むと同時に表示素子１２ａによりマイ
クロスイツチ３ａが、閉となつたことを表示す
る。
マイクロスイツチ３ａが開となれば、上記径路
は遮断され表示素子１２ａは消灯する。押ボタン
スイツチ３ｎに対しても同様に表示素子１２ｎに
より、その動作状態が表示される。これらの動作
表示は外部入力機器３ａ〜３ｎの動作確認、故障
早期発見などの目的から通常設けられる。
は遮断され表示素子１２ａは消灯する。押ボタン
スイツチ３ｎに対しても同様に表示素子１２ｎに
より、その動作状態が表示される。これらの動作
表示は外部入力機器３ａ〜３ｎの動作確認、故障
早期発見などの目的から通常設けられる。
ところで、このようなシ−ケンス制御装置にお
いては、外部入力機器３ａ〜３ｎの動作状態を該
入力機器３ａ〜３ｎ部で表示することが要求され
る場合（例えば被工作物が工作機に供給されてい
るか否かを示す場合など）があり、このような場
合、入力機器３ａ〜３ｎとして第２図に示すよう
な表示付マイクロスイツチ３ｂが用いられること
になる。
いては、外部入力機器３ａ〜３ｎの動作状態を該
入力機器３ａ〜３ｎ部で表示することが要求され
る場合（例えば被工作物が工作機に供給されてい
るか否かを示す場合など）があり、このような場
合、入力機器３ａ〜３ｎとして第２図に示すよう
な表示付マイクロスイツチ３ｂが用いられること
になる。
しかしながら、この表示付マイクロスイツチ３
ｂをシ−ケンス制御装置１の入力端子１３ｂに接
続すると、マイクロスイツチ３ｂの接点が開であ
つても、直流電源２の正極端子１５ａから抵抗１
１ｂ、表示素子１２ｂ、抵抗３０ｂ、表示素子３
１ｂを介して電流が流れ、表示素子１２ｂの発光
感度によつては点灯することがある。このため、
シ−ケンス制御装置１に設けられた表示素子１２
ｂではマイクロスイツチ３ｂの開閉状態が判別で
きなくなり、シ−ケンス制御装置１における動作
状態の確認が難しいものとなつていた。
ｂをシ−ケンス制御装置１の入力端子１３ｂに接
続すると、マイクロスイツチ３ｂの接点が開であ
つても、直流電源２の正極端子１５ａから抵抗１
１ｂ、表示素子１２ｂ、抵抗３０ｂ、表示素子３
１ｂを介して電流が流れ、表示素子１２ｂの発光
感度によつては点灯することがある。このため、
シ−ケンス制御装置１に設けられた表示素子１２
ｂではマイクロスイツチ３ｂの開閉状態が判別で
きなくなり、シ−ケンス制御装置１における動作
状態の確認が難しいものとなつていた。
この考案は、上記のような従来の欠点を除去す
るためになされたもので、表示素子に並列に抵抗
を設けることによりシ−ケンス制御装置１の入力
端子に開動作時にインピ−ダンスを有する外部入
力機器が接続されても、その動作状態を表示でき
るシ−ケンス制御装置の入力表示回路を提供する
ことを目的としている。
るためになされたもので、表示素子に並列に抵抗
を設けることによりシ−ケンス制御装置１の入力
端子に開動作時にインピ−ダンスを有する外部入
力機器が接続されても、その動作状態を表示でき
るシ−ケンス制御装置の入力表示回路を提供する
ことを目的としている。
以下、この考案のシ−ケンス制御回路の実施例
について図面に基づき説明する。第３図はその一
実施例の回路図であり、この第３図において、１
００ａ〜１００ｎは抵抗で各表示素子１２ａ〜１
２ｎに並列に接続されている。入力端子１３ｂに
は表示付マイクロスイツチ３ｂが接続されてい
る。
について図面に基づき説明する。第３図はその一
実施例の回路図であり、この第３図において、１
００ａ〜１００ｎは抵抗で各表示素子１２ａ〜１
２ｎに並列に接続されている。入力端子１３ｂに
は表示付マイクロスイツチ３ｂが接続されてい
る。
表示付マイクロスイツチ３ｂはマイクロスイツ
チに並列に抵抗３０ｂと表示素子３１ｂの直列回
路が接続されている。その他の部分は第１図と同
様であるから、第１図と同一部分には同一符号を
付してその説明を省略する。
チに並列に抵抗３０ｂと表示素子３１ｂの直列回
路が接続されている。その他の部分は第１図と同
様であるから、第１図と同一部分には同一符号を
付してその説明を省略する。
次に、以上のように構成されたこの考案のシ−
ケンス制御装置の入力表示回路の動作について説
明する。いま、直流電源２の出力電圧をVB、抵
抗１１ｂをR11、抵抗１００ｂをR100、抵抗３０
ｂをR30としたとき、マイクロスイツチ３ｂの接
点が開時において、表示素子１２ｂに印加される
電圧は、ほぼR100・VB／R30＋R11＋R100となる。（ただ
し、 発光ダイオ−ドなどの表示素子３１ｂの順方向電
圧VFは一般にVB≫VFなので無視するものとす
る） また、マイクロスイツチ３ｂの接点の閉時は
R100・VB／R11＋R100となるので、表示素子１２ｂの点
灯限 界電圧をVFlimitとしたとき、R100・VB／R30＋R11＋R10
0＜ VFlimit＜R100・VB／R11＋R100を満たすよう外部抵抗３
０ ｂに対応して抵抗１００ｂの値を選定しておけ
ば、入力端子１３ｂに開動作時にインピ−ダンス
を有する外部入力機器３ｂが接続されても表示素
子１２ｂはその開閉状態に応じて消灯あるいは点
灯し、外部入力機器３ｂの動作状態を表示するこ
とが可能となる。
ケンス制御装置の入力表示回路の動作について説
明する。いま、直流電源２の出力電圧をVB、抵
抗１１ｂをR11、抵抗１００ｂをR100、抵抗３０
ｂをR30としたとき、マイクロスイツチ３ｂの接
点が開時において、表示素子１２ｂに印加される
電圧は、ほぼR100・VB／R30＋R11＋R100となる。（ただ
し、 発光ダイオ−ドなどの表示素子３１ｂの順方向電
圧VFは一般にVB≫VFなので無視するものとす
る） また、マイクロスイツチ３ｂの接点の閉時は
R100・VB／R11＋R100となるので、表示素子１２ｂの点
灯限 界電圧をVFlimitとしたとき、R100・VB／R30＋R11＋R10
0＜ VFlimit＜R100・VB／R11＋R100を満たすよう外部抵抗３
０ ｂに対応して抵抗１００ｂの値を選定しておけ
ば、入力端子１３ｂに開動作時にインピ−ダンス
を有する外部入力機器３ｂが接続されても表示素
子１２ｂはその開閉状態に応じて消灯あるいは点
灯し、外部入力機器３ｂの動作状態を表示するこ
とが可能となる。
ここで、シ−ケンス制御装置１としては使用す
る直流電源２の電圧が特定されるものであり、こ
のため、入力端子１３ａ〜１３ｎに接続される外
部入力機器３ａ〜３ｎの定格も特定されることに
なり、したがつて、このような外部入力機器３ａ
〜３ｎを考慮に入れて抵抗１００ｂを選定するこ
とは設計的に可能なことがらであり、かつ、表示
付マイクロスイツチ３ｂの仕様を指定することに
よつても構成することが可能である。
る直流電源２の電圧が特定されるものであり、こ
のため、入力端子１３ａ〜１３ｎに接続される外
部入力機器３ａ〜３ｎの定格も特定されることに
なり、したがつて、このような外部入力機器３ａ
〜３ｎを考慮に入れて抵抗１００ｂを選定するこ
とは設計的に可能なことがらであり、かつ、表示
付マイクロスイツチ３ｂの仕様を指定することに
よつても構成することが可能である。
第４図はこの考案の他の実施例における入力表
示回路の部分を取り出して示したものであり、こ
の第４図に示すように、表示素子１２ｂを入力端
子１３ｂとシ−ケンス制御回路１０の入力間に設
け、表示素子１２ｂに抵抗１００ａを並列に接続
してもその効果は同様であることは云うまでもな
い。
示回路の部分を取り出して示したものであり、こ
の第４図に示すように、表示素子１２ｂを入力端
子１３ｂとシ−ケンス制御回路１０の入力間に設
け、表示素子１２ｂに抵抗１００ａを並列に接続
してもその効果は同様であることは云うまでもな
い。
以上のようにこの考案は、シ−ケンス制御装置
の入力端子に抵抗と表示素子とを直列に接続する
とともにこの表示素子に並列に抵抗を接続するよ
うに構成したので、スイツチ開放時にインピーダ
ンスを有する外部入力機器に対しても、その開閉
状態を確実に表示でき、シ−ケンス制御装置側で
外部入力機器の動作確認、故障発見が容易に行え
るなどの効果がある。
の入力端子に抵抗と表示素子とを直列に接続する
とともにこの表示素子に並列に抵抗を接続するよ
うに構成したので、スイツチ開放時にインピーダ
ンスを有する外部入力機器に対しても、その開閉
状態を確実に表示でき、シ−ケンス制御装置側で
外部入力機器の動作確認、故障発見が容易に行え
るなどの効果がある。
第１図は従来のシ−ケンス制御装置の入力表示
回路を示す回路図、第２図は従来の他のシ−ケン
ス制御装置の入力表示回路における入力表示回路
の部分のみを取り出して示す回路図、第３図はこ
の考案のシ−ケンス制御装置の入力表示回路の一
実施例を示す回路図、第４図はこの考案のシ−ケ
ンス制御装置の入力表示回路の他の実施例におけ
る入力表示回路の部分のみを取り出して示す回路
図である。 １……シ−ケンス制御装置、２……直流電源、
３ａ……マイクロスイツチ、３ｂ……表示付マイ
クロスイツチ、３ｎ……押ボタンスイツチ、１１
ａ〜１１ｎ，３０ｂ……抵抗、１２ａ〜１２ｎ，
３１ｂ……表示素子、１３ａ〜１３ｂ……入力端
子群、１４ａ〜１４ｎ……出力端子群、１５ａ，
１５ｂ……電源端子、１００ａ〜１００ｎ……抵
抗。なお、図中同一符号は同一または相当部分を
示す。
回路を示す回路図、第２図は従来の他のシ−ケン
ス制御装置の入力表示回路における入力表示回路
の部分のみを取り出して示す回路図、第３図はこ
の考案のシ−ケンス制御装置の入力表示回路の一
実施例を示す回路図、第４図はこの考案のシ−ケ
ンス制御装置の入力表示回路の他の実施例におけ
る入力表示回路の部分のみを取り出して示す回路
図である。 １……シ−ケンス制御装置、２……直流電源、
３ａ……マイクロスイツチ、３ｂ……表示付マイ
クロスイツチ、３ｎ……押ボタンスイツチ、１１
ａ〜１１ｎ，３０ｂ……抵抗、１２ａ〜１２ｎ，
３１ｂ……表示素子、１３ａ〜１３ｂ……入力端
子群、１４ａ〜１４ｎ……出力端子群、１５ａ，
１５ｂ……電源端子、１００ａ〜１００ｎ……抵
抗。なお、図中同一符号は同一または相当部分を
示す。
Claims (1)
- 【実用新案登録請求の範囲】 開閉素子に並列にインピ−ダンスR30が接続さ
れた外部入力機器の上記開閉素子の開閉信号をシ
−ケンス制御装置に供給する入力端子、この入力
端子と上記シ−ケンス制御装置の電源との間に直
列接続された表示素子と第１の抵抗R11とからな
り、上記外部入力機器の動作状態を表示する直列
回路、この直列回路の上記表示素子に並列接続さ
れた第２の抵抗R100を有し、該第２の抵抗R100を
上記インピ−ダンスR30に対応して、 R100・VB／R30＋R11＋R100＜VFlimit＜R100・VB／R11
＋R100 （但し、VB：電源の出力電圧、VFlimit：表示素
子の表示限界電圧）を満足するように選定したこ
とを特徴とするシ−ケンス制御装置の入力表示回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1980084572U JPH0318966Y2 (ja) | 1980-06-16 | 1980-06-16 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1980084572U JPH0318966Y2 (ja) | 1980-06-16 | 1980-06-16 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5710009U JPS5710009U (ja) | 1982-01-19 |
| JPH0318966Y2 true JPH0318966Y2 (ja) | 1991-04-22 |
Family
ID=29446861
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1980084572U Expired JPH0318966Y2 (ja) | 1980-06-16 | 1980-06-16 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0318966Y2 (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5431146B2 (ja) * | 1974-03-22 | 1979-10-04 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5710424Y2 (ja) * | 1977-08-05 | 1982-03-01 |
-
1980
- 1980-06-16 JP JP1980084572U patent/JPH0318966Y2/ja not_active Expired
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5431146B2 (ja) * | 1974-03-22 | 1979-10-04 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5710009U (ja) | 1982-01-19 |
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