JPH03148842A - フレキシブル基板の構造 - Google Patents

フレキシブル基板の構造

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JPH03148842A
JPH03148842A JP1288396A JP28839689A JPH03148842A JP H03148842 A JPH03148842 A JP H03148842A JP 1288396 A JP1288396 A JP 1288396A JP 28839689 A JP28839689 A JP 28839689A JP H03148842 A JPH03148842 A JP H03148842A
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JP
Japan
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board
external connection
reduce
flexible board
flexible
Prior art date
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Pending
Application number
JP1288396A
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English (en)
Inventor
Norio Nakamura
典生 中村
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Seiko Epson Corp
Original Assignee
Seiko Epson Corp
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Filing date
Publication date
Application filed by Seiko Epson Corp filed Critical Seiko Epson Corp
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Publication of JPH03148842A publication Critical patent/JPH03148842A/ja
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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/0002Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/02Details
    • H05K1/14Structural association of two or more printed circuits
    • H05K1/141One or more single auxiliary printed circuits mounted on a main printed circuit, e.g. modules, adapters
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/18Printed circuits structurally associated with non-printed electric components

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野] 本発明はフレキシブル基板の端子構造に関する[従来の
技術] 従来フレキシブル基板と外部の接続をはかる際に用いら
れる端子は第1図従来技術によるフレキシブル基板の斜
視図にみられるように双方向にひきだされるか、あるい
はそれ以上の方向にひきだされるかとなっていた。
[発明が解決しようとする課題] しかし、従来のフレキシブル基板は2方向あるいはそれ
以上の方向に外部接続用端子があるため、例えばリジッ
ト基板等に実装する場合、フレキシブル基板同志が交差
することは許されないので、実装する際にフレキシブル
基板の面積は少なくとも専有してしまい、高密度化に限
界があるという1副題点がある。
そこで本発明はこのような画題点を解決するもので、そ
の目的とするところは、一方向のみ外部接続用端子をだ
すことによってフレキシブル基板の柔軟性によって実装
時の、フレキシブル基[M志の交差を許すことによって
実装効率の向上をはかるところにある。
[課題を解決するための手段] 本発明のフレキシブル基板の端子構造は一方向にのみ外
部接続用端子を有することを特徴とする[実施例] 第2図は本発明に基づいてフレキシブル基板の外部接続
用端子を一方向に引き出したフレキシブルチーブの概略
斜視図である。
1はフレキシブル基板の基材となるポリイミドテープ、
2はフレキシブル基板の外部接続用端子である。第5図
は第2図ポリイミドテープでできたフレキシブル基板に
メモリエOを従来TABとして知られている方法を用い
て実装させ、拳品抜きを行ってメモりパッケージとした
ものの斜視図である。3は実装されなメそり工Oである
。第4図はこのメモりパッケージをリジッド基板に複数
個実装してメモリモジュールとしたものの概略斜視図で
ある。第4図の中で、4は本発明を用いて電極を一方向
に引き出したメモりパッケージ、5はメモりパッケージ
を実装するガラエボ基板である第5図は第4図に示−す
メモリモジ晶−ルの断面図である。従来の方法によれば
メモ替パッケージ4を重ねて実装することは不可能であ
ったのに対し、本発明によれば、第5図にみられる様に
メモリーパッケージ4と実装されるガラエポ基板5はそ
の接読を目的とする半田付は部5以外の箇所では交差し
て重なっていても良いため、実装密度の向上は飛躍的な
ものとなる。
メモリーパッケージ4はフレキシブル基板を基材として
いるために充分な柔軟性を有していることから、第5図
断面図に示す様に傾斜角度をもって実装できるため、高
い密度でガラエポ基板51にメモリーパッケージ4を実
装宅きる割に実装厚みを増さな(ても良い。すなわち限
られた体積の中で、できうる限りの高容量を要求される
メモリモジ為−ルを具現化するために本発明は不可欠な
ものである。
一方実装密度の高さを要求しない場合、メモリーパッケ
ージ4をガラエボ基板5に空実する時、外部接続用端子
2が一方向にしかでていない為K、その端子部分だけが
ガラエボ基板5上にあれば実装できるのでガラエボ基板
5はその分小さくてもよいことになる。
[発明の効果] 以上説明した本発明のフレキシブル基板は一方向にのみ
外部接続用端子を有することによって実装密度の向上は
Rtill的なものとなり、逆に同じ容量を実装するの
であればそれだけ小さなリジッド基板ですむためコスト
ダウンが可能となる。
4図面の簡争な説明 第1図は従来技WIによるフレキシブル基板の斜視図。
第2図は本発明に基づ(フレキシブル基板の斜視図。
第3図は本発明を用いたメモりパッケージの斜視図。
第4図は本発明を利用したメモりパッケージを使ったメ
モリモジエールの概略斜視図。
第5図はメモリモジュールの断面図。
1・・・・・−・・ポリイミドテープ 2−−−−−−−−−外部接続端子 3・・・・・・・・・メモリエO 4・・・・・・・・・メモりパッケージS −−−−−
−・・・ガラエポ基板 以上

Claims (1)

    【特許請求の範囲】
  1.  一方向にのみ外部接続用端子を有することを特徴とす
    るフレキシブル基板の構造。
JP1288396A 1989-11-06 1989-11-06 フレキシブル基板の構造 Pending JPH03148842A (ja)

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5239447A (en) * 1991-09-13 1993-08-24 International Business Machines Corporation Stepped electronic device package
EP1471778A1 (en) * 2003-04-24 2004-10-27 Infineon Technologies AG Memory module having space-saving arrangement of memory chips and memory chip therefor
CN113133201A (zh) * 2021-04-19 2021-07-16 京东方科技集团股份有限公司 用于显示屏的电路板、显示屏组件及其加工方法

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5239447A (en) * 1991-09-13 1993-08-24 International Business Machines Corporation Stepped electronic device package
EP1471778A1 (en) * 2003-04-24 2004-10-27 Infineon Technologies AG Memory module having space-saving arrangement of memory chips and memory chip therefor
US7061089B2 (en) 2003-04-24 2006-06-13 Infineon Technologies Ag Memory module having space-saving arrangement of memory chips and memory chip therefore
CN113133201A (zh) * 2021-04-19 2021-07-16 京东方科技集团股份有限公司 用于显示屏的电路板、显示屏组件及其加工方法

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