JPH0293840U - - Google Patents

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JPH0293840U
JPH0293840U JP315589U JP315589U JPH0293840U JP H0293840 U JPH0293840 U JP H0293840U JP 315589 U JP315589 U JP 315589U JP 315589 U JP315589 U JP 315589U JP H0293840 U JPH0293840 U JP H0293840U
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clock signal
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Description

【図面の簡単な説明】
第１図は本考案による分周回路の一実施例を示
すブロツク図である。第２図は、第１図において
遅延素子のデイレイ量を変化させた時の各部の波
形を示すタイミング図である。第３図は、従来技
術による分周回路の一例を示すブロツク図である
。 １１，３１〜３５……Ｄ形フリツプフロツプ、
１２……遅延素子、１０１〜１０３……信号線。

Claims (1)

    【実用新案登録請求の範囲】
  1. Ｄ形フリツプフロツプのクロツク入力端子にク
    ロツク信号を入力し、Ｄ入力端子に出力を帰還
    させ、Ｑ出力端子より分周クロツク信号を得る分
    周回路において、帰還経路に遅延素子を挿入して
    構成したことを特徴とする分周回路。
JP315589U 1989-01-13 1989-01-13 Pending JPH0293840U (ja)

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JP315589U JPH0293840U (ja) 1989-01-13 1989-01-13

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JP315589U JPH0293840U (ja) 1989-01-13 1989-01-13

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JPH0293840U true JPH0293840U (ja) 1990-07-25

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ID=31204538

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JP315589U Pending JPH0293840U (ja) 1989-01-13 1989-01-13

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