JPS6125627U - パルスジツタ−発生回路 - Google Patents

パルスジツタ−発生回路

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JPS6125627U
JPS6125627U JP11000784U JP11000784U JPS6125627U JP S6125627 U JPS6125627 U JP S6125627U JP 11000784 U JP11000784 U JP 11000784U JP 11000784 U JP11000784 U JP 11000784U JP S6125627 U JPS6125627 U JP S6125627U
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JP
Japan
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pulse
period
generation circuit
double
circuit
Prior art date
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Pending
Application number
JP11000784U
Other languages
English (en)
Inventor
洋一 工藤
Original Assignee
富士通株式会社
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Publication date
Application filed by 富士通株式会社 filed Critical 富士通株式会社
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は本考案による1実施例のパルスジッター発生回
路、第2図は基準パルスとマージンパルスの関係を示す
図、第3図は実施例の動作タイムチャートである。 第1図において、1はパルス発振源、3はDタイプフリ
ツブフロツプ、4は可変遅延回路、5はコンデンサであ
る。

Claims (1)

    【実用新案登録請求の範囲】
  1. 一定周期の基準パルスを発生するパルス発振源と、該パ
    ルス発振源から出力される基準パルスを第1の経路で入
    力し該基準パルスの2倍の周期を有するパルスを発生す
    る2倍周期パルス発生回路と、該2倍周期パルス発生回
    路から出力される2倍周期パルスを遅延せしめて該2倍
    周期パルスの立上りおよび立下り変化点が上記パルス発
    振源から第2の経路で出力される基準パルスの立上りも
    しくは立下りのいずれか一方の変化点に一致するよう調
    整する遅延回路と、該遅延回路の出力と上記第2の経路
    とを容量性結合する回路とをそなえて構成したことを特
    徴とするパルスジッター発生回路。
JP11000784U 1984-07-20 1984-07-20 パルスジツタ−発生回路 Pending JPS6125627U (ja)

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JP11000784U JPS6125627U (ja) 1984-07-20 1984-07-20 パルスジツタ−発生回路

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JPS6125627U true JPS6125627U (ja) 1986-02-15

Family

ID=30669136

Family Applications (1)

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JP11000784U Pending JPS6125627U (ja) 1984-07-20 1984-07-20 パルスジツタ−発生回路

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JP (1) JPS6125627U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02123411A (ja) * 1988-11-02 1990-05-10 Nec Corp クロックパルス発生回路

Cited By (1)

* Cited by examiner, † Cited by third party
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JPH02123411A (ja) * 1988-11-02 1990-05-10 Nec Corp クロックパルス発生回路

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