JPS63152319U - - Google Patents
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- Publication number
- JPS63152319U JPS63152319U JP4381587U JP4381587U JPS63152319U JP S63152319 U JPS63152319 U JP S63152319U JP 4381587 U JP4381587 U JP 4381587U JP 4381587 U JP4381587 U JP 4381587U JP S63152319 U JPS63152319 U JP S63152319U
- Authority
- JP
- Japan
- Prior art keywords
- terminal
- input
- level control
- control signal
- low level
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
Description
第１図は本考案の分周回路を示す回路図、第２
図及び第３図は第１図の各部波形を示すタイミン
グチヤート、第４図は従来の分周回路を示す回路
図である。 １……Ｄ型フリツプフロツプ、１７，２０……
抵抗、１９……ダイオード。
図及び第３図は第１図の各部波形を示すタイミン
グチヤート、第４図は従来の分周回路を示す回路
図である。 １……Ｄ型フリツプフロツプ、１７，２０……
抵抗、１９……ダイオード。
Claims (1)
- セツト端子、リセツト端子、クロツク端子、デ
ータ端子、出力端子、及び前記データ端子と接続
された反転出力端子を有するＤ型フリツプフロツ
プと、前記セツト端子に入力するローレベルの制
御信号を前記リセツト端子に入力させると共に前
記セツト端子に入力するハイレベルの制御信号を
前記リセツト端子に入力させないスイツチング素
子と、所定周波数の入力信号を異なるレベルで前
記リセツト端子及びクロツク端子に入力させる分
圧素子より成り、前記ハイレベルの制御信号によ
つて前記入力信号と同一周波数となされた第１の
モード信号及び前記ローレベルの制御信号によつ
て前記入力信号の１／２分周となされた第２のモ
ード信号を前記出力端子から出力することを特徴
とする分周回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4381587U JPS63152319U (ja) | 1987-03-25 | 1987-03-25 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4381587U JPS63152319U (ja) | 1987-03-25 | 1987-03-25 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63152319U true JPS63152319U (ja) | 1988-10-06 |
Family
ID=30861033
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4381587U Pending JPS63152319U (ja) | 1987-03-25 | 1987-03-25 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63152319U (ja) |
-
1987
- 1987-03-25 JP JP4381587U patent/JPS63152319U/ja active Pending
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