JPH02695Y2 - - Google Patents
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- JPH02695Y2 JPH02695Y2 JP1980028717U JP2871780U JPH02695Y2 JP H02695 Y2 JPH02695 Y2 JP H02695Y2 JP 1980028717 U JP1980028717 U JP 1980028717U JP 2871780 U JP2871780 U JP 2871780U JP H02695 Y2 JPH02695 Y2 JP H02695Y2
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- 238000001514 detection method Methods 0.000 claims description 9
- 239000004065 semiconductor Substances 0.000 claims description 2
- 230000003321 amplification Effects 0.000 description 3
- 238000003199 nucleic acid amplification method Methods 0.000 description 3
- 238000010586 diagram Methods 0.000 description 2
- 238000005259 measurement Methods 0.000 description 1
Description
【考案の詳細な説明】
本考案は、直流安定化電源装置等の出力の電圧
−電流特性測定に用いる電子負荷装置等における
負荷抵抗値をデジタル制御する回路に関するもの
である。
−電流特性測定に用いる電子負荷装置等における
負荷抵抗値をデジタル制御する回路に関するもの
である。
直流安定化電源装置等の出力の電圧−電流特
性、或いは過電流保護回路の垂下特性等を試験、
測定するためには、擬似負荷抵抗を接続して負荷
電流を可変しなければならないが、従来の機械的
な摺動抵抗器等に代わて、電子的に負荷電流量を
可変制御する電子負荷装置においては、この負荷
抵抗値（入力抵抗値）をデジタル的に制御するこ
とが必要になる。
性、或いは過電流保護回路の垂下特性等を試験、
測定するためには、擬似負荷抵抗を接続して負荷
電流を可変しなければならないが、従来の機械的
な摺動抵抗器等に代わて、電子的に負荷電流量を
可変制御する電子負荷装置においては、この負荷
抵抗値（入力抵抗値）をデジタル的に制御するこ
とが必要になる。
第１図は従来の制御回路を示す回路図であり、
同図において、１は負荷電流を制御するトランジ
スタ等で構成された電流制御部であり、２は電流
制御部に流れる電流を検出し電圧値に変換する抵
抗器等で構成される電流検出部、３は目標値デー
タを電圧値に変換するデジタル−アナログ変換
部、４は入力電圧Ｖ１を電流検出電圧Ｖ２で除算
する除算部、５は除算部４の出力電圧Ｖ３がデジ
タル−アナログ変換部３の出力電圧Ｖ４と等しく
なるように電流制御部１を制御する誤差増幅部で
ある。
同図において、１は負荷電流を制御するトランジ
スタ等で構成された電流制御部であり、２は電流
制御部に流れる電流を検出し電圧値に変換する抵
抗器等で構成される電流検出部、３は目標値デー
タを電圧値に変換するデジタル−アナログ変換
部、４は入力電圧Ｖ１を電流検出電圧Ｖ２で除算
する除算部、５は除算部４の出力電圧Ｖ３がデジ
タル−アナログ変換部３の出力電圧Ｖ４と等しく
なるように電流制御部１を制御する誤差増幅部で
ある。
同図において電流制御部１に流れる電流Ｉ１は
電流検出部２の抵抗値をＲ１とすると、 I1＝V2／R1 (1) となり、除算部４の出力電圧Ｖ３は、 V3＝V1／V2 (2) となる。(1)と(2)により、 I1＝V1／（V3×R1） (3) 入力端子Ａ−Ｂ間の入力抵抗値Ｒ０は、 R0＝V1／I1 (4) (3)を(4)に代入し R0＝V3，R1 (5) 誤差増幅部５の利得が無限大であるとすると、 V4＝V3 (6) 従つて、R0＝V4・R1となり、デジタル−アナ
ログ変換部３の出力電圧Ｖ４により、デジタル信
号による抵抗値制御が可能となる。
電流検出部２の抵抗値をＲ１とすると、 I1＝V2／R1 (1) となり、除算部４の出力電圧Ｖ３は、 V3＝V1／V2 (2) となる。(1)と(2)により、 I1＝V1／（V3×R1） (3) 入力端子Ａ−Ｂ間の入力抵抗値Ｒ０は、 R0＝V1／I1 (4) (3)を(4)に代入し R0＝V3，R1 (5) 誤差増幅部５の利得が無限大であるとすると、 V4＝V3 (6) 従つて、R0＝V4・R1となり、デジタル−アナ
ログ変換部３の出力電圧Ｖ４により、デジタル信
号による抵抗値制御が可能となる。
しかしながら、制御系内に除算部が存在するた
めに、制御系の応答が遅く、除算器等の除算部を
構成する部品が高価であるという欠点がある。
めに、制御系の応答が遅く、除算器等の除算部を
構成する部品が高価であるという欠点がある。
本考案は、このような欠点を除去することを目
的とし、このような目的は、半導体素子により構
成され負荷電流を制御する電流制御部と、該負荷
電流を電圧値として検出する電流検出部と、基準
抵抗と該基準抵抗の抵抗値に比例した抵抗値毎に
可変する可変抵抗との直列接続からなる比例辺抵
抗部と、該比例辺抵抗部の基準抵抗と可変抵抗と
の接続点に発生する基準電圧と前記電流検出部の
検出電圧とを誤差増幅して前記電流制御部を制御
する誤差増幅器と、負荷抵抗値の目標値として与
えられたデータ値から前記比例辺抵抗部の基準抵
抗値を減じて可変抵抗値を制御する減算部とによ
り構成することを特徴とする負荷抵抗値のデジタ
ル制御回路によつて構成される。
的とし、このような目的は、半導体素子により構
成され負荷電流を制御する電流制御部と、該負荷
電流を電圧値として検出する電流検出部と、基準
抵抗と該基準抵抗の抵抗値に比例した抵抗値毎に
可変する可変抵抗との直列接続からなる比例辺抵
抗部と、該比例辺抵抗部の基準抵抗と可変抵抗と
の接続点に発生する基準電圧と前記電流検出部の
検出電圧とを誤差増幅して前記電流制御部を制御
する誤差増幅器と、負荷抵抗値の目標値として与
えられたデータ値から前記比例辺抵抗部の基準抵
抗値を減じて可変抵抗値を制御する減算部とによ
り構成することを特徴とする負荷抵抗値のデジタ
ル制御回路によつて構成される。
以下、本考案を実施例に基づいて詳細に説明す
る。第２図は、本考案の実施例を示す図であり、
Ｒ３は可変抵抗、Ｒ２は基準抵抗、６は減算部、
７は比例辺抵抗部であり、第１図と同一部材には
同一符号を付している。
る。第２図は、本考案の実施例を示す図であり、
Ｒ３は可変抵抗、Ｒ２は基準抵抗、６は減算部、
７は比例辺抵抗部であり、第１図と同一部材には
同一符号を付している。
本考案においては、従来回路の除算部４の代わ
りに減算部６と比例辺抵抗部７を用い、検出電圧
Ｖ２と比例辺抵抗部７の出力電圧Ｖ５が等しくな
るように誤差増幅器５の出力により電流制御部１
を制御するようにしている。
りに減算部６と比例辺抵抗部７を用い、検出電圧
Ｖ２と比例辺抵抗部７の出力電圧Ｖ５が等しくな
るように誤差増幅器５の出力により電流制御部１
を制御するようにしている。
比例辺抵抗部７は、基準抵抗Ｒ２の抵抗値に比
例した抵抗値毎に可変抵抗Ｒ３の抵抗値を切り換
えるものであり、また減算部６は、与えられる目
標値データが基準抵抗Ｒ２の抵抗値を含んだ値と
なるために、基準抵抗Ｒ２の抵抗値を減算し、正
確な目標値データを比例辺抵抗部７の出力電圧Ｖ
５として出力するために設けている。
例した抵抗値毎に可変抵抗Ｒ３の抵抗値を切り換
えるものであり、また減算部６は、与えられる目
標値データが基準抵抗Ｒ２の抵抗値を含んだ値と
なるために、基準抵抗Ｒ２の抵抗値を減算し、正
確な目標値データを比例辺抵抗部７の出力電圧Ｖ
５として出力するために設けている。
図において、電流制御部１の抵抗値をRTとす
れば、入力端子Ａ−Ｂ間の入力抵抗値Ｒ０は、 R0＝RT＋R1R2＋R3 (7) である。（式中のは並列合成抵抗値をとる意味
の記号）また誤差増幅部５の利得が無限大である
とすると検出電圧Ｖ２と比例辺抵抗部７の出力電
圧Ｖ５は等しくなり、平衡状態の抵抗ブリツジ回
路とみなされるので、次の関係が成り立つ。
れば、入力端子Ａ−Ｂ間の入力抵抗値Ｒ０は、 R0＝RT＋R1R2＋R3 (7) である。（式中のは並列合成抵抗値をとる意味
の記号）また誤差増幅部５の利得が無限大である
とすると検出電圧Ｖ２と比例辺抵抗部７の出力電
圧Ｖ５は等しくなり、平衡状態の抵抗ブリツジ回
路とみなされるので、次の関係が成り立つ。
RT／R1＝R3／R2 (8)
RT＝R1，R3／R2 (9)
(7)へ(9)を代入して、
R0＝R1，R3／R2＋R1R2＋R3
＝R1（１＋R3／R2）R2＋R3 (10)
ここで目標値のデータ値をＸとし、可変抵抗値
Ｒ３の値として、目標値のデータ値Ｘより基準抵
抗値Ｒ２の値を減じた値、すなわち、 R3＝Ｘ−R2 ただし、Ｘ≧R2 (11) となる値に減算部６で減算し、可変抵抗値Ｒ３を
制御すると(10)へ(11)を代入し、 R0＝R1（１＋Ｘ−R2／R2）R2＋R3 (12) ＝R1Ｘ／R2R2＋R3 （13） R2＋R3≫R1Ｘ／R2となる条件下では、 R0＝R1Ｘ／R2 となり、R1／R2を係数として目標値のデータ値
Ｘを制御することにより、入力電圧Ｖに関わりな
く入力抵抗値Ｒ０が制御できることになる。
Ｒ３の値として、目標値のデータ値Ｘより基準抵
抗値Ｒ２の値を減じた値、すなわち、 R3＝Ｘ−R2 ただし、Ｘ≧R2 (11) となる値に減算部６で減算し、可変抵抗値Ｒ３を
制御すると(10)へ(11)を代入し、 R0＝R1（１＋Ｘ−R2／R2）R2＋R3 (12) ＝R1Ｘ／R2R2＋R3 （13） R2＋R3≫R1Ｘ／R2となる条件下では、 R0＝R1Ｘ／R2 となり、R1／R2を係数として目標値のデータ値
Ｘを制御することにより、入力電圧Ｖに関わりな
く入力抵抗値Ｒ０が制御できることになる。
即ち、例えば基準抵抗Ｒ２の抵抗値をＲとし、
可変抵抗Ｒ３の比例抵抗値を０，Ｒ，2R，3R…
…（ｎ−１）Ｒに可変できるように設定し、減算
部６からの信号により可変抵抗Ｒ３を切り換える
ようにし、減算部６をアナログスイツチを用いて
切り換え制御するとすれば、(11)式より、目標値の
データ値ＸをＲ，2R，3R……nRとする場合に
は、アナログスイツチの切り換えにより可変抵抗
値をそぞれ０，Ｒ，2R，3R……（ｎ−１）Ｒに
切り換えるようにするだけで減算したことにな
り、実際に数値減算しなくても見かけ上、減算し
たことになり、減算部６は極めて簡易に構成でき
る。
可変抵抗Ｒ３の比例抵抗値を０，Ｒ，2R，3R…
…（ｎ−１）Ｒに可変できるように設定し、減算
部６からの信号により可変抵抗Ｒ３を切り換える
ようにし、減算部６をアナログスイツチを用いて
切り換え制御するとすれば、(11)式より、目標値の
データ値ＸをＲ，2R，3R……nRとする場合に
は、アナログスイツチの切り換えにより可変抵抗
値をそぞれ０，Ｒ，2R，3R……（ｎ−１）Ｒに
切り換えるようにするだけで減算したことにな
り、実際に数値減算しなくても見かけ上、減算し
たことになり、減算部６は極めて簡易に構成でき
る。
また、例えば基準抵抗Ｒ２の抵抗値をＲとし、
可変抵抗Ｒ３の比例抵抗値をＲステツプの抵抗
群、0.1Rステツプの抵抗群、0.01Rステツプの抵
抗群を直列接続して組合せて可変抵抗Ｒ３を構成
し、それぞれの抵抗群をアナログスイツチ等によ
り切り換え制御すれば、３桁の種類の目標値デー
タを制御できることになり、微小な負荷抵抗値の
デイジタル制御も可能である。
可変抵抗Ｒ３の比例抵抗値をＲステツプの抵抗
群、0.1Rステツプの抵抗群、0.01Rステツプの抵
抗群を直列接続して組合せて可変抵抗Ｒ３を構成
し、それぞれの抵抗群をアナログスイツチ等によ
り切り換え制御すれば、３桁の種類の目標値デー
タを制御できることになり、微小な負荷抵抗値の
デイジタル制御も可能である。
以上述べたように本考案によれば、除算部を用
いないで負荷抵抗値の制御が可能であり、アナロ
グ制御部分の帰還ループが抵抗成分のみであるた
めに、応答特性の優れたデジタル制御ができ、安
価で簡易に負荷抵抗値を制御することができる。
いないで負荷抵抗値の制御が可能であり、アナロ
グ制御部分の帰還ループが抵抗成分のみであるた
めに、応答特性の優れたデジタル制御ができ、安
価で簡易に負荷抵抗値を制御することができる。
第１図は従来の制御回路例、第２図は本考案に
よる制御回路の実施例を示す。 図中、１は電流制御部、２は電流検出部、５は
誤差増幅部、６は減算部、７は比例辺抵抗部をそ
れぞれ示す。
よる制御回路の実施例を示す。 図中、１は電流制御部、２は電流検出部、５は
誤差増幅部、６は減算部、７は比例辺抵抗部をそ
れぞれ示す。
Claims (1)
- 半導体素子により構成され負荷電流を制御する
電流制御部と、該負荷電流を電圧値として検出す
る電流検出部と、基準抵抗と該基準抵抗の抵抗値
に比例した抵抗値毎に可変する可変抵抗との直列
接続からなる比例辺抵抗部と、該比例辺抵抗部の
基準抵抗と可変抵抗との接続点に発生する基準電
圧と前記電流検出部の検出電圧とを誤差増幅して
前記電流制御部を制御する誤差増幅器と、負荷抵
抗値の目標値として与えられたデータ値から前記
比例抵抗部の基準抵抗値を減じて可変抵抗値を制
御する減算部とにより構成することを特徴とする
負荷抵抗値のデジタル制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1980028717U JPH02695Y2 (ja) | 1980-03-05 | 1980-03-05 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1980028717U JPH02695Y2 (ja) | 1980-03-05 | 1980-03-05 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS56130179U JPS56130179U (ja) | 1981-10-02 |
| JPH02695Y2 true JPH02695Y2 (ja) | 1990-01-09 |
Family
ID=29624635
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1980028717U Expired JPH02695Y2 (ja) | 1980-03-05 | 1980-03-05 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02695Y2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6389912A (ja) * | 1986-10-02 | 1988-04-20 | Fuji Electric Co Ltd | 電子的負荷装置 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5537934Y2 (ja) * | 1977-04-01 | 1980-09-05 |
-
1980
- 1980-03-05 JP JP1980028717U patent/JPH02695Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS56130179U (ja) | 1981-10-02 |
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