JPH02296405A - 非線形補償回路の歪発生回路 - Google Patents
非線形補償回路の歪発生回路Info
- Publication number
- JPH02296405A JPH02296405A JP1116103A JP11610389A JPH02296405A JP H02296405 A JPH02296405 A JP H02296405A JP 1116103 A JP1116103 A JP 1116103A JP 11610389 A JP11610389 A JP 11610389A JP H02296405 A JPH02296405 A JP H02296405A
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- JP
- Japan
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- fet
- signal
- input terminal
- gate
- circuit
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- Pending
Links
- 238000000034 method Methods 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 3
- 101100484930 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) VPS41 gene Proteins 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
Landscapes
- Amplifiers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はブリデイスト−ジョン法によって増幅器の非線
形性を補償する非線形補償回路に関し、特に補償用の歪
を発生するための歪発生回路に関する。
形性を補償する非線形補償回路に関し、特に補償用の歪
を発生するための歪発生回路に関する。
従来、この種の非線形補償回路の歪発生回路は、分布定
数回路を利用した方向性結合器と、歪を発生させる非線
形増幅器及び線形増幅器を含んだ構成となっていた。第
２図に従来の回路の一例を示す。
数回路を利用した方向性結合器と、歪を発生させる非線
形増幅器及び線形増幅器を含んだ構成となっていた。第
２図に従来の回路の一例を示す。
図示のように、入力端子１１に入力された信号を方向性
結合器１２によって分割し、それぞれを線形増幅器１３
と非線形増幅器１４で増幅し、方向性結合器１５で再度
合成させる。ここで１．線形増幅器１３からの信号路に
は移相器１７を介挿しているため、非線形増幅器１４か
らの信号とは１８０度の位相差が生じ、合成されて出力
端子１６から出力される信号は相殺される。しかしなが
ら、非線形増幅器１４で生じる非線形成分の信号は線形
増幅器１３側には生じないために相殺されることはない
。したがって、移相器１７と、非線形増幅器１４側の信
号路に介挿した減衰器１８で位相と振幅を調整すること
により、任意の歪成分を持つ信号を出力端子１６に得る
ことができる。
結合器１２によって分割し、それぞれを線形増幅器１３
と非線形増幅器１４で増幅し、方向性結合器１５で再度
合成させる。ここで１．線形増幅器１３からの信号路に
は移相器１７を介挿しているため、非線形増幅器１４か
らの信号とは１８０度の位相差が生じ、合成されて出力
端子１６から出力される信号は相殺される。しかしなが
ら、非線形増幅器１４で生じる非線形成分の信号は線形
増幅器１３側には生じないために相殺されることはない
。したがって、移相器１７と、非線形増幅器１４側の信
号路に介挿した減衰器１８で位相と振幅を調整すること
により、任意の歪成分を持つ信号を出力端子１６に得る
ことができる。
（発明が解決しようとする課題〕
上述した従来の非線形補償回路の歪発生回路は、分布定
数回路により構成される方向性結合器１２゜１５が必要
とされるため、平面回路の面積が大きくなり、小型化が
難しくなるという問題がある。
数回路により構成される方向性結合器１２゜１５が必要
とされるため、平面回路の面積が大きくなり、小型化が
難しくなるという問題がある。
また、線形及び非線形の各増幅器１３．１４が必要であ
るため、組立、調整の手間とコストがかかるという問題
もある。
るため、組立、調整の手間とコストがかかるという問題
もある。
本発明は小型化を可能にし、かつ組立、調整を容易にし
た歪発生回路を提供することを目的とする。
た歪発生回路を提供することを目的とする。
本発明の歪発生回路は、第１のＦＥＴと、これとゲート
幅の異なる第２のＦＥＴと、これらＦＥＴと電源端子と
の間に接続した負荷抵抗とで差動増幅器を構成しており
、一方のＦＥＴのゲートを入力端子とし、他方のＦＥＴ
のゲートを反転入力端子としてそれぞれに逆相の信号を
入力するように構成している。
幅の異なる第２のＦＥＴと、これらＦＥＴと電源端子と
の間に接続した負荷抵抗とで差動増幅器を構成しており
、一方のＦＥＴのゲートを入力端子とし、他方のＦＥＴ
のゲートを反転入力端子としてそれぞれに逆相の信号を
入力するように構成している。
この構成では、入力端子と反転入力端子の各信号を差動
動作によって相殺し、一方のＦＥＴで生じた歪を相殺す
ることなく出力端子から得ることが可能となる。
動作によって相殺し、一方のＦＥＴで生じた歪を相殺す
ることなく出力端子から得ることが可能となる。
次に、本発明を図面を参照して説明する。
第１図は本発明の一実施例の回路図である。図において
、−のゲート幅を有する第１のＦＥＴＩと、これとはゲ
ート幅の異なる、換言すれば入出力特性の異なる第２の
ＦＥＴ２のソース・ドレインを対向して接続し、かつ電
源端子４との間に負荷抵抗３を接続して差動、増幅器を
構成している。
、−のゲート幅を有する第１のＦＥＴＩと、これとはゲ
ート幅の異なる、換言すれば入出力特性の異なる第２の
ＦＥＴ２のソース・ドレインを対向して接続し、かつ電
源端子４との間に負荷抵抗３を接続して差動、増幅器を
構成している。
なお、この実施例では、第２のＦＥＴ２のゲート幅を第
１のＦＥＴＩのゲート幅よりも小さ（している。そして
、第１のＦＥＴＩのゲートを入力端子５とし、第２のＦ
ＥＴ２のゲートを反転入力端子６とし、更に負荷抵抗３
との接続端を出力端子７として構成している。
１のＦＥＴＩのゲート幅よりも小さ（している。そして
、第１のＦＥＴＩのゲートを入力端子５とし、第２のＦ
ＥＴ２のゲートを反転入力端子６とし、更に負荷抵抗３
との接続端を出力端子７として構成している。
この構成において、−の信号を入力端子５に、これと位
相を１８０度相違させた信号、即ち逆相の信号を反転入
力端子６にそれぞれ入力する。すると、入力された信号
はそれぞれ第１のＦＥＴＩ。
相を１８０度相違させた信号、即ち逆相の信号を反転入
力端子６にそれぞれ入力する。すると、入力された信号
はそれぞれ第１のＦＥＴＩ。
第２のＦＥＴ２により増幅されるが、増幅された信号は
増幅器の差動動作により出力端子７では相殺される。
増幅器の差動動作により出力端子７では相殺される。
ところが、第１のＦＥＴＩと第２のＦＥＴ２はゲート幅
、即ち人出力特性が異なるため、ゲート幅の小さいＦ
Ｅ ”Ｉ’、ここでは第２のＦＥＴ２からの信号は、よ
り多くの歪成分を含むことになり、各ＦＥＴＩ、２から
の信号は出力端子７において完全に相殺されず、歪成分
だけが残される。この結果、出力端子７から歪信号を出
力させることが可能となる。
、即ち人出力特性が異なるため、ゲート幅の小さいＦ
Ｅ ”Ｉ’、ここでは第２のＦＥＴ２からの信号は、よ
り多くの歪成分を含むことになり、各ＦＥＴＩ、２から
の信号は出力端子７において完全に相殺されず、歪成分
だけが残される。この結果、出力端子７から歪信号を出
力させることが可能となる。
なお、実際には反転入力端子６の前段に移相器を接続し
、入力端子５又は反転入力端子６の一方に減衰器を接続
することで、任意の歪を得ることが可能となる。
、入力端子５又は反転入力端子６の一方に減衰器を接続
することで、任意の歪を得ることが可能となる。
以上説明したように本発明は、ゲート幅が異なる第１及
び第２のＦＥＴと負荷抵抗とで差動増幅器を構成し、一
方のＦＥＴのゲートを入力端子とし、他方のＦＥＴのゲ
ートを反転入力端子とじてそれぞれに逆相の信号を入力
させているので、入力端子と反転入力端子の各信号を差
動動作によって相殺し、一方のＦＥＴで生じた歪を相殺
することなく出力端子から得ることが可能となる。
び第２のＦＥＴと負荷抵抗とで差動増幅器を構成し、一
方のＦＥＴのゲートを入力端子とし、他方のＦＥＴのゲ
ートを反転入力端子とじてそれぞれに逆相の信号を入力
させているので、入力端子と反転入力端子の各信号を差
動動作によって相殺し、一方のＦＥＴで生じた歪を相殺
することなく出力端子から得ることが可能となる。
これにより、面積の大きな分布定数回路や複雑な構成の
増幅器を使用せずに容易にしかも小型に非線形補償回路
を構成することができ、かつ回路の集積回路化も実現で
きる。
増幅器を使用せずに容易にしかも小型に非線形補償回路
を構成することができ、かつ回路の集積回路化も実現で
きる。
第１図は本発明の歪発生回路の一実施例の回路図、第２
図は従来の歪発生回路のブロック図である。 ｌ・・・第１のＦＥＴ、２・・・第２のＦＥＴ、３・・
・負荷抵抗、４・・・電源端子、５・・・入力端子、６
・・・反転入力端子、７・・・出力端子、１１・・・入
力端子、１２・・・方向性結合器、１３・・・線形増幅
器、１４・・・非線形増幅器、１５・・・方向性結合器
、１６・・・出力端子、・１７・・・移相器、１８・・
・減衰器。
図は従来の歪発生回路のブロック図である。 ｌ・・・第１のＦＥＴ、２・・・第２のＦＥＴ、３・・
・負荷抵抗、４・・・電源端子、５・・・入力端子、６
・・・反転入力端子、７・・・出力端子、１１・・・入
力端子、１２・・・方向性結合器、１３・・・線形増幅
器、１４・・・非線形増幅器、１５・・・方向性結合器
、１６・・・出力端子、・１７・・・移相器、１８・・
・減衰器。
Claims (1)
- １、プリディストーション法により増幅器の非線形性を
補償する非線形補償回路の歪発生回路において、第１の
ＦＥＴと、これとゲート幅の異なる第２のＦＥＴと、こ
れらＦＥＴと電源端子との間に接続した負荷抵抗とで差
動増幅器を構成し、前記一方のＦＥＴのゲートを入力端
子とし、他方のＦＥＴのゲートを反転入力端子としたこ
とを特徴とする非線形補償回路の歪発生回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1116103A JPH02296405A (ja) | 1989-05-11 | 1989-05-11 | 非線形補償回路の歪発生回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1116103A JPH02296405A (ja) | 1989-05-11 | 1989-05-11 | 非線形補償回路の歪発生回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02296405A true JPH02296405A (ja) | 1990-12-07 |
Family
ID=14678773
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1116103A Pending JPH02296405A (ja) | 1989-05-11 | 1989-05-11 | 非線形補償回路の歪発生回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02296405A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006203271A (ja) * | 2005-01-17 | 2006-08-03 | Toshiba Corp | 歪み発生回路および高周波回路 |
-
1989
- 1989-05-11 JP JP1116103A patent/JPH02296405A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006203271A (ja) * | 2005-01-17 | 2006-08-03 | Toshiba Corp | 歪み発生回路および高周波回路 |
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