JPH02268363A - マルチプロセッサシステムにおけるプログラムロード方式 - Google Patents
マルチプロセッサシステムにおけるプログラムロード方式Info
- Publication number
- JPH02268363A JPH02268363A JP9233189A JP9233189A JPH02268363A JP H02268363 A JPH02268363 A JP H02268363A JP 9233189 A JP9233189 A JP 9233189A JP 9233189 A JP9233189 A JP 9233189A JP H02268363 A JPH02268363 A JP H02268363A
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- JP
- Japan
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- processor
- load
- load module
- hard disk
- program
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 4
- 101100084617 Arabidopsis thaliana PBG1 gene Proteins 0.000 description 2
- 230000006870 function Effects 0.000 description 2
- 239000008186 active pharmaceutical agent Substances 0.000 description 1
- 238000011068 loading method Methods 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Landscapes
- Multi Processors (AREA)
- Stored Programmes (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はプログラムを格納するハードディスク装置付き
プロセッサとプログラムロードされる複数のプロセッサ
とが接続されてなるマルチプロセッサシステムにおける
プログラムローｔ’方式に関する。
プロセッサとプログラムロードされる複数のプロセッサ
とが接続されてなるマルチプロセッサシステムにおける
プログラムローｔ’方式に関する。
従来、この種のマルチプロセッサシステムにおけるプロ
グラムロード方式は、ハードディスク装置内に１プロセ
ツサ毎又はプロセッサの種類毎にプログラムファイルを
持たせ、ハードディスク装置付きプロセッサ上のプログ
ラムロード制御部が各プロセッサへプログラムロードを
行なっていた。
グラムロード方式は、ハードディスク装置内に１プロセ
ツサ毎又はプロセッサの種類毎にプログラムファイルを
持たせ、ハードディスク装置付きプロセッサ上のプログ
ラムロード制御部が各プロセッサへプログラムロードを
行なっていた。
上述した従来のマルチプロセッサシステムにおけるプロ
グラムロード方式は、プログラムファイルをプロセッサ
毎又はプロセッサの種類毎にハードディスク装置に持つ
ため、同一機能が各プロセッサに搭載される場合には同
一プログラムを各プログラムファイルに入れる必要があ
るので、ハードディスク装置の容量を無駄に使ってしま
うという欠点がある。
グラムロード方式は、プログラムファイルをプロセッサ
毎又はプロセッサの種類毎にハードディスク装置に持つ
ため、同一機能が各プロセッサに搭載される場合には同
一プログラムを各プログラムファイルに入れる必要があ
るので、ハードディスク装置の容量を無駄に使ってしま
うという欠点がある。
本発明のマルチプロセッサシステムにおけるプログラム
ロード方式は、プログラムを格納するハードディスク装
置付きプロセッサとプログラムロードされる複数のプロ
セッサとが接続されてなるマルチプロセッサシステムに
おいて、前記ハードディスク装置付きプロセッサはプロ
グラムロード制御部を有し、前記ハードディスク装置は
機能的に独立し且つロード先メモリアドレスの連続して
いるロードモジュールとそのロード先メモリアドレスを
セットにして一連の番号を付与したロードモジュールフ
ァイルとこの各ロードモジュールファイルのロード先プ
ロセッサ番号を管理する管理データ部とを有することを
特徴とする。
ロード方式は、プログラムを格納するハードディスク装
置付きプロセッサとプログラムロードされる複数のプロ
セッサとが接続されてなるマルチプロセッサシステムに
おいて、前記ハードディスク装置付きプロセッサはプロ
グラムロード制御部を有し、前記ハードディスク装置は
機能的に独立し且つロード先メモリアドレスの連続して
いるロードモジュールとそのロード先メモリアドレスを
セットにして一連の番号を付与したロードモジュールフ
ァイルとこの各ロードモジュールファイルのロード先プ
ロセッサ番号を管理する管理データ部とを有することを
特徴とする。
次に、本発明について図面を参照して説明する。
第１図は本発明の一実施例を示すマルチプロセッサシス
テムのブロック図、第２図は第１図における管理データ
部に設けるロードモジュールとロード先プロセッサ番号
を対応づけるテーブルの構成図である。
テムのブロック図、第２図は第１図における管理データ
部に設けるロードモジュールとロード先プロセッサ番号
を対応づけるテーブルの構成図である。
第１図において、本実施例のマルチプロセッサシステム
は、ハードディスク装置（以下Ｄ Ｓ Ｋ ）１０を有
するプロセッサ（以下ＰＲＣＨ）１と、プログラムロー
ドされる複数のプロセッサ（以下ＰＲＣ）２，３〜ｎが
ループ状バス１２に接続されてなる。ＰＲＣＨＩはプロ
グラムロード制御部（以下ＰＬＯ）１１を有する。ＤＳ
ＫＩＯは管理データ部（以下ＭＧＤ）１００および複数
のロードモジュールファイル（以下ＦＬＥ）１０２，１
０３、ＮＩｏｎからなり、各ＦＬＥ （例えばＦＬＥ１
０２）はロード先メモリアドレス（以下ＡＤＲ）９０と
ロードモジュール（以下ＭＤＬ）９１からなり、複数の
ＭＤＬは機能的に独立し且っＡＤＲはＦＬＥ１０２，１
０３． ＮＩｏｎで連続している。またＭＧＤ １００
は図示していない実装プロセッサ番号テーブルと、第２
図に示すロードモジュールファイル番号−プロセッサ番
号対応テーブル（以下ＴＢＬ）から、なる。
は、ハードディスク装置（以下Ｄ Ｓ Ｋ ）１０を有
するプロセッサ（以下ＰＲＣＨ）１と、プログラムロー
ドされる複数のプロセッサ（以下ＰＲＣ）２，３〜ｎが
ループ状バス１２に接続されてなる。ＰＲＣＨＩはプロ
グラムロード制御部（以下ＰＬＯ）１１を有する。ＤＳ
ＫＩＯは管理データ部（以下ＭＧＤ）１００および複数
のロードモジュールファイル（以下ＦＬＥ）１０２，１
０３、ＮＩｏｎからなり、各ＦＬＥ （例えばＦＬＥ１
０２）はロード先メモリアドレス（以下ＡＤＲ）９０と
ロードモジュール（以下ＭＤＬ）９１からなり、複数の
ＭＤＬは機能的に独立し且っＡＤＲはＦＬＥ１０２，１
０３． ＮＩｏｎで連続している。またＭＧＤ １００
は図示していない実装プロセッサ番号テーブルと、第２
図に示すロードモジュールファイル番号−プロセッサ番
号対応テーブル（以下ＴＢＬ）から、なる。
続いて本実施例の動作について説明する。
ＰＲＣＨＩのＰＬＣＩＩがＤＳＫＩＯがらＭＧＤｌｏｏ
を読み込み、実装プロセッサ番号テーブルから読み出し
たプログラムロードすべきプロセッサ番号でＴＢＬから
所要のロードモジュール番号を得て、このロードモジュ
ール番号のＦＬＥ （例えばＦＬＥ１０２）のＡＤＲ９
０を参照してＭＤＬ９１をループ状バス１２を介してＰ
ＲＣ２へ転送してロードする。
を読み込み、実装プロセッサ番号テーブルから読み出し
たプログラムロードすべきプロセッサ番号でＴＢＬから
所要のロードモジュール番号を得て、このロードモジュ
ール番号のＦＬＥ （例えばＦＬＥ１０２）のＡＤＲ９
０を参照してＭＤＬ９１をループ状バス１２を介してＰ
ＲＣ２へ転送してロードする。
他のＰＲＣ３，〜ｎにプログラムロードを行なう動作も
上記と同様の動作となる、 〔発明の効果〕 以上説明したように本発明は、ハードディスク装置付き
プロセッサにプログラムロード制御部を備え、ハードデ
ィスク装置内に一連の番号が付与されたロードモジュー
ルファイルとそのロードモジュールファイルをロード先
プロセッサ番号と対応づける管理データ部を設けること
により、同一機能が何台のプロセッサに搭載されても、
メモリ上の割付けを既存のプロセッサと同一にすれば、
管理データの修正だけで済むので、ディスク容量を節約
できるという効果がある。また、あるロードモジュール
を改版したときは、サイズがオーバーしない限り、他の
ロードモジュールブロックに影響を与えないで入れ替え
ることができるという効果もある。
上記と同様の動作となる、 〔発明の効果〕 以上説明したように本発明は、ハードディスク装置付き
プロセッサにプログラムロード制御部を備え、ハードデ
ィスク装置内に一連の番号が付与されたロードモジュー
ルファイルとそのロードモジュールファイルをロード先
プロセッサ番号と対応づける管理データ部を設けること
により、同一機能が何台のプロセッサに搭載されても、
メモリ上の割付けを既存のプロセッサと同一にすれば、
管理データの修正だけで済むので、ディスク容量を節約
できるという効果がある。また、あるロードモジュール
を改版したときは、サイズがオーバーしない限り、他の
ロードモジュールブロックに影響を与えないで入れ替え
ることができるという効果もある。
第１図は本発明の一実施例を示すマルチプロセッサシス
テムのブロック図、第２図は第１図における管理データ
部に設けるロードモジュールファイルとロード先プロセ
ッサ番号を対応づけるテーブルの構成図である。 １・・・ハードディスク装置付きプロセッサ（ＰＲＣＨ
）、２，３．〜ｎ・・・プログラムロードされるプロセ
ッサ（ＰＲＣ）、１０・・・ハードディスク装置（ＤＳ
Ｋ）、１１・・・プログラムロード制御部（ＰＬＣ）、
１２−・・ルーフ状バス、９０・Ｏ−ド先メモリアドレ
ス（ＡＤＲ） ９１・・・ロードモジュール（ＭＤＬ
）１００・・・管理データ部（ＭＧＤ）、１０２，１０
３．〜Ｉｏｎ・−ｏ−トモジュールファイル（ＦＬＥ）
、ＴＢＬ・・・ロードモジュールファイル番号−プロセ
ッサ番号対応テーブル。
テムのブロック図、第２図は第１図における管理データ
部に設けるロードモジュールファイルとロード先プロセ
ッサ番号を対応づけるテーブルの構成図である。 １・・・ハードディスク装置付きプロセッサ（ＰＲＣＨ
）、２，３．〜ｎ・・・プログラムロードされるプロセ
ッサ（ＰＲＣ）、１０・・・ハードディスク装置（ＤＳ
Ｋ）、１１・・・プログラムロード制御部（ＰＬＣ）、
１２−・・ルーフ状バス、９０・Ｏ−ド先メモリアドレ
ス（ＡＤＲ） ９１・・・ロードモジュール（ＭＤＬ
）１００・・・管理データ部（ＭＧＤ）、１０２，１０
３．〜Ｉｏｎ・−ｏ−トモジュールファイル（ＦＬＥ）
、ＴＢＬ・・・ロードモジュールファイル番号−プロセ
ッサ番号対応テーブル。
Claims (1)
- プログラムを格納するハードディスク装置付きプロセッ
サとプログラムロードされる複数のプロセッサとが接続
されてなるマルチプロセッサシステムにおいて、前記ハ
ードディスク装置付きプロセッサはプログラムロード制
御部を有し、前記ハードディスク装置は機能的に独立し
且つロード先メモリアドレスの連続しているロードモジ
ュールとそのロード先メモリアドレスをセットにして一
連の番号を付与したロードモジュールファイルとこの各
ロードモジュールファイルのロード先プロセッサ番号を
管理する管理データ部とを有することを特徴とするマル
チプロセッサシステムにおけるプログラムロード方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9233189A JPH02268363A (ja) | 1989-04-11 | 1989-04-11 | マルチプロセッサシステムにおけるプログラムロード方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9233189A JPH02268363A (ja) | 1989-04-11 | 1989-04-11 | マルチプロセッサシステムにおけるプログラムロード方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02268363A true JPH02268363A (ja) | 1990-11-02 |
Family
ID=14051407
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9233189A Pending JPH02268363A (ja) | 1989-04-11 | 1989-04-11 | マルチプロセッサシステムにおけるプログラムロード方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02268363A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2009245006A (ja) * | 2008-03-28 | 2009-10-22 | Fujitsu Ltd | 論理制御装置およびプログラム書き込み方法 |
-
1989
- 1989-04-11 JP JP9233189A patent/JPH02268363A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2009245006A (ja) * | 2008-03-28 | 2009-10-22 | Fujitsu Ltd | 論理制御装置およびプログラム書き込み方法 |
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