JPH02238729A - 線路等化器 - Google Patents
線路等化器Info
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- JPH02238729A JPH02238729A JP6002489A JP6002489A JPH02238729A JP H02238729 A JPH02238729 A JP H02238729A JP 6002489 A JP6002489 A JP 6002489A JP 6002489 A JP6002489 A JP 6002489A JP H02238729 A JPH02238729 A JP H02238729A
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- analog
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- 238000004364 calculation method Methods 0.000 claims description 13
- 238000013139 quantization Methods 0.000 abstract description 5
- 238000010586 diagram Methods 0.000 description 19
- 239000003990 capacitor Substances 0.000 description 4
- 230000002238 attenuated effect Effects 0.000 description 2
- 101000963440 Bacillus subtilis (strain 168) Biotin carboxylase 1 Proteins 0.000 description 1
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- 238000000034 method Methods 0.000 description 1
- 238000003199 nucleic acid amplification method Methods 0.000 description 1
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- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概 要〕
複数の周波数のアナログ信号を、伝送線路を介して所定
時間入力して、該伝送線路による損失分を補償する特性
を設定し、出力はディジタル信号とする線路等化器に関
し、 精度の高いアナログ・ディジタル変換器（以下Ａ／Ｄ変
換器と称す）を必要とせず、周囲温度が変化しても特性
の安定な線路等化器の提供を目的とし、 入力信号を増幅するアナログ増幅器と、該アナログ増幅
器の出力をディジタル化するＡ／Ｄ変換器と、該Ａ／Ｄ
変換器によりディジタル化された信号を入力し線路等化
をするディジタルフィルタを備え、 該アナログ増幅器ｌと該ディジタルフィルタにて、伝送
線路の損失周波数特性を補償する複数の利得特性を得る
為に、該アナログ増幅器と該ディジタルフィルタの可変
部の値を予め定めておき、ある補償特性にて補償された
該ディジタルフィルタの出力を、パワー演算器に入力し
、該パワー演算器にてパワーを演算した出力を自動利得
制ＩＢ回路（以下ＡＧＣと称す）に入力し、 該ＡＧＣでは、予め定められた目標値と、入力したパワ
ー演算出力とを比較し、該目標値より太きければ、該ア
ナログ増幅器と該ディジタルフィルタにより補償する利
得特性を利得の少ない補償特性とする可変部の値を選択
し、該目標値より小さければ補償する利得特性を利得の
大きい補償特性とする可変部の値を選択することを繰り
返し、該目標値に最も近い補償特性を設定するように構
成する。
時間入力して、該伝送線路による損失分を補償する特性
を設定し、出力はディジタル信号とする線路等化器に関
し、 精度の高いアナログ・ディジタル変換器（以下Ａ／Ｄ変
換器と称す）を必要とせず、周囲温度が変化しても特性
の安定な線路等化器の提供を目的とし、 入力信号を増幅するアナログ増幅器と、該アナログ増幅
器の出力をディジタル化するＡ／Ｄ変換器と、該Ａ／Ｄ
変換器によりディジタル化された信号を入力し線路等化
をするディジタルフィルタを備え、 該アナログ増幅器ｌと該ディジタルフィルタにて、伝送
線路の損失周波数特性を補償する複数の利得特性を得る
為に、該アナログ増幅器と該ディジタルフィルタの可変
部の値を予め定めておき、ある補償特性にて補償された
該ディジタルフィルタの出力を、パワー演算器に入力し
、該パワー演算器にてパワーを演算した出力を自動利得
制ＩＢ回路（以下ＡＧＣと称す）に入力し、 該ＡＧＣでは、予め定められた目標値と、入力したパワ
ー演算出力とを比較し、該目標値より太きければ、該ア
ナログ増幅器と該ディジタルフィルタにより補償する利
得特性を利得の少ない補償特性とする可変部の値を選択
し、該目標値より小さければ補償する利得特性を利得の
大きい補償特性とする可変部の値を選択することを繰り
返し、該目標値に最も近い補償特性を設定するように構
成する。
本発明は、ＩＳＤＮにて、２ＢＩＱ符号を用いたデータ
をトレーニングパターンとして、アナログ伝送線路を介
して送信し、受信側にて伝送線路の損失分を補償する特
性を設定する場合の如く、複数の周波数のアナログ信号
を、伝送線路を介して所定時間入力して、該伝送線路に
よる損失分を補償する特性を設定し、出力はディジタル
信号とする線路等化器の改良に関する。
をトレーニングパターンとして、アナログ伝送線路を介
して送信し、受信側にて伝送線路の損失分を補償する特
性を設定する場合の如く、複数の周波数のアナログ信号
を、伝送線路を介して所定時間入力して、該伝送線路に
よる損失分を補償する特性を設定し、出力はディジタル
信号とする線路等化器の改良に関する。
ＩＳＤＮにて、２情報と制御信号を送信する（２Ｂ＋Ｄ
）場合の伝送速度は通常１６０ＫｂｐＳであるが、２Ｂ
ＩＱ符号を用いると中心周波数は４０ＫＨｚの周波数と
低くすることが出来る。
）場合の伝送速度は通常１６０ＫｂｐＳであるが、２Ｂ
ＩＱ符号を用いると中心周波数は４０ＫＨｚの周波数と
低くすることが出来る。
２ＢＩＱ符号とは、第３図（Ｄ）に示す如く、２ビット
の信号にて４種類の信号を送るもので、最初のビットが
符号ビットであり、１で＋，０で一を示し、２番目のビ
ットが振幅ビットで１で１値をＯで３値を示すものであ
り、この場合のアナログ信号の組合せを示すと、第３図
（Ａ）に示す如く２ビットの期間にて４種類の信号とな
る。
の信号にて４種類の信号を送るもので、最初のビットが
符号ビットであり、１で＋，０で一を示し、２番目のビ
ットが振幅ビットで１で１値をＯで３値を示すものであ
り、この場合のアナログ信号の組合せを示すと、第３図
（Ａ）に示す如く２ビットの期間にて４種類の信号とな
る。
第３図（Ａ）に示す信号で、（Ｃ）に示す如く、最初の
２ビットの期間と次の２ビットの期間とが符号の異なる
信号であれば、周波数は４０ＫＨｚとなるが、（Ｂ）に
示す如く、最初の２ビットの期間と次の２ビットの期間
とが＋３又は−３なる同符号の場合は、周波数は８０Ｋ
Ｈｚとなるが、ある闇値を越えれば＋３又は−３なる信
号と見做せる。
２ビットの期間と次の２ビットの期間とが符号の異なる
信号であれば、周波数は４０ＫＨｚとなるが、（Ｂ）に
示す如く、最初の２ビットの期間と次の２ビットの期間
とが＋３又は−３なる同符号の場合は、周波数は８０Ｋ
Ｈｚとなるが、ある闇値を越えれば＋３又は−３なる信
号と見做せる。
そのため、このような場合、直流増幅が必要となり、８
０ＫＨｚの周波数を等化する必要はない．従って、この
信号が送信されると、受信側で伝送線路の損失を補償す
る場合は、少なくとも直流と４０ＫＨｚの周波数を等化
する必要がある。
０ＫＨｚの周波数を等化する必要はない．従って、この
信号が送信されると、受信側で伝送線路の損失を補償す
る場合は、少なくとも直流と４０ＫＨｚの周波数を等化
する必要がある。
このような等化を行う線路等化器では、周囲温度の変化
に対して特性が安定しており又Ａ／Ｄ変換器のビット精
度が低くてもよいことが望ましい。
に対して特性が安定しており又Ａ／Ｄ変換器のビット精
度が低くてもよいことが望ましい。
？従来の技術〕
第２図は１例の特性設定用テーブルを示す図、第４図は
１例の伝送線路の線路損失の周波数特性図、第５図は１
例の補償特性を示す図、第６図は従来例の線路等化器の
ブロック図、第７図は１例のアナログ増幅器の回路図、
第８図は１例のアナログ型ハイバスフィルタの回路図、
第９図は１例のディジタル型フィルタの回路図を示す。
１例の伝送線路の線路損失の周波数特性図、第５図は１
例の補償特性を示す図、第６図は従来例の線路等化器の
ブロック図、第７図は１例のアナログ増幅器の回路図、
第８図は１例のアナログ型ハイバスフィルタの回路図、
第９図は１例のディジタル型フィルタの回路図を示す。
第４図は伝送線路の線路損失の周波数特性を示しており
、周波数が高くなる程損失は増加し、又伝送線路が１．
，ｌ■．１，と長い程損失が大きく傾斜も急峻となる。
、周波数が高くなる程損失は増加し、又伝送線路が１．
，ｌ■．１，と長い程損失が大きく傾斜も急峻となる。
第４図に示す如き損失特性を、直流，４０ＫＨｚにて補
償する為には、伝送線路の線路長に応じて第５図ａ，ｂ
，ｃに示す如《可変出来る利得特性を持つ線路等化器が
必要になる。 この為に、従来は第６図（Ａ）（Ｂ）に
示す如き線路等化器が用いられている。
償する為には、伝送線路の線路長に応じて第５図ａ，ｂ
，ｃに示す如《可変出来る利得特性を持つ線路等化器が
必要になる。 この為に、従来は第６図（Ａ）（Ｂ）に
示す如き線路等化器が用いられている。
（Ａ）の場合は、アナログ増幅器１，ハイパスフィルタ
ｌＯにて、第５図ａ，ｂ，ｃに示す如く変化する特性を
実現する為の、アナログ増幅器１，ハイパスフィルタ１
０の可変部の値を予め定め、第２図に示す如く番号を付
したテーブルを作成しておき、この番号をＡＧＣ１３に
て設定すると、アナログ増幅器１，ハイパスフィルタ１
０は、可変部をこれに対応した特性を実現する値とする
ようにしてある。
ｌＯにて、第５図ａ，ｂ，ｃに示す如く変化する特性を
実現する為の、アナログ増幅器１，ハイパスフィルタ１
０の可変部の値を予め定め、第２図に示す如く番号を付
したテーブルを作成しておき、この番号をＡＧＣ１３に
て設定すると、アナログ増幅器１，ハイパスフィルタ１
０は、可変部をこれに対応した特性を実現する値とする
ようにしてある。
又（Ｂ）の場合は、Ａ／Ｄ変換器１５にてディジタル信
号に変換してディジタルフィルタｌ６に入力するように
し、ディジタルフィルタ１６にて、第５図ａ，ｂ，ｃに
示す如く変化する特性を実現する為の、可変部の値を予
め定め、第２図に示す如く番号を付したテーブルを作成
しておき、この番号をＡＣＣ １ Ｂにて設定すると、
ディジタルフィルタ１６は、可変部をこれに対応した特
性を実現する値とするようにしてある。
号に変換してディジタルフィルタｌ６に入力するように
し、ディジタルフィルタ１６にて、第５図ａ，ｂ，ｃに
示す如く変化する特性を実現する為の、可変部の値を予
め定め、第２図に示す如く番号を付したテーブルを作成
しておき、この番号をＡＣＣ １ Ｂにて設定すると、
ディジタルフィルタ１６は、可変部をこれに対応した特
性を実現する値とするようにしてある。
そこで、トレーニング信号として、２ＢＩＱ符号にて発
生する各種組合せの信号を、伝送線路を介して所定の時
間送信すると、（Ａ）の場合は、伝送線路にて減衰され
た信号は、アナログ増幅器１，ハイパスフィルタ１０に
て補償され、Ａ／Ｄ変換器１ｌにてディジタル信号に変
換され、パワー演算器１２に入力する。
生する各種組合せの信号を、伝送線路を介して所定の時
間送信すると、（Ａ）の場合は、伝送線路にて減衰され
た信号は、アナログ増幅器１，ハイパスフィルタ１０に
て補償され、Ａ／Ｄ変換器１ｌにてディジタル信号に変
換され、パワー演算器１２に入力する。
パワー演算器１２では下記（１）式のようにパワー演算
を行いＡＣＣ１３にパワー演算値Ｐを人力する。
を行いＡＣＣ１３にパワー演算値Ｐを人力する。
Ｐ＝１／ｋ（ΣＡＤ２（ｉ）） ・・・ （１）シ・
ｌ （但しＰはパワー演算値，ｋは演算回数，ＡＤは入力し
たディジタル値） ＡＧＣ１３では、予め定めてあるパワー目標値ＰＣが、
ＰＣ＜Ｐの時は、アナログ増幅器１，ハイパスフィルタ
ｌＯにて利得を下げる方向の、上記テーブルの番号の値
を設定させ、Ｐｅ＞Ｐの時は、アナログ増幅器ｌ．ハイ
パスフィルタ１０にて利得を上げる方向の、上記テーブ
ルの番号の値を設定させることを繰り返し、予め定めて
あるパワー目標値ＰＣに収束する値に設定させる。
ｌ （但しＰはパワー演算値，ｋは演算回数，ＡＤは入力し
たディジタル値） ＡＧＣ１３では、予め定めてあるパワー目標値ＰＣが、
ＰＣ＜Ｐの時は、アナログ増幅器１，ハイパスフィルタ
ｌＯにて利得を下げる方向の、上記テーブルの番号の値
を設定させ、Ｐｅ＞Ｐの時は、アナログ増幅器ｌ．ハイ
パスフィルタ１０にて利得を上げる方向の、上記テーブ
ルの番号の値を設定させることを繰り返し、予め定めて
あるパワー目標値ＰＣに収束する値に設定させる。
このようにして等化特性が設定されると、通常の入力信
号は等化補償されてＡ／Ｄ変換器１１にてディジタル化
されて出力される。
号は等化補償されてＡ／Ｄ変換器１１にてディジタル化
されて出力される。
（Ｂ）の場合は、ディジタルフィルタ１６の出力のディ
ジタル信号はパワー演算器ｌ７に入力し、（１）式のよ
うにパワー演算を行いＡＧＣ１Ｂに入力する。
ジタル信号はパワー演算器ｌ７に入力し、（１）式のよ
うにパワー演算を行いＡＧＣ１Ｂに入力する。
ＡＣＣ１８では、ＡＧＣ１３と同じく、予め定めてある
パワー目標値ＰＣが、ＰＣ＜Ｐの時は、ディジタルフィ
ルタ１６にて利得を下げる方向の、上記テーブルの番号
の値を設定させ、ｐｃ＞ｐの時は、ディジタルフィルタ
１６にて利得を上げる方向の、上記テーブルの番号の値
を設定させることを繰り返し、予め定めてあるパワー目
標値ＰＣに収束する値に設定させる。
パワー目標値ＰＣが、ＰＣ＜Ｐの時は、ディジタルフィ
ルタ１６にて利得を下げる方向の、上記テーブルの番号
の値を設定させ、ｐｃ＞ｐの時は、ディジタルフィルタ
１６にて利得を上げる方向の、上記テーブルの番号の値
を設定させることを繰り返し、予め定めてあるパワー目
標値ＰＣに収束する値に設定させる。
従って、通常の２８ＩＱ符号にて発生する各種組合せの
アナログ入力信号は、等化補償されディジタル化されて
出力する。
アナログ入力信号は、等化補償されディジタル化されて
出力する。
次に、アナログ増幅器１の回路を示すと、第７図に示す
如く、演算増幅器２０と抵抗Ｒｌ， Ｒ２を用いたもの
で、利得Ｇ＝−Ｒ２／Ｒｌで抵抗比で定まり、利得は抵
抗Ｒ２を変化することで変化し、周囲温度の変化で抵抗
値が変化しても利得は変化しない。
如く、演算増幅器２０と抵抗Ｒｌ， Ｒ２を用いたもの
で、利得Ｇ＝−Ｒ２／Ｒｌで抵抗比で定まり、利得は抵
抗Ｒ２を変化することで変化し、周囲温度の変化で抵抗
値が変化しても利得は変化しない。
ハイパスフィルタ１０の回路を示すと、第８図に示す如
く、演算増幅器２１と抵抗Ｒ３，Ｒ４，コンデンサＣよ
りなるもので、利得Ｇは第８図（Ａ）に示す如くであり
、抵抗Ｒ３，Ｒ４の値を変化することで周波数特性の一
次傾斜を変えることが出来る。
く、演算増幅器２１と抵抗Ｒ３，Ｒ４，コンデンサＣよ
りなるもので、利得Ｇは第８図（Ａ）に示す如くであり
、抵抗Ｒ３，Ｒ４の値を変化することで周波数特性の一
次傾斜を変えることが出来る。
しかし、この場合はコンデンサＣを用いているので、周
囲温度が変化すると傾斜特性は変化する。
囲温度が変化すると傾斜特性は変化する。
ディジタルフィルタ（１６）の回路を示すと、第９図に
示す如く、遅延素子３０〜３４，乗算器３５〜４１，加
算器４２，係数Ｃ０〜Ｃ．よりなるものであり、係数０
０〜０．４の値にて第５図ａに示す如き特性を持たせ、
且つ係数００〜ＣＭを変化することで，第５図ｂ，ｃに
示す如き特性を持たせ、ａ，ｂ，ｃに示す特性を実現す
るこれ等の係数に対して、番号を付した第２図に示す如
きテーブルを予め作成してある． このディジタルフィルタはディジタル処理にて特性を定
めているので、周囲温度が変化しても特性は安定してい
る。
示す如く、遅延素子３０〜３４，乗算器３５〜４１，加
算器４２，係数Ｃ０〜Ｃ．よりなるものであり、係数０
０〜０．４の値にて第５図ａに示す如き特性を持たせ、
且つ係数００〜ＣＭを変化することで，第５図ｂ，ｃに
示す如き特性を持たせ、ａ，ｂ，ｃに示す特性を実現す
るこれ等の係数に対して、番号を付した第２図に示す如
きテーブルを予め作成してある． このディジタルフィルタはディジタル処理にて特性を定
めているので、周囲温度が変化しても特性は安定してい
る。
（発明が解決しようとする課題〕
しかしながら、第６図（Ａ）に示す線路等化器では、周
囲温度が変化するとハイパスフィルタ１０の特性が変化
する問題点があり、第６図（Ｂ）に示す線路等化器では
入力するレベルの低いアナログ信号をＡ／Ｄ変換器１５
にてディジタル信号に変換するので、レベルの小さい信
号を量子化せねばならず、相対的に量子化誤差が大きく
なるので、精度の高いＡ／Ｄ変換器が必要となる問題点
がある。
囲温度が変化するとハイパスフィルタ１０の特性が変化
する問題点があり、第６図（Ｂ）に示す線路等化器では
入力するレベルの低いアナログ信号をＡ／Ｄ変換器１５
にてディジタル信号に変換するので、レベルの小さい信
号を量子化せねばならず、相対的に量子化誤差が大きく
なるので、精度の高いＡ／Ｄ変換器が必要となる問題点
がある。
本発明は、精度の高いＡ／Ｄ変換器を必要とせず、周囲
温度が変化しても特性の安定な線路等化器の提供を目的
としている。
温度が変化しても特性の安定な線路等化器の提供を目的
としている。
〔課題を解決するための手段］
第１図は本発明の実施例のブロック図である．複数の周
波数のアナログ信号を、伝送線路を介して所定時間入力
して、該伝送線路による損失分を補償する特性を設定し
、出力をディジタル信号とする線路等化器において、 第１図に示す如く、入力信号を増幅するアナログ増幅器
１と、該アナログ増幅器１の出力をディジタル化するＡ
／Ｄ変換器２と、該Ａ／Ｄ変換器２によりディジタル化
された信号を入力し線路等化をするディジタルフィルタ
３を備え、 該アナログ増幅器ｌと該ディジタルフィ゜ルタ３にて、
伝送線路の損失周波数特性を補償する複数の利得特性を
得る為の、該アナログ増幅器１と該ディジタルフィルタ
３の可変部の値を予め作成しておき、 ある補償特性にて補償された該ディジタルフィルタ３の
出力を、パワー演算器４に入力し、該パワー演算器４に
てパワーを演算した出力をＡＧＣ５に入力し、 該Ａｃｃｓでは、予め定められた目標値と、入力したパ
ワー演算出力とを比較し、該目標値より大きければ、該
アナログ増幅器１と該ディジタルフィルタ３により補償
する利得特性を利得の少ない補償特性とする可変部の値
を選択し、該目標値より小さければ補償する利得特性を
利得の大きい補償特性とする可変部の値を選択すること
を繰り返し、該目標値に最も近い補償特性を設定するよ
うにする。
波数のアナログ信号を、伝送線路を介して所定時間入力
して、該伝送線路による損失分を補償する特性を設定し
、出力をディジタル信号とする線路等化器において、 第１図に示す如く、入力信号を増幅するアナログ増幅器
１と、該アナログ増幅器１の出力をディジタル化するＡ
／Ｄ変換器２と、該Ａ／Ｄ変換器２によりディジタル化
された信号を入力し線路等化をするディジタルフィルタ
３を備え、 該アナログ増幅器ｌと該ディジタルフィ゜ルタ３にて、
伝送線路の損失周波数特性を補償する複数の利得特性を
得る為の、該アナログ増幅器１と該ディジタルフィルタ
３の可変部の値を予め作成しておき、 ある補償特性にて補償された該ディジタルフィルタ３の
出力を、パワー演算器４に入力し、該パワー演算器４に
てパワーを演算した出力をＡＧＣ５に入力し、 該Ａｃｃｓでは、予め定められた目標値と、入力したパ
ワー演算出力とを比較し、該目標値より大きければ、該
アナログ増幅器１と該ディジタルフィルタ３により補償
する利得特性を利得の少ない補償特性とする可変部の値
を選択し、該目標値より小さければ補償する利得特性を
利得の大きい補償特性とする可変部の値を選択すること
を繰り返し、該目標値に最も近い補償特性を設定するよ
うにする。
本発明の線路等化器では、入力信号を増幅するアナログ
増幅器１と、該アナログ増幅器ｌの出力をディジタル化
するＡ／Ｄ変換器２と、該Ａ／Ｄ変換器２によりディジ
タル化された信号を入力し線路等化をするディジタルフ
ィルタ３を備え、該アナログ増幅器１と該ディジタルフ
ィルタ３にて、伝送線路の損失周波数特性を補償する複
数の利得特性を得る為の、該アナログ増幅器１と該ディ
ジタルフィルタ３の可変部の値を予め作成しておき、 ある補償特性にて補償された該ディジタルフィルタ３の
出力を、パワー演算器４に入力し、該パワー演算器４に
てパワーを演算した出力をＡＧＣ５に入力し、 該ＡＧＣ５では、予め定められた目標値と、入力したパ
ワー演算出力とを比較し、該目標値より大きければ、該
アナログ増幅器１と該ディジタルフィルタ３により補償
する利得特性を利得の少ない補償特性とする可変部の値
を選択し、該目標値より小さければ補償する利得特性を
利得の大きい補償特性とする可変部の値を選択すること
を繰り返し、該目標値に最も近い補償特性を設定して、
線路等化器として使用するようにする。
増幅器１と、該アナログ増幅器ｌの出力をディジタル化
するＡ／Ｄ変換器２と、該Ａ／Ｄ変換器２によりディジ
タル化された信号を入力し線路等化をするディジタルフ
ィルタ３を備え、該アナログ増幅器１と該ディジタルフ
ィルタ３にて、伝送線路の損失周波数特性を補償する複
数の利得特性を得る為の、該アナログ増幅器１と該ディ
ジタルフィルタ３の可変部の値を予め作成しておき、 ある補償特性にて補償された該ディジタルフィルタ３の
出力を、パワー演算器４に入力し、該パワー演算器４に
てパワーを演算した出力をＡＧＣ５に入力し、 該ＡＧＣ５では、予め定められた目標値と、入力したパ
ワー演算出力とを比較し、該目標値より大きければ、該
アナログ増幅器１と該ディジタルフィルタ３により補償
する利得特性を利得の少ない補償特性とする可変部の値
を選択し、該目標値より小さければ補償する利得特性を
利得の大きい補償特性とする可変部の値を選択すること
を繰り返し、該目標値に最も近い補償特性を設定して、
線路等化器として使用するようにする。
この場合、入力信号をＡＧＣ５にて設定されたアナログ
増幅器１にて増幅し、レベルを大きくした後、Ａ／Ｄ変
換器２にてディジタル信号に変換するので、相対的に量
子化誤差は少なくなり、Ａ／Ｄ変換器２の精度を低くす
ることが出来る。
増幅器１にて増幅し、レベルを大きくした後、Ａ／Ｄ変
換器２にてディジタル信号に変換するので、相対的に量
子化誤差は少なくなり、Ａ／Ｄ変換器２の精度を低くす
ることが出来る。
又等化特性は、周囲温度が変化しても特性の安定な、先
に説明した、アナログ増幅器１とディジタルフィルタ３
にて構成しているので、周囲温度変化に対して安定な線
路等化器となる。
に説明した、アナログ増幅器１とディジタルフィルタ３
にて構成しているので、周囲温度変化に対して安定な線
路等化器となる。
第１図は本発明の実施例の線路等化器のブロック図であ
る。
る。
第１図の場合は、アナログ増幅器１とディジタルフィル
タ３にて、第５図ａ，ｂ，ｃに示す如く変化する特性を
実現する為の、アナログ増幅器１．ディジタルフィルタ
３の可変部の値を予め定め、第２図に示す如く番号を付
したテーブルを作成しておき、この番号をＡＧＣ５にて
設定すると、アナログ増幅器１，ディジタルフィルタ３
は可変部をこれに対応した特性を実現する値となるよう
にしてある。
タ３にて、第５図ａ，ｂ，ｃに示す如く変化する特性を
実現する為の、アナログ増幅器１．ディジタルフィルタ
３の可変部の値を予め定め、第２図に示す如く番号を付
したテーブルを作成しておき、この番号をＡＧＣ５にて
設定すると、アナログ増幅器１，ディジタルフィルタ３
は可変部をこれに対応した特性を実現する値となるよう
にしてある。
そこでトレーニング信号として、２ＢＩＱ符号にて発生
する各種組合せの信号を、伝送線路を介して所定の時間
送信すると、伝送線路にて減衰された信号は、アナログ
増幅器１にて増幅され、Ａ／Ｄ変換器２にてディジタル
信号に変換され、ディジタルフィルタ３にて１次傾斜特
性が補償され、パワー演算器４に入力し、前記（１）式
のようにパワー演算されたパワー演算値Ｐを、ＡＧＣ５
に入力する。
する各種組合せの信号を、伝送線路を介して所定の時間
送信すると、伝送線路にて減衰された信号は、アナログ
増幅器１にて増幅され、Ａ／Ｄ変換器２にてディジタル
信号に変換され、ディジタルフィルタ３にて１次傾斜特
性が補償され、パワー演算器４に入力し、前記（１）式
のようにパワー演算されたパワー演算値Ｐを、ＡＧＣ５
に入力する。
ＡＧＣ５では、従来例と同様に、予め定めてあるパワー
目標値ＰＣが、ＰＣ＜Ｐの時は、アナログ増幅器１，デ
ィジタルフィルタ３にて利得を下げる方向の、第２図の
テーブルの番号の値を設定させ、ＰＣ＞Ｐの時は、アナ
ログ増幅器１．ディジタルフィルタ３にて利得を上げる
方向の、上記テーブルの番号の値を設定させることを繰
り返し、予め定めてあるパワー目標値Ｐｃに収束する値
に設定させる。
目標値ＰＣが、ＰＣ＜Ｐの時は、アナログ増幅器１，デ
ィジタルフィルタ３にて利得を下げる方向の、第２図の
テーブルの番号の値を設定させ、ＰＣ＞Ｐの時は、アナ
ログ増幅器１．ディジタルフィルタ３にて利得を上げる
方向の、上記テーブルの番号の値を設定させることを繰
り返し、予め定めてあるパワー目標値Ｐｃに収束する値
に設定させる。
このようにして等化特性が設定されると、通常の入力信
号は等化補償されてディジタルフィルタ３の出力よりデ
ィジタル化された信号が出力される。
号は等化補償されてディジタルフィルタ３の出力よりデ
ィジタル化された信号が出力される。
尚、アナログ増幅器１は第７図に示す如くコンデンサを
含まないため周囲温度変化に対し安定である。
含まないため周囲温度変化に対し安定である。
又ディジタルフィルタ３としては、第９図に示す如きも
のを用いる。
のを用いる。
第１図の場合は、Ａ／Ｄ変換器２の入力は、ＡＧＣ５で
設定したアナログ増幅器１にて増幅された信号が人力す
るので、レベルは高くなっており、量子化誤差は相対的
に少なくなるので、Ａ／Ｄ変換器２は精度の低いもので
もよく、又等化補償するアナログ増幅器１及びディジタ
ルフィルタ３は周囲温度の変化に対し安定であるので、
周囲温度が変化しても特性は安定している。
設定したアナログ増幅器１にて増幅された信号が人力す
るので、レベルは高くなっており、量子化誤差は相対的
に少なくなるので、Ａ／Ｄ変換器２は精度の低いもので
もよく、又等化補償するアナログ増幅器１及びディジタ
ルフィルタ３は周囲温度の変化に対し安定であるので、
周囲温度が変化しても特性は安定している。
以上詳細に説明せる如く本発明によれば、周囲温度が変
化しても等化特性は安定で、且つ精度の低いＡ／Ｄ変換
器を用いることが出来る線路等化器が得られる効果があ
る。
化しても等化特性は安定で、且つ精度の低いＡ／Ｄ変換
器を用いることが出来る線路等化器が得られる効果があ
る。
第１図は本発明の実施例の線路等化器のブロック図、
第２図は１例の特性設定用テーブルを示す図、第３図は
１例の２８ＩＱ符号によるアナログ波形及び周波数説明
図、 第４図は１例の伝送線路の線路損失の周波数特性図、 第５図は１例の補償特性を示す図、 第６図は従来例の線路等化器のブロック図、第７図は１
例のアナログ増幅器の回路図、第８図は１例のアナログ
型バイパスフィルタの回路図、 第９図は１例のディジタル型フィルタの回路図を示す。 図において、 １はアナログ増幅器、 ２，１１．１５はアナログ・ディジタル変換器、３．１
６はディジタルフィルタ、 ４，１２．１７はパワー演算器、 ５，１３．１８は自動利得制御回路、 ２０， １は演算増幅器、 ３０〜３４は遅延素子、 ３５〜４ １は乗算器、 ４２は加算器、 Ｒ１〜Ｒ４は抵抗、 Ｃはコンデンサを示す。
１例の２８ＩＱ符号によるアナログ波形及び周波数説明
図、 第４図は１例の伝送線路の線路損失の周波数特性図、 第５図は１例の補償特性を示す図、 第６図は従来例の線路等化器のブロック図、第７図は１
例のアナログ増幅器の回路図、第８図は１例のアナログ
型バイパスフィルタの回路図、 第９図は１例のディジタル型フィルタの回路図を示す。 図において、 １はアナログ増幅器、 ２，１１．１５はアナログ・ディジタル変換器、３．１
６はディジタルフィルタ、 ４，１２．１７はパワー演算器、 ５，１３．１８は自動利得制御回路、 ２０， １は演算増幅器、 ３０〜３４は遅延素子、 ３５〜４ １は乗算器、 ４２は加算器、 Ｒ１〜Ｒ４は抵抗、 Ｃはコンデンサを示す。
Claims (1)
- 【特許請求の範囲】 複数の周波数のアナログ信号を、伝送線路を介して所定
時間入力して、該伝送線路による損失分を補償する特性
を設定し、出力はディジタル信号とする線路等化器にお
いて、 入力信号を増幅するアナログ増幅器（１）と、該アナロ
グ増幅器（１）の出力をディジタル化するアナログ・デ
ィジタル変換器（２）と、該アナログ・ディジタル変換
器（２）によりディジタル化された信号を入力し線路等
化をするディジタルフィルタ（３）を備え、 該アナログ増幅器（１）と該ディジタルフィルタ（３）
にて、伝送線路の損失周波数特性を補償する複数の利得
特性を得る為に、該アナログ増幅器（１）と該ディジタ
ルフィルタ（３）の可変部の値を予め作成しておき、 ある補償特性にて補償された該ディジタルフィルタ（３
）の出力を、パワー演算器（４）に入力し、該パワー演
算器（４）にてパワーを演算した出力を自動利得制御回
路（５）に入力し、 該自動利得制御回路（５）では、予め定められた目標値
と、入力したパワー演算出力とを比較し、該目標値より
大きければ、該アナログ増幅器（１）と該ディジタルフ
ィルタ（３）により補償する利得特性を利得の少ない補
償特性とする可変部の値を選択し、該目標値より小さけ
れば補償する利得特性を利得の大きい補償特性とする可
変部の値を選択することを繰り返し、該目標値に最も近
い補償特性を設定するようにしたことを特徴とする線路
等化器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6002489A JPH02238729A (ja) | 1989-03-13 | 1989-03-13 | 線路等化器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6002489A JPH02238729A (ja) | 1989-03-13 | 1989-03-13 | 線路等化器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02238729A true JPH02238729A (ja) | 1990-09-21 |
Family
ID=13130087
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6002489A Pending JPH02238729A (ja) | 1989-03-13 | 1989-03-13 | 線路等化器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02238729A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7447260B2 (en) | 2002-06-10 | 2008-11-04 | Nec Corporation | Equalizer, equalization method, and transmitter |
-
1989
- 1989-03-13 JP JP6002489A patent/JPH02238729A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7447260B2 (en) | 2002-06-10 | 2008-11-04 | Nec Corporation | Equalizer, equalization method, and transmitter |
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