JPH02212911A - 時刻装置の時刻合わせ方法 - Google Patents

時刻装置の時刻合わせ方法

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Publication number
JPH02212911A
JPH02212911A JP1033973A JP3397389A JPH02212911A JP H02212911 A JPH02212911 A JP H02212911A JP 1033973 A JP1033973 A JP 1033973A JP 3397389 A JP3397389 A JP 3397389A JP H02212911 A JPH02212911 A JP H02212911A
Authority
JP
Japan
Prior art keywords
time
computer
response
signal
response signal
Prior art date
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Pending
Application number
JP1033973A
Other languages
English (en)
Inventor
Masahiro Nakagawa
雅博 中川
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Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
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Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP1033973A priority Critical patent/JPH02212911A/ja
Publication of JPH02212911A publication Critical patent/JPH02212911A/ja
Pending legal-status Critical Current

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  • Synchronisation In Digital Transmission Systems (AREA)
  • Electric Clocks (AREA)
  • Communication Control (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、時別処理手段をもった時刻装置の時刻合わせ
に関する方法である。
従来の技術 近年、タイマー、カレンダー時計等の時刻装置をもった
コンピュータをはじめとする電子装置の利用台数は増大
する一方である。
従来、時刻装置をもった電子装置の時刻合わせ操作は、
各々の電子装置に対して電子装置の操作者が別々の方法
で行っていた。
発明が解決しようとする課題 前記のような方法では、操作者によって時刻の合わせ方
法が異なるので、時刻装置の間で時刻差が大きくなり、
時刻装置をもった複数の電子装置が各々の時刻装置の時
刻を基準に同期して機能動作させることが、不可能とい
う欠点を有していた。
本発明は上記従来の問題点を解決するもので、時刻処理
手段をtっだ時刻装置の時刻合わせ方法を提供すること
を目的とする。
課題を解決するための手段 この問題点を解決するために、本発明は少なくとも時刻
処理手段をもった時刻装置どうしの時刻合わせ方法にお
いて、一方の時刻装置から応答要求信号を他方の時刻装
置の時刻処理手段に送信し、前記時刻処理手段は自己の
応答信号および同応答信号の発生時刻および前記応答要
求信号の受理時刻を前記一方の時刻装置に送信し、前記
一方の時刻装置は前記応答信号の受信時刻および前記他
方の時刻装置から送信されてきた応答信号の時刻と前記
応答要求信号の受信時刻との計算処理を行ない、前記一
方の時刻装置が合わせる時刻に対応する他方の時刻装置
の時刻を求め、前記一方の時刻装置が合わせる時刻を前
記他方の時刻装置の時刻に設定する方法である。
作用 上記の方法によって、通信手段の信号遅れ時間を補正し
、一方の時刻装置が合わせようとする時刻に対する他方
の時刻装置の時刻を算出するため1時刻装置の間の時刻
差が10分の1秒から1000分の1秒の誤差で合わせ
ることができる。
実施例 以下、本発明の一実施例について、図面を参照しながら
説明する。
第1図は本発明の一実施例における通信回線で接続され
た2台のコンピュータの構成図である。
第1図において、1は第1コンピユータのメモリ、2は
第1コンピユータの時刻装置1.3は第1コンピユータ
の通信装置、4は第1コンピユータのレジスタ、5は第
1コンピユータの演算装置、6は第1コンピユータの制
御装置、7は通信回線、8は第2コンピユータの通信装
置、9は第2コンピユータの時刻装置、10は第2コン
ピユータのメモリ、11は第2コンピユータのレジスタ
、12は第2コンピユータの演算装置、13は第2コン
ピユータの制御装置である。
第2図は上記構成の場合の動作説明図である。
第2図において、14は応答要求信号の送信時刻、15
は応答要求信号、16は応答要求信号の受信時刻、17
は応答信号の送信時刻、18は応答信号、19は応答信
号の受信時刻、20は応答要求信号受信時刻および応答
信号送信時刻を値とする通信データ、21は第1コンピ
ユータ倒での設定時刻、22は第1コンピユータ側での
合わせ時刻である。
以上のように構成された通信回線で接続された2台のコ
ンピュータについて、以下その動作を説明する。
まず、第1コンピユータのメモリlに蓄積しであるプロ
グラムによる時刻処理手段において、応答要求信号15
を第1コンピユータの通信装置3から通信口&117を
通し第2コンピユータの通信装置8へ送信し、第1コン
ピユータの時刻装置2から第1コンピユータのレジスタ
4に応答要求信号15の送信時刻14として記録し、第
2コンピユータからの応答信号18を第1コンピユータ
の通信値R3で受信するまで待機する。第2コンピユー
タのメモリ10に蓄積しであるプログラムによる時刻処
理手段において、第2コンピユータの通信装置8で前記
第1コンピユータの通信装置3からの応答要求信号15
を待機し、前記応答要求信号15を受信した時、第2コ
ンピユータの時刻装置9から第2コンピユータのレジス
タ11に前記応答要求信号15の受信時刻16として記
録し、応答信号18を第2コンピユータの通信値M8か
ら通信回線7を通し第1コンピユータの通信装置3へ送
信し、第2コンピユータの時刻装置9から第2コンピユ
ータのレジスタ11に応答信号18の送信時刻17とし
て記録し、第2コンピユータのレジスタ11から前記応
答要求信号15の受信時刻16および前記応答信号18
の送信時刻17の値を通信データ20として第2コンピ
ユータの通信装置iY8から通信回線7を通し第1コン
ピユータの通信装置3に送信する。
前記第1コンピユータ側の時刻処理手段で前記第2コン
ピユータの通信装置8からの応答信号18を受信した時
、第1コンピユータの時刻装置2から第1コンピユータ
のレジスタ4に前記応答信号18の受信時刻19として
記録し、第2コンピユータの通信装置8から第2コンピ
ユータ側の前記応答要求信号15の受信時刻16および
前記応答信号18の送信時刻17を受信した時、第1コ
ンピユータのレジスタ4に第2コンピュータ側の前記応
答要求信号15の受信時刻16および前記応答信号18
の送信時刻17を記録し、さらに第1コンピユータの時
刻装置2からの時刻に合わせ時刻算出のための計算処理
時間より充分大きい任意の時間として、10分の1秒か
ら100分の1秒等の値を加え、第1コンピユータ側で
の設定時刻21としてレジスタ4に記録する。第1コン
ピユータのレジスタ4に記録した、第1コンピユータ側
の応答要求信号15の送信時刻14と応答信号18の受
信時刻19および第2コンピユータ倒の応答要求信号1
5の受信時刻16と応答信号18の送信時刻17および
第1コンピユータの時刻装置2に設定すべき第1コンピ
ユータ側での設定時刻21から第1コンピユータの時刻
装置1F2に設定する合わせ時刻22を第1コンピユー
タの演算袋fl15において、以下の式(1)に相当す
る計算処理により算出し、第1コンピユータのレジスタ
4に記録する。
合わせ時刻22= +2X設定時刻2J応答信号受信時
刻19 +応答信号送信時刻17 +応答要求信号受信時刻16 一応答要求信号送信時刻14) ÷2       ・・・・・・・・・ (1)第1コ
ンピユータ側での設定時刻21にな−)た時、この計算
処理で算出した合わせ時刻22を、第1コンピユータの
時刻装置2に設定する。
尚、この説明では2台のコンピュータを例にして説明し
たが・3台以上であっても当然かまわない。また、説明
ではコンピュータのソウトウエアによる手段の例として
説明したがノ1−ドウエアによる手段であっても当然か
まわない。
発明の効果 以上のように本発明によれば、応答要求信号と応答信号
の送信受信時刻を記録するこ七により、通信による回線
上の時間遅れ、通信装置における処理時間遅れを補正す
る事ができる優れた時間処理手段をもった時刻装置の時
刻合わせを実現できるものである。
【図面の簡単な説明】
第1図は本発明の一実施例における通信回線で接続され
た2台のコンピュータ構成図、第2図は動作説明図であ
る。 ■・・・・・・第1コンピユータのメモリ、2・・・・
・・第1コンピユータの時刻装置、3・・・・・・第1
コンピユータの通信装置、4・・・・・・第1コンピユ
ータのレジスタ、5・・・・・・第1コンピユータの演
算装置、6・・・・・・第1コンピユータの制御装置、
7・・・・・・通信回線、8・・・・・・第2コンピユ
ータの通信装置、9・・・・・・第2コンピユータの時
刻装置、10・・・・・・第2コンピユータのメモリ、
11・・・・・・第2コンピユータのレジスタ、12・
・・・・・第2コンピユータの演算装置。 13・・・・・・第2コンピユータの$+制御装置、1
4・・・・・・応答要求信号の送信時刻、15・・・・
・・応答要求信号、16・・・・・・応答要求信号の受
信時刻、17・・・・・・応答信号の送信時刻、18・
・・・・・応答信号、19・・・・・・応答信号の受信
時刻、20・・・・・・応答要求信号受信時刻および応
答信号送信時刻を値とする通信データ、21・・・・・
・第1コンピユータ側での設定時刻、22・・・・・・
第1コンピユータ側での合わせ時刻。 代理人の氏名 弁理士 粟野重孝 ほか1名第 図 第1コンビーータ制の動作 第2コンピユータ倒の動作 第1コンビ】−夕餉の同II 壕2コンビコ 夕餉の時刺

Claims (1)

    【特許請求の範囲】
  1. 複数の時刻装置どうしの時刻合わせで、一方の時刻装置
    から応答要求信号を他方の時刻装置の時刻処理手段に送
    信し、前記時刻処理手段は自己の応答信号および同応答
    信号の発生時刻および前記応答要求信号の受信時刻を前
    記一方の時刻装置に送信し、前記一方の時刻装置は前記
    応答信号の受信時刻および前記他方の時刻装置から送信
    されてきた応答信号の時刻と前記応答要求信号の発生時
    刻との計算処理を行ない、前記一方の時刻装置の時刻を
    前記他方の時刻装置の時刻に合わせることを特徴とする
    時刻装置の時刻合わせ方法。
JP1033973A 1989-02-14 1989-02-14 時刻装置の時刻合わせ方法 Pending JPH02212911A (ja)

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JPH02212911A true JPH02212911A (ja) 1990-08-24

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JP (1) JPH02212911A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2944755B2 (ja) * 1992-10-15 1999-09-06 川崎製鉄株式会社 金属帯の連続浸炭方法
US6832326B2 (en) 2000-08-02 2004-12-14 Fujitsu Limited Multiprocessor clock synchronization with adjustment based on measuring propagation delay between a processor and a plurality of processors

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* Cited by examiner, † Cited by third party
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JP2944755B2 (ja) * 1992-10-15 1999-09-06 川崎製鉄株式会社 金属帯の連続浸炭方法
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