JPH0216427Y2 - - Google Patents

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JPH0216427Y2
JPH0216427Y2 JP17195382U JP17195382U JPH0216427Y2 JP H0216427 Y2 JPH0216427 Y2 JP H0216427Y2 JP 17195382 U JP17195382 U JP 17195382U JP 17195382 U JP17195382 U JP 17195382U JP H0216427 Y2 JPH0216427 Y2 JP H0216427Y2
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JP
Japan
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tape
output
stop
counter
stop signal
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JP17195382U
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JPS5978595U (ja
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Description

【考案の詳細な説明】 〔産業上の利用分野〕 本考案はテープカウンタを備えているビデオテ
ープレコーダー(VTR)等において早送り又は
巻戻し時などにこのカウンタが所定の値となつた
時、自動的にテープ走行を停止させる為のメモリ
ーストツプ回路に関する。
〔従来技術〕
ある番組(VTRの場合)を繰返して再生しよ
うとする場合等には、その番組のはじめの部分で
テープカウンタを零にリセツトして再生を開始
し、終つた時点で巻戻しを行なつてカウンタが零
になつた時にテープが自動的に停止する、さらに
は自動的に再生にはいる様構成されていれば便利
である。この為従来では機械式又は電子式のカウ
ンタを備えていて、そのカウンタが所定の値(外
部より設定可能な場合もある)となつた時にテー
プストツプ用の信号を出力する様になつている。
しかしテープを停止させたい時点でテープスト
ツプ用の信号を出力していたのでは、テープ駆動
系等の慣性により巻戻し過ぎてしまうという欠点
がある。これを補正して希望の所でテープ停止さ
せる為には、テープ駆動系の慣性を考慮して希望
する位置よりも少し前のタイミングでテープスト
ツプ信号を出力する様に構成すればよい。しかし
テープ駆動系の慣性は一定ではなくテープの巻き
はじめ、巻おわりにより、(すなわちテープの巻
径の変化により)又は、巻戻しするテープ量等に
よつても変化するので正確なテープ停止は困難で
ある。
〔考案の目的〕
本考案は上記の点に鑑みなされたものであつ
て、停止位置の正確なメモリーストツプ回路を提
供することを目的とする。
〔考案の構成〕
本考案はテープ走行に関連して増減するアツプ
ダウンカウンタ部と、該カウンタ部出力を入力と
してテープストツプ信号を出力するストツプ信号
出力部とを備え、テープ停止までのテープ走行量
に応じて前記テープストツプ信号の発生タイミン
グが変化することを特徴とするメモリーストツプ
回路である。
〔実施例〕
実施例の説明にはいる前にまず、実施回路の使
用されるVTRが以下の特性(駆動系等)である
ことが実験により解つているものと仮定する。
巻戻し開始時点から駆動系が一定の巻戻し状
態になるまでにカウンタの値で20カウント要す
る。
上記の一定巻戻し状態から停止させるとカウ
ンターの値で10カウント巻戻し過ぎる。
上記一定の巻戻し状態に達しない内にテープ
を停止させると2カウント巻戻し過ぎる。
従つて巻戻しするテープ量により巻戻し過ぎる
カウント値が変化するのでこのVTRで正確なメ
モリーストツプを行なおうとすれば、巻戻しする
テープ量(すなわち巻戻しに要する時間)従つて
カウンタの値に応じてテープストツプ信号の発生
するタイミングを変化させてやればよい。
第1図に実施例の回路ブロツク図を示す。図に
おいてはアツプダウンカウンタ部、はストツ
プ信号出力部である。アツプダウンカウンタ部
にはアンプ3,4を介して巻取リール台センサー
5及び供給リール台センサー6からの各リール台
の回転に関連した信号(リール回転パルス)が印
加されている。アツプダウンカウンタ部(以下カ
ウンタ部)はマイクロコンピユーター(CPU)
で構成されていて、単なるカウンタではなく各リ
ール台からの信号によりテープの残量を演算する
機能も有する。表示手段7はカウンタ部の内容
(内容テープカウント値、残量時間等)を表示す
る。
カウンタ部がテープカウンタとして動作する
時には巻取リール又は供給リールのうち一方の回
転を計数する。リール回転パルスをアツプカウン
トするかダウンカウントするかは、VTRのシス
テムコントロール回路(図示省略)からのモード
信号を利用してカウンタ部に指示される。SW1
はカウンタ部の内容をリセツト(「0000」に)
する為の又、後述のD−フリツプフロツプをリセ
ツトする為のリセツトスイツチである。カウンタ
からの出力S1〜S4は、カウンタの内容が夫々
「0020」の時ハイレベルとなる、「0019」の時ハイ
レベルとなる、「0010」の時ハイレベル「0002」
の時ハイレベルとなる出力であつてストツプ信号
出力部に印加される。
ストップ信号出力部は、「0020」出力S1を抵
抗とコンデンサによる積分回路9を介して、又
「0019」出力S2を直接入力するANDゲート8と該
ANDゲート8の出力bをクロツク入力(CLK)
とするD−フリツプフロツプ(D−FF)10と、
該D−FF10の出力Cと「0010」出力S3を入力
とするANDゲート11と、該ANDゲート11の
出力と「0002」出力S4とを入力するORゲート1
2と、該ORゲート12の出力及びメモリースト
ツプスイツチSW2に接続されたインバータ13の
出力を入力とするANDゲート14より構成され、
該ANDゲート14の出力がテープストツプ信号
Sとなる(例えばシステムコントロール回路に入
力される)。
次に第2図の要部波形図に従い動作を説明す
る。メモリーストツプスイツチSW2が投入されて
いる時にはANDゲート14が開いておりテープ
ストツプ信号が出力され、、メモリーストツプ動
作が行なわれる。テープの巻戻しが行なわれる
と、システムコントロール回路の指令により、カ
ウンタ部は巻取リール台のリール回転パルスを
ダウンカウントしている。巻戻しの量が20カウン
ト以上である時、すなわち本実施例ではカウンタ
が「0000」の時にテープを停止させるのであるか
らカウンタの値が「0020」以上の位置から巻戻す
時には、前述の如く10カウント前にストツプ信号
を出力すればよい。この為にカウンタ部のリセ
ツト時に同じくリセツトしたD−FF10を
「0020」出力S1及び「0019」出力S2でセツトして
(D−FFのデータ入力はプルアツプされて常にハ
イレベルである)ANDゲート11を開き、
「0010」出力がテープストツプ信号とし出力され
る様にしてある。巻戻しの量が20カウント以下の
時には「0002」出力がテープストツプ信号となり
テープが停止する。尚「0019」出力と「0020」出
力の遅延したものとのANDをとつたのは誤動作
防止の為であつて、「0020」出力のみでD−FF1
0をセツトしてもよい。
実施例ではカウンタの値が「0000」の位置で停
止するものであるが、停止する位置を外部より設
定する様構成することも可能である。この時には
設定値の2カウント前、10カウント前、19カウン
ト前、20カウント前にカウンタ部より出力され
る様構成すればよい(カウンタのデコーダを変え
る)。またさらに正確にテープを停止させる為に
は、上記の2区分をさらに細かくすればよい。
又、本考案は巻戻し時のメモリーストツプに限る
ものではない。
〔考案の効果〕
本考案は上記の如く、テープ走行に関連して増
減し、複数の計数値に対応した複数のテープスト
ツプ信号を出力するアツプダウンカウンタ部
と、早送りまたは巻戻し開始時における前記アツ
プダウンカウンタ部の計数値からテープ停止まで
のテープ走行量を判別する判別手段(D−フリツ
プフロツプ10が対応する)と、この判別手段の
出力に基づき前記複数のテープストツプ信号から
選択する選択手段(ANDゲート11、ORゲート
12が対応する)とを備えているから、テープ駆
動系の巻戻し状態、すなわちリール台の回転速度
により巻戻し過ぎる量が異なることを補正して希
望する正確な位置でテープを停止することができ
効果がある。
【図面の簡単な説明】
第1図は本考案一実施例の回路ブロツク図、第
2図はその要部波形図である。 主な図番の説明、……アツプダウンカウンタ
部、……ストツプ信号出力部。

Claims (1)

  1. 【実用新案登録請求の範囲】 テープ走行に関連して増減し、複数の計数値に
    対応した複数のテープストツプ信号を出力するア
    ツプダウンカウンタ部1と、早送りまたは巻戻し
    開始時における前記アツプダウンカウンタ部の計
    数値からテープ停止までのテープ走行量を判別す
    る判別手段10と、この判別手段の出力に基づき
    前記複数のテープストツプ信号から選択する選択
    手段11,12とを備え、 テープ停止までのテープ走行量に応じて前記テ
    ープストツプ信号の発生タイミングが変化するこ
    とを特徴とするメモリーストツプ回路。
JP17195382U 1982-11-12 1982-11-12 メモリ−ストツプ回路 Granted JPS5978595U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP17195382U JPS5978595U (ja) 1982-11-12 1982-11-12 メモリ−ストツプ回路

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP17195382U JPS5978595U (ja) 1982-11-12 1982-11-12 メモリ−ストツプ回路

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Publication Number Publication Date
JPS5978595U JPS5978595U (ja) 1984-05-28
JPH0216427Y2 true JPH0216427Y2 (ja) 1990-05-07

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ID=30374959

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JP17195382U Granted JPS5978595U (ja) 1982-11-12 1982-11-12 メモリ−ストツプ回路

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JPS5978595U (ja) 1984-05-28

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