JPH02119397A - アブソリュートエンコーダー検出信号の伝送回路 - Google Patents
アブソリュートエンコーダー検出信号の伝送回路Info
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- JPH02119397A JPH02119397A JP27212588A JP27212588A JPH02119397A JP H02119397 A JPH02119397 A JP H02119397A JP 27212588 A JP27212588 A JP 27212588A JP 27212588 A JP27212588 A JP 27212588A JP H02119397 A JPH02119397 A JP H02119397A
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- 230000005540 biological transmission Effects 0.000 title claims description 16
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- 238000000034 method Methods 0.000 description 3
- 238000006243 chemical reaction Methods 0.000 description 2
- 230000008054 signal transmission Effects 0.000 description 2
- 238000004519 manufacturing process Methods 0.000 description 1
Landscapes
- Arrangements For Transmission Of Measured Signals (AREA)
- Numerical Control (AREA)
- Control Of Position Or Direction (AREA)
- Selective Calling Equipment (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野１
本発明は、産業用ロボット或いはＮＣ工作機械のような
産業機械に於ける移動軸或いは回転軸の位置を計測する
ためのアブソリュートエンコーダ（以下エンコーダと記
す）検出信号伝送回路に関する。
産業機械に於ける移動軸或いは回転軸の位置を計測する
ためのアブソリュートエンコーダ（以下エンコーダと記
す）検出信号伝送回路に関する。
Ｃｔ；を束の技術］
伝送回線を経由して信号を伝送し、機械から制（１装置
まで伝送することを目的とする情報伝送システムに於け
る従来の伝送方式を第３図＜ａ＞（ｂ）、第４図によっ
て３５１明する。
まで伝送することを目的とする情報伝送システムに於け
る従来の伝送方式を第３図＜ａ＞（ｂ）、第４図によっ
て３５１明する。
第３図において１ａは通常のエンコーダ、１ｂはンリア
ル変ｔａ１Ｍ能を持ったエンコーダ、２ａ、２ｂはコネ
クタ、３ａ、３ｂは入力回路、４ａはゲート、４Ｆ）は
シリアル・パラレル変換回路、５はコンピュータ等の制
御装置である。
ル変ｔａ１Ｍ能を持ったエンコーダ、２ａ、２ｂはコネ
クタ、３ａ、３ｂは入力回路、４ａはゲート、４Ｆ）は
シリアル・パラレル変換回路、５はコンピュータ等の制
御装置である。
１のエンコーダは移動軸又は回転軸の絶対位置を検出す
るために多くの情報酸かあり、例えば二進法で２０ビッ
ト前後の信号を同時に送る必要がある９第３図（ａ）は
エンコーダの出力回路をそのまま並列に伝送するシステ
ムであってエンコーダの数の例えば約２０倍の信号線と
必要部品を含んでいる。第３１″Ａ（ｂ）は各エンコ−
ダの複数の出力端子からの複数の情報をシリアルに変Ｉ
Ｑ Ｌそれ以降の伝送線の数を減らして伝送するシステ
ムである。コネクタ２ａ、２ｂはエンコーダの装着され
た機械本体から雛れな制御装置に必要な情報を入出力す
るためのインタフェース部品であって、点線によって図
面におけるコネクタから右１１ｉ１１が制御装置内部で
あることを示している。
るために多くの情報酸かあり、例えば二進法で２０ビッ
ト前後の信号を同時に送る必要がある９第３図（ａ）は
エンコーダの出力回路をそのまま並列に伝送するシステ
ムであってエンコーダの数の例えば約２０倍の信号線と
必要部品を含んでいる。第３１″Ａ（ｂ）は各エンコ−
ダの複数の出力端子からの複数の情報をシリアルに変Ｉ
Ｑ Ｌそれ以降の伝送線の数を減らして伝送するシステ
ムである。コネクタ２ａ、２ｂはエンコーダの装着され
た機械本体から雛れな制御装置に必要な情報を入出力す
るためのインタフェース部品であって、点線によって図
面におけるコネクタから右１１ｉ１１が制御装置内部で
あることを示している。
第４図は第３図（ａ）の働きをより詳細に説明したもの
てあって１は１１個の工〉′コーグ、２は１１個の１ネ
クタ、３はｎ ｊ囚の入力回路、４はｎ （１２Ｊのケ
ート、５はコンビ、：Ｊ−−９等の制（１装置、６は制
御装置からの指令にもとづき被測定軸用のゲート制御信
号を出力するためのアドレスデコーダ、７はデータバス
である１点線はその右＋１ｔｌｌか制御装置内部である
ことを示している。■から【ｌまでの各エンコーダから
のデータ伝送線はエンコーダが例えば２０ビ・ノドの情
報から成り立っているとすれば約２０本の信号線がち成
り立っており、コネクタ２、入力回路３は同しく約２０
の回路から成り立っている。エンコーダ１の位置情報は
て１イ・フタ２に、Ｌつて制（３１１装置の入力回路３
に人力される。人力された情報はゲート・１にＥ達する
が、制御装置５からの信号によってデコーダ６はｎ個の
ゲート４の切り替えず、−号を作って各ゲートを切り替
え、指定エンコーダからの情報をそのエン−１−ダの番
地を確認しながら制御装置の入力に伝送している。第３
図（［］）においては各エン″′１−夕からの情報は直
列に伝送されているためにコネクタ２［）、入力回路３
ｂはそれぞれのエンコーダに７）シーて１回路用で済み
、ンリアル ノ（うしル変換回ｙ各、１ ｂは各エンコ
ーダから直列で送られてきた十“報をコンビ−７−−タ
に人力するために、１Ｌ列σ）（Ｘ 、＋；に変換する
ための回路て′ある９ ［発明が解決し、Ｌうとする課題１ １・４記に説明したように、第３［４（ａ）α）よう（
−各エンコーダの出力をそのまま、ｉｒ列に伝２ゴーる
方式て′あるとエンコーダの各出力婿１子（こｊ９＃１
されたち数のデータ伝送用の信号線、多７に：Ｊ）二１
ネタ、多数の入力回路やゲート等非常に多数のハードウ
ェアを必要とする為に回路が複雑になって製造価格が高
く故障発生の頻度も高かった。
てあって１は１１個の工〉′コーグ、２は１１個の１ネ
クタ、３はｎ ｊ囚の入力回路、４はｎ （１２Ｊのケ
ート、５はコンビ、：Ｊ−−９等の制（１装置、６は制
御装置からの指令にもとづき被測定軸用のゲート制御信
号を出力するためのアドレスデコーダ、７はデータバス
である１点線はその右＋１ｔｌｌか制御装置内部である
ことを示している。■から【ｌまでの各エンコーダから
のデータ伝送線はエンコーダが例えば２０ビ・ノドの情
報から成り立っているとすれば約２０本の信号線がち成
り立っており、コネクタ２、入力回路３は同しく約２０
の回路から成り立っている。エンコーダ１の位置情報は
て１イ・フタ２に、Ｌつて制（３１１装置の入力回路３
に人力される。人力された情報はゲート・１にＥ達する
が、制御装置５からの信号によってデコーダ６はｎ個の
ゲート４の切り替えず、−号を作って各ゲートを切り替
え、指定エンコーダからの情報をそのエン−１−ダの番
地を確認しながら制御装置の入力に伝送している。第３
図（［］）においては各エン″′１−夕からの情報は直
列に伝送されているためにコネクタ２［）、入力回路３
ｂはそれぞれのエンコーダに７）シーて１回路用で済み
、ンリアル ノ（うしル変換回ｙ各、１ ｂは各エンコ
ーダから直列で送られてきた十“報をコンビ−７−−タ
に人力するために、１Ｌ列σ）（Ｘ 、＋；に変換する
ための回路て′ある９ ［発明が解決し、Ｌうとする課題１ １・４記に説明したように、第３［４（ａ）α）よう（
−各エンコーダの出力をそのまま、ｉｒ列に伝２ゴーる
方式て′あるとエンコーダの各出力婿１子（こｊ９＃１
されたち数のデータ伝送用の信号線、多７に：Ｊ）二１
ネタ、多数の入力回路やゲート等非常に多数のハードウ
ェアを必要とする為に回路が複雑になって製造価格が高
く故障発生の頻度も高かった。
一方第３［Ｊ（ｂ）に説明したような直列の伝送方式で
あると各エンコーダ当たりの信号線、コネクタ、入力回
路が一回線用ですむためにハードウェアの数は少なくて
すむがエン１−ダの例えば約２０ピリドの信号を直列に
伝送するには多くの時間を必要とし、制御装置の処理」
二大きな制約を生した。
あると各エンコーダ当たりの信号線、コネクタ、入力回
路が一回線用ですむためにハードウェアの数は少なくて
すむがエン１−ダの例えば約２０ピリドの信号を直列に
伝送するには多くの時間を必要とし、制御装置の処理」
二大きな制約を生した。
［課題を解決するための手段］
エン７１− ダの持つ情報を一組の伝送線路によって産
業機械の制御コル装置または計測装：〃に伝送するよう
にした位置Ｊ１測ンステムのアフソリュトエンコーダの
検出信号の伝送回路におい°ζ、１′ｒ１１記エンコー
ダの出力回路とデータバスとの間にトライステーｈのゲ
ート回り各を設けそのゲートを０ｉ１記制（１装置また
は言１訓装置からのイネーブル信号によってｊＡ択制御
ｆｆｌするようにしたことを特徴としている。
業機械の制御コル装置または計測装：〃に伝送するよう
にした位置Ｊ１測ンステムのアフソリュトエンコーダの
検出信号の伝送回路におい°ζ、１′ｒ１１記エンコー
ダの出力回路とデータバスとの間にトライステーｈのゲ
ート回り各を設けそのゲートを０ｉ１記制（１装置また
は言１訓装置からのイネーブル信号によってｊＡ択制御
ｆｆｌするようにしたことを特徴としている。
［ｆｌ：川］
上記のように構成された回路において通常は各エン７７
−ダの出力回路か１１Ｆ列にｆ−タハスに接続されてい
てもｌ−ライステート・ｔ１／）ケーＦ・出力端一１′
−がハイインピーダンスになっているのて回路特性」−
はデータバスから分画されているノ）に各エンコーダの
出力は相互に１−渉することはない９制（耳装置から出
力されるイネーブル信号はアドレスデコーダによつ′ζ
制（耳装置か指定する特定のエンコーダにχ・ｔする制
御回路にイネーフルｆ、１号−を出力し、イネ−フル信
号を受けたｌ・ライステート・ゲートの出力ｒ４（ｊｊ
−，１は１−一夕パスにＩ妾続されてその持っている＋
ｉ’ｉ ？Ｎをデータバス−Ｌに出力するのて′性能の
良いエンコーダの出力回路を得ることか出東る。
−ダの出力回路か１１Ｆ列にｆ−タハスに接続されてい
てもｌ−ライステート・ｔ１／）ケーＦ・出力端一１′
−がハイインピーダンスになっているのて回路特性」−
はデータバスから分画されているノ）に各エンコーダの
出力は相互に１−渉することはない９制（耳装置から出
力されるイネーブル信号はアドレスデコーダによつ′ζ
制（耳装置か指定する特定のエンコーダにχ・ｔする制
御回路にイネーフルｆ、１号−を出力し、イネ−フル信
号を受けたｌ・ライステート・ゲートの出力ｒ４（ｊｊ
−，１は１−一夕パスにＩ妾続されてその持っている＋
ｉ’ｉ ？Ｎをデータバス−Ｌに出力するのて′性能の
良いエンコーダの出力回路を得ることか出東る。
し実施例１
本発明のアブンリＪ−−ｈ １：、シ１−ダ検出信号の
伝送回路について第１Ｉ２１、第２ ＩＩによって説明
する。図において１はｌ’１個のエンコーダであって、
ｌ−１，１−２等はそれぞれ別間の１ン−１−ダを示し
ている、１ｇはエンコーダそれぞれの出力端子に接続さ
れたトライステートのゲート、２はコネクタであって点
線から右側が制御装置内部であることを示している、３
は入力回路、４はゲート、５はコンピュータ、６は所定
のエンコーダを指定するアドレスのデコーダ、７はｆｆ
；ＩＩ ｆｆｆｌ装置内のデータバス、８は各ゲート１
ｇの出力端子を各エンコーダの出力例えば二進法の各桁
毎に並列に接続したデータバス、９はｎ回線のイネーブ
ル信号線、１０はイネーブル信号出力用のコネクタ、１
１はオア回路である。
伝送回路について第１Ｉ２１、第２ ＩＩによって説明
する。図において１はｌ’１個のエンコーダであって、
ｌ−１，１−２等はそれぞれ別間の１ン−１−ダを示し
ている、１ｇはエンコーダそれぞれの出力端子に接続さ
れたトライステートのゲート、２はコネクタであって点
線から右側が制御装置内部であることを示している、３
は入力回路、４はゲート、５はコンピュータ、６は所定
のエンコーダを指定するアドレスのデコーダ、７はｆｆ
；ＩＩ ｆｆｆｌ装置内のデータバス、８は各ゲート１
ｇの出力端子を各エンコーダの出力例えば二進法の各桁
毎に並列に接続したデータバス、９はｎ回線のイネーブ
ル信号線、１０はイネーブル信号出力用のコネクタ、１
１はオア回路である。
各トライステートゲート１ｇの出力端子はイネーブル信
号がその制御端子に加えられていない時はハイインピー
ダンスになっているのでデータバス８とは回路特性上は
切り離されたのと同様になっている。
号がその制御端子に加えられていない時はハイインピー
ダンスになっているのでデータバス８とは回路特性上は
切り離されたのと同様になっている。
Ｌ記のように構成された回路において、制御装置５から
出力されたイネーブル信号はアドレスデコーダ６によっ
て、制御装置が指定する特定のエンコーダの各出力回路
に接続された、データバス８と接続するそれぞれのトラ
イステートゲート・の制御端子に入力する。
出力されたイネーブル信号はアドレスデコーダ６によっ
て、制御装置が指定する特定のエンコーダの各出力回路
に接続された、データバス８と接続するそれぞれのトラ
イステートゲート・の制御端子に入力する。
イネーブル信号が人力されたエンコーダの出力ゲートは
データバスに接続状態となってその信号をデータバスに
送出する。テ°コーダ６の出力はオア回路１１を経由し
てゲート４を開きデータバスにのっている指定したエン
コーダからの出力情報を制御装置５に取り込む。このよ
うに芥エンコーダは制御装置か指定していない間は実質
的にデータバスから＋：ｌＪす１ｊｌｌｔされているの
で全てのエンコーダはデータバスに対して」１列に接続
することが出来、制（ゴー装置の入力ボートは一つです
む為にコイ・フタ２、入力回路３、ケート４はそれぞれ
エンコーダー個相当分たけあればよい、又イネーブル信
号の為の伝送四′線は各エンコーダ毎に一回線ですむの
て多数のエンコーダを使用しているシステムであっても
必要とするハードウェアの増加分は僅かですむ９第２図
において１はｎ（固のエンコーダて′あるがここでは２
個だけをＩＡ示している。
データバスに接続状態となってその信号をデータバスに
送出する。テ°コーダ６の出力はオア回路１１を経由し
てゲート４を開きデータバスにのっている指定したエン
コーダからの出力情報を制御装置５に取り込む。このよ
うに芥エンコーダは制御装置か指定していない間は実質
的にデータバスから＋：ｌＪす１ｊｌｌｔされているの
で全てのエンコーダはデータバスに対して」１列に接続
することが出来、制（ゴー装置の入力ボートは一つです
む為にコイ・フタ２、入力回路３、ケート４はそれぞれ
エンコーダー個相当分たけあればよい、又イネーブル信
号の為の伝送四′線は各エンコーダ毎に一回線ですむの
て多数のエンコーダを使用しているシステムであっても
必要とするハードウェアの増加分は僅かですむ９第２図
において１はｎ（固のエンコーダて′あるがここでは２
個だけをＩＡ示している。
［発明の効果］
上記のように構成された回路において通常は各エンコー
ダの出力回路が並列にデータバスに接続されていてもト
ライステートのゲート出力端子がハイインピーダンスに
なっているのでデータバスから分離されている為に各エ
ンコーダの出力は相互に干渉することはない、ｌｌｌＩ
ｎ装置から出力されるイネーブル信号はアドレスデコー
ダによって制御装置が指定する特定のエンコーダに対す
る制御回路にイネーブル信号を出力し、イネーブル信号
を受けたトライステートのゲートはデータバスに接続さ
れてその持っている情報をデータバス上に出方するので
性能の良いエンコーダの出力回路を得ることが出来る。
ダの出力回路が並列にデータバスに接続されていてもト
ライステートのゲート出力端子がハイインピーダンスに
なっているのでデータバスから分離されている為に各エ
ンコーダの出力は相互に干渉することはない、ｌｌｌＩ
ｎ装置から出力されるイネーブル信号はアドレスデコー
ダによって制御装置が指定する特定のエンコーダに対す
る制御回路にイネーブル信号を出力し、イネーブル信号
を受けたトライステートのゲートはデータバスに接続さ
れてその持っている情報をデータバス上に出方するので
性能の良いエンコーダの出力回路を得ることが出来る。
第１図は本発明による伝送回路のプロ・ツク図。
第２図は本発明による伝送回路詳細のブロック図。
第３図は従来の伝送回路のブロック図。
第４図は従来の並列式伝送回路のブロック図。
ｌ、ｌａ、ｌｂ・・・・・エンコーダ
１４、・・・・トライステートヶ−１へ２．２ａ、２ｂ
・・・・・・コネクタ ３．３ａ、３ｂ ・・・入力回路 ４．４ａ、・・・・ ケート ４ ｂ・・・・シリアル パラレル変換回路５・・・・
・制（ｆｆｌ装置例えばコンピュータ６・・・・アドレ
スのデコーダ ７・・−制御装置内のデータバス ８・−・ データバス ９・・・・イネーブル信号線 １０・・・・・・コネクタ １１・・・・・オア回路
・・・・・・コネクタ ３．３ａ、３ｂ ・・・入力回路 ４．４ａ、・・・・ ケート ４ ｂ・・・・シリアル パラレル変換回路５・・・・
・制（ｆｆｌ装置例えばコンピュータ６・・・・アドレ
スのデコーダ ７・・−制御装置内のデータバス ８・−・ データバス ９・・・・イネーブル信号線 １０・・・・・・コネクタ １１・・・・・オア回路
Claims (1)
- エンコーダの持つ情報を一組の伝送線路によって産業機
械の制御装置または計測装置に伝送するようにした位置
計測システムのアブソリュートエンコーダの検出信号の
伝送回路において、前記エンコーダの出力回路とデータ
バスとの間にトライステートのゲート回路を設けそのゲ
ートを前記制御装置または計測装置からのイネーブル信
号によって選択制御するようにしたことを特徴とするア
ブソリュートエンコーダ検出信号の伝送回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27212588A JPH02119397A (ja) | 1988-10-27 | 1988-10-27 | アブソリュートエンコーダー検出信号の伝送回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27212588A JPH02119397A (ja) | 1988-10-27 | 1988-10-27 | アブソリュートエンコーダー検出信号の伝送回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02119397A true JPH02119397A (ja) | 1990-05-07 |
Family
ID=17509440
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP27212588A Pending JPH02119397A (ja) | 1988-10-27 | 1988-10-27 | アブソリュートエンコーダー検出信号の伝送回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02119397A (ja) |
-
1988
- 1988-10-27 JP JP27212588A patent/JPH02119397A/ja active Pending
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