JPH0160949B2 - - Google Patents

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JPH0160949B2
JPH0160949B2 JP22264383A JP22264383A JPH0160949B2 JP H0160949 B2 JPH0160949 B2 JP H0160949B2 JP 22264383 A JP22264383 A JP 22264383A JP 22264383 A JP22264383 A JP 22264383A JP H0160949 B2 JPH0160949 B2 JP H0160949B2
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JP
Japan
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lead
package
ground
internal
semiconductor
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JP22264383A
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English (en)
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JPS60113451A (ja
Inventor
Takashi Kondo
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
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    • H01—ELECTRIC ELEMENTS
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    • H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495—Lead-frames or other flat leads
    • H01L23/49541—Geometry of the lead-frame
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Description

【発明の詳細な説明】 〔発明の技術分野〕 この発明は、半導体素子を収納する気密型パツ
ケージに関するものである。
〔従来技術〕
従来、この種のパツケージとして第１図ａ，ｂ
に示すものがあつた。これらの図において、１は
パツケージ基体で、通常、セラミツクやプリント
基板からなり、その主表面に内部リード２と、シ
ールエリア３と、ダイエリア４とからなり、それ
ぞれ印刷や蒸着等のプロセスにより導体が、絶縁
体からなるパツケージ基体１上に付与パターニン
グされる。また、パツケージ基体１の他の面には
このパツケージ基体１を貫通して、第１図ｂに示
すように導体のスルーホール５と接続された外部
リード６が設けられている。
なお、通常は内部リード２の内１つ以上がグラ
ンド端子７として用いられ、ダイエリア４（ある
いはシールエリア３）と連結されている。
このような従来のパツケージでは、通常、相互
に近接して設けられている信号授受用の内部リー
ド２間の干渉によるノイズのため、収納された半
導体素子が誤動作することがあつた。
〔発明の概要〕
この発明は、上記のような従来のものの欠点を
除去するためになされたもので、内部リードを取
り囲むようにグランドリードを設けた半導体パツ
ケージを提供することを目的としている。
〔発明の実施例〕
以下、この発明の一実施例を第２図について説
明する。
第２図において、８はグランドリードで、それ
ぞれ内部リード２を取り囲み、少なくともその一
部が、グランド端子７、ダイエリア４、またはシ
ールエリア３のいずれかに連結されている（第２
図は全部に連結されている場合を示す）。
なお、第２図の実施例では全ての内部リード２
をグランドリード８で囲つているが、これはもち
ろん必要な内部リード２だけを囲うようにしても
よい。
〔発明の効果〕
以上説明したように、この発明は、所要個所の
内部リードを個々にそれぞれの全周をグランドリ
ードで取り囲み少なくともその一部をグランド端
子またはダイエリアまたはシールエリアと接続し
た構成としたので、従来と全く同じプロセスで半
導体パツケージが製造でき、したがつて、特別な
装置を必要とせずに他の内部リードの干渉による
ノイズの侵入を防止できる、しかもパツケージの
蓋を金属とすれば、これと電気的に接続されたグ
ランドによつて信号線は全面的にシールすること
ができ、性能のよい半導体パツケージの提供が可
能である。
【図面の簡単な説明】
第１図ａ，ｂは従来の半導体パツケージの平面
図および側面図、第２図はこの発明の一実施例を
示す平面図である。 図中、１はパツケージ基体、２は内部リード、
３はシールエリア、４はダイエリア、５はスルー
ホール、６は外部リード、７はグランド端子、８
はグランドリードである。なお、図中の同一符号
は同一または相当部分を示す。

Claims (1)

    【特許請求の範囲】
  1. １ 半導体素子を収容固着するダイエリアと、前
    記半導体素子とパツケージとを電気的に接続する
    ための複数の内部リードと、封止のためのシール
    エリアとを同一平面上に形成した絶縁体からなる
    パツケージ基体と、このパツケージ基体に形成さ
    れたスルーホールを貫通して外部リードと前記内
    部リードとが接続されこの内部リードのうち所要
    のものをグランド端子とした構造の半導体パツケ
    ージにおい手、前記複数の内部リードの所要のも
    のを個々にそれぞれの全周をグランドリードで取
    り囲み、かつ、このグランドリードを少なくとも
    前記グランド端子、またはダイエリア、またはシ
    ールエリアと接続したことを特徴とする半導体パ
    ツケージ。
JP22264383A 1983-11-24 1983-11-24 半導体パツケ−ジ Granted JPS60113451A (ja)

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JPS60113451A JPS60113451A (ja) 1985-06-19
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JP7172617B2 (ja) * 2019-01-11 2022-11-16 株式会社デンソー 電子装置およびその製造方法

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