JPH0154792B2 - - Google Patents
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- Publication number
- JPH0154792B2 JPH0154792B2 JP55107937A JP10793780A JPH0154792B2 JP H0154792 B2 JPH0154792 B2 JP H0154792B2 JP 55107937 A JP55107937 A JP 55107937A JP 10793780 A JP10793780 A JP 10793780A JP H0154792 B2 JPH0154792 B2 JP H0154792B2
- Authority
- JP
- Japan
- Prior art keywords
- data
- error
- circuit
- register
- error detection
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B27/00—Editing; Indexing; Addressing; Timing or synchronising; Monitoring; Measuring tape travel
- G11B27/02—Editing, e.g. varying the order of information signals recorded on, or reproduced from, record carriers
- G11B27/031—Electronic editing of digitised analogue information signals, e.g. audio or video signals
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/18—Error detection or correction; Testing, e.g. of drop-outs
- G11B20/1806—Pulse code modulation systems for audio signals
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/18—Error detection or correction; Testing, e.g. of drop-outs
- G11B20/1876—Interpolating methods
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
- Error Detection And Correction (AREA)
- Transmission Systems Not Characterized By The Medium Used For Transmission (AREA)
- Noise Elimination (AREA)
Description
本発明は符号化信号の処理装置に関し、特に
VTR等を媒介とするPCM記録再生装置に用いて
最適なものである。 音声信号を符号化（PCM）してVTR等で記中
録再生を行うようにした装置では、一般に、記録
媒体からの信号再生時の読み取り不良に対して誤
り訂正符号または誤り検出符号などを組み合わせ
て聴感上問題の起きないような処理を行つてい
る。ところが再生信号にドロツプアウトが非常に
多い場合、誤り訂正、誤り検出信号等による処理
が不完全になり、クリツクノイズが発生する。ま
た手切り編集等を行うと、テープのつなぎ目でデ
ータが不連続になり、クリツクノイズが発生す
る。特に読み取り不良率を低減させるために遅延
形のインターリーブ（データ織り込み）を行つて
いる場合、手切り編集を行うと、インターリーブ
が崩れ、データの再現ができなくなり、テープの
つなぎ目の両側にわたつて長く異音が発生する。
また変速再生のときにもインタターリーブが崩れ
て異音が発生することもある。 本発明は上述の問題点にかんがみてなされたも
のであつて、編集、特殊再生等を行つてたときに
クリツク音等が極力発生されないようにすること
を目的としている。 本発明の符号化信号の処理装置は、誤り検出及
び訂正処理された符号化信号を複数ワード分蓄え
る記憶回路と、この記憶回路に蓄えられたデータ
のうちの少なくとも１ワードの誤りを線形予測法
により検出する誤り検出回路と、予め定めた誤り
発生の確率に応じて誤りデータの前後の数ワード
の区間で誤り信号を誤り検出出力に基いて発生さ
せる誤り信号発生回路と、この誤り信号によつて
動作されるデータ補間回路とを夫々具備する。 第１図の実施例において、記憶回路は、３ワー
ド分の直列レジスタ１，２，３から成る。誤り検
出回路２０は、加算器４、1/2割算器５、加算器
６、反転器７、コンパレータ８及び絶対値回路１
４で構成され、レジスタ１，３内のワードW1，
W3の平均値とレジスタ２のワードW2との差が一
定値より大きくなると誤り信号を発生する。 誤り信号発生回路２１は、３ビツト直列のレジ
スタ９及びその並列出力を入力とするオアゲート
１０から成り、誤り検出信号の数ワード後まで誤
り信号を継続発生する。 この誤り信号に基いて補間回路１１において、
平均値補間、前値データ補間等を行うと、補間処
理に冗長度が与えられ、線形予測方式の誤り検出
回路の検出能力の限界を補足した補間が行われ、
ほぼ完全なデータ補正ができるようになる。 以下本発明の実施例を図面を参照して説明す
る。第１図本発明の一つの実施例を示す再生符号
化信号の処理回路のブロツク図である。音声
PCM信号として読み出されて誤り検出及び訂正
の処理がなされたデータは夫々１ワード分のレジ
スタ１，２，３に順次蓄えられる。なお１ワード
はＬチヤンネル及びＲチヤンネルのPCMデータ
及び誤り訂正符号から成つている。レジスタ１及
び３の内容W1及びW3を加算器４に供給すること
により、W1＋W3が得られる。加算結果は1/2割
算器５に供給され、ここで（W1＋W3）／２の演
算が行われる。割算結果は加算器６に供給され、
レジスタの２の内容W2を反転器７で極性反転し
た信号―W2と加算される。 加算器６の出力はデータW1及びW3によつて予
測されるW2の予測と実際のデーータW2との差で
ある。加算器６の出力は絶対値回路１４に供給さ
れ、差の絶対値｜（W1＋W3）／２―W2｜が求め
られる。絶対値回路１４の出力はコンパレータ８
に供給され、ここで基準のレベル信号REFと比
較し、 ｜（W1A＋W3）／２―W2｜＜REF ……(1) のとき、誤りがないと判断する。逆の場合にはデ
ータW1〜W3のどれかが大きく飛び離れていると
してコンパレータ８の高レベルの出力をレジスタ
９に供給する。 上記加算器４、1/2割算器５、加算器６、反転
器７、コンパレータ８及び絶対値回路１４によ
り、誤り検出回路２０が構成され、また上記レジ
スタ９及びその並列オア出力を得るオアゲート１
０により、誤り信号発生回路２１が構成されてい
る。 レジスタ９は例えば３ビツトであり、そのシフ
トはワードごとに行われる。レジスタ９の各ビツ
ト出力b1，b2，b3はオアゲート１０を介して補間
回路１１に制御信号として供給される。従つて一
度誤りが検出されるとその後の２ワードも誤りと
みなしてレジスタ１の出力のデータの補間が行わ
れる。 第２図は第１図の処理回路の動作を説明するた
めの図表である。時点t1でレジスタ３に不良デー
タW3が入ると、線形予測回路４〜８によつて誤
りが発見され、レジスタ９のビツトb3に１が入
る。この場合２ワード前のデータW1を誤りと見
なしてデータW1を補間回路１で補間する。次に
時点t2で不良データタがW2に移ると共に良デー
タがW3に入つた状態ではやはりW1を誤りとみな
してこれを補間する。この状態では、第１式の線
形予測に基いて誤りデータを含むことが検出さ
れ、レジスタ９のb3に“１”が書込まれる。b2に
は前回の誤り検出結果の“１”がシフトされてい
る。同様に時点t3でも第１式に基いて誤りが発見
され、データW1が補間される。この状態ではレ
ジスタ９の内容は全て“１”になつている。 時点t4，t5ではレジスタ１〜３の内容が全て良
データとなるが、依然として誤りが続いていると
判断し、レジスタ９の内容が全て“０”になるま
で補間を行う。即ち、時点t3で誤りを発見したと
き、データW3が誤りであるとも見なせるので、
このデータがレジスタ１に達するまで補間を行
う。時点t6ではW1〜W3がすべて良データであ
り、またb1〜b3が全て“０”となつて補間は行わ
れない。 一般には、誤り訂正及び検出ビツトによる処理
の見逃しなどによる聴感上有害なデータが何ワー
ド続くかで検出用レジスタ１〜３の個数を設定す
る必要がある。例えばｘワード連続して誤つたデ
ータが発生する可能性のある場合には、全体の検
出に必要なデータ数ｎ、すなわち、検出用レジス
タ数を、 ｎ≧2x ……(2) にしないと、正しいデータより誤つたデータ数の
方が優勢になるので誤検出の可能性がある。例え
ば第１図では（W3，W2，W1）＝（××〇）とな
ると、不良データＸが優勢で、実質的には線形予
測の際に不良データに基いて良データが不良デー
タから離れていることを検出するようなことにな
る。このため、この線形予測は不良データと良デ
ータとの関係が逆であつて、良／不良を誤つて検
出する確率が高くなる。 従つてこの場合検出データ数は４以上にして良
データの方を数的に優勢にする必要がある。なお
１図の実施例では誤りデータの連続点数をｘ＝１
とし検出用データ数ｎ＝３にしている。 また検出データ数を増加させる代りに、第１図
のようにレジスタ９を設けて、一度誤りを発見し
たとき、その後も不良データが続いているとみな
して、誤り検出の如何にかかわらず補間を続行さ
せるような方式を採用することができる。 なお第１図の点線で示すようにオアゲート１０
の出力が“１”になつたとき、インバータ１２で
これを反転した信号で、コンパレータ８とレジス
タ９との間のアンドゲート１３を閉じて、コンパ
レータ８の出力がレジスタ９に供給されるのを禁
止してもよい。またインバータ１２の出力で予測
回路４〜８の動作を禁止してもよい。 なお誤りデータの連続する個数はデータのイン
ターリーブのかけ方から予測することができる。
例えば３ワードから成る１ブロツク（１水平区
間）のデータL3o，L3o+1，L3o+2に対し、 Ho Hv L3o →L3o L3o+1→（２ブロツク遅延）→L3(o-2)+1 L3o+2→（４ブロツク遅延）→L3(o-4)+2 のようなインターリーブ操作を行うと、 ……H0H1H2H3…… L0L3L6L9 L+2L1L4 L-7L-4Ｌ のようなデータＡが形成される。これに対してテ
ープの手切り編集などにより別のデータＢが付加
されると、
VTR等を媒介とするPCM記録再生装置に用いて
最適なものである。 音声信号を符号化（PCM）してVTR等で記中
録再生を行うようにした装置では、一般に、記録
媒体からの信号再生時の読み取り不良に対して誤
り訂正符号または誤り検出符号などを組み合わせ
て聴感上問題の起きないような処理を行つてい
る。ところが再生信号にドロツプアウトが非常に
多い場合、誤り訂正、誤り検出信号等による処理
が不完全になり、クリツクノイズが発生する。ま
た手切り編集等を行うと、テープのつなぎ目でデ
ータが不連続になり、クリツクノイズが発生す
る。特に読み取り不良率を低減させるために遅延
形のインターリーブ（データ織り込み）を行つて
いる場合、手切り編集を行うと、インターリーブ
が崩れ、データの再現ができなくなり、テープの
つなぎ目の両側にわたつて長く異音が発生する。
また変速再生のときにもインタターリーブが崩れ
て異音が発生することもある。 本発明は上述の問題点にかんがみてなされたも
のであつて、編集、特殊再生等を行つてたときに
クリツク音等が極力発生されないようにすること
を目的としている。 本発明の符号化信号の処理装置は、誤り検出及
び訂正処理された符号化信号を複数ワード分蓄え
る記憶回路と、この記憶回路に蓄えられたデータ
のうちの少なくとも１ワードの誤りを線形予測法
により検出する誤り検出回路と、予め定めた誤り
発生の確率に応じて誤りデータの前後の数ワード
の区間で誤り信号を誤り検出出力に基いて発生さ
せる誤り信号発生回路と、この誤り信号によつて
動作されるデータ補間回路とを夫々具備する。 第１図の実施例において、記憶回路は、３ワー
ド分の直列レジスタ１，２，３から成る。誤り検
出回路２０は、加算器４、1/2割算器５、加算器
６、反転器７、コンパレータ８及び絶対値回路１
４で構成され、レジスタ１，３内のワードW1，
W3の平均値とレジスタ２のワードW2との差が一
定値より大きくなると誤り信号を発生する。 誤り信号発生回路２１は、３ビツト直列のレジ
スタ９及びその並列出力を入力とするオアゲート
１０から成り、誤り検出信号の数ワード後まで誤
り信号を継続発生する。 この誤り信号に基いて補間回路１１において、
平均値補間、前値データ補間等を行うと、補間処
理に冗長度が与えられ、線形予測方式の誤り検出
回路の検出能力の限界を補足した補間が行われ、
ほぼ完全なデータ補正ができるようになる。 以下本発明の実施例を図面を参照して説明す
る。第１図本発明の一つの実施例を示す再生符号
化信号の処理回路のブロツク図である。音声
PCM信号として読み出されて誤り検出及び訂正
の処理がなされたデータは夫々１ワード分のレジ
スタ１，２，３に順次蓄えられる。なお１ワード
はＬチヤンネル及びＲチヤンネルのPCMデータ
及び誤り訂正符号から成つている。レジスタ１及
び３の内容W1及びW3を加算器４に供給すること
により、W1＋W3が得られる。加算結果は1/2割
算器５に供給され、ここで（W1＋W3）／２の演
算が行われる。割算結果は加算器６に供給され、
レジスタの２の内容W2を反転器７で極性反転し
た信号―W2と加算される。 加算器６の出力はデータW1及びW3によつて予
測されるW2の予測と実際のデーータW2との差で
ある。加算器６の出力は絶対値回路１４に供給さ
れ、差の絶対値｜（W1＋W3）／２―W2｜が求め
られる。絶対値回路１４の出力はコンパレータ８
に供給され、ここで基準のレベル信号REFと比
較し、 ｜（W1A＋W3）／２―W2｜＜REF ……(1) のとき、誤りがないと判断する。逆の場合にはデ
ータW1〜W3のどれかが大きく飛び離れていると
してコンパレータ８の高レベルの出力をレジスタ
９に供給する。 上記加算器４、1/2割算器５、加算器６、反転
器７、コンパレータ８及び絶対値回路１４によ
り、誤り検出回路２０が構成され、また上記レジ
スタ９及びその並列オア出力を得るオアゲート１
０により、誤り信号発生回路２１が構成されてい
る。 レジスタ９は例えば３ビツトであり、そのシフ
トはワードごとに行われる。レジスタ９の各ビツ
ト出力b1，b2，b3はオアゲート１０を介して補間
回路１１に制御信号として供給される。従つて一
度誤りが検出されるとその後の２ワードも誤りと
みなしてレジスタ１の出力のデータの補間が行わ
れる。 第２図は第１図の処理回路の動作を説明するた
めの図表である。時点t1でレジスタ３に不良デー
タW3が入ると、線形予測回路４〜８によつて誤
りが発見され、レジスタ９のビツトb3に１が入
る。この場合２ワード前のデータW1を誤りと見
なしてデータW1を補間回路１で補間する。次に
時点t2で不良データタがW2に移ると共に良デー
タがW3に入つた状態ではやはりW1を誤りとみな
してこれを補間する。この状態では、第１式の線
形予測に基いて誤りデータを含むことが検出さ
れ、レジスタ９のb3に“１”が書込まれる。b2に
は前回の誤り検出結果の“１”がシフトされてい
る。同様に時点t3でも第１式に基いて誤りが発見
され、データW1が補間される。この状態ではレ
ジスタ９の内容は全て“１”になつている。 時点t4，t5ではレジスタ１〜３の内容が全て良
データとなるが、依然として誤りが続いていると
判断し、レジスタ９の内容が全て“０”になるま
で補間を行う。即ち、時点t3で誤りを発見したと
き、データW3が誤りであるとも見なせるので、
このデータがレジスタ１に達するまで補間を行
う。時点t6ではW1〜W3がすべて良データであ
り、またb1〜b3が全て“０”となつて補間は行わ
れない。 一般には、誤り訂正及び検出ビツトによる処理
の見逃しなどによる聴感上有害なデータが何ワー
ド続くかで検出用レジスタ１〜３の個数を設定す
る必要がある。例えばｘワード連続して誤つたデ
ータが発生する可能性のある場合には、全体の検
出に必要なデータ数ｎ、すなわち、検出用レジス
タ数を、 ｎ≧2x ……(2) にしないと、正しいデータより誤つたデータ数の
方が優勢になるので誤検出の可能性がある。例え
ば第１図では（W3，W2，W1）＝（××〇）とな
ると、不良データＸが優勢で、実質的には線形予
測の際に不良データに基いて良データが不良デー
タから離れていることを検出するようなことにな
る。このため、この線形予測は不良データと良デ
ータとの関係が逆であつて、良／不良を誤つて検
出する確率が高くなる。 従つてこの場合検出データ数は４以上にして良
データの方を数的に優勢にする必要がある。なお
１図の実施例では誤りデータの連続点数をｘ＝１
とし検出用データ数ｎ＝３にしている。 また検出データ数を増加させる代りに、第１図
のようにレジスタ９を設けて、一度誤りを発見し
たとき、その後も不良データが続いているとみな
して、誤り検出の如何にかかわらず補間を続行さ
せるような方式を採用することができる。 なお第１図の点線で示すようにオアゲート１０
の出力が“１”になつたとき、インバータ１２で
これを反転した信号で、コンパレータ８とレジス
タ９との間のアンドゲート１３を閉じて、コンパ
レータ８の出力がレジスタ９に供給されるのを禁
止してもよい。またインバータ１２の出力で予測
回路４〜８の動作を禁止してもよい。 なお誤りデータの連続する個数はデータのイン
ターリーブのかけ方から予測することができる。
例えば３ワードから成る１ブロツク（１水平区
間）のデータL3o，L3o+1，L3o+2に対し、 Ho Hv L3o →L3o L3o+1→（２ブロツク遅延）→L3(o-2)+1 L3o+2→（４ブロツク遅延）→L3(o-4)+2 のようなインターリーブ操作を行うと、 ……H0H1H2H3…… L0L3L6L9 L+2L1L4 L-7L-4Ｌ のようなデータＡが形成される。これに対してテ
ープの手切り編集などにより別のデータＢが付加
されると、
【表】
のようになる。
このインターリーブデータを復元（デインター
リーブ）すると、 L0L1L8L3L4L11L6L13L14L9L16 × × ×× × のようにテープの手切り編集で完全なデータ復元
ができくなり、××のように誤りデータが２回連
続することもある。一般にインターリーブのかけ
方は更に複雑であつて、誤りデータの連続回数は
更に増加する。このようにインターリーブのかけ
方から第２式のデータ数ｎを確率的に求めること
ができる。 本発明は上述の如く、複数ワードの符号化デー
タ中から線形予測法によつて誤りデータを検出
し、予め定めた誤り発生の確率に応じてこの誤り
データの前後の数ワード区間において、データの
補間が行われるようにした符号化信号の処理装置
である。従つて各データに付加した誤り訂正また
は誤り検出ビツトによる信号処理の見逃しがあつ
ても、異常データを検出してこれを補間すること
ができる。また線形予測法によりサンプルの期待
値を算出して不良データを検出するため、より高
度な誤差の少ない信号処理が可能であり、音声
PCM信号に適用した場合、ドロツプアウトの多
い信号、テープの手切り編集を行つたためにイン
ターリーブが崩れた信号に対しても完全な補正を
行うことができ、再生音にクリツク等が発生しな
い。 また線形予測法による誤り検出回路が有してい
る不良データ位置の不特定性に起因する補間能力
の制限を、冗長性のある誤り信号発生回路で補足
しているので、高精度の誤り検出と相まつて高性
能のデータ補正処理を行うことが可能となる。
リーブ）すると、 L0L1L8L3L4L11L6L13L14L9L16 × × ×× × のようにテープの手切り編集で完全なデータ復元
ができくなり、××のように誤りデータが２回連
続することもある。一般にインターリーブのかけ
方は更に複雑であつて、誤りデータの連続回数は
更に増加する。このようにインターリーブのかけ
方から第２式のデータ数ｎを確率的に求めること
ができる。 本発明は上述の如く、複数ワードの符号化デー
タ中から線形予測法によつて誤りデータを検出
し、予め定めた誤り発生の確率に応じてこの誤り
データの前後の数ワード区間において、データの
補間が行われるようにした符号化信号の処理装置
である。従つて各データに付加した誤り訂正また
は誤り検出ビツトによる信号処理の見逃しがあつ
ても、異常データを検出してこれを補間すること
ができる。また線形予測法によりサンプルの期待
値を算出して不良データを検出するため、より高
度な誤差の少ない信号処理が可能であり、音声
PCM信号に適用した場合、ドロツプアウトの多
い信号、テープの手切り編集を行つたためにイン
ターリーブが崩れた信号に対しても完全な補正を
行うことができ、再生音にクリツク等が発生しな
い。 また線形予測法による誤り検出回路が有してい
る不良データ位置の不特定性に起因する補間能力
の制限を、冗長性のある誤り信号発生回路で補足
しているので、高精度の誤り検出と相まつて高性
能のデータ補正処理を行うことが可能となる。
第１図は本発明の一実施例を示す再生符号化信
号の処理回路のブロツク図、第２図は第１図の動
作を説明するための図表である。 なお図面に用いられている符号において、１，
２，３，９……レジスタ、４，６……加算器、５
……1/2割算器、７……反転器、８……コンパレ
ータ、９……レジスタ、１０……オアゲート、１
１……補間回路、１４……絶対値回路、２０……
誤り検出回路、２１……誤り信号発生回路、であ
る。
号の処理回路のブロツク図、第２図は第１図の動
作を説明するための図表である。 なお図面に用いられている符号において、１，
２，３，９……レジスタ、４，６……加算器、５
……1/2割算器、７……反転器、８……コンパレ
ータ、９……レジスタ、１０……オアゲート、１
１……補間回路、１４……絶対値回路、２０……
誤り検出回路、２１……誤り信号発生回路、であ
る。
Claims (1)
- １ 誤り検出及び訂正処理された符号化信号を複
数ワード分蓄える記憶回路と、この記憶回路に蓄
えられたデータのうちの少なくとも１ワードの誤
りを線形予測法により検出する誤り検出回路と、
予め定めた誤り発生の確率に応じて誤りデータの
前後の数ワードの区間で誤り信号を誤り検出出力
に基いて発生させる誤り信号発生回路と、この誤
り信号によつて動作されるデータ補間回路とを
夫々具備する符号化信号の処理装置。
Priority Applications (9)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10793780A JPS5732135A (en) | 1980-08-06 | 1980-08-06 | Processor for coded signal |
| AU73493/81A AU547000B2 (en) | 1980-08-06 | 1981-07-28 | Pcm signal processor |
| US06/289,970 US4451921A (en) | 1980-08-06 | 1981-08-04 | PCM Signal processing circuit |
| GB8123836A GB2082026B (en) | 1980-08-06 | 1981-08-04 | Pcm signal processing circuits |
| NL8103693A NL8103693A (nl) | 1980-08-06 | 1981-08-05 | Pulscode gemoduleerd signaalverwerkingsschakeling. |
| DE19813131062 DE3131062A1 (de) | 1980-08-06 | 1981-08-05 | Pcm-signalverarbeitungsschaltung |
| CA000383244A CA1174365A (en) | 1980-08-06 | 1981-08-05 | Pcm signal processing circuit |
| FR8115302A FR2488464B1 (fr) | 1980-08-06 | 1981-08-06 | Circuit de traitement de signaux pcm |
| AT0347481A AT376055B (de) | 1980-08-06 | 1981-08-06 | Pcm-signalaufbereitungsstufe, insbesondere fuer ein ton-pcm aufzeichen/wiedergabegeraet |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10793780A JPS5732135A (en) | 1980-08-06 | 1980-08-06 | Processor for coded signal |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5732135A JPS5732135A (en) | 1982-02-20 |
| JPH0154792B2 true JPH0154792B2 (ja) | 1989-11-21 |
Family
ID=14471823
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10793780A Granted JPS5732135A (en) | 1980-08-06 | 1980-08-06 | Processor for coded signal |
Country Status (9)
| Country | Link |
|---|---|
| US (1) | US4451921A (ja) |
| JP (1) | JPS5732135A (ja) |
| AT (1) | AT376055B (ja) |
| AU (1) | AU547000B2 (ja) |
| CA (1) | CA1174365A (ja) |
| DE (1) | DE3131062A1 (ja) |
| FR (1) | FR2488464B1 (ja) |
| GB (1) | GB2082026B (ja) |
| NL (1) | NL8103693A (ja) |
Families Citing this family (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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