JPH0142822Y2 - - Google Patents
Info
- Publication number
- JPH0142822Y2 JPH0142822Y2 JP17041482U JP17041482U JPH0142822Y2 JP H0142822 Y2 JPH0142822 Y2 JP H0142822Y2 JP 17041482 U JP17041482 U JP 17041482U JP 17041482 U JP17041482 U JP 17041482U JP H0142822 Y2 JPH0142822 Y2 JP H0142822Y2
- Authority
- JP
- Japan
- Prior art keywords
- tape
- deck
- dubbing
- speed
- double
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 238000001514 detection method Methods 0.000 claims description 10
- 238000010586 diagram Methods 0.000 description 2
Description
【考案の詳細な説明】
本考案は、一つのテープレコーダ内に二つのテ
ープデツキが組込まれ、一方のテープデツキで再
生された信号を、他方のテープデツキで録音する
ことのできるダブルデツキテープレコーダに関す
るものである。
ープデツキが組込まれ、一方のテープデツキで再
生された信号を、他方のテープデツキで録音する
ことのできるダブルデツキテープレコーダに関す
るものである。
この種のダブルデツキテープレコーダを用い
て、ダビングする際、テープ走行速度が通常の録
音・再生定速走行であると、ダビングに要する時
間が長くかかり過ぎて不便である。
て、ダビングする際、テープ走行速度が通常の録
音・再生定速走行であると、ダビングに要する時
間が長くかかり過ぎて不便である。
そこで、テープスピード切換スイツチを設け
て、上記定速走行の２倍、３倍のスピードで再生
し、録音する高速ダビングが可能なシステムが提
案されている。
て、上記定速走行の２倍、３倍のスピードで再生
し、録音する高速ダビングが可能なシステムが提
案されている。
しかしながら、たのような従来の高速ダビング
が可能なテープレコーダでは、操作がマニユアル
であるため、操作者が誤つて定速ダビング中に高
速ダビングに切換えた場合、両テープデツキの立
上り特性が異なるため、録音側テープでの録音特
性が変化し、音質を損ねるという問題があつた。
が可能なテープレコーダでは、操作がマニユアル
であるため、操作者が誤つて定速ダビング中に高
速ダビングに切換えた場合、両テープデツキの立
上り特性が異なるため、録音側テープでの録音特
性が変化し、音質を損ねるという問題があつた。
本考案の目的は、上記従来の技術の問題点を克
服し、ダビング中にテープスピードを切換えた場
合、自動的にそれに対応して、録音側テープの音
質変化を防止することのできるダブルデツキテー
プレコーダを提供することにある。
服し、ダビング中にテープスピードを切換えた場
合、自動的にそれに対応して、録音側テープの音
質変化を防止することのできるダブルデツキテー
プレコーダを提供することにある。
以下、図によつて本考案を具体的に説明する。
第１図は、本考案の一実施例よりなるダブルデ
ツキテープレコーダの要部ブロツク図である。
ツキテープレコーダの要部ブロツク図である。
同図において、１はテープスピード切換検出回
路、２は第１のデツキであるＡデツキ７制御用マ
イコン、３は第２のデツキであるＢデツキ８制御
用マイコン、４は曲頭一致検出回路、５および６
はそれぞれ制御信号であり、Ａデツキ７及びＢデ
ツキ８はそれぞれ制御信号５，６によつて動作す
る。
路、２は第１のデツキであるＡデツキ７制御用マ
イコン、３は第２のデツキであるＢデツキ８制御
用マイコン、４は曲頭一致検出回路、５および６
はそれぞれ制御信号であり、Ａデツキ７及びＢデ
ツキ８はそれぞれ制御信号５，６によつて動作す
る。
次に、本考案のダブルデツキテープレコーダの
動作について説明する。
動作について説明する。
テープダビング中にテープスピード切換スイツ
チを高速ダビング側に切り換えると、テープスピ
ード切換検出回路１からの信号がＡデツキ制御用
マイコン２およびＢデツキ制御用マイコン３に入
る。
チを高速ダビング側に切り換えると、テープスピ
ード切換検出回路１からの信号がＡデツキ制御用
マイコン２およびＢデツキ制御用マイコン３に入
る。
このテープスピード切換検出回路１の信号は、
ダビングスイツチがON、Ａデツキ７がRECモー
ド、およびＢデツキ８がPLAYモードの場合の
み、出力されるように設定されている。
ダビングスイツチがON、Ａデツキ７がRECモー
ド、およびＢデツキ８がPLAYモードの場合の
み、出力されるように設定されている。
上記信号がそれぞれＢデツキ制御用マイコン２
およびＢデツキ制御用マイコン３に入力される
と、制御信号５，６によりＡデツキ７およびＢデ
ツキ８はREWモードになり、ダビング中の曲の
曲頭を検知して、STOPする（第２図参照）。
およびＢデツキ制御用マイコン３に入力される
と、制御信号５，６によりＡデツキ７およびＢデ
ツキ８はREWモードになり、ダビング中の曲の
曲頭を検知して、STOPする（第２図参照）。
曲頭を検知すると、第２図に示すように、曲頭
検知出力が“Ｈ”レベルになる。Ａデツキ制御用
マイコン２およびＢデツキ制御用マイコン３の出
力がかともに“Ｈ”レベルになると、曲頭一致検
出回路４からの信号がそれぞれ２′，３′に入力さ
れ、Ａデツキ７はREWモード、Ｂデツキ８は
PLAYモードとなつて、ダビングが再開される。
検知出力が“Ｈ”レベルになる。Ａデツキ制御用
マイコン２およびＢデツキ制御用マイコン３の出
力がかともに“Ｈ”レベルになると、曲頭一致検
出回路４からの信号がそれぞれ２′，３′に入力さ
れ、Ａデツキ７はREWモード、Ｂデツキ８は
PLAYモードとなつて、ダビングが再開される。
以上説明したように、本考案のダブルデツキテ
ープレコーダによれば、ダビング中にテープスピ
ードを切り換えた場合でも、再生側テープ、録音
側テープともに自動的に現在の曲の頭まで巻き戻
した後に、同期してダビングを再開させるように
することができるため、曲の途中での音質の変化
を防止することができる。
ープレコーダによれば、ダビング中にテープスピ
ードを切り換えた場合でも、再生側テープ、録音
側テープともに自動的に現在の曲の頭まで巻き戻
した後に、同期してダビングを再開させるように
することができるため、曲の途中での音質の変化
を防止することができる。
しかも、以上の操作は自動で行なわれるため、
従来のテープレコーダのようなマニユアル操作の
手間が省ける。
従来のテープレコーダのようなマニユアル操作の
手間が省ける。
第１図は本考案の一実施例よりなるダブルデツ
キテープレコーダの要部ブロツク図、および第２
図は本考案のダブルデツキテープレコーダの動作
を説明するためのタイミング・チヤートである。 １……テープスピード切換検出回路、２……Ａ
デツキ制御用マイコン、３……Ｂデツキ制御用マ
イコン、４……曲頭一致検出回路。
キテープレコーダの要部ブロツク図、および第２
図は本考案のダブルデツキテープレコーダの動作
を説明するためのタイミング・チヤートである。 １……テープスピード切換検出回路、２……Ａ
デツキ制御用マイコン、３……Ｂデツキ制御用マ
イコン、４……曲頭一致検出回路。
Claims (1)
- テープスピード切換スイツチを有するダブルデ
ツキテープレコーダにおいて、テープスピード切
換検出手段、二つのデツキの各制御手段および曲
頭一致検出手段を設け、テープダビング中にテー
プスピードを切換えた時、再生側テープを現在再
生されている曲の頭まで戻し、録音側テープを現
在録音されている曲のブランク部分まで戻し、こ
れら両テープを同期させながらダビングを再開す
るように構成したことを特徴とするダブルデツキ
テープレコーダ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17041482U JPS5974524U (ja) | 1982-11-12 | 1982-11-12 | ダブルデツキテ−プレコ−ダ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17041482U JPS5974524U (ja) | 1982-11-12 | 1982-11-12 | ダブルデツキテ−プレコ−ダ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5974524U JPS5974524U (ja) | 1984-05-21 |
| JPH0142822Y2 true JPH0142822Y2 (ja) | 1989-12-13 |
Family
ID=30372032
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17041482U Granted JPS5974524U (ja) | 1982-11-12 | 1982-11-12 | ダブルデツキテ−プレコ−ダ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5974524U (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6137123U (ja) * | 1984-08-11 | 1986-03-07 | オンキヨー株式会社 | テ−プレコ−ダ |
-
1982
- 1982-11-12 JP JP17041482U patent/JPS5974524U/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5974524U (ja) | 1984-05-21 |
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