JPH01315864A - 情報処理システムのデータ制御回路 - Google Patents
情報処理システムのデータ制御回路Info
- Publication number
- JPH01315864A JPH01315864A JP63148814A JP14881488A JPH01315864A JP H01315864 A JPH01315864 A JP H01315864A JP 63148814 A JP63148814 A JP 63148814A JP 14881488 A JP14881488 A JP 14881488A JP H01315864 A JPH01315864 A JP H01315864A
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- 230000010365 information processing Effects 0.000 title claims description 14
- 238000001514 detection method Methods 0.000 claims description 23
- 238000010586 diagram Methods 0.000 description 3
- 238000000034 method Methods 0.000 description 3
Landscapes
- Multi Processors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は情報処理システムのデータ制御回路に関し、特
にマスタ装置とスレーブ装置が遠隔地にある場合のスレ
ーブ装置からの処理要求信号検出時における情報処理シ
ステムのデータ制御回路に関する。
にマスタ装置とスレーブ装置が遠隔地にある場合のスレ
ーブ装置からの処理要求信号検出時における情報処理シ
ステムのデータ制御回路に関する。
従来、この種の情報処理システムは、スレーブ装置から
の処理要求信号を検出した際、各スレーブ装置のステー
タス情報を読み出し、処理要求信号を送出したスレーブ
装置を検出する方式となっていた。
の処理要求信号を検出した際、各スレーブ装置のステー
タス情報を読み出し、処理要求信号を送出したスレーブ
装置を検出する方式となっていた。
第３図は、従来のこの種のデータ処理装置の処理要求検
出シーケンスを示す図であり、１台のマスタ装置１と複
数のスレーブ装置２１〜２ｎにより構成されている場合
を示す。スレーブ装置２ｎから処理要求信号を受信した
マスタ装置１は、スレーブ装置２１から順に全てのスレ
ーブ装置に対してステータス情報を読み出し、どのスレ
ーブ装置からの処理要求信号かを検出する。
出シーケンスを示す図であり、１台のマスタ装置１と複
数のスレーブ装置２１〜２ｎにより構成されている場合
を示す。スレーブ装置２ｎから処理要求信号を受信した
マスタ装置１は、スレーブ装置２１から順に全てのスレ
ーブ装置に対してステータス情報を読み出し、どのスレ
ーブ装置からの処理要求信号かを検出する。
上述した従来の情報処理システムはスレーブ装置からの
処理要求信号検出に対して各スレーブ装置のステータス
情報を読み出し、処理要求信号を送出したスレーブ装置
を検出するため、処理要求信号検出処理が遅いという欠
点がある。
処理要求信号検出に対して各スレーブ装置のステータス
情報を読み出し、処理要求信号を送出したスレーブ装置
を検出するため、処理要求信号検出処理が遅いという欠
点がある。
本発明の情報処理システムのデータ制御回路の構成は、
１台のマスタ装置と複数台のスレーブ装置からなる情報
処理システムにおいて、前記スレーブ装置からのデータ
の入力及びそのデータの処理要求信号を検出し、どのス
レーブ装置からの処理要求信号かを判断してデータ選択
情報を出力する処理要求検出回路と、この処理要求検出
回路からのデータ選択情報を受け取り、前記処理要求信
号を送出したスレーブ装置だけに対しデータを送出する
データ選択回路とを含んで構成される事を特徴とする。
１台のマスタ装置と複数台のスレーブ装置からなる情報
処理システムにおいて、前記スレーブ装置からのデータ
の入力及びそのデータの処理要求信号を検出し、どのス
レーブ装置からの処理要求信号かを判断してデータ選択
情報を出力する処理要求検出回路と、この処理要求検出
回路からのデータ選択情報を受け取り、前記処理要求信
号を送出したスレーブ装置だけに対しデータを送出する
データ選択回路とを含んで構成される事を特徴とする。
次に、本発明について図面を参照して説明する。
第１図は本発明の一実施例の情報処理システムのデータ
制御回路を示すブロック図であり、１台のマスタ装置１
と、複数台のスレーブ装置２１〜２ｎと、処理要求検出
回路３と、データ選択２回路４により構成される。
制御回路を示すブロック図であり、１台のマスタ装置１
と、複数台のスレーブ装置２１〜２ｎと、処理要求検出
回路３と、データ選択２回路４により構成される。
処理要求検出回路３には、各スレーブ装置２１〜２ｎか
らの処理要求信号及びデータが入力されてマスタ装置１
に送出される。また、データ選択回路４は、処理要求検
出回路３により出力されたデータ選択情報５により各ス
レーブ装置２１〜２ｎにマスタ装置１からのデータを出
力する。処理要求検出回路３は、スレーブ装置２１〜２
ｎからの処理要求検出時に処理要求信号７をマスタ装置
１に送出するとともに、どのスレーブ装置からの処理要
求信号かを判断してデータ選択情報５をデータ選択回路
４へ送出する。
らの処理要求信号及びデータが入力されてマスタ装置１
に送出される。また、データ選択回路４は、処理要求検
出回路３により出力されたデータ選択情報５により各ス
レーブ装置２１〜２ｎにマスタ装置１からのデータを出
力する。処理要求検出回路３は、スレーブ装置２１〜２
ｎからの処理要求検出時に処理要求信号７をマスタ装置
１に送出するとともに、どのスレーブ装置からの処理要
求信号かを判断してデータ選択情報５をデータ選択回路
４へ送出する。
処理要求検出回路３から処理要求信号を受け取ったマス
タ装置１は、データ選択回路４に対してデータを送出す
る。マスタ装置１からデータを受信したデータ選択回路
４は、処理要求検出回路３から出力されたデータ選択情
報５を基に、処理要求信号を送出したスレーブ装置を選
択し、処理要求信号を送出したスレーブ装置１に対して
マスタ装置１からのデータ６を送出してステータスの読
み出しを行なう。
タ装置１は、データ選択回路４に対してデータを送出す
る。マスタ装置１からデータを受信したデータ選択回路
４は、処理要求検出回路３から出力されたデータ選択情
報５を基に、処理要求信号を送出したスレーブ装置を選
択し、処理要求信号を送出したスレーブ装置１に対して
マスタ装置１からのデータ６を送出してステータスの読
み出しを行なう。
マスタ装置１からのデータを受信したスレーブ装置は、
処理要求検出回路３にステータス情報を送出する。処理
要求検出回路３では、スレーブ装置からのステータス情
報をマスタ装置１に送出する。処理要求検出回路３から
ステータス情報を受信したマスタ装置１では、以後、処
理要求信号を送出したスレーブ装置との間でデータの送
受信を行なう。
処理要求検出回路３にステータス情報を送出する。処理
要求検出回路３では、スレーブ装置からのステータス情
報をマスタ装置１に送出する。処理要求検出回路３から
ステータス情報を受信したマスタ装置１では、以後、処
理要求信号を送出したスレーブ装置との間でデータの送
受信を行なう。
第２図は第１図を実施した場合の情報処理システムの処
理要求検出シーケンスである。
理要求検出シーケンスである。
スレーブ装置２ｎから処理要求信号を検出したマスタ装
置１は、スレーブ装置２ｎに対してステータスの読み出
しを行なう、スレーブ装置２ｎからステータス情報を受
信したマスタ装Ｗ１はスレーブ装置２ｎに対して応答を
返す。マスタ装置からの応答を受信したスレーブ装置２
ｎはマスタ装置１に対して応答を返して処理要求検出シ
ーケンスが終了する。
置１は、スレーブ装置２ｎに対してステータスの読み出
しを行なう、スレーブ装置２ｎからステータス情報を受
信したマスタ装Ｗ１はスレーブ装置２ｎに対して応答を
返す。マスタ装置からの応答を受信したスレーブ装置２
ｎはマスタ装置１に対して応答を返して処理要求検出シ
ーケンスが終了する。
以上説明したように本発明は、処理要求検出回路により
どのスレーブ装置からの処理要求信号かを検出すること
により、各スレーブ装置のステータス情報を読み出さず
にどのスレーブ装置からの処理要求信号かを検出できる
効果がある。
どのスレーブ装置からの処理要求信号かを検出すること
により、各スレーブ装置のステータス情報を読み出さず
にどのスレーブ装置からの処理要求信号かを検出できる
効果がある。
第１図は本発明の情報処理システムのデータ制御回路の
ブロック図、第２図は情報処理システムのデータ制御時
の処理要求検出シーケンス、第３図は従来の情報処理シ
ステムのデータ制御時の処理要求検出シーケンスである
。 １・・・マスタ装置、２・・・スレーブ装置、３・・・
処理要求検出回路、４・・・データ選択回路、５・・・
処理要求検出回路からのデータ選択情報、６・・・マス
タ装置からのデータ、７・・・マスタ装置への処理要求
信第 １ 図 第 ２ 羽
ブロック図、第２図は情報処理システムのデータ制御時
の処理要求検出シーケンス、第３図は従来の情報処理シ
ステムのデータ制御時の処理要求検出シーケンスである
。 １・・・マスタ装置、２・・・スレーブ装置、３・・・
処理要求検出回路、４・・・データ選択回路、５・・・
処理要求検出回路からのデータ選択情報、６・・・マス
タ装置からのデータ、７・・・マスタ装置への処理要求
信第 １ 図 第 ２ 羽
Claims (1)
- １台のマスタ装置と複数台のスレーブ装置からなる情報
処理システムにおいて、前記スレーブ装置からのデータ
の入力及びそのデータの処理要求信号を検出し、どのス
レーブ装置からの処理要求信号かを判断してデータ選択
情報を出力する処理要求検出回路と、この処理要求検出
回路からのデータ選択情報を受け取り、前記処理要求信
号を送出したスレーブ装置だけに対しデータを送出する
データ選択回路とを含んで構成される事を特徴とする情
報処理システムのデータ制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63148814A JPH01315864A (ja) | 1988-06-15 | 1988-06-15 | 情報処理システムのデータ制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63148814A JPH01315864A (ja) | 1988-06-15 | 1988-06-15 | 情報処理システムのデータ制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01315864A true JPH01315864A (ja) | 1989-12-20 |
Family
ID=15461312
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63148814A Pending JPH01315864A (ja) | 1988-06-15 | 1988-06-15 | 情報処理システムのデータ制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01315864A (ja) |
-
1988
- 1988-06-15 JP JP63148814A patent/JPH01315864A/ja active Pending
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