JPH0129448B2 - - Google Patents

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JPH0129448B2
JPH0129448B2 JP14283183A JP14283183A JPH0129448B2 JP H0129448 B2 JPH0129448 B2 JP H0129448B2 JP 14283183 A JP14283183 A JP 14283183A JP 14283183 A JP14283183 A JP 14283183A JP H0129448 B2 JPH0129448 B2 JP H0129448B2
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JP
Japan
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circuit
input terminal
input
matching
capacitor
Prior art date
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Expired
Application number
JP14283183A
Other languages
English (en)
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JPS6033743A (ja
Inventor
Hideki Oodo
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Corp
Original Assignee
Tokyo Shibaura Electric Co Ltd
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Filing date
Publication date
Application filed by Tokyo Shibaura Electric Co Ltd filed Critical Tokyo Shibaura Electric Co Ltd
Priority to JP14283183A priority Critical patent/JPS6033743A/ja
Publication of JPS6033743A publication Critical patent/JPS6033743A/ja
Publication of JPH0129448B2 publication Critical patent/JPH0129448B2/ja
Granted legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03HIMPEDANCE NETWORKS, e.g. RESONANT CIRCUITS; RESONATORS
    • H03H11/00Networks using active elements
    • H03H11/02Multiple-port networks
    • H03H11/28Impedance matching networks
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04BTRANSMISSION
    • H04B1/00Details of transmission systems, not covered by a single one of groups H04B3/00 - H04B13/00; Details of transmission systems not characterised by the medium used for transmission
    • H04B1/06Receivers
    • H04B1/16Circuits
    • H04B1/18Input circuits, e.g. for coupling to an antenna or a transmission line

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Input Circuits Of Receivers And Coupling Of Receivers And Audio Equipment (AREA)

Description

【発明の詳細な説明】 〔発明の技術分野〕 この発明は、例えば衛星放送用SHF受信シス
テムに利用されるものであつて屋外ユニツトと屋
内ユニツトとの間に設けられる入力整合回路に関
する。
〔発明の技術的背景〕
一般にSHF帯受信システム、例えば衛星放送
用SHF受信システムにおいては、衛星からの
SHF帯の放送信号(11.7〜12.2GHz)は、パラボ
ラアンテナで受信され、アンテナに付属の屋外ユ
ニツト(第1のコンバータ)でUHF帯の信号
(1〜1.5GHz)に変換される。このUHF帯の信号
は、一般家庭の屋内ユニツト(第2のコンバータ
を含む)でVHF帯の定められた周波数(例えば
130MHz)に変換される。続いて、このVHFの信
号は、FM復調回路に入力されベースバンド信号
またRF信号に変換され、一般のテレビジヨン受
像機にて受信可能な信号となる。
第1図は上記のシステムを概略的に示すもの
で、11はパラボラアンテナ、12は屋外ユニツ
ト、13は屋内ユニツトである。ここで、屋内ユ
ニツト13は、入力端子14、増幅回路15、可
変前段バンドパスフイルタ16、混合回路17、
局部発振器18、増幅回路19、後段バンドパス
フイルタ20、増幅回路21、出力端子22を第
2コンバータ部として有する。入力端子14に入
力したUHF帯の信号(1〜1.5GHz)は、混合回
路17においてVHF帯の信号に変換されること
になる。
ここで、端子23はコイル24を介して入力端
子14に接続されている。これは、屋内ユニツト
13側から屋外ユニツト12側に直流電源+Bを
供給する必要があるからである。
このようなシステムにおいて、屋内ユニツト1
3の入力部では、FM信号伝送を歪なく行うため
の良好なVSWRが要求される。
〔背景技術の問題点〕
一般に良好なVSWRを得るための手法として
は、フイルタ構成による整合回路を用いる方法、
アイソレータを用いる方法などがある。しかし、
前述した第2のコンバータ部のように、1〜
1.5GHzの広帯域を扱い、しかも入力端子に直流
電源を重畳させるような回路の入力整合には次の
ような問題がある。
たとえば、フイルタ構成による整合回路の場
合、周波数特性を考慮すると広帯域なために多段
構成になるとともに、入力部に短絡スタブを構成
できない。また減衰器を挿入する際も直流電圧が
重畳するため直流阻止コンデンサが余分に必要と
なる。次にアイソレータを用いるにしても、広帯
域用のものが必要となり民生用としては高価にな
りすぎるという問題がある。
〔発明の目的〕
この発明は上記の事情に対処すべくなされたも
ので、簡単な回路構成で広帯域にわたる入力整合
回路を提供することを目的とするものである。
〔発明の概要〕
この発明においては、入力インピーダンスに整
合した抵抗と直流阻止コンデンサを直列にし、こ
の直列回路と並列にコンデンサとコイルの直列回
路を接続するものである。
〔発明の実施例〕
以下この発明の実施例を図面を参照して説明す
る。
第2図はこの発明による入力整合回路であり、
第1図で説明した第2コンバータの前段に適用し
たものである。
第2図において入力端子14には、UHF帯の
信号(1〜1.5GHz)が入力される。入力端子1
4は、コイル32を介して屋外ユニツト電源用入
力端子31に接続されるとともに、整合抵抗3
3、整合用コンデンサ35の一方の端子に接続さ
れる本実施例の場合、入力インピーダンスが75Ω
であるので、抵抗33の値は75Ωに選定される。
整合抵抗33の他端は、直流阻止コンデンサ34
を介して、また整合コンデンサ35の他端はコイ
ル36を介してトランジスタ37のベースに接続
される。つまり、この整合部の後段には、トラン
ジスタ増幅回路が接続されている。
ここで、入力周波数は、1〜1.5GHzであるの
で、周波数特性設定回路を構成するコンデンサ3
5とコイル36の値は、上限周波数1.5GHzをf
として C35=1/2πfR …(1) L36=kR/2πf …(2) R;入力インピーダンス k;0.5〜0.7 なるコンデンサ35の値C35、コイル36の値L36
を用いれば良い。本実施例では、C35=1.5pF、
L36=4nHを採用している。
次に、後段には、トランジスタ増幅器が構成さ
れている。
38は電源供給端子であり、ここの電源は抵抗
39,40により分圧され、その分圧電圧は、コ
イル41を介してトランジスタ37のベースバイ
アスとなる。また、電源は、抵抗43、コイル4
4を介してトランジスタ37のコレクタにも供給
され駆動電源として作用する。トランジスタ37
のエミツタは、エミツタ抵抗46を介して接地さ
れる。そして、出力は、トランジスタ37のコレ
クタから結合コンデンサ48、出力整合用コンデ
ンサ50を介して出力端子49に導出される。な
おコンデンサ42,45,47は、交流パイパス
コンデンサである。
トランジスタ37のベースに接続されたコイル
41は、利得補正用であり、その条件としては、
(1)、(2)式と同じように L41=R/2πf …(3) で計算される値のインダクタンスを用いれば良
い。
上記のように構成された入力整合回路による
と、VSWRが非常に良好で、周波数に対して平
坦な特性の増幅回路を実現できた。第3図は、第
2図の回路の通過特性と反射特性を示している。
VSWRは反射損失Γ(dB)とすると、 であらわされ、第3図からVSWRは1.07〜1.22と
読みとれる。第3図のように反射損失の曲線Aは
広帯域にわたつて変化が少ない。
上記実施例において、コイル36は、コンデン
サ35のリードインダクタンスで代替される。ま
たパターンインダクタンスで代替することも可能
である。
〔発明の効果〕
以上説明したようにこの発明によると広帯域に
整合し、しかも少ない部品数で良好なVSWRが
得られ、かつ広帯域にわたつて利得が平坦な増幅
回路も容易に実現できる入力整合回路を提供でき
る。
【図面の簡単な説明】
第1図は衛星放送用SHF受信システムを示す
図、第2図はこの発明の一実施例を示す回路図、
第3図は本実施例における実測値を示すグラフで
ある。 14…入力端子、31…電源用入力端子、32
…コイル、33…整合抵抗、34…直流阻止コン
デンサ、35…整合用コンデンサ、36…コイ
ル、37…トランジスタ。

Claims (1)

  1. 【特許請求の範囲】 1 入力端子に出力信号を導入する外部回路に対
    して前記入力端子を介して直流電源を供給するた
    めに、前記入力端子にコイルを介して接続された
    電源入力端子と、 前記入力端子と増幅回路入力部間に直列に接続
    された整合抵抗及び直流阻止コンデンサと、 前記整合抵抗と直流阻止コンデンサの直列接続
    に対して並列に接続されたコンデンサとインダク
    タによる周波数特性設定回路とを具備したことを
    特徴とする入力整合回路。
JP14283183A 1983-08-04 1983-08-04 入力整合回路 Granted JPS6033743A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP14283183A JPS6033743A (ja) 1983-08-04 1983-08-04 入力整合回路

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP14283183A JPS6033743A (ja) 1983-08-04 1983-08-04 入力整合回路

Publications (2)

Publication Number Publication Date
JPS6033743A JPS6033743A (ja) 1985-02-21
JPH0129448B2 true JPH0129448B2 (ja) 1989-06-12

Family

ID=15324627

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Application Number Title Priority Date Filing Date
JP14283183A Granted JPS6033743A (ja) 1983-08-04 1983-08-04 入力整合回路

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JP (1) JPS6033743A (ja)

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JPS6033743A (ja) 1985-02-21

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