JPH01241846A - バンプ電極の形成方法 - Google Patents

バンプ電極の形成方法

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Publication number
JPH01241846A
JPH01241846A JP63069985A JP6998588A JPH01241846A JP H01241846 A JPH01241846 A JP H01241846A JP 63069985 A JP63069985 A JP 63069985A JP 6998588 A JP6998588 A JP 6998588A JP H01241846 A JPH01241846 A JP H01241846A
Authority
JP
Japan
Prior art keywords
bump
electrode
metal
bump electrode
film
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP63069985A
Other languages
English (en)
Inventor
Akihito Tsuda
昭仁 津田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Seiko Epson Corp
Original Assignee
Seiko Epson Corp
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Filing date
Publication date
Application filed by Seiko Epson Corp filed Critical Seiko Epson Corp
Priority to JP63069985A priority Critical patent/JPH01241846A/ja
Publication of JPH01241846A publication Critical patent/JPH01241846A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/11Manufacturing methods

Landscapes

  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は、半導体装置より外部へ電気的接続を取るバン
プ電極の形成方法に関する。
〔従来の技術〕
従来のバンプ電極構造は、5olid 5tate T
echn。
1ogy April 1980版 P26よりP31
にある様に、必要な回路を形成した半導体基板に、まず
、バンプ下バリア金属膜を形成し、しかる後に、バンプ
形成のためのフォトレジストパターンを形成し、このレ
ジストをマスクとしてバンプ電極を選択的に形成する。
この後、不必要な部分のバンプ下バリア金属膜をエツチ
ング除去して、第2図にある様な構造とするバンプ電極
であった。
[発明が解決しようとする課題1 この電極構造は、バンプ形成用レジストパターンのため
にバンプ下部の接着面積が小さく、上部のバンプ部分が
大きい、下のくびれ型であり、バンプ電極の下地に対す
る接着強度が十分に取れないという問題点があった。こ
れは特に高密度実装のために、バンプサイズを小さくし
、バンプピッチを狭めた時に問題となっていた。
また、下くびれ型の形状は、ギヤグボンディング時に、
フィンガーの合せがずれると荷重が片寄りバンプを破壊
する問題点もあった。
本発明はこの様な問題点を解決するもので、その目的と
するところは、バンプ電極が下くびれ型とならない構造
を提供することにある。
[課題を解決するための手段] 本発明のバンプ電極は、基板に1、バンプ電極となる金
属を全面、あるいは一部分に形成した後、前記金属を選
択的にエツチングし、必要なバンプ形状を得ることを特
徴とする。
[実 施 例] 以下、本発明について実施例に基づき詳細に説明する。
第1図は本発明の実施例を示すバンプ電極の主要断面図
であり、1は基板、2は絶縁膜、3は保護膜、4は金属
配線、5はバリア膜、6はバンプ金属である。また、第
3図から第6図は本発明の実施例を示すバンプ電極の形
成工程を示す断面図である。第3図に示す様に、半導体
基板l上に絶縁膜2を形成し、さらに必要な金属配線4
を形成し、保護膜3を部分的に開口した外部接続電極部
に、まずバリア膜5を全面に形成する。このバリア膜は
、上に形成するバンプ金属との関係により2層又は2層
以上の層数て必要な厚みに形成する。次にこのバリア膜
5上にバンプ金rjA8を必要な厚さで形成する。この
バンプ金属8の形成は電気メツキ法、スパッタ法等金属
の種類により最適の方法で行なうことができる。本実施
例では、メツキ法による金メツキ層の例を示しである。
しかる後、第5図に示す様に、バンプ金属層8上にフォ
トレジストを必要な形状に公知の方法で形成する。次に
このフォトレジストパターン9をマスクに下のバンプ金
属層8を選択的にエツチングを行なう。本実施例の第8
図では、薬液を使用した場合を示してあり、台形のバン
プが形成される。
薬液の代りにドライエツチングを用いれば異方性のエツ
チングが行なわれ垂直な壁面を持つパーティカルバンプ
が形成できる。
〔発明の効果1 以上述べた様に本発明によれば、台形、又は直方体形状
のバンプ電極を形成することができ、従来の様な下くび
れ型のバンプ電極にある、バンプ上部の面積に比べ、下
部の接着面の方が小さくなり接着強度が十分に取れない
様な問題はなくなるものである。また、ギヤグボンディ
ング時に、フィンガーの合せがずれた場合でも、荷重の
集中が起こりにくく、バンプ下の破壊を防止できるとい
う効果も有するものである。
本発明の効果は、高密度実装のためにバンプサイズを小
さくした時に大きくあられれ、今後の技術として有望な
ものである。
【図面の簡単な説明】
第1図は本発明のバンプ電極の一実施例を示す断面図。 第2図は従来のバンプ電極を示す断面図。 第3〜第6図は本発明の実施例を示すバンプ電極の形成
工程を示す断面図。 l・・・半導体基板 2・・・絶縁膜 3・・・保護膜 4・・・金属配線 5・ ・ ・バリア膜 6.7・・・バンプ電極 8・・・バンプ金属層 9・・・フォトレジストパターン 以上 出願人 セイコーエプソン株式会社

Claims (1)

    【特許請求の範囲】
  1.  外部接続用電極にバンプ電極が設けられた半導体装置
    のバンプ電極の形成方法において、バンプ電極となる金
    属を全面、あるいは一部分に形成した後、前記金属を選
    択的にエッチングを行ない前記バンプ電極を成形したこ
    とを特徴とするバンプ電極の形成方法。
JP63069985A 1988-03-24 1988-03-24 バンプ電極の形成方法 Pending JPH01241846A (ja)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR19980070399A (ko) * 1997-02-04 1998-10-26 존에이치.무어 플립칩 부착물

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR19980070399A (ko) * 1997-02-04 1998-10-26 존에이치.무어 플립칩 부착물

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