JPH0122784B2 - - Google Patents
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- Publication number
- JPH0122784B2 JPH0122784B2 JP57193822A JP19382282A JPH0122784B2 JP H0122784 B2 JPH0122784 B2 JP H0122784B2 JP 57193822 A JP57193822 A JP 57193822A JP 19382282 A JP19382282 A JP 19382282A JP H0122784 B2 JPH0122784 B2 JP H0122784B2
- Authority
- JP
- Japan
- Prior art keywords
- terminals
- data
- information memory
- transmission
- control unit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 230000005540 biological transmission Effects 0.000 claims description 37
- 238000013500 data storage Methods 0.000 claims description 5
- 238000000034 method Methods 0.000 claims description 5
- 230000010365 information processing Effects 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 3
- 230000006870 function Effects 0.000 description 2
- 230000002093 peripheral effect Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
Description
【発明の詳細な説明】
本発明は構内用電子式交換機において、中央処
理装置と周辺端末との間で情報の伝送を行なうた
めの制御方式に関するものである。
理装置と周辺端末との間で情報の伝送を行なうた
めの制御方式に関するものである。
例えば、従来の交換機において、情報伝送処理
速度の異なる端末、すなわち局線中継台、局線状
態表示装置、内線状態表示装置、その他通話以外
のサービス機能をもつ端末と中央処理装置との間
で情報の伝送を行なうためには、中央処理装置と
端末との間を結合する制御装置を各端末毎に設け
る必要があつた。すなわち、これらの端末には、
中央処理装置との情報送受信を早い同期で行なう
必要がある装置と、低い同期で行なつてよい装置
とがあり、端末の種類によつて情報の送受信同期
が異なつているので、従来は同期が異なる毎に制
御装置を設ける必要があつた。したがつてハード
ウエアが増大し、交換装置の構成が複雑で大形に
なると共に価格も高くなると云う欠点があつた。
速度の異なる端末、すなわち局線中継台、局線状
態表示装置、内線状態表示装置、その他通話以外
のサービス機能をもつ端末と中央処理装置との間
で情報の伝送を行なうためには、中央処理装置と
端末との間を結合する制御装置を各端末毎に設け
る必要があつた。すなわち、これらの端末には、
中央処理装置との情報送受信を早い同期で行なう
必要がある装置と、低い同期で行なつてよい装置
とがあり、端末の種類によつて情報の送受信同期
が異なつているので、従来は同期が異なる毎に制
御装置を設ける必要があつた。したがつてハード
ウエアが増大し、交換装置の構成が複雑で大形に
なると共に価格も高くなると云う欠点があつた。
本発明の目的は上述した欠点を除去し、処理速
度の異なる複数の端末を共通の端末制御装置によ
つて制御することにより、制御装置の個数を著し
く減少させることができ、したがつて交換装置全
体の構成も簡単で廉価となるデータ伝送制御方式
を提案しようとするものである。
度の異なる複数の端末を共通の端末制御装置によ
つて制御することにより、制御装置の個数を著し
く減少させることができ、したがつて交換装置全
体の構成も簡単で廉価となるデータ伝送制御方式
を提案しようとするものである。
本発明は、構内用電子式交換装置において、情
報処理速度の異なる多数の端末と中央制御装置と
の間でデータ伝送を行なうに当たり、中央制御装
置と端末との間に共通端末制御部を設け、この共
通端末制御部には中央制御装置から出力され、総
ての端末に対応するアドレス位置を有し、これら
端末へ送信すべきデータを一時的に格納する送信
情報メモリと、総ての端末に対応するアドレス位
置を有し、これら端末から出力され、中央制御装
置へ伝送すべきデータを一時的に格納する受信情
報メモリと、ｎ個のデータ記憶欄を有し、その
各々に複数の端末の番号をその処理速度に見合つ
た頻度で予じめ登録することができる実装テーブ
ルと、こら送信情報メモリ、受信情報メモリおよ
び実装テーブルを制御する制御装置とを設け、前
記実装テーブルのｎ個のデータ記憶欄を、中央制
御装置のデータ伝送のサイクルタイムＴをｎ等分
したＴ／ｎの周期で順次に繰返えし読み出し、読
み出されたデータ記憶欄に登録されている番号の
複数の端末に対するデータの伝送を、当該周期
Ｔ／ｎ中に行なうことを特徴とするものである。
報処理速度の異なる多数の端末と中央制御装置と
の間でデータ伝送を行なうに当たり、中央制御装
置と端末との間に共通端末制御部を設け、この共
通端末制御部には中央制御装置から出力され、総
ての端末に対応するアドレス位置を有し、これら
端末へ送信すべきデータを一時的に格納する送信
情報メモリと、総ての端末に対応するアドレス位
置を有し、これら端末から出力され、中央制御装
置へ伝送すべきデータを一時的に格納する受信情
報メモリと、ｎ個のデータ記憶欄を有し、その
各々に複数の端末の番号をその処理速度に見合つ
た頻度で予じめ登録することができる実装テーブ
ルと、こら送信情報メモリ、受信情報メモリおよ
び実装テーブルを制御する制御装置とを設け、前
記実装テーブルのｎ個のデータ記憶欄を、中央制
御装置のデータ伝送のサイクルタイムＴをｎ等分
したＴ／ｎの周期で順次に繰返えし読み出し、読
み出されたデータ記憶欄に登録されている番号の
複数の端末に対するデータの伝送を、当該周期
Ｔ／ｎ中に行なうことを特徴とするものである。
以下、図面を参照して本発明を詳細に説明す
る。
る。
第１図は本発明のデータ伝送制御方式に基づく
データ伝送装置の構成を示すブロツク図である。
装置全体は大別すると中央制御部１、共通端末制
御部２および端末部３から構成されている。中央
制御部１には、構内用電子式交換機の中央処理装
置である中央制御装置４が設けられている。また
共通端末制御部２には中央制御装置４に結合され
た一台の制御装置５を設ける。この共通端末制御
部２にはさらに、中央制御装置４から出力され、
各端末へ送信すべき情報を格納する送信情報メモ
リ６と、後述するように各端末の処理速度を決め
る実装テーブル７と、各端末から受信し、中央制
御装置４へ送信すべき情報を格納する受信情報メ
モリ８と、送信情報メモリ６および受信情報メモ
リ８と各端末との間で情報の送受信を行なうデー
タ送受信回路９とを設ける。端末部３にはデータ
送受信回路９に並列的に接続された多数の端末１
０―Ａ―１０―Ｎを設ける。これら端末は異なる
情報処理速度を有するものである。
データ伝送装置の構成を示すブロツク図である。
装置全体は大別すると中央制御部１、共通端末制
御部２および端末部３から構成されている。中央
制御部１には、構内用電子式交換機の中央処理装
置である中央制御装置４が設けられている。また
共通端末制御部２には中央制御装置４に結合され
た一台の制御装置５を設ける。この共通端末制御
部２にはさらに、中央制御装置４から出力され、
各端末へ送信すべき情報を格納する送信情報メモ
リ６と、後述するように各端末の処理速度を決め
る実装テーブル７と、各端末から受信し、中央制
御装置４へ送信すべき情報を格納する受信情報メ
モリ８と、送信情報メモリ６および受信情報メモ
リ８と各端末との間で情報の送受信を行なうデー
タ送受信回路９とを設ける。端末部３にはデータ
送受信回路９に並列的に接続された多数の端末１
０―Ａ―１０―Ｎを設ける。これら端末は異なる
情報処理速度を有するものである。
第２図は共通端末制御部２に設けた実装テーブ
ル７の構成の一例を示すものである。実装テーブ
ル７はアドレス１〜ｎを有し、各アドレス位置と
対応するデータ欄には端末番号Ａ，Ｂ，Ｃ……が
記憶されている。アドレス１〜ｎのデータは、中
央制御装置４の動作周期Ｔをｎ等分したＴ／ｎ周
期で順次読み出される。第２図に示すように端末
１０―Ａの番号Ａは総てのアドレス位置１〜ｎに
記憶されているので、Ｔ／ｎの周期で毎回読み出
され、この端末１０―Ａと関連するデータはＴ／
ｎの周期で毎回処理されることになる。一方、端
末１０―Ｂの番号Ｂはアドレス位置１，３，５…
…に記憶され、端末１０―Ｄの番号Ｄはアドレス
位置２，４，６……に記憶されているので、これ
らの端末１０―Ｂおよび１０―Ｄと関連するデー
タは2T／ｎの周期で処理されることになる。ま
た、端末１０―Ｃ，１０―Ｅおよび１０―Ｅの番
号は３欄置きに記憶されているので、これらの端
末と関連するデータは3T／ｎの周期で処理され
ることになる。このように、実装テーブル７に
は、各端末の番号が、各端末の処理速度に応じた
頻度で記憶されている。第３図は中央制御装置４
から各端末へ伝送すべき情報を一時的に格納する
送信情報メモリ６の一例の構成を示すものであ
る。各端末１０―Ａ〜１０―Ｎのアドレス位置に
対応したデータ欄に当該端末へ伝送すべきデータ
を格納できるようになつている。受信情報メモリ
８の構成もこの送信情報メモリ６の内容と全く同
じであり、各端末のアドレス位置に対応したデー
タ欄に当該端末から伝送されて来るデータを格納
できるようになつている。
ル７の構成の一例を示すものである。実装テーブ
ル７はアドレス１〜ｎを有し、各アドレス位置と
対応するデータ欄には端末番号Ａ，Ｂ，Ｃ……が
記憶されている。アドレス１〜ｎのデータは、中
央制御装置４の動作周期Ｔをｎ等分したＴ／ｎ周
期で順次読み出される。第２図に示すように端末
１０―Ａの番号Ａは総てのアドレス位置１〜ｎに
記憶されているので、Ｔ／ｎの周期で毎回読み出
され、この端末１０―Ａと関連するデータはＴ／
ｎの周期で毎回処理されることになる。一方、端
末１０―Ｂの番号Ｂはアドレス位置１，３，５…
…に記憶され、端末１０―Ｄの番号Ｄはアドレス
位置２，４，６……に記憶されているので、これ
らの端末１０―Ｂおよび１０―Ｄと関連するデー
タは2T／ｎの周期で処理されることになる。ま
た、端末１０―Ｃ，１０―Ｅおよび１０―Ｅの番
号は３欄置きに記憶されているので、これらの端
末と関連するデータは3T／ｎの周期で処理され
ることになる。このように、実装テーブル７に
は、各端末の番号が、各端末の処理速度に応じた
頻度で記憶されている。第３図は中央制御装置４
から各端末へ伝送すべき情報を一時的に格納する
送信情報メモリ６の一例の構成を示すものであ
る。各端末１０―Ａ〜１０―Ｎのアドレス位置に
対応したデータ欄に当該端末へ伝送すべきデータ
を格納できるようになつている。受信情報メモリ
８の構成もこの送信情報メモリ６の内容と全く同
じであり、各端末のアドレス位置に対応したデー
タ欄に当該端末から伝送されて来るデータを格納
できるようになつている。
次に、本例のデータ伝送制御方式の動作を説明
する。先ず、時間の経過とともに中央制御装置４
から発生される端末への必要情報を制御装置５を
介して送信情報メモリ６の該当する端末アドレス
のデータ欄の空き番地に格納する。制御装置５は
実装テーブル７をＴ／ｎの周期で１番地からｎ番
地まで順次に読み出し、再び１番地に戻つてくり
返し読み出しを行なう。このとき、第２図に示す
ように１番地にはＡ，Ｂ，Ｃの三つの端末１０―
Ａ，１０―Ｂ，１０―Ｃの番号が登録されていた
とすると、送信情報メモリ６の、端末１０―Ａの
アドレス位置に対応するデータ欄から情報を読み
出し、データ送受信回路９を介して端末１０―Ａ
へ伝送する。このようにして読み出された送信情
報メモリ６の記憶位置は空となる。また、このと
き、端末１０―Ａから中央制御装置４へ伝送すべ
き情報があれば、これを受信情報メモリ８の端末
Ａのアドレス位置に対応するデータ欄の空き番地
に記憶する。以下、端末１０―Ｂおよび１０―Ｃ
に対しても同様の動作を行ない、中央制御装置４
からの情報をそれぞれの端末に伝送すると共にこ
れら端末からの情報を受信情報メモリ８の対応す
るアドレス位置の空き番地に格納する。このよう
にして、実装テーブル７の１番地に登録されてい
る端末１０―Ａ，１０―Ｂ，１０―Ｃに対する情
報の送受信を完了すると、制御装置５は当該周期
中受信情報メモリ８に格納された端末１０―Ａ，
１０―Ｂ，１０―Ｃからの情報を中央制御装置４
へ送出する。このようにして、実装テーブル７の
１番地に対する送受信動作を行なう。
する。先ず、時間の経過とともに中央制御装置４
から発生される端末への必要情報を制御装置５を
介して送信情報メモリ６の該当する端末アドレス
のデータ欄の空き番地に格納する。制御装置５は
実装テーブル７をＴ／ｎの周期で１番地からｎ番
地まで順次に読み出し、再び１番地に戻つてくり
返し読み出しを行なう。このとき、第２図に示す
ように１番地にはＡ，Ｂ，Ｃの三つの端末１０―
Ａ，１０―Ｂ，１０―Ｃの番号が登録されていた
とすると、送信情報メモリ６の、端末１０―Ａの
アドレス位置に対応するデータ欄から情報を読み
出し、データ送受信回路９を介して端末１０―Ａ
へ伝送する。このようにして読み出された送信情
報メモリ６の記憶位置は空となる。また、このと
き、端末１０―Ａから中央制御装置４へ伝送すべ
き情報があれば、これを受信情報メモリ８の端末
Ａのアドレス位置に対応するデータ欄の空き番地
に記憶する。以下、端末１０―Ｂおよび１０―Ｃ
に対しても同様の動作を行ない、中央制御装置４
からの情報をそれぞれの端末に伝送すると共にこ
れら端末からの情報を受信情報メモリ８の対応す
るアドレス位置の空き番地に格納する。このよう
にして、実装テーブル７の１番地に登録されてい
る端末１０―Ａ，１０―Ｂ，１０―Ｃに対する情
報の送受信を完了すると、制御装置５は当該周期
中受信情報メモリ８に格納された端末１０―Ａ，
１０―Ｂ，１０―Ｃからの情報を中央制御装置４
へ送出する。このようにして、実装テーブル７の
１番地に対する送受信動作を行なう。
次に制御装置５は実装テーブル７の２番地に登
録されている端末番地Ａ，Ｄ，Ｅを読み出し、端
末１０―Ａ，１０―Ｄ，１０―Ｅに対する情報の
伝送を行なう。以下順次の番地に登録されている
端末番号を読み出し、その端末に対する情報の伝
送を行なう。したがつて、各端末に対するデータ
伝送は実装テーブル７に登録されたタイミングで
行なわれることになり、処理速度の異なる多数の
端末に対するデータ伝送を１つの制御装置５で行
なうことができる。
録されている端末番地Ａ，Ｄ，Ｅを読み出し、端
末１０―Ａ，１０―Ｄ，１０―Ｅに対する情報の
伝送を行なう。以下順次の番地に登録されている
端末番号を読み出し、その端末に対する情報の伝
送を行なう。したがつて、各端末に対するデータ
伝送は実装テーブル７に登録されたタイミングで
行なわれることになり、処理速度の異なる多数の
端末に対するデータ伝送を１つの制御装置５で行
なうことができる。
本発明は上述した例にのみ限定されるものでは
なく、幾多の変更を加えることができる。例えば
上述した例では送信情報メモリおよび受信情報メ
モリには総ての端末に対するアドレス位置を設け
たが、必らずしもこのようにする必要はなく、各
端末のアドレスと一緒に情報を記憶するように構
成することもでき、この場合には記憶容量は少な
くても足りる。
なく、幾多の変更を加えることができる。例えば
上述した例では送信情報メモリおよび受信情報メ
モリには総ての端末に対するアドレス位置を設け
たが、必らずしもこのようにする必要はなく、各
端末のアドレスと一緒に情報を記憶するように構
成することもでき、この場合には記憶容量は少な
くても足りる。
上述したように本発明のデーテ伝送制御方式に
よれば、処理速度が異なる多数を端末の番号を、
処理速度に見合つた頻度で実装テーブルに予じめ
記憶しておくことにより、一台の制御装置で多数
の端末に対するデータの送受信を制御することが
できるので、処理速度の異なる端末毎に一台づつ
制御装置を設けていた従来のものに比べて構成は
著しく簡略化され、ハードウエアは少なくなり、
廉価とすることができる等の利点がある。
よれば、処理速度が異なる多数を端末の番号を、
処理速度に見合つた頻度で実装テーブルに予じめ
記憶しておくことにより、一台の制御装置で多数
の端末に対するデータの送受信を制御することが
できるので、処理速度の異なる端末毎に一台づつ
制御装置を設けていた従来のものに比べて構成は
著しく簡略化され、ハードウエアは少なくなり、
廉価とすることができる等の利点がある。
第１図は本発明のデータ伝送制御方式に基づく
伝送装置の全体の構成を示すブロツク図、第２図
は同じくその実装テーブルの一例の構成を示す
図、第３図は同じく送信情報メモリの一例の構成
を示す図である。 １……中央制御部、２……共通端末制御部、３
……端末部、４……中央制御装置、５……制御装
置、６……送信情報メモリ、７……実装テーブ
ル、８……受信情報メモリ、９……データ送受信
回路、１０―Ａ〜１０―Ｎ……端末。
伝送装置の全体の構成を示すブロツク図、第２図
は同じくその実装テーブルの一例の構成を示す
図、第３図は同じく送信情報メモリの一例の構成
を示す図である。 １……中央制御部、２……共通端末制御部、３
……端末部、４……中央制御装置、５……制御装
置、６……送信情報メモリ、７……実装テーブ
ル、８……受信情報メモリ、９……データ送受信
回路、１０―Ａ〜１０―Ｎ……端末。
Claims (1)
- １ 構内用電子式交換装置において、情報処理速
度の異なる多数の端末と中央制御装置との間でデ
ータ伝送を行なうに当たり、中央制御装置と端末
との間に共通端末制御部を設け、この共通端末制
御部には中央制御装置から出力され、総ての端末
に対応するアドレス位置を有し、これら端末へ送
信すべきデータを一時的に格納する送信情報メモ
リと、総ての端末に対応するアドレス位置を有
し、これら端末から出力され、中央制御装置へ伝
送すべきデータを一時的に格納する受信情報メモ
リと、ｎ個のデータ記憶欄を有し、その各々に複
数の端末の番号をその処理速度に見合つた頻度で
予じめ登録することができる実装テーブルと、こ
れら送信情報メモリ、受信情報メモリおよび実装
テーブルを制御する制御装置とを設け、前記実装
テーブルのｎ個のデータ記憶欄を、中央制御装置
のデータ伝送のサイクルタイムＴをｎ等分した
Ｔ／ｎの周期で順次に繰返えし読み出し、読み出
されたデータ記憶欄に登録されている番号の複数
の端末に対するデータの伝送を、当該周期Ｔ／ｎ
中に行なうことを特徴とするデータ伝送制御方
式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57193822A JPS5983436A (ja) | 1982-11-04 | 1982-11-04 | デ−タ伝送制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57193822A JPS5983436A (ja) | 1982-11-04 | 1982-11-04 | デ−タ伝送制御方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5983436A JPS5983436A (ja) | 1984-05-14 |
| JPH0122784B2 true JPH0122784B2 (ja) | 1989-04-27 |
Family
ID=16314321
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57193822A Granted JPS5983436A (ja) | 1982-11-04 | 1982-11-04 | デ−タ伝送制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5983436A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2629598B2 (ja) * | 1994-05-24 | 1997-07-09 | 日本電気株式会社 | 間欠通信制御方法及びそれを適用した間欠通信制御型遠隔装置用制御装置 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5671355A (en) * | 1979-11-16 | 1981-06-13 | Nec Corp | Communication processor |
-
1982
- 1982-11-04 JP JP57193822A patent/JPS5983436A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5671355A (en) * | 1979-11-16 | 1981-06-13 | Nec Corp | Communication processor |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5983436A (ja) | 1984-05-14 |
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