JPH01215186A - 固体撮像装置 - Google Patents
固体撮像装置Info
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- JPH01215186A JPH01215186A JP63039989A JP3998988A JPH01215186A JP H01215186 A JPH01215186 A JP H01215186A JP 63039989 A JP63039989 A JP 63039989A JP 3998988 A JP3998988 A JP 3998988A JP H01215186 A JPH01215186 A JP H01215186A
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- Japan
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- signal
- standard
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- 238000006243 chemical reaction Methods 0.000 claims abstract description 22
- 238000003384 imaging method Methods 0.000 claims description 44
- 238000010586 diagram Methods 0.000 description 6
- 238000001514 detection method Methods 0.000 description 3
- 238000000034 method Methods 0.000 description 2
- 230000003287 optical effect Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 230000002093 peripheral effect Effects 0.000 description 1
- 238000005070 sampling Methods 0.000 description 1
Landscapes
- Transforming Light Signals Into Electric Signals (AREA)
- Color Television Image Signal Generators (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、水平方向の画素数が、標準の水平方向の画素
数よりも少なくされたCCD撮像素子を用いて構成され
る固体撮像装置に関する。
数よりも少なくされたCCD撮像素子を用いて構成され
る固体撮像装置に関する。
本発明は、水平方向の画素数が、標準の水平方向の画素
数のl/nの画素数とされたCCD撮像素子より、標準
の1フレーム期間に複数回撮像信号を得て、その走査線
変換を標準の1水平期間の1/nの期間の信号を単位と
して行ない、複数個の画像を同時表示し得る撮像信号を
得るようにしたことにより、安価に構成でき、また、複
数回得られる撮像信号を標準モニターで画像再生できる
と共に標準V’l″Rで記録でき、さらに、一定時間差
の複数個の画像を同時に観察できるようにしたものであ
る。
数のl/nの画素数とされたCCD撮像素子より、標準
の1フレーム期間に複数回撮像信号を得て、その走査線
変換を標準の1水平期間の1/nの期間の信号を単位と
して行ない、複数個の画像を同時表示し得る撮像信号を
得るようにしたことにより、安価に構成でき、また、複
数回得られる撮像信号を標準モニターで画像再生できる
と共に標準V’l″Rで記録でき、さらに、一定時間差
の複数個の画像を同時に観察できるようにしたものであ
る。
面品位テレビジョンは、例えば1125本/60フィー
ルド、インターレース比2:1.アスペクト比9:16
の表示がなされるものであり、例えばNTSC方式のテ
レビジョン(525本/60フィールド、インターレー
ス比2:1.アスペクト比3:4)に比べて約4倍の情
報社を持っている。
ルド、インターレース比2:1.アスペクト比9:16
の表示がなされるものであり、例えばNTSC方式のテ
レビジョン(525本/60フィールド、インターレー
ス比2:1.アスペクト比3:4)に比べて約4倍の情
報社を持っている。
ごのように茜品位テレビジョンのアスペクト比は、9:
16であるので、高品位ビデオシステムにおける固体撮
像装置に使用されるCCD撮像素子の画素数は、このア
スペクト比に対応したものとされている。例えば、垂直
方向に1035の画素数を有すると共に、水平方向に1
920の画素数を有するようになされている。
16であるので、高品位ビデオシステムにおける固体撮
像装置に使用されるCCD撮像素子の画素数は、このア
スペクト比に対応したものとされている。例えば、垂直
方向に1035の画素数を有すると共に、水平方向に1
920の画素数を有するようになされている。
このように、高品位ビデオシステムにおけるCCD撮像
素子の画素数は非常に多くなるので、高価となる問題が
あった。
素子の画素数は非常に多くなるので、高価となる問題が
あった。
また、産業用途では、アスペクト比が9:16である必
要はなく、例えばl:1のアスペクト比が望まれる場合
が多い。
要はなく、例えばl:1のアスペクト比が望まれる場合
が多い。
なお、アスペクト比が、例えばl:lとなるようにCC
04@@素子を構成する場合であっても、モニター、ビ
デオテープレコーダ(V ’l’ )()等の周辺機器
として、高品位ビデオシステムの標準機撞を利用できる
ことが望ましい。
04@@素子を構成する場合であっても、モニター、ビ
デオテープレコーダ(V ’l’ )()等の周辺機器
として、高品位ビデオシステムの標準機撞を利用できる
ことが望ましい。
本発明は、このような点を考慮し、安IIN+に構成で
き、また、標準モニター、標準V T Rを使用でき、
さらに、一定時間差の複数個の画像を同時に観察できる
ようにすることを目的とするものである。
き、また、標準モニター、標準V T Rを使用でき、
さらに、一定時間差の複数個の画像を同時に観察できる
ようにすることを目的とするものである。
本発明は、標準の水平方向の画素数をNHとしたとき、
水平方向にN H/ nの画素数を有する撮像部と、こ
の撮像部からの電荷が転送されN H/ nの画素数に
対応する段数を持つ水平出力レジスフ部とを有するcc
uflll象素子(1)色素子準の1フレーム期間にC
CD撮像素子(1)で複数回前られる撮像信号の走査線
変換を、標準の1水平期間のl/nの期間の信号を単位
として行なう走査線変換回路(9)とを備えてなるもの
であり、走査線変換回路(9)より複数回前られる撮像
信号による複数個の画像客同時表示し得る撮像信号を得
るようにしたものである。
水平方向にN H/ nの画素数を有する撮像部と、こ
の撮像部からの電荷が転送されN H/ nの画素数に
対応する段数を持つ水平出力レジスフ部とを有するcc
uflll象素子(1)色素子準の1フレーム期間にC
CD撮像素子(1)で複数回前られる撮像信号の走査線
変換を、標準の1水平期間のl/nの期間の信号を単位
として行なう走査線変換回路(9)とを備えてなるもの
であり、走査線変換回路(9)より複数回前られる撮像
信号による複数個の画像客同時表示し得る撮像信号を得
るようにしたものである。
1作用」
上述構成においζは、CCD撮像素子(1)の画素数が
標準の画素数より少なくなるので、安価に構成し得る。
標準の画素数より少なくなるので、安価に構成し得る。
また、標準の水平方向の画素数の1/nの画像数とされ
たCCD撮像素子(1)より、標準の1フレーム期間に
複数回撮像信号を得て、その走査線変換を標準の1水平
期間のl/nの期間の信号を単位として行ない、複数個
の画像を同時表示し得る描像信号を得るようにしたので
、複数回前られる撮像信号を標準モニターで画像再生し
得ると共に標準V ’l’ Rで記録し得る。さらに、
複数個の画像を同時表示し得る撮像信号をi#るように
したので、一定時間差の複数個の画像を同時に観察し得
る。
たCCD撮像素子(1)より、標準の1フレーム期間に
複数回撮像信号を得て、その走査線変換を標準の1水平
期間のl/nの期間の信号を単位として行ない、複数個
の画像を同時表示し得る描像信号を得るようにしたので
、複数回前られる撮像信号を標準モニターで画像再生し
得ると共に標準V ’l’ Rで記録し得る。さらに、
複数個の画像を同時表示し得る撮像信号をi#るように
したので、一定時間差の複数個の画像を同時に観察し得
る。
以下、第1図を参照しながら本発明の一実施例について
説明する。本例は、例えばインターライントランスファ
一方式のCCD撮像素子を用いて構成した例である。
説明する。本例は、例えばインターライントランスファ
一方式のCCD撮像素子を用いて構成した例である。
゛ 同図において、(L)はインターライントランスフ
ァ一方式のccDt!&@!素子である。このCCD撮
像素子+11は、高品位ビデオシステムにおける固体撮
像装置に使用される標準のCCD撮像素子(gl直方向
の画素数がN V %例えば1035.水平方向の画素
数がNH+例えば1920)に対して、水平方向の画素
数が1/2とされ、アスペクト比9:8に対応する構成
とされる。即ち、垂直方向にNνの内素数を有すると共
に、水平方向にNH/2の画素数を有する1/2サイズ
のものとされる。
ァ一方式のccDt!&@!素子である。このCCD撮
像素子+11は、高品位ビデオシステムにおける固体撮
像装置に使用される標準のCCD撮像素子(gl直方向
の画素数がN V %例えば1035.水平方向の画素
数がNH+例えば1920)に対して、水平方向の画素
数が1/2とされ、アスペクト比9:8に対応する構成
とされる。即ち、垂直方向にNνの内素数を有すると共
に、水平方向にNH/2の画素数を有する1/2サイズ
のものとされる。
また、(2)はタイミング発生回路であり、このタイミ
ング発生回路(2)には、端子(3)及び(4)より、
夫々高品位テレビジョンにおける水平同期信号HD及び
垂直同期信号VDが供給される。そして、このタイミン
グ発生回路(2)よりCCD撮像素子(1)の垂直シフ
トレジスタ(図示せず)には、 1/2水平周期の4相
の垂直転送りロックφv1〜φv4が供給され、受光部
(図示せず)に蓄積された信号電荷の垂直シフトレジス
タへの転送、及びこのように垂直シフトレジスタに転送
された信号電荷の水平シフトレジスタ(5)への転送が
行なわれる。この場合、垂直転送りロックφv1〜ψv
4は1/2水平周期であるので、奇数フィールドの最初
及び中間で、夫々受光部に蓄積されている奇数フィール
ドライン及び偶数フィールドラインの信号電荷が垂直シ
フトレジスタに転送されたのち、垂直シフトレジスタに
よって水平シフトレジスタ(5)に、1/2水平周期毎
に1ライン分ずつ転送される。
ング発生回路(2)には、端子(3)及び(4)より、
夫々高品位テレビジョンにおける水平同期信号HD及び
垂直同期信号VDが供給される。そして、このタイミン
グ発生回路(2)よりCCD撮像素子(1)の垂直シフ
トレジスタ(図示せず)には、 1/2水平周期の4相
の垂直転送りロックφv1〜φv4が供給され、受光部
(図示せず)に蓄積された信号電荷の垂直シフトレジス
タへの転送、及びこのように垂直シフトレジスタに転送
された信号電荷の水平シフトレジスタ(5)への転送が
行なわれる。この場合、垂直転送りロックφv1〜ψv
4は1/2水平周期であるので、奇数フィールドの最初
及び中間で、夫々受光部に蓄積されている奇数フィール
ドライン及び偶数フィールドラインの信号電荷が垂直シ
フトレジスタに転送されたのち、垂直シフトレジスタに
よって水平シフトレジスタ(5)に、1/2水平周期毎
に1ライン分ずつ転送される。
同様に、偶数フィールドの最初及び中間で、夫々受光部
に蓄積されている奇数フィールドライン及び偶数フィー
ルドラインの信号電荷が垂直シフトレジスタに転送され
たのち、垂直シフトレジスタによって水平シフトレジス
タ(5)に、 l/2水平周期毎に1ライン分ずつ転送
される。
に蓄積されている奇数フィールドライン及び偶数フィー
ルドラインの信号電荷が垂直シフトレジスタに転送され
たのち、垂直シフトレジスタによって水平シフトレジス
タ(5)に、 l/2水平周期毎に1ライン分ずつ転送
される。
また、タイミング発生回路(2)より、CCD撮像素子
(11の水平シフトレジスタ(5)には、1画素周期の
2相の水平転送りロックφH1+ φH2が供給される
。この水平転送りロックφH1+ φH2の周波数は、
水平方向の画素数がNHである標準のCCL)撮像素子
に供給される水平転送りロックと同じ周波数とされる。
(11の水平シフトレジスタ(5)には、1画素周期の
2相の水平転送りロックφH1+ φH2が供給される
。この水平転送りロックφH1+ φH2の周波数は、
水平方向の画素数がNHである標準のCCL)撮像素子
に供給される水平転送りロックと同じ周波数とされる。
即ち、NHの画素数を1水平期間に読み出し得る周波数
とされる。そして、信号電荷は電荷検出部(6;を介し
て順次取り出される。この場合、ccDJM@!素子+
1)の水平方向の画素数は標準の1/2とされているの
で、水平シフトレジスタ(5)に、 l/2水平周期毎
に転送される1947分の信号電荷は全て取り出される
。
とされる。そして、信号電荷は電荷検出部(6;を介し
て順次取り出される。この場合、ccDJM@!素子+
1)の水平方向の画素数は標準の1/2とされているの
で、水平シフトレジスタ(5)に、 l/2水平周期毎
に転送される1947分の信号電荷は全て取り出される
。
このCCD撮像素子(1)の電荷検出部(6)の出力は
、サンプルホールド回路(7)に供給される。このサン
プルホールド回路(7)には、タイミング発生回路(2
)より電荷検出部(6)の出力の信号レベル期間に対応
してサンプリングパルスPsが供給され、このサンプル
ホールド回路(7)からは、本来の奇数フ、イールドの
期間に、奇数フィールドラインの信号(フィールドIの
信号)及び偶数フィールドラインの信号(フィールド2
の信号)が連続した1フレーム(フレームA)の撮像信
号が得られると共に、同様に本来の偶数フィールドの期
間に、奇数フィールドラインの信号(フィールl” 1
の信号)及び偶数フィールドラインの信号(フィールド
2の信号)が連続した1フレーム(フレームB)の撮像
信号が得られる。
、サンプルホールド回路(7)に供給される。このサン
プルホールド回路(7)には、タイミング発生回路(2
)より電荷検出部(6)の出力の信号レベル期間に対応
してサンプリングパルスPsが供給され、このサンプル
ホールド回路(7)からは、本来の奇数フ、イールドの
期間に、奇数フィールドラインの信号(フィールドIの
信号)及び偶数フィールドラインの信号(フィールド2
の信号)が連続した1フレーム(フレームA)の撮像信
号が得られると共に、同様に本来の偶数フィールドの期
間に、奇数フィールドラインの信号(フィールl” 1
の信号)及び偶数フィールドラインの信号(フィールド
2の信号)が連続した1フレーム(フレームB)の撮像
信号が得られる。
例えば、CCD撮像素子(1)の水平ラインを9ライン
とし、第1ライン〜第5ラインが奇数フィールドライン
、第6ライン〜第9ラインが偶数フィールドラインとす
ると、本来の奇数フィールドの期間には、第4図Aに示
すように、フィールドlの信号としてAl−A3、フィ
ールド2の信号としてA6〜A9のライン信号が連続し
たフレームAの撮像信号が得られると共に、同様に本来
の偶数フィールドの期間には、同図Bにmすように、フ
ィールドlの信号としてB1−85、フィールド2の信
号としてB6〜B9のライン信号が連続したフレームB
の撮像信号が得られる。したがって、サンプルホールド
回路(7)からは、第3図Cに示すような撮像信号が得
られる。ここで、同図A及びDは、夫々垂直同期信号V
D及び水平同期信号HDを示している。なお、第4図C
及びDは、夫々フレームA及びBの撮像信号による表示
画像を示しており、実線部はフィールド1の走査線、破
線部はフィールド2の走査線を示している。
とし、第1ライン〜第5ラインが奇数フィールドライン
、第6ライン〜第9ラインが偶数フィールドラインとす
ると、本来の奇数フィールドの期間には、第4図Aに示
すように、フィールドlの信号としてAl−A3、フィ
ールド2の信号としてA6〜A9のライン信号が連続し
たフレームAの撮像信号が得られると共に、同様に本来
の偶数フィールドの期間には、同図Bにmすように、フ
ィールドlの信号としてB1−85、フィールド2の信
号としてB6〜B9のライン信号が連続したフレームB
の撮像信号が得られる。したがって、サンプルホールド
回路(7)からは、第3図Cに示すような撮像信号が得
られる。ここで、同図A及びDは、夫々垂直同期信号V
D及び水平同期信号HDを示している。なお、第4図C
及びDは、夫々フレームA及びBの撮像信号による表示
画像を示しており、実線部はフィールド1の走査線、破
線部はフィールド2の走査線を示している。
また、サンプルホールド回路(7)からの撮像信号So
はクランプ回路(8)に供給される。このクランプ回路
(8)には、タイミング発生回路(2)より、描像信号
Soのオプティカルブラックレベル(図承せず)の期間
に対応したクランプパルスPCLが供給され、撮像信号
SOのオプティカルブラックレベルが一定レベルとなる
ようにクランプされる。
はクランプ回路(8)に供給される。このクランプ回路
(8)には、タイミング発生回路(2)より、描像信号
Soのオプティカルブラックレベル(図承せず)の期間
に対応したクランプパルスPCLが供給され、撮像信号
SOのオプティカルブラックレベルが一定レベルとなる
ようにクランプされる。
また、このクランプ回路(8)でクランプされた撮像信
号Soは、走査線変換回路(9)を構成するメモリ (
lO)に供給される。また、(11)は、走査線変換回
路(9)を構成する読み出し/Wき込み制御回路であり
、この制御回路(11)には、タイミング発生回路(2
)よりクロックCLKが供給されると共に同期信号VD
、H1)が供給され、この制御回路(11)によりメモ
リ (lO)が制御される。そして、メモリ (10)
には、#M像信号SOのフレームA及びフレームBの撮
像信号が順次供給されて書き込まれると共に、このメモ
リ (10)より、 1/2水平期間の単位で、即ちラ
イン信号単位でフレームA及びBの信号が父互に順次読
み出される。第2図は、この走査線変換回路(9)の具
体構成図を示すものである。同図において、入力端子(
21)より供給される撮像信号Soは、A/Ll変換器
(22)でデジタル信号に変換されたのち、切換スイッ
チ(23)のa側及びb側を介してメモリ (24A)
及び(24B )に供給される。また、一端子(25)
より供給されるクロックCjKは書き込みクロック発生
回路(26)に供給され、この書き込みクロック発生回
路(26)からの暑き込みクロックWCLKはA/D変
換器(22)及び書き込みアドレス発生回路(27)に
供給される。また、端子(28)より供給される垂直同
期信号Vl)は′■゛フリフプフ[1ノブ(29)に供
給され、このTフリップフロップ(29)からは、第3
図Bに示すように、奇数フィールドで低レベル“0”と
なり、偶数フィールドで高し・\ル″1′となる1フレ
ーム周期のパルス信号pFが出力される。このパルス信
号PFは切換スイッチ(23)に切換制御信号として供
給され、この切換スイッチ(23)は、奇数フィールド
にはa側に、偶数フィールドにはb側に、夫々接続され
るようになされる。これと同時に、パルス信号p re
は書き込みアドレス発生回路(27)に制御信号として
供給され、この書き込みアドレス発生回路(27)から
の書き込みアドレス信号は、奇数フィールドにはメモリ
(24A)に、偶数フィールドにはメモリ (24B
)に、夫々供給されるようになされる。
号Soは、走査線変換回路(9)を構成するメモリ (
lO)に供給される。また、(11)は、走査線変換回
路(9)を構成する読み出し/Wき込み制御回路であり
、この制御回路(11)には、タイミング発生回路(2
)よりクロックCLKが供給されると共に同期信号VD
、H1)が供給され、この制御回路(11)によりメモ
リ (lO)が制御される。そして、メモリ (10)
には、#M像信号SOのフレームA及びフレームBの撮
像信号が順次供給されて書き込まれると共に、このメモ
リ (10)より、 1/2水平期間の単位で、即ちラ
イン信号単位でフレームA及びBの信号が父互に順次読
み出される。第2図は、この走査線変換回路(9)の具
体構成図を示すものである。同図において、入力端子(
21)より供給される撮像信号Soは、A/Ll変換器
(22)でデジタル信号に変換されたのち、切換スイッ
チ(23)のa側及びb側を介してメモリ (24A)
及び(24B )に供給される。また、一端子(25)
より供給されるクロックCjKは書き込みクロック発生
回路(26)に供給され、この書き込みクロック発生回
路(26)からの暑き込みクロックWCLKはA/D変
換器(22)及び書き込みアドレス発生回路(27)に
供給される。また、端子(28)より供給される垂直同
期信号Vl)は′■゛フリフプフ[1ノブ(29)に供
給され、このTフリップフロップ(29)からは、第3
図Bに示すように、奇数フィールドで低レベル“0”と
なり、偶数フィールドで高し・\ル″1′となる1フレ
ーム周期のパルス信号pFが出力される。このパルス信
号PFは切換スイッチ(23)に切換制御信号として供
給され、この切換スイッチ(23)は、奇数フィールド
にはa側に、偶数フィールドにはb側に、夫々接続され
るようになされる。これと同時に、パルス信号p re
は書き込みアドレス発生回路(27)に制御信号として
供給され、この書き込みアドレス発生回路(27)から
の書き込みアドレス信号は、奇数フィールドにはメモリ
(24A)に、偶数フィールドにはメモリ (24B
)に、夫々供給されるようになされる。
このように、奇数フィールドには、切換スイッチ(23
)がa側に接続されてメモリ(24A)に撮像信号So
が供給されると共に、このメモリ (24^)に書き込
みアドレス信号が供給されるので、メモリ (24A)
にはフレームAの撮像信号が書き込まれる。一方、偶数
フィールドには、切換スイッチ(23)がb側に接続さ
れてメモリ (24B)に撮像信号Soが供給されると
共に、このメモリ (24B )に書き込みアドレス信
号が供給されるので、メモリ (24B)にはフレーム
Bの撮像信号が書き込まれる。
)がa側に接続されてメモリ(24A)に撮像信号So
が供給されると共に、このメモリ (24^)に書き込
みアドレス信号が供給されるので、メモリ (24A)
にはフレームAの撮像信号が書き込まれる。一方、偶数
フィールドには、切換スイッチ(23)がb側に接続さ
れてメモリ (24B)に撮像信号Soが供給されると
共に、このメモリ (24B )に書き込みアドレス信
号が供給されるので、メモリ (24B)にはフレーム
Bの撮像信号が書き込まれる。
また、端子(25)より供給されるクロックCLKは読
み出しクロック発生回路(30)に供給され、この読み
出しクロック発生回路(30)からの読み出しクロック
RCLKは0/八変換器(31)及び読み出しアドレス
発生回路(32)に供給される。
み出しクロック発生回路(30)に供給され、この読み
出しクロック発生回路(30)からの読み出しクロック
RCLKは0/八変換器(31)及び読み出しアドレス
発生回路(32)に供給される。
また、端子(33)より供給される水平同期信号HL)
は、位相比較器(341) 、ローパスフィルタ(34
2)及び電圧制御発振器(343)を有してなるPLL
回路(34)に供給され、このPLL回路(34)から
は、第3図Eに示すように、各水平期間の前半では低レ
ベル“O″となり、後半では高レベル“l”となる1水
平周期でデユーティ50%ノパルス信号PHが出力され
る。このパルス信号PMは切換スイッチ(35)に切換
制御信号として供給され、この切換スイッチ(35)は
各水平期間の前半にはa 11!Iに、後半にはb側に
、夫々接続されるようになされる。これと同時に、パル
ス信号PMは読み出しアドレス発生回路(32)に制御
信号として供給され、この読み出しアドレス発生回路(
32)からの読み出しアドレス信号は、各水平期間の前
半にはメモリ (24A)に、後半にはメモリ (24
B)に、夫々供給されるようになされる。
は、位相比較器(341) 、ローパスフィルタ(34
2)及び電圧制御発振器(343)を有してなるPLL
回路(34)に供給され、このPLL回路(34)から
は、第3図Eに示すように、各水平期間の前半では低レ
ベル“O″となり、後半では高レベル“l”となる1水
平周期でデユーティ50%ノパルス信号PHが出力され
る。このパルス信号PMは切換スイッチ(35)に切換
制御信号として供給され、この切換スイッチ(35)は
各水平期間の前半にはa 11!Iに、後半にはb側に
、夫々接続されるようになされる。これと同時に、パル
ス信号PMは読み出しアドレス発生回路(32)に制御
信号として供給され、この読み出しアドレス発生回路(
32)からの読み出しアドレス信号は、各水平期間の前
半にはメモリ (24A)に、後半にはメモリ (24
B)に、夫々供給されるようになされる。
このように、各水平期間の前半には、メモリ(24A)
’に読み出しアドレス信号が供給されるので、このメモ
リ (24A )より 1/2水平期間分、つまり19
42分の信号が読み出されて切換スイッチ(35)のa
側に供給されると共に、その後半には、メモリ (24
B)に読み出しアドレス信号が供給されるので、このメ
モリ (24B )より 1/2水平期間分、つまり1
942分の信号が読み出されて切換スイッチ(35)の
b側に供給される。そして、切換スイッチ(35)は、
各水平期間の前半はa側には接続され、その後半はb側
に接続されるので、この切換スイッチ(35)からは、
1/2水平期間の単位で、即ちライン信号単位でフレ
ームA及びBの信号が交互に順次群られる。そして、こ
の切換スイッチ(35)の出力は0/^変換器(31)
に供給されてアナログ信号とされ、このD/^変換器(
31)より導出される出方端子(36)には走査線変換
された撮像信号So’が得られる。
’に読み出しアドレス信号が供給されるので、このメモ
リ (24A )より 1/2水平期間分、つまり19
42分の信号が読み出されて切換スイッチ(35)のa
側に供給されると共に、その後半には、メモリ (24
B)に読み出しアドレス信号が供給されるので、このメ
モリ (24B )より 1/2水平期間分、つまり1
942分の信号が読み出されて切換スイッチ(35)の
b側に供給される。そして、切換スイッチ(35)は、
各水平期間の前半はa側には接続され、その後半はb側
に接続されるので、この切換スイッチ(35)からは、
1/2水平期間の単位で、即ちライン信号単位でフレ
ームA及びBの信号が交互に順次群られる。そして、こ
の切換スイッチ(35)の出力は0/^変換器(31)
に供給されてアナログ信号とされ、このD/^変換器(
31)より導出される出方端子(36)には走査線変換
された撮像信号So’が得られる。
例えば、入力端子(21)に供給される撮像信号Soが
、第3図Cに示すようであるとすると、走査線変換され
た撮像信号So’は、同図ドに示すようになり、その奇
数フィールド、偶数フィールドの信号は、各水平期間の
前半にフレームAの撮像信号が、その後半にフレームB
の撮像信号が配されて合成されたものとなる。
、第3図Cに示すようであるとすると、走査線変換され
た撮像信号So’は、同図ドに示すようになり、その奇
数フィールド、偶数フィールドの信号は、各水平期間の
前半にフレームAの撮像信号が、その後半にフレームB
の撮像信号が配されて合成されたものとなる。
また、第1図に戻って、走査線変換回路(9)より出力
される撮像信号So’はプロセス回路(12)に供給さ
れて、ガンマ補正、ブランキング信号混合。
される撮像信号So’はプロセス回路(12)に供給さ
れて、ガンマ補正、ブランキング信号混合。
クリップ、輪郭補正、同期信号付加等の処理がなされ、
このプロセス回路(12)より導出される出力端子(1
3)には映像信号Svが得られる。
このプロセス回路(12)より導出される出力端子(1
3)には映像信号Svが得られる。
本例はこのように構成されているので、出力端子(13
)に得られる映像信号Svが、高品位ビデオシステムの
標準のモニターに供給されるときには、モニターの画面
上に、フレームA及びBの撮@!信号による画像IA及
び1Bが同時に表示される。第4図Eは、撮像信号So
’が第3図Fに示すようであるときのモニターの表示画
像を示したものであり、フレームA及びBの撮像信号に
よる画像■Δ及びIBが、画面の左右に同時に表示され
る。この第4図Eにおいて、実線部は奇数フィールドの
走査線、破線部は偶数フィールドの走査線を示している
。
)に得られる映像信号Svが、高品位ビデオシステムの
標準のモニターに供給されるときには、モニターの画面
上に、フレームA及びBの撮@!信号による画像IA及
び1Bが同時に表示される。第4図Eは、撮像信号So
’が第3図Fに示すようであるときのモニターの表示画
像を示したものであり、フレームA及びBの撮像信号に
よる画像■Δ及びIBが、画面の左右に同時に表示され
る。この第4図Eにおいて、実線部は奇数フィールドの
走査線、破線部は偶数フィールドの走査線を示している
。
このように本例によれば、CCD撮像素子(1)は水平
方向の画素数が標準の1/2とされた1/2サイズのも
のであり、画素数が少ないので、全体として安価に構成
することができる。また、このc CD tJa像素子
+1)より標準の1フレーム期間にフレームA及びBの
撮像信号を得ると共に、走査線変換回vPr(91によ
って1/2水平期間単位で走査線変換し、フレームA及
びBの撮像信号による画像を同時表示できる撮像信号S
o’を得るようにしているので、高品位ビデオシステム
における標準モニターで画像を再生できると共に、これ
を標準VTRで記録することができる。さらに、フレー
ムA及びBの撮像信号による1/2垂直期間差の画(I
!1^及び1Bを同時に観察できるので、動作解析に利
用して好適なものとなる。
方向の画素数が標準の1/2とされた1/2サイズのも
のであり、画素数が少ないので、全体として安価に構成
することができる。また、このc CD tJa像素子
+1)より標準の1フレーム期間にフレームA及びBの
撮像信号を得ると共に、走査線変換回vPr(91によ
って1/2水平期間単位で走査線変換し、フレームA及
びBの撮像信号による画像を同時表示できる撮像信号S
o’を得るようにしているので、高品位ビデオシステム
における標準モニターで画像を再生できると共に、これ
を標準VTRで記録することができる。さらに、フレー
ムA及びBの撮像信号による1/2垂直期間差の画(I
!1^及び1Bを同時に観察できるので、動作解析に利
用して好適なものとなる。
なお、上述実施例において、CCL)撮像素子(1)は
水平方向の画素数が標準の1/2とされた1/2サイズ
のもので、このCCDj1gC091g像上子標準の1
フレーム期間でフレームA及びBの撮像信号を得、この
フレームA及びBの撮像信号による画像が同時表示され
るように走査線変換回路(9)で走査線変換するもので
あるが、同様にして、1/NサイズのCCD撮像素子を
用いるものも構成することができる。
水平方向の画素数が標準の1/2とされた1/2サイズ
のもので、このCCDj1gC091g像上子標準の1
フレーム期間でフレームA及びBの撮像信号を得、この
フレームA及びBの撮像信号による画像が同時表示され
るように走査線変換回路(9)で走査線変換するもので
あるが、同様にして、1/NサイズのCCD撮像素子を
用いるものも構成することができる。
例えば1/4サイズのCCD撮像素子、即ち水平方向及
び垂直方向の画素数が標準の1/2とされたCCD撮像
素子を用いるものにおいては、標準の1フレーム期間に
、SS図Bに示すようにフレームA−Dの撮像信号So
を得ると共に、走査線変換回路では、この撮像信号So
が1/2水平期間の信号単位で、即ちライン信号単位で
走査線変換されることで同図りに示すような走査線変換
された撮像信号So′を得るようになされる。なお、同
図A及びBは、夫々垂直同期信号VD及び水平同期信号
HDを示している。
び垂直方向の画素数が標準の1/2とされたCCD撮像
素子を用いるものにおいては、標準の1フレーム期間に
、SS図Bに示すようにフレームA−Dの撮像信号So
を得ると共に、走査線変換回路では、この撮像信号So
が1/2水平期間の信号単位で、即ちライン信号単位で
走査線変換されることで同図りに示すような走査線変換
された撮像信号So′を得るようになされる。なお、同
図A及びBは、夫々垂直同期信号VD及び水平同期信号
HDを示している。
この、撮像信号So’より形成された映像信号が高品位
ビデオシステムにおける標準のモニターに供給されると
きには、第6図A−Dに示すようなフレームA−1)の
撮像信号による画像IA”i。
ビデオシステムにおける標準のモニターに供給されると
きには、第6図A−Dに示すようなフレームA−1)の
撮像信号による画像IA”i。
が、同図Eに示すようにモニターの画面上に同時に表示
されることとなる。
されることとなる。
なお、上述実施例は高品位ビデオシステムを例にとって
説明したが、通常のビデオシステムに対しても同様に通
用することができる。
説明したが、通常のビデオシステムに対しても同様に通
用することができる。
以上述べた本発明によれば、CCIJIJd像4子の画
素数が標準の画素数より少なくなるので、全体として安
価に構成することができる。また、標準の水平方向の1
/nの画素数とされたCCL)撮像素子より標準の1フ
レーム期間に複数回偶像信号を得て、その走査線変換を
標準の1水平期間の1/nの期間の信号を単位として行
ない、複数(INの画像を同時表示しうる撮像信号を得
るようにしたので、このように複数回得られる撮像信号
を標準モニターで画像再生できると共に、標準V ′r
Rで記録することもできる。さらに複数個のil!ll
像を同時表示し得る撮像信号を得るようにしたので、一
定時間差の複数個の画像を同時に観察できる利点があり
、例えば動作解析に利用することもできる。
素数が標準の画素数より少なくなるので、全体として安
価に構成することができる。また、標準の水平方向の1
/nの画素数とされたCCL)撮像素子より標準の1フ
レーム期間に複数回偶像信号を得て、その走査線変換を
標準の1水平期間の1/nの期間の信号を単位として行
ない、複数(INの画像を同時表示しうる撮像信号を得
るようにしたので、このように複数回得られる撮像信号
を標準モニターで画像再生できると共に、標準V ′r
Rで記録することもできる。さらに複数個のil!ll
像を同時表示し得る撮像信号を得るようにしたので、一
定時間差の複数個の画像を同時に観察できる利点があり
、例えば動作解析に利用することもできる。
第1図は本発明の一実施例を示す構成図、第2図は走査
線変換回路の具体構成図、第3図及び第4図は一実施例
の説明のための図、第5図及び第6図は本発明の他の実
施例の説明のための図である。 11はCCD撮像素子、(2)はタイミング発生回路、
(9)は走査線変換回路である。
線変換回路の具体構成図、第3図及び第4図は一実施例
の説明のための図、第5図及び第6図は本発明の他の実
施例の説明のための図である。 11はCCD撮像素子、(2)はタイミング発生回路、
(9)は走査線変換回路である。
Claims (1)
- 【特許請求の範囲】 標準の水平方向の画素数をN_Hとしたとき、水平方向
にN_H/nの画素数を有する撮像部と、この撮像部か
らの電荷が転送されN_H/nの画素数に対応する段数
を持つ水平出力レジスタ部とを有するCCD撮像素子と
、 標準の1フレーム期間に上記CCD撮像素子で複数回得
られる撮像信号の走査線変換を、標準の1水平期間の1
/nの期間の信号を単位として行なう走査線変換回路と
を備えてなり、 上記走査線変換回路より上記複数回得られる撮像信号に
よる複数個の画像を同時表示し得る撮像信号を得ること
を特徴とする固体撮像装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63039989A JP2596042B2 (ja) | 1988-02-23 | 1988-02-23 | 固体撮像装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63039989A JP2596042B2 (ja) | 1988-02-23 | 1988-02-23 | 固体撮像装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH01215186A true JPH01215186A (ja) | 1989-08-29 |
JP2596042B2 JP2596042B2 (ja) | 1997-04-02 |
Family
ID=12568347
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63039989A Expired - Fee Related JP2596042B2 (ja) | 1988-02-23 | 1988-02-23 | 固体撮像装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2596042B2 (ja) |
-
1988
- 1988-02-23 JP JP63039989A patent/JP2596042B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JP2596042B2 (ja) | 1997-04-02 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
LAPS | Cancellation because of no payment of annual fees |