JPH01205462A - 半導体素子 - Google Patents

半導体素子

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JPH01205462A
JPH01205462A JP2924888A JP2924888A JPH01205462A JP H01205462 A JPH01205462 A JP H01205462A JP 2924888 A JP2924888 A JP 2924888A JP 2924888 A JP2924888 A JP 2924888A JP H01205462 A JPH01205462 A JP H01205462A
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JP
Japan
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film
silicon nitride
nitride film
silicon oxide
oxide film
Prior art date
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Pending
Application number
JP2924888A
Other languages
English (en)
Inventor
Masanobu Takasuka
高須賀 正信
Masayuki Yamaguchi
正之 山口
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Panasonic Holdings Corp
Original Assignee
Matsushita Electronics Corp
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は受光部と増幅回路部を1チップに集積化した半
導体素子(集積化受光素子)に関するものである。
従来の技術 増幅回路だけを集積化した半導体集積回路素子では、電
気特性安定化のために、素子の表面保護膜としてシリコ
ン酸化膜、シリコン窒化膜なとの絶縁性被膜が用いられ
ている。受光部と増幅回路を一体化した集積化受光素子
においても従来の半導体集積回路の表面保護膜がそのま
ま使われている。第2図に従来例の集積化受光素子の断
面構造を示す。N型半導体層5,10及びP型半導体層
7は受光部のカソード及びアノードを形成している。N
型半導体層2,4,9.P型半導体層6゜N型半導体層
8はトランジスタのコレクタ、ペース、エミッタを形成
している。第2図には回路素子としてトランジスタが示
されているが、他の周辺回路素子として抵抗、容量等も
トランジスタと同様の製作工程で容易に形成てきる。か
かる回路素子部、受光部の作りこみがなされた半導体層
上に、シリコン酸化膜11、シリコン窒化膜13の被膜
が形成されている。このシリコン酸化膜は、2000〜
6000人、シリコン窒化膜は5000〜20000A
の厚さに形成されている。
発明が解決しようとする課題 従来の保護膜形成のなされた半導体素子においては、受
光部を形成する領域の表面上にも回路部領域の表面と同
等の被膜が形成されるため、光の干渉による光電変換効
率の低下やばらつきが太きくなる問題があった。とくに
、半導体レーザから発せられろ特定波長光なとに対して
、ばらつきが大きくなりやすく、セラ1〜の不動作にも
つながることがあった。
本発明の目的は、従来と同等の保護効果を有し、特定波
長の入射光に対し高い光電変換効率を呈し、かつ、感度
のばらつきを抑えた半導体素子を提供することにある。
課題を解決するための手段 本発明の半導体素子は受光部と回路部を1チップに集積
化した半導体素子に適用するものであり、受光部領域を
除いた半導体層表面には従来通りシリコン酸化膜とシリ
コン窒化膜からなる絶縁性被膜が積層されているが、受
光部領域は、反射防止膜として、シリコン酸化膜を10
0〜1000八にシリコン窒化膜を500〜1000A
に積層して形成した保護膜構造である。
作用 受光部領域を反射防止膜構造とすることにより、受光部
の分光感度特性が平坦化されるとともに、充電変換効率
が向」ニする。とくに、この反射防止膜構造は可視光〜
近赤外光領域の光源に対して充電変換効率の向上、最適
化をはかったものてあり、光電変換効率のばらつきも従
来の1/2以下に低減できる。
実施例 第1図に本発明の実施例である受光部と回路部を1−チ
ップに集積化した半導体素子の断面図を示す。本実施例
では回路部は1個のトランジスタについてのみ示してい
るが、通常は複数のI・ランシスタ、抵抗、コンデンサ
などて構成される。第1図てはP型半導体基板1にN型
埋込層2を選択形成した後、N型エピタキシャル層4,
5を形成している。次に、P型層3を拡散形成しN型エ
ピタキシャル層を分離し、P型拡散層6.N型拡散層8
.9を形成する。このようにして、N型層4゜2.9を
コレクタ領域、P型層6をベース領域、N型層8をエミ
ッタ領域とするトランジスタを構成する。受光部のアノ
ード領域7はトランジスタのベース領域形成工程で、ま
た、カッー+:領域10はトランジスタのエミッタ領域
形成工程で、それぞれ同時形成される。
次に、受光部領域主表面上のシリコン酸化膜を、選択的
に除去し、半導体レーザ光(800nm)に対して、反
射防止膜となるよう新たにシリコン酸化膜14を300
Aに、シリコン窒化膜15を800Aに制御して積層形
成した。続いてアルミニウム電極12を形成した後、プ
ラズマCVD法により、厚さ100OOAのシリコン窒
化膜]3を素子表面に形成し、受光部領域の前記プラズ
マシリコン窒化膜13を選択除去した。
本実施例では、0.6A/Wと高い光電変換効率を実現
でき、半導体層の表面をシリコン窒化膜からなる絶縁被
膜でおおっているため、耐湿性やナトリウムイオンなど
に対する遮蔽効果にすぐれた特性をもつ。また、周辺回
路部の絶縁被膜上に、アルミニウム膜等を付設すれば、
光による漏れ電流の防止、SN比向上がなされるのは言
うまでもない。
発明の効果 = 5 − 本発明の構造による半導体素子によれば、従来より20
%以上高い0.60A/W(入射波長800nm)の光
電変換効率を実現できた。また、光電変換効率のばらつ
きも±5%程度になり、従来の1/2以下に抑えること
ができ、実用上火きな効果がある。
【図面の簡単な説明】
第1図は本発明の実施例半導体素子の断面構造図、第2
図は従来例の断面構造図である。 1・・・・・P型半導体基板、2・・・・・・N型半導
体基板、3・・・・・・P型分離層、4,5・・・・・
・N型エピタキシャル層、6,7・・・・・・P型拡散
層、8,9.10・・・・・・N型拡散層、11.14
・・・・・・シリコン酸化膜、12・・・・・・アルミ
ニウム電極、13.15・・・・・・シリコン窒化膜。

Claims (1)

    【特許請求の範囲】
  1.  受光部と増幅回路部とを1チップに集積化した半導体
    素子において、前記受光部上に、反射防止膜として、シ
    リコン酸化膜を100〜1000Åに、シリコン窒化膜
    を500〜1000Åに積層形成したことを特徴とする
    半導体素子。
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