JPH01160372A - 電力変換器のデジタル周波数制御装置 - Google Patents
電力変換器のデジタル周波数制御装置Info
- Publication number
- JPH01160372A JPH01160372A JP62317765A JP31776587A JPH01160372A JP H01160372 A JPH01160372 A JP H01160372A JP 62317765 A JP62317765 A JP 62317765A JP 31776587 A JP31776587 A JP 31776587A JP H01160372 A JPH01160372 A JP H01160372A
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- JP
- Japan
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- cpu
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- inverter
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- Granted
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- 230000006698 induction Effects 0.000 abstract description 6
- 230000002159 abnormal effect Effects 0.000 abstract description 2
- 238000001514 detection method Methods 0.000 abstract description 2
- 230000002194 synthesizing effect Effects 0.000 abstract 1
- 230000015572 biosynthetic process Effects 0.000 description 5
- 238000003786 synthesis reaction Methods 0.000 description 5
- 238000010586 diagram Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 2
- 239000013256 coordination polymer Substances 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 238000010304 firing Methods 0.000 description 1
Classifications
-
- C—CHEMISTRY; METALLURGY
- C06—EXPLOSIVES; MATCHES
- C06C—DETONATING OR PRIMING DEVICES; FUSES; CHEMICAL LIGHTERS; PYROPHORIC COMPOSITIONS
- C06C7/00—Non-electric detonators; Blasting caps; Primers
Landscapes
- Chemical & Material Sciences (AREA)
- Organic Chemistry (AREA)
- Inverter Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野〕
この発明は電力変換器が出力する交流電力の周波数を制
御する電力変換器のデジタル周波数制御装置に関する。
御する電力変換器のデジタル周波数制御装置に関する。
第２図はインバータが出力する交流の周波数をデジタル
制御する従来例を示す制御ブロック図である。この第２
図において、交流電源１からの交流電力は整流器２によ
り直流電力に変換される。
制御する従来例を示す制御ブロック図である。この第２
図において、交流電源１からの交流電力は整流器２によ
り直流電力に変換される。
この直流電力は、電力変換器としてのインバータ３によ
り再び交流電力に変換されて誘導電動機４へ供給される
のであるが、この誘導電動機４を所望の速度で駆動する
ために、当該インバータ３が出力する交流の周波数は任
意の値に設定できな（てはならない。
り再び交流電力に変換されて誘導電動機４へ供給される
のであるが、この誘導電動機４を所望の速度で駆動する
ために、当該インバータ３が出力する交流の周波数は任
意の値に設定できな（てはならない。
インバータ３が出力する交流の周波数は次のようにして
制御される。すなわち、デジタル量である周波数指令信
号と、クロック発振器１１から出力されるクロックパル
スとをレートマルチプライヤ１２へ入力させると、この
レートマルチプライヤ１２からは入力された周波数指令
信号に比例した周波数のパルス列信号が出力されるので
、このパルス列信号をカウンタ１３を介してメモリー１
４へ与える。このメモリー１４にはインバータ３を構成
し１ているスイッチ素子をオン・オフさせる制御信号の
論理パターン（一般には正弦パターン）が記憶されてい
るので、周波数指令信号の変化に対応してこのメモリー
１４に記憶されている正弦パターンの読出し速度が変化
することになる。
制御される。すなわち、デジタル量である周波数指令信
号と、クロック発振器１１から出力されるクロックパル
スとをレートマルチプライヤ１２へ入力させると、この
レートマルチプライヤ１２からは入力された周波数指令
信号に比例した周波数のパルス列信号が出力されるので
、このパルス列信号をカウンタ１３を介してメモリー１
４へ与える。このメモリー１４にはインバータ３を構成
し１ているスイッチ素子をオン・オフさせる制御信号の
論理パターン（一般には正弦パターン）が記憶されてい
るので、周波数指令信号の変化に対応してこのメモリー
１４に記憶されている正弦パターンの読出し速度が変化
することになる。
メモリー１４から読出されたデータは、波形合成回路１
５においてインバータ３のスイッチ素子を動作させるス
イッチング信号が合成され、増幅回路１６を経てスイッ
チ素子を動作させるのであり、これによりインバータ３
が出力する交流の周波数は、上述したようにメモリー１
４から読出される正弦パターンの読出し速度に対応した
ものとなる。
５においてインバータ３のスイッチ素子を動作させるス
イッチング信号が合成され、増幅回路１６を経てスイッ
チ素子を動作させるのであり、これによりインバータ３
が出力する交流の周波数は、上述したようにメモリー１
４から読出される正弦パターンの読出し速度に対応した
ものとなる。
ところがインバータ３が出力する交流の周波数が、交流
電源１の周波数の整数倍であると、インバータ３の出力
電流がこの交流電源１と共振し、当該インバータ３の制
御が乱調となって良好な運転ができなくなる不都合を生
ずる。とくにインバータ３の負荷として、第２図に示す
ような誘導電動機４を接続している場合、一般にこの誘
導電動機４は広い速度変化範囲において任意の速度を高
い精度で維持できることが期待されているので、上述の
ような乱調の発生は好ましいことではない。
電源１の周波数の整数倍であると、インバータ３の出力
電流がこの交流電源１と共振し、当該インバータ３の制
御が乱調となって良好な運転ができなくなる不都合を生
ずる。とくにインバータ３の負荷として、第２図に示す
ような誘導電動機４を接続している場合、一般にこの誘
導電動機４は広い速度変化範囲において任意の速度を高
い精度で維持できることが期待されているので、上述の
ような乱調の発生は好ましいことではない。
この発明は、電力変換器から出力される交流が、交流電
源と共振することを回避し、良好な制御特性を得ること
ができる電力変換器のデジタル周波数制御装置を提供す
ることを目的とする。
源と共振することを回避し、良好な制御特性を得ること
ができる電力変換器のデジタル周波数制御装置を提供す
ることを目的とする。
上記の目的を達成するために、この発明の電力変換器の
デジタル周波数制御装置は、クロック発振器から出力さ
れるクロックパルスとデジタル周波数指令信号とを入力
してこのデジタル周波数指令信号に比例した周波数のパ
ルス列信号を出力するレートマルチプライヤを備え、前
記パルス列信号に対応した周波数の交流を電力変換器が
出力するようにしている電力変換器のデジタル周波数制
御装置において、前記デジタル周波数指令信号と電源周
波数信号を入力し、このデジタル周波数指令信号の値が
電源周波数の整数倍に等しいとき前記デジタル周波数指
令信号の値に所定値を加算して前記レートマルチプライ
ヤへ供給する演算回路を設ける。
デジタル周波数制御装置は、クロック発振器から出力さ
れるクロックパルスとデジタル周波数指令信号とを入力
してこのデジタル周波数指令信号に比例した周波数のパ
ルス列信号を出力するレートマルチプライヤを備え、前
記パルス列信号に対応した周波数の交流を電力変換器が
出力するようにしている電力変換器のデジタル周波数制
御装置において、前記デジタル周波数指令信号と電源周
波数信号を入力し、このデジタル周波数指令信号の値が
電源周波数の整数倍に等しいとき前記デジタル周波数指
令信号の値に所定値を加算して前記レートマルチプライ
ヤへ供給する演算回路を設ける。
この発明によれば、周波数指令信号の値が電源周波数の
整数倍となる値を指令したとき、この周波数指令信号の
値に所定値を加算する演算回路により、電力変換器から
出力される交流の実際の周波数は、電源周波数の整数倍
からずれた値となる。
整数倍となる値を指令したとき、この周波数指令信号の
値に所定値を加算する演算回路により、電力変換器から
出力される交流の実際の周波数は、電源周波数の整数倍
からずれた値となる。
第１図はこの発明の実施例を示すブロック図である。図
において、交流電源１から交流電力を整流器２により直
流電力に変換・し、この直流電力を電力変換器としての
インバータ３により再び交流電力に変換して誘導電動機
４に供給するように構成しているのは、第２図に示す従
来例の場合と同じである。
において、交流電源１から交流電力を整流器２により直
流電力に変換・し、この直流電力を電力変換器としての
インバータ３により再び交流電力に変換して誘導電動機
４に供給するように構成しているのは、第２図に示す従
来例の場合と同じである。
このインバータ３が出力する交流の周波数をデジタル制
御するのであるが、この発明においては、デジタル量で
ある周波数指令信号Ｓがまず演算回路の一種である中央
演算装置ＣＰＵ （以下ＣＰＵと云う）に入力される。
御するのであるが、この発明においては、デジタル量で
ある周波数指令信号Ｓがまず演算回路の一種である中央
演算装置ＣＰＵ （以下ＣＰＵと云う）に入力される。
一方電源電圧Ｖが電源周波数検出回路１７に入力されて
周波数が検出されデジタル量の周波数信号ＳｏがＣＰＵ
に入力される。ＣＰＵにおいて、周波数指令信号Ｓと電
源電圧の周波数信号Ｓｏとが比較され、周波数指令信号
Ｓの値が電源電圧の周波数信号ＳＯの整数倍に等しいと
き周波数指令信号Ｓの値に所定値例えば１を加算しレー
トマルチプライヤ１２へ第２次周波数指令、信号Ｓ、を
入力させる。クロック発振器１１からのクロックパルス
と、上記のＣＰＵからの出力とにより、レートマルチプ
ライヤ１２からはＣＰＵの出力に対応した周波数のパル
ス列信号が出力され、このパルス列信号がカウンタ１３
に入力され、メモリー１４のアドレスが決定される。こ
のメモリー１４から出力されたデータを用いて波形合成
回路１５においてインバータ３を構成するス・イツチン
グ素子を動作させるためのスイッチング信号が合成され
る。
周波数が検出されデジタル量の周波数信号ＳｏがＣＰＵ
に入力される。ＣＰＵにおいて、周波数指令信号Ｓと電
源電圧の周波数信号Ｓｏとが比較され、周波数指令信号
Ｓの値が電源電圧の周波数信号ＳＯの整数倍に等しいと
き周波数指令信号Ｓの値に所定値例えば１を加算しレー
トマルチプライヤ１２へ第２次周波数指令、信号Ｓ、を
入力させる。クロック発振器１１からのクロックパルス
と、上記のＣＰＵからの出力とにより、レートマルチプ
ライヤ１２からはＣＰＵの出力に対応した周波数のパル
ス列信号が出力され、このパルス列信号がカウンタ１３
に入力され、メモリー１４のアドレスが決定される。こ
のメモリー１４から出力されたデータを用いて波形合成
回路１５においてインバータ３を構成するス・イツチン
グ素子を動作させるためのスイッチング信号が合成され
る。
この波形合成回路１５は、たとえばＤ−フリップフロッ
プで構成されていて、メモリー１４から読み出されるデ
ータと、カウンタ１３が出力する最下位ビットを入力す
ることで上記のスイッチング信号が合成される。
プで構成されていて、メモリー１４から読み出されるデ
ータと、カウンタ１３が出力する最下位ビットを入力す
ることで上記のスイッチング信号が合成される。
ついで波形合成回路１５から出力されるスイッチング信
号は、増幅回路１６で増幅され、スイッチング素子であ
るトランジスタに点弧信号として与えられるので、イン
バータ３から出力される交流の周波数はＣＰＵに入力さ
れる周波数指令信号Ｓに対応した値となるが、このＣＰ
Ｕの動作により、周波数指令信号Ｓの値が交流電源１の
周波数の整数倍となる値を指令しても、インバータ３が
出力する交流の周波数は上記整数倍の値と相違している
値となる。
号は、増幅回路１６で増幅され、スイッチング素子であ
るトランジスタに点弧信号として与えられるので、イン
バータ３から出力される交流の周波数はＣＰＵに入力さ
れる周波数指令信号Ｓに対応した値となるが、このＣＰ
Ｕの動作により、周波数指令信号Ｓの値が交流電源１の
周波数の整数倍となる値を指令しても、インバータ３が
出力する交流の周波数は上記整数倍の値と相違している
値となる。
この発明によれば、デジタル周波数制御により電力変換
器が出力する交流の周波数を所望値に設定する場合にお
いて、所望値が交流電源の周波数の整数倍に等しい場合
にＣＰＵの作用により回避するようにデジタル周波数制
御装置を構成しているので、所望値として周波数指令信
号が電源周波数の整数倍となる値を指令したとき、電力
変換器から出力される交流の実際の周波数は、電源周波
数の整数倍からずれた値となり、この電力変換器の出力
電流が電源と共振して乱調となってこの電力変換器の制
御が困難になるという異常状態を容易に回避することが
できる。
器が出力する交流の周波数を所望値に設定する場合にお
いて、所望値が交流電源の周波数の整数倍に等しい場合
にＣＰＵの作用により回避するようにデジタル周波数制
御装置を構成しているので、所望値として周波数指令信
号が電源周波数の整数倍となる値を指令したとき、電力
変換器から出力される交流の実際の周波数は、電源周波
数の整数倍からずれた値となり、この電力変換器の出力
電流が電源と共振して乱調となってこの電力変換器の制
御が困難になるという異常状態を容易に回避することが
できる。
第１図はこの発明の実施例を示す制御ブロック図、第２
図は電力変換器が出力する交流の周波数をデジタル制御
する従来例を示す制御ブロック図である。 １・・・交流電源、２・・・整流器、３・・・電力変換
器、１１・・・クロック発振器、１２・・・レートマル
チプライヤ、１５・・・波形合成回路、ＣＰＵ・・・中
央演算装置（演算回路）。 第２図
図は電力変換器が出力する交流の周波数をデジタル制御
する従来例を示す制御ブロック図である。 １・・・交流電源、２・・・整流器、３・・・電力変換
器、１１・・・クロック発振器、１２・・・レートマル
チプライヤ、１５・・・波形合成回路、ＣＰＵ・・・中
央演算装置（演算回路）。 第２図
Claims (1)
- １）クロック発振器から出力されるクロックパルスとデ
ジタル周波数指令信号とを入力してこのデジタル周波数
指令信号に比例した周波数のパルス列信号を出力するレ
ートマルチプライヤを備え、前記パルス列信号に対応し
た周波数の交流を電力変換器が出力するようにしている
電力変換器のデジタル周波数制御装置において、前記デ
ジタル周波数指令信号と電源周波数信号を入力し、この
デジタル周波数指令信号の値が電源周波数の整数倍に等
しいとき前記デジタル周波数指令信号の値に所定値を加
算して前記レートマルチプライヤへ供給する演算回路を
設けたことを特徴とする電力変換器のデジタル周波数制
御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62317765A JP2674768B2 (ja) | 1987-12-16 | 1987-12-16 | 電力変換器のデジタル周波数制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62317765A JP2674768B2 (ja) | 1987-12-16 | 1987-12-16 | 電力変換器のデジタル周波数制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01160372A true JPH01160372A (ja) | 1989-06-23 |
| JP2674768B2 JP2674768B2 (ja) | 1997-11-12 |
Family
ID=18091796
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62317765A Expired - Fee Related JP2674768B2 (ja) | 1987-12-16 | 1987-12-16 | 電力変換器のデジタル周波数制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2674768B2 (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5843188A (ja) * | 1981-09-03 | 1983-03-12 | Shinko Electric Co Ltd | 主軸駆動発電システム |
| JPS62171314A (ja) * | 1986-01-24 | 1987-07-28 | Fuji Electric Co Ltd | パルス列信号発生回路 |
-
1987
- 1987-12-16 JP JP62317765A patent/JP2674768B2/ja not_active Expired - Fee Related
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5843188A (ja) * | 1981-09-03 | 1983-03-12 | Shinko Electric Co Ltd | 主軸駆動発電システム |
| JPS62171314A (ja) * | 1986-01-24 | 1987-07-28 | Fuji Electric Co Ltd | パルス列信号発生回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2674768B2 (ja) | 1997-11-12 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| LAPS | Cancellation because of no payment of annual fees |