JPH01147823A - 混成集積回路装置の製造方法 - Google Patents

混成集積回路装置の製造方法

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Publication number
JPH01147823A
JPH01147823A JP62308056A JP30805687A JPH01147823A JP H01147823 A JPH01147823 A JP H01147823A JP 62308056 A JP62308056 A JP 62308056A JP 30805687 A JP30805687 A JP 30805687A JP H01147823 A JPH01147823 A JP H01147823A
Authority
JP
Japan
Prior art keywords
pin
cutting
disused
mark
integrated circuit
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP62308056A
Other languages
English (en)
Inventor
Shogo Ariyoshi
有吉 昭吾
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP62308056A priority Critical patent/JPH01147823A/ja
Publication of JPH01147823A publication Critical patent/JPH01147823A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/02Details
    • H05K1/0266Marks, test patterns or identification means
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistor
    • H05K3/32Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
    • H05K3/34Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
    • H05K3/3405Edge mounted components, e.g. terminals

Landscapes

  • Fixed Capacitors And Capacitor Manufacturing Machines (AREA)
  • Structure Of Printed Boards (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は混成集積回路の製造方法に関するものである
〔従来の技術〕
第2図はクリップリード線を使用する、混成集積回路装
置の従来の製造工程を示す。図において(a) 、 (
b)・・・(f)の各段階順に工程が進められる。(a
)の段階では部品の取付けが完了した厚膜基板(1)、
にはクリップリード接続用電極(2)がある0(b)の
段階では、クリップリード接続用電極(2)に合う様に
、クリップリード(3)をはめ込む(クランプする)。
(C)の段階では、はんだデツピングや、ロー付けなト
チクリップリード接続用電極(2)とクリップリード(
3)を接続する。(d)の段階ではクリップリード(3
)が規定長になる様にタイバ一部と一緒に切り落とす。
ここで、更に機械的強度の向上、耐環境性向上のために
、外装(ヱポキシ系・セラミック系)が施される場合も
殉されない場合もあるが、いづれにしても、(e)の段
階では表裏の判別、又は型名を明確にするため、商標や
型名、又は機番の表示(6)をマーキングする。(ある
いは厚膜基板の組込み時点であらかじめ入れる。)また
、外部の装置へ接続されるクリップリード(3)の中、
所定の端ツクリップリード(3)の近傍に順番を示すマ
ーク(5)を入れる。更に、(f)の段階ではクリップ
リード線(3)の中の不用ピン(7)をカットする。こ
の不用ピン(7)は次の理由で発生する。混成集積回路
装置や、これを取付けるユニットは高密度化しておシ、
混成集積回路装置では、表裏両面に回路を構成するケー
クが多くな勺、クリップリード(3)も表裏の回路接続
を行うために設けていて、外部との接続に使われないも
のがでてくる。また、外部との接続時に裏表逆に接続さ
れるのを防止する(接続面に対して回転対称としない)
。多数の外部との接続点があり、且つ、途中が外部接続
側の都合でいわゆる歯抜けになる場合は、工程の簡略化
の為、歯抜は部にもクリップリード接続を行い、後でカ
ットするなどである。従来の混成集積回路装置では、こ
の不用ピンカット位置の判定が難しく、品種ごとに設定
された治具の位置決めなどに頼っており、間違って別の
リードをカットしても電気的チエツク以外のチエツクア
ウトが困難であった。
この発明は上記のような問題点を解消するためになされ
たもので、視覚で容易に不用ピンカット位置を判別可能
とし、カット時のカット間違い防止、及びカット後のチ
エツクを容易にすることを目的とする。
〔問題点を解決するための手段〕
この発明に係る混成集積回路装置は、不用ビンの近傍に
、不用ビンを示すマークを設け、視覚で容易に不用ピン
カット位置を判別可能としたものである。
〔作用〕
この発明における不用ビンを示すマークを基準に確認し
つつカット作業を行うとともに、カット後の目視検査工
程ではこのマークとカットされたビンを対比させながら
検査を行うことにより確実に組立てることができる。
〔発明の実施例〕
以下、この発明の一実施例である混成集積回路装置μの
製造方法を第1図について説明する。
図において(a) 、 (b)・・・(f)の各段階順
に工程が進められるが、(1)ないしく7)は従来例で
ある第2図で説明したものと同等のものであるので説明
を省略する。(8〕は不用ビン表示マークで、(a)の
段階には厚膜基板(1)にマーヤングしておく。その他
、(b)ないしげ)の各段階の工程は第2図において説
明した(b)ないしげ)と同様である。
このように不用ビン(1)を示す不用ビン表示マーク(
3)を予め施しておくことによシ、不用ビン(7)をカ
ットする時の誤カットを防ぐのみでなく、カット後の検
証も容易となる。この不用ビン表示マーク(8)は、自
動機の認識マークとしても使用できるので、この不用ビ
ン表示マーク(81の有無を認識させ、自動的に不用ビ
ン(7)をカットすることも可能となシ、安価゛で高品
質な製品を提供することができる。
〔発明の効果〕
以上のように、この発明によれば不用ビン表示(8)を
施すことにより、加工時の間違いを防ぎ、且つ、加工後
の検証を容易にするのみでなく、自動化の導入を容易に
し安価で、高品質の製品を提供することができる。
【図面の簡単な説明】
第1図は、この発明の一実施例による混成集積回路装置
の製造方法の工程を示す図、第2図は′従来例による製
造工程を示す図である。 図において(1)は厚膜基板、(2)はクリップリード
接続用’JXW、(3)はクリップリード、(4)はは
んだ、(5)は順番を示すマーク、(6)は商標、型名
1機番の表示、(7)は不用ビン、(8)は不用ビン表
示マークである。 なお、図中、同一符号は同一、又は相当部分を示す。

Claims (1)

    【特許請求の範囲】
  1.  クリップリード線を使用する混成集積回路装置におい
    て、外部回路に接続しない、いわゆる不用ピンの位置を
    示すマークを上記、不用ピンの近傍に施したことを特徴
    とする混成集積回路装置の製造方法。
JP62308056A 1987-12-03 1987-12-03 混成集積回路装置の製造方法 Pending JPH01147823A (ja)

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Application Number Priority Date Filing Date Title
JP62308056A JPH01147823A (ja) 1987-12-03 1987-12-03 混成集積回路装置の製造方法

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JP62308056A JPH01147823A (ja) 1987-12-03 1987-12-03 混成集積回路装置の製造方法

Publications (1)

Publication Number Publication Date
JPH01147823A true JPH01147823A (ja) 1989-06-09

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ID=17976353

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JP62308056A Pending JPH01147823A (ja) 1987-12-03 1987-12-03 混成集積回路装置の製造方法

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JP (1) JPH01147823A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100434218B1 (ko) * 2002-01-09 2004-06-04 파츠닉(주) 콘덴서의 프레임 공장 검사 확인 장치

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
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