JPH01147652A - バス制御装置 - Google Patents
バス制御装置Info
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- JPH01147652A JPH01147652A JP62303269A JP30326987A JPH01147652A JP H01147652 A JPH01147652 A JP H01147652A JP 62303269 A JP62303269 A JP 62303269A JP 30326987 A JP30326987 A JP 30326987A JP H01147652 A JPH01147652 A JP H01147652A
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- 238000004891 communication Methods 0.000 claims abstract description 24
- 230000002093 peripheral effect Effects 0.000 claims description 8
- 238000000034 method Methods 0.000 description 13
- 238000010586 diagram Methods 0.000 description 4
- 230000010365 information processing Effects 0.000 description 3
- 230000004044 response Effects 0.000 description 3
- 230000000694 effects Effects 0.000 description 2
- 101001041669 Oryctolagus cuniculus Corticostatin 1 Proteins 0.000 description 1
- 235000015927 pasta Nutrition 0.000 description 1
- 230000002250 progressing effect Effects 0.000 description 1
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- Bus Control (AREA)
- Small-Scale Networks (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は、バス使用権獲得プロトコルを有する汎用バス
同士を接続するバス制御装置に関するものである。
同士を接続するバス制御装置に関するものである。
［従来技術］
従来の小型コンピュータ・システムでは、周辺装置のコ
ントローラはホストバスに直結しているため、周辺装置
が増えるほどホストバスに負担がかかつていた。そこで
、周辺装置用のバスをホストバスと分離し、ホストとコ
ントローラが同じように１つのバスにぶらさがる構造に
したバス使用権獲得プロトコ゛ルを有するＳ ＣＳ Ｉ
（ＳｍａｌｌＣｏｍｐｕｔｅｒ ５ｙｓｔｅ＋ｓ Ｉ
ｎｔｅｒｆａｃｅ）バス等の汎用バスの標準化が進めら
れてきた。
ントローラはホストバスに直結しているため、周辺装置
が増えるほどホストバスに負担がかかつていた。そこで
、周辺装置用のバスをホストバスと分離し、ホストとコ
ントローラが同じように１つのバスにぶらさがる構造に
したバス使用権獲得プロトコ゛ルを有するＳ ＣＳ Ｉ
（ＳｍａｌｌＣｏｍｐｕｔｅｒ ５ｙｓｔｅ＋ｓ Ｉ
ｎｔｅｒｆａｃｅ）バス等の汎用バスの標準化が進めら
れてきた。
［発明が解決しようとしている問題点］このような汎用
バス上ではコントローラ同士の通信をホストの介在なし
に行うことができ、マルチタスク処理を容易に実現でき
る。しかし、例えば、５ＣＳＩバスでは合計８台のホス
トコンピュータとコントローラしか接続できないなど、
拡張性の点で問題があった。
バス上ではコントローラ同士の通信をホストの介在なし
に行うことができ、マルチタスク処理を容易に実現でき
る。しかし、例えば、５ＣＳＩバスでは合計８台のホス
トコンピュータとコントローラしか接続できないなど、
拡張性の点で問題があった。
本発明は上記従来例に鑑みてなされたもので、少なくと
も２組の汎用バスを通信回線を介して接続制御し、汎用
バス上でデータ転送可能な周辺装置の数々を増やすこと
のできるバス制御装置を提供することを目的とする。
も２組の汎用バスを通信回線を介して接続制御し、汎用
バス上でデータ転送可能な周辺装置の数々を増やすこと
のできるバス制御装置を提供することを目的とする。
［問題点を解決するための手段］
上記目的を達成するために本発明のバス制御装置は以下
の様な構成からなる。即ち、 少なくとも１つのコンピュータと周辺制御装置を接続し
た汎用バスに接続されたバス制御装置であって、回線を
介して他の汎用バスのバス制御装置との通信制御を行う
通信手段と、前記コンピュータにより指示された他の汎
用バスとの間で、前記通信手段によりデータ転送を行う
転送手段とを備える。
の様な構成からなる。即ち、 少なくとも１つのコンピュータと周辺制御装置を接続し
た汎用バスに接続されたバス制御装置であって、回線を
介して他の汎用バスのバス制御装置との通信制御を行う
通信手段と、前記コンピュータにより指示された他の汎
用バスとの間で、前記通信手段によりデータ転送を行う
転送手段とを備える。
［作用］
以上の構成において、通信手段に゛より回線を介して、
一方の汎用バスのバス制御装置と、他の汎用バスのバス
制御装置との間での通信制御を行い、一方の汎用バスと
、その汎用バスのコンピュータにより指示された他の汎
用バスとの間で、データ転送を行うように動作する。
一方の汎用バスのバス制御装置と、他の汎用バスのバス
制御装置との間での通信制御を行い、一方の汎用バスと
、その汎用バスのコンピュータにより指示された他の汎
用バスとの間で、データ転送を行うように動作する。
［実施例］
以下、ＳＣＳ Ｉバスを例にとり添付図面を参照して本
発明の好適な実施例を詳細に説明する。
発明の好適な実施例を詳細に説明する。
［情報処理システムの説明 （第１図）］第１図は実施
例のバス接続装置５と５′を用いた情報処理システムの
構造例を示す図である。
例のバス接続装置５と５′を用いた情報処理システムの
構造例を示す図である。
図中、１はメインフレームのＳＣ３Ｉバス４のホストコ
ンピュータで、ホストアダプタ１−３を介してＳＣＳ
Ｉパス４に接続されている。ホストコンピュータ１のＣ
ＰＵｌ−１はＲＯＭｌ−２に内蔵された制御プログラム
に従って、５ＣＳＩパス４とのデータ入出力を行う、２
．３は５Ｃ３Ｉバス４と、プリンタやディスク等の周辺
機器との接続制御を行うデバイス・コントローラ（ＤＣ
ＴＲ）である、５．５′は実施例のバス接続装置（ＬＣ
ＴＲ）で、５Ｃ５Ｉパス４とＳＣ３Ｉバス９とを通信回
線６を介して接続している。
ンピュータで、ホストアダプタ１−３を介してＳＣＳ
Ｉパス４に接続されている。ホストコンピュータ１のＣ
ＰＵｌ−１はＲＯＭｌ−２に内蔵された制御プログラム
に従って、５ＣＳＩパス４とのデータ入出力を行う、２
．３は５Ｃ３Ｉバス４と、プリンタやディスク等の周辺
機器との接続制御を行うデバイス・コントローラ（ＤＣ
ＴＲ）である、５．５′は実施例のバス接続装置（ＬＣ
ＴＲ）で、５Ｃ５Ｉパス４とＳＣ３Ｉバス９とを通信回
線６を介して接続している。
ＳＣＳ Ｉバス９は、それぞれディスクやプリンタ等の
制御を行うデバイス・コントローラ（ＤＣＴＲ）７〜８
とバス接続装置５′等を接続しており、コントローラ７
〜８同士あるいは図示しないＳＣ３Ｉバス９のホストコ
ンピュータとの間で相互に通信を行うことができる。ま
たＳＣ３Ｉバス９はバス接続装置５．５′を介して、Ｓ
ＣＳ Ｉパス４のホストコンピュータ１との通信をも行
うことができる。
制御を行うデバイス・コントローラ（ＤＣＴＲ）７〜８
とバス接続装置５′等を接続しており、コントローラ７
〜８同士あるいは図示しないＳＣ３Ｉバス９のホストコ
ンピュータとの間で相互に通信を行うことができる。ま
たＳＣ３Ｉバス９はバス接続装置５．５′を介して、Ｓ
ＣＳ Ｉパス４のホストコンピュータ１との通信をも行
うことができる。
［バス接続装置の説明］ （第２図）］第２図は実施
例のバス接続装置５．５′の構成を示すブロック図であ
る。
例のバス接続装置５．５′の構成を示すブロック図であ
る。
図中１，５０は例えばマイクロプロセッサ等のＭＰＵで
、ＲＯＭ５１に記憶され、第４図と第５図のフローチャ
ートで示された制御プログラムに従ってＳＣ３Ｉパスと
のプロトコル制御や通信回線６との通信制御を行う、５
２はＲＡＭ等のメモリで、ＭＰＵ５０のワークエリアと
して各種データの一時保存を行うとともに、セレクトフ
ラグ等の各種制御変数を記憶する。
、ＲＯＭ５１に記憶され、第４図と第５図のフローチャ
ートで示された制御プログラムに従ってＳＣ３Ｉパスと
のプロトコル制御や通信回線６との通信制御を行う、５
２はＲＡＭ等のメモリで、ＭＰＵ５０のワークエリアと
して各種データの一時保存を行うとともに、セレクトフ
ラグ等の各種制御変数を記憶する。
５３は通信回線６との通信制御を行う回線制御部、５４
はＳＣＳ Ｉバスとのデータ送受信を行うＳＣＳ Ｉプ
ロトコル・ドライバ／レシーバ（ＳＣＤＲＶ）である。
はＳＣＳ Ｉバスとのデータ送受信を行うＳＣＳ Ｉプ
ロトコル・ドライバ／レシーバ（ＳＣＤＲＶ）である。
［動作説明 （第３図〜第５図）］
第３図はＳＣＳ Ｉバス４のホストコンピュータ１の制
御動作を示すフローチャートで、本プログラムは５Ｃ３
Ｉパス４のホストコンピュータ１のＲＯＭｌ−２に格納
されている。
御動作を示すフローチャートで、本プログラムは５Ｃ３
Ｉパス４のホストコンピュータ１のＲＯＭｌ−２に格納
されている。
本プログラムはホストコンピュータ１より５ＣＳＩパス
９への通信要求が生ずることにより開始され、まずステ
ップＳ１でバス接続装置５に５Ｃ３Ｉバス９のセレクト
コマンドを発行して、データ転送を行うＳＣ３Ｉバス９
のコントローラ（ＤＣＴＲ）のデバイスＩＤを通知する
。
９への通信要求が生ずることにより開始され、まずステ
ップＳ１でバス接続装置５に５Ｃ３Ｉバス９のセレクト
コマンドを発行して、データ転送を行うＳＣ３Ｉバス９
のコントローラ（ＤＣＴＲ）のデバイスＩＤを通知する
。
ステップＳ２ではバス接続装置５にＳＣＳ Ｉバス９の
コントローラに対する実行デバイスコマンド（ＲＥＡＤ
、ＷＲＩＴＥ等）を発行し、これ以降、ハス接続装置５
をＳＣ３Ｉバス９のデバイスコントローラ（ＤＣＴＲ）
そのものとみなしてデータ転送を行う。
コントローラに対する実行デバイスコマンド（ＲＥＡＤ
、ＷＲＩＴＥ等）を発行し、これ以降、ハス接続装置５
をＳＣ３Ｉバス９のデバイスコントローラ（ＤＣＴＲ）
そのものとみなしてデータ転送を行う。
第４図は５ＣＳＩバス４のコントローラ（ＬＣＴＲ）５
の動作を示すフローチャートで、本プログラムはＲＯＭ
５１に格納されている。
の動作を示すフローチャートで、本プログラムはＲＯＭ
５１に格納されている。
本プログラムはホストコンピュータ１よりのアクセスに
より開始され、ステップＳ１０で５ＣＳＩバス４のセレ
クト信号を確認する。ステップＳ１１でセレクトフラグ
がオンかどうか、即ち、ホストコンピュータ１よりＳＣ
Ｓ Ｉバス９のセレクトコマンドを既に受取っているか
を調べる。セレクトフラグがオンでなければ、ステップ
Ｓ１２に進み５Ｃ３Ｉバス４のセレクト信号に応答を返
す。次にステップＳ１３でホストコンピュータ１よりの
コマンドを入力し、ステップＳ１４でセレクトコマンド
かをみる。
より開始され、ステップＳ１０で５ＣＳＩバス４のセレ
クト信号を確認する。ステップＳ１１でセレクトフラグ
がオンかどうか、即ち、ホストコンピュータ１よりＳＣ
Ｓ Ｉバス９のセレクトコマンドを既に受取っているか
を調べる。セレクトフラグがオンでなければ、ステップ
Ｓ１２に進み５Ｃ３Ｉバス４のセレクト信号に応答を返
す。次にステップＳ１３でホストコンピュータ１よりの
コマンドを入力し、ステップＳ１４でセレクトコマンド
かをみる。
ステップＳ１４でホストコンピュータ１よりのセレクト
コマンドを受取ると、ステップｓ１５に進んでメモリ５
２のセレクトフラグをオンにし、ステップＳ１６でホス
トコンピュータ１よりのコマンド中に含まれている、５
ＣＳＩバス９のコントローラ（ＤＣＴＲ）のＩＤをメモ
リ５２に記憶する。そして、ステップＳｆ７でホストコ
ンピュータ１に、コマンド正常受付のステータスメツセ
ージを返送して処理を終了する。
コマンドを受取ると、ステップｓ１５に進んでメモリ５
２のセレクトフラグをオンにし、ステップＳ１６でホス
トコンピュータ１よりのコマンド中に含まれている、５
ＣＳＩバス９のコントローラ（ＤＣＴＲ）のＩＤをメモ
リ５２に記憶する。そして、ステップＳｆ７でホストコ
ンピュータ１に、コマンド正常受付のステータスメツセ
ージを返送して処理を終了する。
一方、ステップＳ１４でＳＣ３Ｉバス９のセレクトコマ
ンドを受取らないときはステップ１８に進み、５Ｃ３Ｉ
バス９のセレクトコマンドが未発行であることを、ＳＣ
Ｓ Ｉバス４によりホストコンピュータ１に知らせて処
理を終了する。
ンドを受取らないときはステップ１８に進み、５Ｃ３Ｉ
バス９のセレクトコマンドが未発行であることを、ＳＣ
Ｓ Ｉバス４によりホストコンピュータ１に知らせて処
理を終了する。
ステップＳｉｔでセレクトフラグがオンであれば、既に
５Ｃ５Ｉバス９のセレクトコマンドが発行されているた
めステップＳ１９に進み、５ＣＳＩバスのバス接続装置
５′に通信回線６を通してＳＣ３Ｉバス９のコントロー
ラ（ＤＣＴＲ）のセレクトコマンドを発行する。これは
、実際にデータ転送を行・うＳＣ３Ｉバス９のデバイス
コントローラ（ＤＣＴＲ）とバス接続装置５′との間で
の５Ｃ３Ｉバス９の使用権を、バス接続装置５′に獲得
するように要求するものである。
５Ｃ５Ｉバス９のセレクトコマンドが発行されているた
めステップＳ１９に進み、５ＣＳＩバスのバス接続装置
５′に通信回線６を通してＳＣ３Ｉバス９のコントロー
ラ（ＤＣＴＲ）のセレクトコマンドを発行する。これは
、実際にデータ転送を行・うＳＣ３Ｉバス９のデバイス
コントローラ（ＤＣＴＲ）とバス接続装置５′との間で
の５Ｃ３Ｉバス９の使用権を、バス接続装置５′に獲得
するように要求するものである。
ステップ３２０でイ（入接続装置５′からのコントロー
ラ・セレクトコマンド受理のステータスを受信したかを
調べ、受理ステータスを受信しないときはステップＳ２
１に進んで、５ＣＳＩバス９が未獲得であることをホス
トコンピュータ１に伝える。
ラ・セレクトコマンド受理のステータスを受信したかを
調べ、受理ステータスを受信しないときはステップＳ２
１に進んで、５ＣＳＩバス９が未獲得であることをホス
トコンピュータ１に伝える。
バス接続装置５′によりセレクトコマンドが受理された
ことが確認されるとステップＳ２２に進み、ホストコン
ピュータ１よりのＳＣＳ Ｉパス４のセレクト信号に応
答を返す、ステップＳ２３でバス接続装置５′に、ホス
トコンピュータ１から送られてくるデバイスＩＤやデー
タ等を、回線制御部５３より通信回線６を介してに送出
するとともに、通信回線６から受信したデータ・ステー
タスメツセージをＳＣＳ Ｉバス４を介してホストコン
ピュータ１に送出する。
ことが確認されるとステップＳ２２に進み、ホストコン
ピュータ１よりのＳＣＳ Ｉパス４のセレクト信号に応
答を返す、ステップＳ２３でバス接続装置５′に、ホス
トコンピュータ１から送られてくるデバイスＩＤやデー
タ等を、回線制御部５３より通信回線６を介してに送出
するとともに、通信回線６から受信したデータ・ステー
タスメツセージをＳＣＳ Ｉバス４を介してホストコン
ピュータ１に送出する。
こうしてステップ３２４でホストコンピュータ１よりの
コマンドの実行が終了すると、ステップＳ２５でメモリ
５２のセレクトフラグをオフにして処理を終了する。
コマンドの実行が終了すると、ステップＳ２５でメモリ
５２のセレクトフラグをオフにして処理を終了する。
第５図はＳＣＳ Ｉバス９のバス接続装置５′の制御動
作を示すフローチャートで、本プログラムはバス接続装
置５よりのコマンド受信により開始される。
作を示すフローチャートで、本プログラムはバス接続装
置５よりのコマンド受信により開始される。
ステップ５．３０でバス接続装置５よりのデータを回線
制御部５３により受信すると、ステップＳ３１でバス接
続装置５′の選択コマンドかをみる。これは第４図のス
テップＳ１９で出力される選択コマンドに対応している
。
制御部５３により受信すると、ステップＳ３１でバス接
続装置５′の選択コマンドかをみる。これは第４図のス
テップＳ１９で出力される選択コマンドに対応している
。
選択コマンドのときはステップＳ３２に進み、コマンド
で指示されたＳＣＳ Ｉバス９のデバイスコントローラ
（ＤＣＴＲ）とバス接続装置５′との間でＳＣ３Ｉバス
９の使用権を獲得する。使用権が獲得できればステップ
３３３でバス接続装置５に選択コマンドの応答ステータ
スを返送する。
で指示されたＳＣＳ Ｉバス９のデバイスコントローラ
（ＤＣＴＲ）とバス接続装置５′との間でＳＣ３Ｉバス
９の使用権を獲得する。使用権が獲得できればステップ
３３３でバス接続装置５に選択コマンドの応答ステータ
スを返送する。
これにより、バス接続装置５の処理は第４図のステップ
Ｓ２０からステップＳ２２に進む。
Ｓ２０からステップＳ２２に進む。
一方、ステップＳ３１でコントローラセレクトコマンド
でなければステップＳ３４に進み、５ｃＳＩパス９の使
用権が獲得さ゛れているかをみる。
でなければステップＳ３４に進み、５ｃＳＩパス９の使
用権が獲得さ゛れているかをみる。
使用権がなければステップＳ３５に進み、５ｃｓＩバス
９の使用権が未獲得であることを示すメツセージをバス
接続装置５に送る。
９の使用権が未獲得であることを示すメツセージをバス
接続装置５に送る。
ステップＳ３４でＳＣＳ Ｉバス９の使用権があればス
テップＳ３６に進み、バス接続装置５より受信したデー
タを５Ｃ３Ｉバス９のデバイスコントローラに転送し、
ステップＳ３フで５Ｃ３Ｉパスタのデバイスコントロー
ラからのデータやステータス信号等を入力し、通信回線
６を介してバス接続装置５に転送する。
テップＳ３６に進み、バス接続装置５より受信したデー
タを５Ｃ３Ｉバス９のデバイスコントローラに転送し、
ステップＳ３フで５Ｃ３Ｉパスタのデバイスコントロー
ラからのデータやステータス信号等を入力し、通信回線
６を介してバス接続装置５に転送する。
以上説明したように本実施例によれば、少なくとも２組
のＳＣ３Ｉバスをバス接続装置により通信回線を介して
接続制御することにより、遠隔の別のＳＣＳ Ｉバス上
のデバイスを、同一の５Ｃ３Ｉバス上のデバイスとみな
してデータ転送することが可能となる。
のＳＣ３Ｉバスをバス接続装置により通信回線を介して
接続制御することにより、遠隔の別のＳＣＳ Ｉバス上
のデバイスを、同一の５Ｃ３Ｉバス上のデバイスとみな
してデータ転送することが可能となる。
また、このようにして更に多くのＳＣ３Ｉバスを接続し
ていくことにより、システムの拡張が容易に行える効果
がある。尚、本実施例では本発明を５Ｃ３Ｉバスに用い
た構成の説明を行ったが、バス使用権獲得プロトコルを
有する他の汎用バスにも適用可能である。
ていくことにより、システムの拡張が容易に行える効果
がある。尚、本実施例では本発明を５Ｃ３Ｉバスに用い
た構成の説明を行ったが、バス使用権獲得プロトコルを
有する他の汎用バスにも適用可能である。
［発明の効果］
以上述べたように本発明によれば、少なくとも２つの汎
用バス同士を接続し、他の汎用バスの周辺制御装置等と
の間で、同じ汎用バス上のデバイスと同様にデータ転送
を行うことができる効果がある。
用バス同士を接続し、他の汎用バスの周辺制御装置等と
の間で、同じ汎用バス上のデバイスと同様にデータ転送
を行うことができる効果がある。
第１図は本実施例のバス接続装置を用いた情報処理シス
テム構築例を示す図、 第２図は実施例のバス接続装置の概略構成を示すブロッ
ク図、 第３図は本実施例のＳＣ３Ｉホストコンピュータの制御
フローチャート、 第４図は本実施例のホストコンピュータ側の５Ｃ３Ｉバ
スの接続装置の制御動作を示すフローチャート、 第５図は本実施例の他のＳＣＳ Ｉバス側のバス接続装
置の制御動作を示すフローチャートである。 図中、１・・・ホストコンピュータ、２，３，７〜８・
・・デバイスコントローラ（ＤＣＴＲ）、４．９・・・
ＳＣＳ Ｉパス、５．５′・・・バス接続装置（ＬＣＴ
Ｒ）、６・・・通信回線、５０・・−ＭＰＵ、５１・・
・ＲＯＭ、５２・・・メモリ、５３・・・回線制御部、
５４・・・５ＣＳＩプロトコル・ドライバ／レシーバ（
ＳＣＤＲＶ）である。 第１図 第２図 第３図 第５図
テム構築例を示す図、 第２図は実施例のバス接続装置の概略構成を示すブロッ
ク図、 第３図は本実施例のＳＣ３Ｉホストコンピュータの制御
フローチャート、 第４図は本実施例のホストコンピュータ側の５Ｃ３Ｉバ
スの接続装置の制御動作を示すフローチャート、 第５図は本実施例の他のＳＣＳ Ｉバス側のバス接続装
置の制御動作を示すフローチャートである。 図中、１・・・ホストコンピュータ、２，３，７〜８・
・・デバイスコントローラ（ＤＣＴＲ）、４．９・・・
ＳＣＳ Ｉパス、５．５′・・・バス接続装置（ＬＣＴ
Ｒ）、６・・・通信回線、５０・・−ＭＰＵ、５１・・
・ＲＯＭ、５２・・・メモリ、５３・・・回線制御部、
５４・・・５ＣＳＩプロトコル・ドライバ／レシーバ（
ＳＣＤＲＶ）である。 第１図 第２図 第３図 第５図
Claims (1)
- 【特許請求の範囲】 少なくとも１つのコンピュータと周辺制御装置を接続し
たバス使用権獲得プロトコルを有する汎用バスに接続さ
れたバス制御装置であつて、回線を介して他の前記汎用
バスのバス制御装置との通信制御を行う通信手段と、 前記コンピュータにより指示された他の前記汎用バスと
の間で、前記通信手段によりデータ転送を行う転送手段
とを備えることを特徴とするバス制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62303269A JPH01147652A (ja) | 1987-12-02 | 1987-12-02 | バス制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62303269A JPH01147652A (ja) | 1987-12-02 | 1987-12-02 | バス制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01147652A true JPH01147652A (ja) | 1989-06-09 |
Family
ID=17918924
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62303269A Pending JPH01147652A (ja) | 1987-12-02 | 1987-12-02 | バス制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01147652A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7763999B2 (en) | 2006-07-20 | 2010-07-27 | Sanyo Denki Co., Ltd | Stator for rotary electric machines |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6069764A (ja) * | 1983-09-26 | 1985-04-20 | Fujitsu Ltd | バス延長回路 |
| JPS6174052A (ja) * | 1984-09-19 | 1986-04-16 | Toshiba Corp | デ−タ処理装置 |
| JPS63263514A (ja) * | 1987-04-21 | 1988-10-31 | Yokogawa Electric Corp | Ｓｃｓｉバスの平衡／不平衡変換装置 |
-
1987
- 1987-12-02 JP JP62303269A patent/JPH01147652A/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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