JP7411415B2 - アレイ基板、その検出方法、ディスプレイパネル及びディスプレイデバイス - Google Patents
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Description
本開示は、2018年08月24日に中国特許庁に提出した、出願番号が201810973788.2であり、出願名称が「アレイ基板、その検出方法、ディスプレイパネル及びディスプレイデバイス」の中国特許出願の優先権を主張し、その全内容が引用により本願に組み込まれる。
表示領域と前記表示領域を囲む周辺領域を有するベース基板と、
アレイが前記表示領域内に配置される複数のサブピクセルユニットと、
各データ線が対応する列の前記サブピクセルユニットに電気接続する複数のデータ線と、
前記周辺領域の第1側面に位置し、前記第1スイッチングトランジスタのドレインは1つの前記データ線に電気接続する少なくとも1つの第1スイッチングトランジスタであって、前記第1スイッチングトランジスタのドレインに接続された前記データ線は第1データ線である、前記少なくとも1つの第1スイッチングトランジスタと、
前記周辺領域の第1側面に位置し、前記第1スイッチングトランジスタのゲートに電気接続するゲート制御線と、
少なくとも前記周辺領域の第1側面と第2側面に位置し、前記第1スイッチングトランジスタのソースに電気接続する少なくとも1つの検出線であって、前記第1側面と第2側面は隣接する側面である前記少なくとも1つの検出線と、を含む。
前記検出線は、前記第1データ線の第1端部から、前記周辺領域の第1側面、第2側面と第3側面に沿って前記第1データ線の第2端部までに延びる第1部分を含み、前記第3側面は前記第1側面と対向する側面である。
前記検出線の前記第1部分と前記第2部分の和は少なくとも前記表示領域を1周囲む。
各前記検出線中の前記第1部分と前記第2部分の、前記周辺領域における側面は同じである。
各前記第2スイッチングトランジスタのソースそれぞれは表示検出電源線に電気接続し、各前記第2スイッチングトランジスタのゲートそれぞれは前記ゲート制御線に電気接続し、各前記第2スイッチングトランジスタのドレインはそれぞれ対応するデータ線に電気接続する。
前記選択制御回路は、前記アレイ基板に亀裂があるかどうかを検出する際に前記第1スイッチングトランジスタのソースと前記検出線との伝導を制御し、前記アレイ基板に表示が正常であるかどうかを検出する際に前記第1スイッチングトランジスタのソースと前記表示検出電源線との伝導を制御するように配置する。
前記検出線にプリセットされた電圧の検出信号を印加し、且つ前記ゲート制御線にゲート制御信号を印加し、且つ前記ゲート制御信号の電圧と前記プリセットされた電圧との差は前記第1スイッチングトランジスタの閾値電圧より小さく、
前記第1データ線に電気接続したサブピクセルユニットが発光する時に、前記アレイ基板に亀裂があると判断し、前記第1データ線に電気接続したサブピクセルユニットが発光しない時に、前記アレイ基板に亀裂がないと判断する。
第3態様によれば、本開示の実施形態は、第1態様のアレイ基板を含むディスプレイパネルをさらに提供する。
Claims (17)
- 表示領域と前記表示領域を囲む周辺領域を有するベース基板と、
アレイが前記表示領域内に配置される複数のサブピクセルユニットと、
各データ線が対応する列の前記サブピクセルユニットに電気接続する複数のデータ線と、
前記周辺領域の第1側面に位置し、第1スイッチングトランジスタのドレインは1つの前記データ線に電気接続する少なくとも1つの第1スイッチングトランジスタであって、前記第1スイッチングトランジスタのドレインに接続された前記データ線は第1データ線である、前記少なくとも1つの第1スイッチングトランジスタと、
前記周辺領域の第1側面に位置し、前記第1スイッチングトランジスタのゲートに電気接続するゲート制御線と、
少なくとも前記周辺領域の第1側面と第2側面に位置し、前記第1スイッチングトランジスタのソースに電気接続する少なくとも1つの検出線であって、前記第1側面と第2側面は隣接する側面である前記少なくとも1つの検出線と、
前記周辺領域に位置し、且つ前記第1データ線を除くほかの各前記データ線に1対1に対応する第2スイッチングトランジスタとを含み、
各前記第2スイッチングトランジスタのソースそれぞれは表示検出電源線に電気接続し、各前記第2スイッチングトランジスタのゲートそれぞれは前記ゲート制御線に電気接続し、各前記第2スイッチングトランジスタのドレインはそれぞれ対応するデータ線に電気接続し、
各前記第1スイッチングトランジスタは選択制御回路を介して前記検出線に電気接続し、
前記選択制御回路は、アレイ基板に亀裂があるかどうかを検出する際に前記第1スイッチングトランジスタのソースと前記検出線との伝導を制御し、前記アレイ基板に表示が正常であるかどうかを検出する際に前記第1スイッチングトランジスタのソースと前記表示検出電源線との伝導を制御するように配置される、アレイ基板。 - 前記第1スイッチングトランジスタは、対応する前記第1データ線の第1端部に位置し、
前記検出線は、前記第1データ線の第1端部から、前記周辺領域の第1側面、第2側面と第3側面に沿って前記第1データ線の第2端部までに延びる第1部分を含み、前記第3側面は前記第1側面と対向する側面である請求項1に記載のアレイ基板。 - 前記検出線の信号入力端は前記第1側面に位置し、前記検出線は、前記第1データ線の第2端部から前記周辺領域の第3側面、第2側面と第1側面に沿って前記信号入力端までに延びる第2部分をさらに含む請求項2に記載のアレイ基板。
- 前記検出線は前記周辺領域の第2側面の部分に複数のバイパストレース部を有する請求項3に記載のアレイ基板。
- 前記バイパストレース部は前記第2部分に位置することを特徴とする請求項4に記載のアレイ基板。
- 前記周辺領域に1本の検出線が設置されており、
前記検出線の前記第1部分と前記第2部分の和は少なくとも前記表示領域を1周囲む請求項3に記載のアレイ基板。 - 前記第1部分は前記周辺領域の第1側面に位置しバイパス部分として呈される請求項6に記載のアレイ基板。
- 前記周辺領域に2本の検出線が設置されており、
各前記検出線中の前記第1部分と前記第2部分の、前記周辺領域における側面は同じである請求項3から請求項5のいずれか一項に記載のアレイ基板。 - 2本の前記検出線が対称的に設置される請求項8に記載のアレイ基板。
- 同一の前記検出線は複数の前記第1スイッチングトランジスタのソースに電気接続する請求項1から請求項7のいずれか一項に記載のアレイ基板。
- 前記第1データ線に電気接続したサブピクセルユニットすべては緑色のサブピクセルユニットである請求項1から請求項7のいずれか一項に記載のアレイ基板。
- 前記第1スイッチングトランジスタと前記第2スイッチングトランジスタは前記周辺領域の第1側面に位置する請求項1に記載のアレイ基板。
- 前記表示検出電源線と前記ゲート制御線は平行に設置される請求項12に記載のアレイ基板。
- 前記検出線にプリセットされた電圧の検出信号を印加し、且つ前記ゲート制御線にゲート制御信号を印加し、且つ前記ゲート制御信号の電圧と前記プリセットされた電圧との差は前記第1スイッチングトランジスタの閾値電圧より小さく、
前記第1データ線に電気接続したサブピクセルユニットが発光する時に、前記アレイ基板に亀裂があると判断し、前記第1データ線に電気接続したサブピクセルユニットが発光しない時に、前記アレイ基板に亀裂がないと判断する請求項1から請求項13のいずれか一項に記載のアレイ基板の検出方法。 - 請求項1から請求項13のいずれか一項に記載のアレイ基板を含むディスプレイパネル。
- 前記ディスプレイパネルは有機発光ダイオードディスプレイパネルである請求項15に記載のディスプレイパネル。
- 請求項15または請求項16に記載のディスプレイパネルを含むディスプレイデバイス。
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