JP7356287B2 - 半導体レーザ駆動装置、および、電子機器 - Google Patents

半導体レーザ駆動装置、および、電子機器 Download PDF

Info

Publication number
JP7356287B2
JP7356287B2 JP2019144174A JP2019144174A JP7356287B2 JP 7356287 B2 JP7356287 B2 JP 7356287B2 JP 2019144174 A JP2019144174 A JP 2019144174A JP 2019144174 A JP2019144174 A JP 2019144174A JP 7356287 B2 JP7356287 B2 JP 7356287B2
Authority
JP
Japan
Prior art keywords
semiconductor laser
driver
laser
substrate
driving device
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
JP2019144174A
Other languages
English (en)
Other versions
JP2021027182A (ja
Inventor
清久 酒井
浩永 安川
真行 長尾
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sony Semiconductor Solutions Corp
Original Assignee
Sony Semiconductor Solutions Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Sony Semiconductor Solutions Corp filed Critical Sony Semiconductor Solutions Corp
Priority to JP2019144174A priority Critical patent/JP7356287B2/ja
Priority to EP20742950.7A priority patent/EP4010952A1/en
Priority to CN202080055289.0A priority patent/CN114556722A/zh
Priority to US17/626,278 priority patent/US20220293545A1/en
Priority to PCT/JP2020/025772 priority patent/WO2021024652A1/en
Publication of JP2021027182A publication Critical patent/JP2021027182A/ja
Application granted granted Critical
Publication of JP7356287B2 publication Critical patent/JP7356287B2/ja
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00—Semiconductor lasers
    • H01S5/02—Structural details or components not essential to laser action
    • H01S5/022—Mountings; Housings
    • H01S5/023—Mount members, e.g. sub-mount members
    • H01S5/02315—Support members, e.g. bases or carriers
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/18—High density interconnect [HDI] connectors; Manufacturing methods related thereto
    • H01L24/20—Structure, shape, material or disposition of high density interconnect preforms
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00—Semiconductor lasers
    • H01S5/02—Structural details or components not essential to laser action
    • H01S5/024—Arrangements for thermal management
    • H01S5/02469—Passive cooling, e.g. where heat is removed by the housing as a whole or by a heat pipe without any active cooling element like a TEC
    • G—PHYSICS
    • G01—MEASURING; TESTING
    • G01S—RADIO DIRECTION-FINDING; RADIO NAVIGATION; DETERMINING DISTANCE OR VELOCITY BY USE OF RADIO WAVES; LOCATING OR PRESENCE-DETECTING BY USE OF THE REFLECTION OR RERADIATION OF RADIO WAVES; ANALOGOUS ARRANGEMENTS USING OTHER WAVES
    • G01S7/00—Details of systems according to groups G01S13/00, G01S15/00, G01S17/00
    • G01S7/48—Details of systems according to groups G01S13/00, G01S15/00, G01S17/00 of systems according to group G01S17/00
    • G01S7/481—Constructional features, e.g. arrangements of optical elements
    • G01S7/4814—Constructional features, e.g. arrangements of optical elements of transmitters alone
    • G—PHYSICS
    • G01—MEASURING; TESTING
    • G01S—RADIO DIRECTION-FINDING; RADIO NAVIGATION; DETERMINING DISTANCE OR VELOCITY BY USE OF RADIO WAVES; LOCATING OR PRESENCE-DETECTING BY USE OF THE REFLECTION OR RERADIATION OF RADIO WAVES; ANALOGOUS ARRANGEMENTS USING OTHER WAVES
    • G01S7/00—Details of systems according to groups G01S13/00, G01S15/00, G01S17/00
    • G01S7/48—Details of systems according to groups G01S13/00, G01S15/00, G01S17/00 of systems according to group G01S17/00
    • G01S7/491—Details of non-pulse systems
    • G01S7/4911—Transmitters
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00—Details of semiconductor or other solid state devices
    • H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
    • H01L23/49822—Multilayer substrates
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00—Details of semiconductor or other solid state devices
    • H01L23/52—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames
    • H01L23/538—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames the interconnection structure between a plurality of semiconductor chips being formed on, or in, insulating substrates
    • H01L23/5389—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames the interconnection structure between a plurality of semiconductor chips being formed on, or in, insulating substrates the chips being integrally enclosed by the interconnect and support structures
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/18—High density interconnect [HDI] connectors; Manufacturing methods related thereto
    • H01L24/19—Manufacturing methods of high density interconnect preforms
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00—Semiconductor lasers
    • H01S5/02—Structural details or components not essential to laser action
    • H01S5/022—Mountings; Housings
    • H01S5/023—Mount members, e.g. sub-mount members
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00—Semiconductor lasers
    • H01S5/02—Structural details or components not essential to laser action
    • H01S5/022—Mountings; Housings
    • H01S5/0233—Mounting configuration of laser chips
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00—Semiconductor lasers
    • H01S5/02—Structural details or components not essential to laser action
    • H01S5/022—Mountings; Housings
    • H01S5/0233—Mounting configuration of laser chips
    • H01S5/02345—Wire-bonding
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00—Semiconductor lasers
    • H01S5/02—Structural details or components not essential to laser action
    • H01S5/022—Mountings; Housings
    • H01S5/0235—Method for mounting laser chips
    • H—ELECTRICITY
    • H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00—Printed circuits
    • H05K1/02—Details
    • H05K1/11—Printed elements for providing electric connections to or between printed circuits
    • H05K1/115—Via connections; Lands around holes or via connections
    • H—ELECTRICITY
    • H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00—Printed circuits
    • H05K1/18—Printed circuits structurally associated with non-printed electric components
    • H05K1/182—Printed circuits structurally associated with non-printed electric components associated with components mounted in the printed circuit board, e.g. insert mounted components [IMC]
    • H05K1/185—Components encapsulated in the insulating substrate of the printed circuit or incorporated in internal layers of a multilayer circuit
    • H05K1/186—Components encapsulated in the insulating substrate of the printed circuit or incorporated in internal layers of a multilayer circuit manufactured by mounting on or connecting to patterned circuits before or during embedding
    • G—PHYSICS
    • G01—MEASURING; TESTING
    • G01S—RADIO DIRECTION-FINDING; RADIO NAVIGATION; DETERMINING DISTANCE OR VELOCITY BY USE OF RADIO WAVES; LOCATING OR PRESENCE-DETECTING BY USE OF THE REFLECTION OR RERADIATION OF RADIO WAVES; ANALOGOUS ARRANGEMENTS USING OTHER WAVES
    • G01S17/00—Systems using the reflection or reradiation of electromagnetic waves other than radio waves, e.g. lidar systems
    • G01S17/88—Lidar systems specially adapted for specific applications
    • G01S17/89—Lidar systems specially adapted for specific applications for mapping or imaging
    • G01S17/894—3D imaging with simultaneous measurement of time-of-flight at a 2D array of receiver pixels, e.g. time-of-flight cameras or flash lidar
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/04105—Bonding areas formed on an encapsulation of the semiconductor or solid-state body, e.g. bonding areas on chip-scale packages
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/07—Structure, shape, material or disposition of the bonding areas after the connecting process
    • H01L2224/08—Structure, shape, material or disposition of the bonding areas after the connecting process of an individual bonding area
    • H01L2224/081—Disposition
    • H01L2224/0812—Disposition the bonding area connecting directly to another bonding area, i.e. connectorless bonding, e.g. bumpless bonding
    • H01L2224/08151—Disposition the bonding area connecting directly to another bonding area, i.e. connectorless bonding, e.g. bumpless bonding the bonding area connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/08221—Disposition the bonding area connecting directly to another bonding area, i.e. connectorless bonding, e.g. bumpless bonding the bonding area connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/08225—Disposition the bonding area connecting directly to another bonding area, i.e. connectorless bonding, e.g. bumpless bonding the bonding area connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/18—High density interconnect [HDI] connectors; Manufacturing methods related thereto
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/27—Manufacturing methods
    • H01L2224/274—Manufacturing methods by blanket deposition of the material of the layer connector
    • H01L2224/2743—Manufacturing methods by blanket deposition of the material of the layer connector in solid form
    • H01L2224/27436—Lamination of a preform, e.g. foil, sheet or layer
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29099—Material
    • H01L2224/2919—Material with a principal constituent of the material being a polymer, e.g. polyester, phenolic based polymer, epoxy
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321—Disposition
    • H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481—Disposition
    • H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/48227—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732—Location after the connecting process
    • H01L2224/73251—Location after the connecting process on different surfaces
    • H01L2224/73267—Layer and HDI connectors
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • H01L2224/8319—Arrangement of the layer connectors prior to mounting
    • H01L2224/83191—Arrangement of the layer connectors prior to mounting wherein the layer connectors are disposed only on the semiconductor or solid-state body
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/91—Methods for connecting semiconductor or solid state bodies including different methods provided for in two or more of groups H01L2224/80 - H01L2224/90
    • H01L2224/92—Specific sequence of method steps
    • H01L2224/922—Connecting different surfaces of the semiconductor or solid-state body with connectors of different types
    • H01L2224/9222—Sequential connecting processes
    • H01L2224/92242—Sequential connecting processes the first connecting process involving a layer connector
    • H01L2224/92244—Sequential connecting processes the first connecting process involving a layer connector the second connecting process involving a build-up interconnect
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00—Details of semiconductor or other solid state devices
    • H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
    • H01L23/49811—Additional leads joined to the metallisation on the insulating substrate, e.g. pins, bumps, wires, flat leads
    • H01L23/49816—Spherical bumps on the substrate for external connection, e.g. ball grid arrays [BGA]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/02—Bonding areas ; Manufacturing methods related thereto
    • H01L24/07—Structure, shape, material or disposition of the bonding areas after the connecting process
    • H01L24/08—Structure, shape, material or disposition of the bonding areas after the connecting process of an individual bonding area
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L24/27—Manufacturing methods
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L24/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L24/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L24/31—Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L24/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42—Wire connectors; Manufacturing methods related thereto
    • H01L24/47—Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L24/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10—Details of semiconductor or other solid state devices to be connected
    • H01L2924/11—Device type
    • H01L2924/12—Passive devices, e.g. 2 terminal devices
    • H01L2924/1204—Optical Diode
    • H01L2924/12042—LASER
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10—Details of semiconductor or other solid state devices to be connected
    • H01L2924/11—Device type
    • H01L2924/12—Passive devices, e.g. 2 terminal devices
    • H01L2924/1204—Optical Diode
    • H01L2924/12043—Photo diode
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10—Details of semiconductor or other solid state devices to be connected
    • H01L2924/11—Device type
    • H01L2924/14—Integrated circuits
    • H01L2924/141—Analog devices
    • H01L2924/1426—Driver
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151—Die mounting substrate
    • H01L2924/153—Connection portion
    • H01L2924/1531—Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface
    • H01L2924/15311—Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface being a ball array, e.g. BGA
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151—Die mounting substrate
    • H01L2924/153—Connection portion
    • H01L2924/1531—Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface
    • H01L2924/15313—Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface being a land array, e.g. LGA
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/19—Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
    • H01L2924/191—Disposition
    • H01L2924/19101—Disposition of discrete passive components
    • H01L2924/19105—Disposition of discrete passive components in a side-by-side arrangement on a common die mounting substrate
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00—Semiconductor lasers
    • H01S5/02—Structural details or components not essential to laser action
    • H01S5/022—Mountings; Housings
    • H01S5/02208—Mountings; Housings characterised by the shape of the housings
    • H01S5/02216—Butterfly-type, i.e. with electrode pins extending horizontally from the housings
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00—Semiconductor lasers
    • H01S5/02—Structural details or components not essential to laser action
    • H01S5/022—Mountings; Housings
    • H01S5/0225—Out-coupling of light
    • H01S5/02257—Out-coupling of light using windows, e.g. specially adapted for back-reflecting light to a detector inside the housing
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00—Semiconductor lasers
    • H01S5/02—Structural details or components not essential to laser action
    • H01S5/022—Mountings; Housings
    • H01S5/023—Mount members, e.g. sub-mount members
    • H01S5/02325—Mechanically integrated components on mount members or optical micro-benches
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00—Semiconductor lasers
    • H01S5/02—Structural details or components not essential to laser action
    • H01S5/024—Arrangements for thermal management
    • H01S5/02476—Heat spreaders, i.e. improving heat flow between laser chip and heat dissipating elements
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00—Semiconductor lasers
    • H01S5/04—Processes or apparatus for excitation, e.g. pumping, e.g. by electron beams
    • H01S5/042—Electrical excitation ; Circuits therefor
    • H01S5/0425—Electrodes, e.g. characterised by the structure
    • H01S5/04256—Electrodes, e.g. characterised by the structure characterised by the configuration
    • H01S5/04257—Electrodes, e.g. characterised by the structure characterised by the configuration having positive and negative electrodes on the same side of the substrate
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00—Semiconductor lasers
    • H01S5/04—Processes or apparatus for excitation, e.g. pumping, e.g. by electron beams
    • H01S5/042—Electrical excitation ; Circuits therefor
    • H01S5/0427—Electrical excitation ; Circuits therefor for applying modulation to the laser
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00—Semiconductor lasers
    • H01S5/06—Arrangements for controlling the laser output parameters, e.g. by operating on the active medium
    • H01S5/062—Arrangements for controlling the laser output parameters, e.g. by operating on the active medium by varying the potential of the electrodes
    • H01S5/06226—Modulation at ultra-high frequencies
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00—Semiconductor lasers
    • H01S5/06—Arrangements for controlling the laser output parameters, e.g. by operating on the active medium
    • H01S5/068—Stabilisation of laser output parameters
    • H01S5/0683—Stabilisation of laser output parameters by monitoring the optical output parameters
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
    • H01S5/00—Semiconductor lasers
    • H01S5/40—Arrangement of two or more semiconductor lasers, not provided for in groups H01S5/02 - H01S5/30
    • H01S5/4025—Array arrangements, e.g. constituted by discrete laser diodes or laser bar
    • H—ELECTRICITY
    • H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00—Printed circuits
    • H05K1/02—Details
    • H05K1/0201—Thermal arrangements, e.g. for cooling, heating or preventing overheating
    • H05K1/0203—Cooling of mounted components
    • H05K1/0204—Cooling of mounted components using means for thermal conduction connection in the thickness direction of the substrate
    • H05K1/0206—Cooling of mounted components using means for thermal conduction connection in the thickness direction of the substrate by printed thermal vias
    • H—ELECTRICITY
    • H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00—Printed circuits
    • H05K1/18—Printed circuits structurally associated with non-printed electric components
    • H05K1/181—Printed circuits structurally associated with non-printed electric components associated with surface mounted components
    • H—ELECTRICITY
    • H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00—Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/10—Details of components or other objects attached to or integrated in a printed circuit board
    • H05K2201/10007—Types of components
    • H05K2201/10106—Light emitting diode [LED]

Landscapes

  • Physics & Mathematics (AREA)
  • Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Electromagnetism (AREA)
  • Optics & Photonics (AREA)
  • Power Engineering (AREA)
  • Computer Hardware Design (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Radar, Positioning & Navigation (AREA)
  • Remote Sensing (AREA)
  • Manufacturing & Machinery (AREA)
  • Semiconductor Lasers (AREA)
  • Production Of Multi-Layered Print Wiring Board (AREA)
  • Structures For Mounting Electric Components On Printed Circuit Boards (AREA)
  • Structure Of Printed Boards (AREA)
  • Cooling Or The Like Of Semiconductors Or Solid State Devices (AREA)

Description

本技術は、半導体レーザ駆動装置に関する。詳しくは、レーザドライバを基板に内蔵した半導体レーザ駆動装置、および、電子機器に関する。
従来、測距機能を持つ電子装置において、ＴｏＦ（Time of Flight）と呼ばれる測距方式がよく用いられている。このＴｏＦは、発光部がサイン波や矩形波の照射光を物体に照射し、その物体からの反射光を受光部が受光して、測距演算部が照射光と反射光との位相差から距離を測定する方式である。そのような測距機能を実現するため、発光素子と、その発光素子を駆動する電子半導体チップとをケース内に収容して一体化した光モジュールが知られている。例えば、基板の電極パターン上に整列して実装されたレーザーダイオードアレイと、レーザーダイオードアレイに電気的に接続されたレーザドライバとを備える光モジュールが提案されている（例えば、特許文献１参照。）。
特開２００９－１７０６７５号公報
上述の従来技術では、レーザーダイオードアレイとレーザドライバとを光モジュールとして一体化して構成している。しかしながら、この従来技術では、レーザドライバが基板に内蔵されている。このため、基板の放熱性能が低い場合、レーザドライバで生じた熱を基板が放熱しきれず、その熱がレーザダイオードに伝導してレーザダイオードの発光特性を低下させてしまう、という問題がある。
本技術はこのような状況に鑑みて生み出されたものであり、レーザドライバを設けた半導体レーザ駆動装置において、放熱性能を向上させることを目的とする。
本技術は、上述の問題点を解消するためになされたものであり、その第１の側面は、レーザドライバを内蔵する基板と、上記基板の一方の面に実装された半導体レーザと、上記レーザドライバと上記半導体レーザとを０．５ナノヘンリー以下の配線インダクタンスにより電気接続する接続配線と、上記レーザドライバと上記基板の他方の面との間に設けられて上記レーザドライバで生じた熱を上記他方の面へ放出するドライバ側サーマルビアとを具備する半導体レーザ駆動装置である。これにより、レーザドライバで生じた熱がドライバ側サーマルビアにより放出されるという作用をもたらす。
また、この第１の側面において、上記基板の上記一方の面とは反対の面において外部との接続端子をさらに具備し、上記ドライバ側サーマルビアの一端は、上記接続端子に接続されてもよい。これにより、レーザドライバで生じた熱が接続端子へ放出されるという作用をもたらす。
また、この第１の側面において、上記基板は、絶縁層および導体を含み、上記導体と上記レーザドライバとの間には上記絶縁層が配置され、上記ドライバ側サーマルビアの他端は、上記導体に接続されてもよい。これにより、レーザドライバで生じた熱が導体およびドライバ側サーマルビアにより放出されるという作用をもたらす。
また、この第１の側面において、上記レーザドライバの所定平面に形成された金属膜をさらに具備し、上記ドライバ側サーマルビアの他端は、上記金属膜に接続されてもよい。これにより、レーザドライバで生じた熱が、金属膜およびドライバ側サーマルビアにより放出されるという作用をもたらす。
また、この第１の側面において、上記接続端子は、半田ボール、銅コアボール、銅ピラーバンプ、および、ランドグリッドアレイの少なくとも何れか１つにより形成されてもよい。
また、この第１の側面において、上記接続配線は、０．５ミリメートル以下の長さを備えることが望ましい。また、上記接続配線は、０．３ミリメートル以下であることがより好ましい。
また、この第１の側面において、上記接続配線は、上記基板に設けられる接続ビアを介してもよい。これにより、配線長を短くするという作用をもたらす。
また、この第１の側面において、上記半導体レーザは、その一部が上記レーザドライバの上方に重ねて配置されるようにしてもよい。この場合において、上記半導体レーザは、その面積の５０％以下の部分が上記レーザドライバの上方に重ねて配置されるようにしてもよい。
また、この第１の側面において、上記基板は、上記半導体レーザが実装された位置においてレーザ側サーマルビアを備えるようにしてもよい。これにより、放熱を促進するという作用をもたらす。
また、この第１の側面において、上記基板の上記一方の面において上記半導体レーザを含む領域を囲う外壁と、上記外壁に囲まれた領域の上方を覆う拡散板とをさらに具備してもよい。
また、この第１の側面において、上記基板の上記一方の面に実装されて上記半導体レーザから照射されたレーザ光の光強度を監視するフォトダイオードをさらに具備してもよい。これにより、半導体レーザの出力を一定に維持するという作用をもたらす。
また、本技術の第２の側面は、レーザドライバを内蔵する基板と、上記基板の一方の面に実装された半導体レーザと、上記レーザドライバと上記半導体レーザとを０．５ナノヘンリー以下の配線インダクタンスにより電気接続する接続配線と、上記レーザドライバと上記基板の他方の面との間に設けられて上記レーザドライバで生じた熱を上記他方の面へ放出するドライバ側サーマルビアとを具備する電子機器である。これにより、レーザドライバで生じた熱がドライバ側サーマルビアにより放出されるという作用をもたらす。
本技術の実施の形態における半導体レーザ駆動装置１０の上面図の一例を示す図である。 本技術の実施の形態におけるＹ軸に沿って切断した際の半導体レーザ駆動装置１０の断面図の一例を示す図である。 本技術の実施の形態における半導体レーザ駆動装置１０の下面図の一例である。 本技術の実施の形態におけるＸ軸に沿って切断した際の半導体レーザ駆動装置１０の断面図の一例を示す図である。 本技術の実施の形態におけるレーザドライバ２００と半導体レーザ３００とのオーバラップ量の定義を示す図である。 アディティブ法により配線パターンを形成した場合の、配線長Ｌおよび配線幅Ｗに対する配線インダクタンスの数値例を示す図である。 サブトラクティブ法により配線パターンを形成した場合の、配線長Ｌおよび配線幅Ｗに対する配線インダクタンスの数値例を示す図である。 本技術の実施の形態のレーザドライバ２００の製造過程において銅ランドおよび銅配線層（ＲＤＬ）を加工する工程の一例を示す第１の図である。 本技術の実施の形態のレーザドライバ２００の製造過程において銅ランドおよび銅配線層（ＲＤＬ）を加工する工程の一例を示す第２の図である。 本技術の実施の形態における基板１００の製造工程の一例を示す第１の図である。 本技術の実施の形態における基板１００の製造工程の一例を示す第２の図である。 本技術の実施の形態における基板１００の製造工程の一例を示す第３の図である。 本技術の実施の形態における基板１００の製造工程の一例を示す第４の図である。 本技術の実施の形態における基板１００の製造工程の一例を示す第５の図である。 本技術の実施の形態の変形例におけるＹ軸に沿って切断した際の半導体レーザ駆動装置１０の断面図の一例を示す図である。 本技術の実施の形態の適用例である電子機器８００のシステム構成例を示す図である。 本技術の実施の形態の適用例である電子機器８００の外観構成例を示す図である。
以下、本技術を実施するための形態（以下、実施の形態と称する）について説明する。説明は以下の順序により行う。
１．実施の形態（半導体レーザ駆動装置）
２．適用例（電子機器）
＜１．実施の形態＞
［半導体レーザ駆動装置］
図１は、本技術の実施の形態における半導体レーザ駆動装置１０の上面図の一例を示す図である。
この半導体レーザ駆動装置１０は、ＴｏＦによる距離の測定を想定したものである。ＴｏＦは、ストラクチャードライトほどではないものの奥行き精度が高く、また、暗い環境下でも問題なく動作可能という特徴を有する。他にも、装置構成の単純さや、コストなどにおいて、ストラクチャードライトやステレオカメラなどの他の方式と比べてメリットが多いと考えられる。
この半導体レーザ駆動装置１０では、レーザドライバ２００を内蔵する基板１００の表面に、半導体レーザ３００、フォトダイオード４００および受動部品５００がワイヤボンディングにより電気接続されて実装される。基板１００としては、プリント配線板が想定される。
半導体レーザ３００は、化合物半導体のＰＮ接合に電流を流すことにより、レーザ光を放射する半導体デバイスである。ここで、利用される化合物半導体としては、例えば、アルミニウムガリウム砒素（ＡｌＧａＡｓ）、インジウムガリウム砒素リン（ＩｎＧａＡｓＰ）、アルミニウムガリウムインジウムリン（ＡｌＧａＩｎＰ）、ガリウムナイトライド（ＧａＮ）などが想定される。
レーザドライバ２００は、半導体レーザ３００を駆動するためのドライバ集積回路（ＩＣ：Integrated Circuit）である。このレーザドライバ２００は、フェイスアップ状態で基板１００に内蔵される。半導体レーザ３００との間の電気接続については、配線インダクタンスを低減させる必要があるため、出来る限り短い配線長とすることが望ましい。この具体的数値については後述する。
フォトダイオード４００は、光を検出するためのダイオードである。このフォトダイオード４００は、半導体レーザ３００の光強度を監視して、半導体レーザ３００の出力を一定に維持するためのＡＰＣ制御（Automatic Power Control）に用いられる。
受動部品５００は、コンデンサおよび抵抗などの能動素子以外の回路部品である。この受動部品５００には、半導体レーザ３００を駆動するためのデカップリングコンデンサが含まれる。
以下、基板１００に垂直な軸を「Ｚ軸」とする。また、基板１００に平行な所定の軸を「Ｘ軸」とし、Ｘ軸およびＺ軸に垂直な軸を「Ｙ軸」とする。
図２は、本技術の実施の形態におけるＹ軸に沿って切断した際の半導体レーザ駆動装置１０の断面図の一例を示す図である。例えば、図１の線分Ｃ－Ｄに沿って基板１００を切断することにより、図２の断面図が得られる。
同図に例示するように、基板１００の両面のうち半導体レーザ３００が実装された面を表面として、表面に対する裏面には、外部との接続端子１０５が設けられる。同図において矢印は、半導体レーザ３００による光の照射方向を示す。
また、基板１００は、レーザドライバ２００や接続ビア１０１の他、導体１０３を含み、これらは基板１００の絶縁層内に形成される。
導体１０３は、基板１００内の複数の個所において、放熱や電気的接続を目的として形成される。例えば、基板１００の裏面から表面への方向を上方として、レーザドライバ２００の下方に、放熱を目的として、一定面積の導体１０３が形成される。この導体１０３は、レーザドライバ２００に密着しておらず、導体１０３とレーザドライバ２００との間には絶縁層が配置される。
また、レーザドライバ２００の下方の導体１０３と基板１００の裏面との間には、所定数のサーマルビア１０４が設けられる。
サーマルビア１０４の一端は、導体１０３に接続され、他端は、接続端子１０５に接続される。この構成により、サーマルビア１０４は、レーザドライバ２００で生じた熱を、基板１００の裏面の接続端子１０５へ放出することができる。なお、サーマルビア１０４は、特許請求の範囲に記載のドライバ側サーマルビアの一例である。
サーマルビア１０４の配置により、半導体レーザ駆動装置において、半導体レーザ駆動装置１０の放熱性能（熱抵抗など）を向上させることができる。放熱性能の向上により、レーザドライバ２００で生じた熱が半導体レーザ３００に伝導することを抑制し、半導体レーザ３００の発光特性の低下を防止することができる。
図３は、本技術の実施の形態における半導体レーザ駆動装置１０の下面（言い換えれば、基板１００の裏面）の一例を示す図である。同図に例示するように、基板１００の裏面には、複数の接続端子１０５が配置される。
図４は、本技術の実施の形態におけるＸ軸に沿って切断した際の半導体レーザ駆動装置１０の断面図の一例を示す図である。例えば、図１の線分Ａ－Ｂに沿って基板１００を切断することにより、図４の断面図が得られる。なお、図４において、レーザドライバ２００の下方のサーマルビア１０４等は省略されている。
上述のように、基板１００はレーザドライバ２００を内蔵し、その表面には半導体レーザ３００などが実装される。半導体レーザ３００とレーザドライバ２００との間の接続は、接続ビア１０１を介して行われる。この接続ビア１０１を用いることにより、配線長を短くすることが可能となる。なお、接続ビア１０１は、特許請求の範囲に記載の接続配線の一例である。
また、基板１００は、放熱のためのサーマルビア１０２を備える。基板１００に実装された各部品は発熱源であり、サーマルビア１０２を用いることにより、各部品（半導体レーザ３００など）において発生した熱を基板１００の裏面から放熱することが可能となる。なお、サーマルビア１０２は、特許請求の範囲に記載のレーザ側サーマルビアの一例である。
基板１００の表面に実装された半導体レーザ３００、フォトダイオード４００および受動部品５００は、側壁６００によって囲まれる。この側壁６００の材料としては、例えば、プラスティック材料、または、金属が想定される。
側壁６００によって囲まれた上面は、拡散板７００によって覆われる。この拡散板７００は、半導体レーザ３００からのレーザ光を拡散させるための光学素子であり、ディフューザとも呼ばれる。
図５は、本技術の実施の形態におけるレーザドライバ２００と半導体レーザ３００とのオーバラップ量の定義を示す図である。
上述のように、半導体レーザ３００とレーザドライバ２００との間の接続は接続ビア１０１を介して行われることを想定しているため、上面から見ると両者は重なって配置されることになる。その一方で、半導体レーザ３００の下面にはサーマルビア１０２を設けることが望ましく、そのための領域を確保する必要もある。そこで、レーザドライバ２００と半導体レーザ３００の位置関係を明らかにするために、両者のオーバラップ量を以下のように定義する。
同図におけるａに示す配置では、上面から見て両者に重なる領域が存在しない。この場合のオーバラップ量を０％と定義する。一方、同図におけるｃに示す配置では、上面から見て半導体レーザ３００の全てがレーザドライバ２００と重なっている。この場合のオーバラップ量を１００％と定義する。
そして、同図におけるｂに示す配置では、上面から見て半導体レーザ３００の半分の領域がレーザドライバ２００と重なっている。この場合のオーバラップ量を５０％と定義する。
この実施の形態では、上述の接続ビア１０１のための領域を設けるために、オーバラップ量は０％よりも大きいことが望ましい。一方、半導体レーザ３００の直下においてある程度の数のサーマルビア１０２を配置することを考慮すると、オーバラップ量は５０％以下であることが望ましい。したがって、オーバラップ量を０％より大きく、５０％以下とすることにより、配線インダクタンスを小さくするとともに、良好な放熱特性を得ることが可能となる。
［配線インダクタンス］
上述のように、半導体レーザ３００とレーザドライバ２００との間の接続においては、配線インダクタンスが問題となる。全ての導体には誘導成分があり、ＴｏＦシステムのような高周波領域では、極めて短いリード線のインダクタンスでも悪影響をおよぼすおそれがある。すなわち、高周波動作した際に、配線インダクタンスの影響によりレーザドライバ２００から半導体レーザ３００を駆動するための駆動波形が歪んでしまい、動作が不安定になるおそれがある。
ここで、配線インダクタンスを計算するための理論式について検討する。例えば、長さＬ［ｍｍ］、半径Ｒ［ｍｍ］の円形断面を持つ直線リード線のインダクタンスＩＤＣ［μＨ］は、自由空間において次式により表される。ただし、ｌｎは自然対数を表す。
ＩＤＣ＝０．０００２Ｌ・（ｌｎ（２Ｌ／Ｒ）－０．７５）
また、例えば、長さＬ［ｍｍ］、幅Ｗ［ｍｍ］、厚さＨ［ｍｍ］のストリップ・ライン（基板配線パターン）のインダクタンスＩＤＣ［μＨ］は、自由空間において次式により表される。
ＩＤＣ＝０．０００２Ｌ・（ｌｎ（２Ｌ／（Ｗ＋Ｈ））
＋０．２２３５（（Ｗ＋Ｈ）／Ｌ）＋０．５）
プリント配線板の内部に内蔵されたレーザドライバとプリント配線板の上部に電気接続された半導体レーザとの配線インダクタンス［ｎＨ］を試算したものが、図４および図５である。
図６は、アディティブ法により配線パターンを形成した場合の、配線長Ｌおよび配線幅Ｗに対する配線インダクタンスの数値例を示す図である。アディティブ法とは、絶縁樹脂面の必要な部分にだけ銅を析出させて、パターン形成する方法である。
図７は、サブトラクティブ法により配線パターンを形成した場合の、配線長Ｌおよび配線幅Ｗに対する配線インダクタンスの数値例を示す図である。サブトラクティブとは、銅張積層板の不要な部分をエッチングして、パターンを形成する方法である。
ＴｏＦシステムのような半導体レーザ駆動装置の場合、数百メガヘルツで駆動させることを想定すると、配線インダクタンスとしては０．５ｎＨ以下であることが望ましく、さらに０．３ｎＨ以下であることがより好ましい。したがって、上述の試算結果を考慮すると、半導体レーザ３００とレーザドライバ２００との間の配線長としては、０．５ミリメートル以下にすることが望ましく、さらに０．３ミリメートル以下であることがより好ましいと考えられる。
［製造方法］
図８および図９は、本技術の実施の形態のレーザドライバ２００の製造過程において銅ランドおよび銅配線層（ＲＤＬ：Redistribution Layer）を加工する工程の一例を示す図である。
まず、図８におけるａに示すように、半導体ウェハにおいて、例えばアルミニウムなどによるＩ／Ｏパッド２１０が形成される。そして、表面にＳｉＮなどの保護絶縁層２２０が成膜され、Ｉ／Ｏパッド２１０の領域が開孔される。
次に、図８におけるｂに示すように、ポリイミド（ＰＩ：Polyimide）またはポリベンゾオキサゾール（ＰＢＯ：Polybenzoxazole）による表面保護膜２３０が成膜され、Ｉ／Ｏパッド２１０の領域が開孔される。
次に、図８におけるｃに示すように、数十乃至百ｎｍ程度のチタンタングステン（ＴｉＷ）、百乃至千ｎｍ程度の銅（Ｃｕ）を連続スパッタして密着層およびシード層２４０を形成する。ここで、密着層は、チタンタングステン（ＴｉＷ）の他にクロム（Ｃｒ）、ニッケル（Ｎｉ）、チタン（Ｔｉ）、チタン銅（ＴｉＣｕ）、プラチナ（Ｐｔ）等の高融点金属やその合金を適用してもよい。また、シード層には、銅（Ｃｕ）の他にニッケル（Ｎｉ）、銀（Ａｇ）、金（Ａｕ）、または、その合金を適用してもよい。
次に、図９におけるｄに示すように、電気接合用の銅ランドと銅配線層を形成するために、フォトレジスト２５０をパターニングする。具体的には、表面洗浄、レジスト塗布、乾燥、露光、現像の各工程によって形成する。
次に、図９におけるｅに示すように、密着層およびシード層２４０の上にめっき法により、電気接合用の銅ランドおよび銅配線層（ＲＤＬ）２６０を形成する。ここで、めっき法としては、例えば、電解銅めっき法や電解ニッケルめっき法などを用いることができる。また、銅ランドの直径は５０乃至１００マイクロメートル程度、銅配線層の厚さは３乃至１０マイクロメートル程度、銅配線層の最小幅は１０マイクロメートル程度が望ましい。
次に、図９におけるｆに示すように、フォトレジスト２５０を除去し、半導体チップの銅ランドおよび銅配線層（ＲＤＬ）２６０をマスクして、ドライエッチングを行う。ここで、ドライエッチングは、例えば、アルゴンイオンビームを照射するイオンミリングを用いることができる。このドライエッチングにより、不要領域の密着層およびシード層２４０を選択的に除去することができ、銅ランドおよび銅配線層が各々分離される。なお、この不要領域の除去は、王水、硝酸第二セリウムアンモニウムや水酸化カリウムの水溶液等のウエットエッチングでも可能だが、銅ランドおよび銅配線層を構成する金属層のサイドエッチや厚み減少を考慮するとドライエッチングの方が望ましい。
図１０乃至図１４は、本技術の実施の形態における基板１００の製造工程の一例を示す図である。
まず、図１０におけるａに示すように、支持板１１０に接着性樹脂層１２０を介して、極薄銅箔１３２とキャリア銅箔１３１の２層構造から成るピーラブル銅箔１３０を、ロールラミネートまたは積層プレスにより片面に熱圧着させる。
支持板１１０は、無機材料や金属材料、樹脂材料等からなる基板を使用することができる。例えば、シリコン（Ｓｉ）、ガラス、セラミック、銅、銅系合金、アルミニウム、アルミ合金、ステンレス、ポリイミド樹脂、エポキシ樹脂を使用することができる。
ピーラブル銅箔１３０は、厚さ２乃至５マイクロメートルの極薄銅箔１３２に、厚さ１８乃至３５マイクロメートルのキャリア銅箔１３１を真空密着したものを用いる。ピーラブル銅箔１３０としては、例えば、３ＦＤ－Ｐ３／３５（古河サーキットフォイル株式会社製）、ＭＴ－１８Ｓ５ＤＨ（三井金属鉱業株式会社製）等を用いることができる。
接着性樹脂層１２０の樹脂材料としては、ガラス繊維の補強材入りの、エポキシ樹脂、ポリイミド樹脂、ＰＰＥ樹脂、フェノール樹脂、ＰＴＦＥ樹脂、珪素樹脂、ポリブタジエン樹脂、ポリエステル樹脂、メラミン樹脂、ユリア樹脂、ＰＰＳ樹脂、ＰＰＯ樹脂などの有機樹脂を使用することができる。また、補強材としては、ガラス繊維以外に、アラミド不織布やアラミド繊維、ポリエステル繊維などを用いることもできる。
次に、図１０におけるｂに示すように、無電解銅めっき処理により、ピーラブル銅箔１３０の極薄銅箔１３２の表面に厚さ０．５乃至３マイクロメートルの（図示しない）めっき下地導電層を形成する。なお、この無電解銅めっき処理は、次に配線パターンを形成する電解銅めっきの下地の導電層を形成するものである。ただし、この無電解銅めっき処理を省略して、ピーラブル銅箔１３０に直接的に電解銅めっき用の電極を接触させて、ピーラブル銅箔１３０の上に直接的に電解銅めっき処理を施して、配線パターンを形成してもよい。
次に、図１０におけるｃに示すように、支持板の表面に感光性レジストをロールラミネートで貼り付けて、配線パターン用のレジストパターン（ソルダーレジスト１４０）を形成する。この感光性レジストとしては、例えば、ドライフィルムのめっきレジストを用いることができる。
次に、図１０におけるｄに示すように、電解銅めっき処理により、厚さ１５マイクロメートル程度の配線パターン１５０を形成する。
次に、図１１におけるｅに示すように、めっきレジストを剥離させる。そして、層間絶縁性樹脂を形成するための前処理として、配線パターン表面を粗化処理して、層間絶縁性樹脂と配線パターンの接着性を向上させる。なお、粗化処理は、酸化還元処理による黒化処理または過水硫酸系のソフトエッチング処理によって行うことができる。
次に、図１１におけるｆに示すように、配線パターン上に層間絶縁性樹脂１６１を、ロールラミネートまたは積層プレスで熱圧着させる。例えば、厚さ４５マイクロメートルのエポキシ樹脂をロールラミネートする。 ガラスエポキシ樹脂を使う場合は、任意の厚さの銅箔を重ね合わせて、積層プレスで熱圧着させる。層間絶縁性樹脂１６１の樹脂材料としては、エポキシ樹脂、ポリイミド樹脂、ＰＰＥ樹脂、フェノール樹脂、ＰＴＦＥ樹脂、珪素樹脂、ポリブタジエン樹脂、ポリエステル樹脂、メラミン樹脂、ユリア樹脂、ＰＰＳ樹脂、ＰＰＯ樹脂などの有機樹脂を使用することができる。また、これらの樹脂単独でも、複数樹脂を混合あるいは化合物を作成するなどした樹脂の組み合わせも使用することができる。さらに、これらの材料に無機フィラーを含有させたり、ガラス繊維の補強材を混入させたりした層間絶縁性樹脂も使用することができる。
次に、図１１におけるｇに示すように、層間電気接続用のビアホールをレーザ法またはフォトエッチング法により形成する。層間絶縁性樹脂１６１が熱硬化性樹脂の場合は、レーザ法によりビアホールを形成する。レーザ光としては、高調波ＹＡＧレーザやエキシマレーザなどの紫外線レーザ、炭酸ガスレーザなどの赤外線レーザを用いることができる。なお、レーザ光にてビアホールを形成した場合は、ビアホール底に薄い樹脂膜が残る場合があるため、デスミア処理を行う。このデスミア処理は、強アルカリにより樹脂を膨潤させ、クロム酸、過マンガン酸塩水溶液等の酸化剤を使用して樹脂を分解除去する。また、プラズマ処理や研磨材によるサンドブラスト処理にて除去することもできる。層間絶縁性樹脂１６１が感光性樹脂の場合は、フォトエッチング法によりビアホール１７０を形成する。つまり、マスクを通して、紫外線を用いて露光した後に現像することにより、ビアホール１７０を形成する。
次に、粗化処理の後、ビアホール１７０の壁面および層間絶縁性樹脂１６１の表面に、無電解めっき処理を行う。次に、表面に無電解めっき処理した層間絶縁性樹脂１６１の面に感光性レジストをロールラミネートで貼り付ける。この場合の感光性レジストとしては、例えば、ドライフィルムの感光性めっきレジストフィルムを用いることができる。この感光性めっきレジストフィルムを露光した後に現像することにより、ビアホール１７０の部分および配線パターンの部分を開口しためっきレジストのパターンを形成する。 次に、めっきレジストパターンの開口部分に、厚さ１５マイクロメートルの電解銅めっき処理を施す。 次に、めっきレジストを剥離し、層間絶縁性樹脂上に残っている無電解めっきを過水硫酸系のフラッシュエッチングなどで除去することにより、図１１におけるｈに示すような銅めっきで充填したビアホール１７０と配線パターンを形成する。そして、同様の配線パターンの粗化工程と層間絶縁性樹脂１６２の形成工程を繰り返し行う。
次に、図１２におけるｉに示すように、厚み約３０乃至５０マイクロメートルに薄化した銅ランドおよび銅配線層を加工済みのダイアタッチフィルム（Die Attach Film：ＤＡＦ）２９０が付いたレーザドライバ２００をフェイスアップ状態で実装する。
次に、図１２におけるｊに示すように、層間絶縁性樹脂１６３を、ロールラミネートまたは積層プレスで熱圧着させる。
次に、図１２におけるｋおよび図１３におけるｌに示すように、これまでと同様のビアホール加工、デスミア処理、粗化処理、無電解めっき処理、電解めっき処理を行う。なお、レーザドライバ２００の銅ランドへの浅いビアホール１７１の加工と、１階層下の深いビアホール１７２の加工、デスミア処理および粗化処理とは同時に行う。
ここで、浅いビアホール１７１は、銅めっきで充填したフィルドビアである。ビアのサイズおよび深さは、それぞれ２０乃至３０マイクロメートル程度である。また、ランドのサイズは、直径６０乃至８０マイクロメートル程度である。
一方、深いビアホール１７２は、銅めっきをビア外側のみに施したいわゆるコンフォーマルビアである。ビアのサイズおよび深さは、それぞれ８０乃至１５０マイクロメートル程度である。また、ランドのサイズは、直径１５０乃至２００マイクロメートル程度である。なお、深いビアホール１７２は、レーザドライバ２００の外形より１００マイクロメートル程度の絶縁性樹脂を介して配置することが望ましい。
次に、図１３におけるｍに示すように、これまでと同様の層間絶縁性樹脂を、ロールラミネートまたは積層プレスにより熱圧着させる。この際、コンフォーマルビアの内側が層間絶縁性樹脂で充填される。次に、これまでと同様のビアホール加工、デスミア処理、粗化処理、無電解めっき処理、および、電解めっき処理を行う。
次に、図１３におけるｎに示すように、支持板１１０を、ピーラブル銅箔１３０のキャリア銅箔１３１と極薄銅箔１３２の界面より剥離させることによって、分離する。
次に、図１４におけるｏに示すように、硫酸－過酸化水素系ソフトエッチングを用いて極薄銅箔１３２とめっき下地導電層を除去することにより、配線パターンが露出した部品内蔵基板を得ることができる。
次に、図１４におけるｐに示すように、露出させた配線パターン上に、配線パターンのランド部分において開口部を有するパターンのソルダーレジスト１８０を印刷する。なお、ソルダーレジスト１８０は、フィルムタイプを用いて、ロールコーターによって形成することも可能である。次に、ソルダーレジスト１８０の開口部のランド部分に、無電解Ｎｉめっきを３マイクロメートル以上形成し、その上に無電解Ａｕめっきを０．０３マイクロメートル以上形成する。無電解Ａｕめっきは１マイクロメートル以上形成してもよい。さらに、その上に半田をプリコートすることも可能である。または、ソルダーレジスト１８０の開口部に、電解Ｎｉめっきを３マイクロメートル以上形成し、その上に電解Ａｕめっきを０．５マイクロメートル以上形成してもよい。さらに、ソルダーレジスト１８０の開口部に、金属めっき以外に、有機防錆皮膜を形成してもよい。
また、外部接続用のランドに、接続端子１０５として、クリーム半田を印刷塗布して、半田ボールのＢＧＡ（Ball Grid Array）を搭載してもよい。また、この接続端子１０５としては、銅コアボール、銅ピラーバンプ、または、ランドグリッドアレイ（ＬＧＡ：Land Grid Array）などを用いてもよい。
このようにして製造された基板１００の表面に、図１４におけるｑに示すように、半導体レーザ３００、フォトダイオード４００および受動部品５００を実装し、側壁６００および拡散板７００を取り付ける。一般的には、集合基板状で行った後に外形をダイサーなどで加工して個片に分離する。
なお、上述の工程ではピーラブル銅箔１３０と支持板１１０を用いた例について説明したが、これらに代えて銅張積層板（ＣＣＬ：Copper Clad Laminate）を用いることも可能である。また、部品を基板へ内蔵する製造方法は、基板にキャビティ形成して搭載する方法を用いてもよい。
このように、本技術の実施の形態によれば、レーザドライバ２００と基板１００の裏面との間にサーマルビア１０４を配置したため、レーザドライバ２００で生じた熱を裏面から放出することができる。これにより、半導体レーザ駆動装置１０の放熱性能を向上させ、レーザドライバ２００で生じた熱が、半導体レーザ３００に伝導することを抑制することができる。
［変形例］
上述の実施の形態では、サーマルビア１０４に接続された導体１０３は、レーザドライバ２００に密着していなかったが、放熱性能向上の観点から、密着させることが望ましい。この実施の形態の変形例の半導体レーザ駆動装置１０は、放熱性能をさらに向上させた点において実施の形態と異なる。
図１５は、本技術の実施の形態の変形例におけるＹ軸に沿って切断した際の半導体レーザ駆動装置１０の断面図の一例を示す図である。この実施の形態の変形例の半導体レーザ駆動装置１０は、レーザドライバ２００の下方に、導体１０３の代わりに、金属膜１０６が設けられる点において実施の形態と異なる。
金属膜１０６は、レーザドライバ２００の下面に密着しており、例えば、蒸着やスパッタリングにより形成される。この金属膜１０６は、サーマルビア１０４の一端に接続される。
製造工程においては、例えば、図８におけるｃの工程の直後において、蒸着等によりレーザドライバ２００の下面に金属膜１０６を形成する工程が追加される。
同図に例示したように、サーマルビア１０４の一端の金属膜１０６がレーザドライバ２００の下面に密着しているため、導体１０３が密着していない場合と比較して、レーザドライバ２００の熱の放熱性を向上させることができる。
このように、本技術の実施の形態の変形例によれば、レーザドライバ２００の下面に金属膜１０６を形成し、サーマルビア１０４に接続したため、導体１０３が密着していない場合と比較して、レーザドライバ２００の熱の放熱性能を向上させることができる。
＜２．適用例＞
［電子機器］
図１６は、本技術の実施の形態の適用例である電子機器８００のシステム構成例を示す図である。
この電子機器８００は、上述の実施の形態による半導体レーザ駆動装置１０を搭載した携帯端末である。この電子機器８００は、撮像部８１０と、半導体レーザ駆動装置８２０と、シャッタボタン８３０と、電源ボタン８４０と、制御部８５０と、記憶部８６０と、無線通信部８７０と、表示部８８０と、バッテリ８９０とを備える。
撮像部８１０は、被写体を撮像するイメージセンサである。半導体レーザ駆動装置８２０は、上述の実施の形態による半導体レーザ駆動装置１０である。
シャッタボタン８３０は、撮像部８１０における撮像タイミングを電子機器８００の外部から指示するためのボタンである。電源ボタン８４０は、電子機器８００の電源のオンオフを電子機器８００の外部から指示するためのボタンである。
制御部８５０は、電子機器８００の全体の制御を司る処理部である。記憶部８６０は、電子機器８００の動作に必要なデータやプログラムを記憶するメモリである。無線通信部８７０は、電子機器８００の外部との無線通信を行うものである。表示部８８０は、画像等を表示するディスプレイである。バッテリ８９０は、電子機器８００の各部に電源を供給する電源供給源である。
撮像部８１０、半導体レーザ駆動装置８２０を制御する発光制御信号の特定の位相（例えば、立上りタイミング）を０度として、０度から１８０度までの受光量をＱ１として検出し、１８０度から３６０度までの受光量をＱ２として検出する。また、撮像部８１０は、９０度から２７０度までの受光量をＱ３として検出し、２７０度から９０度までの受光量をＱ４として検出する。制御部８５０は、これらの受光量Ｑ１乃至Ｑ４から、次式により物体との距離ｄを演算し、表示部８８０に表示する。
ｄ＝（ｃ／４πｆ）×ａｒｃｔａｎ｛（Ｑ３－Ｑ４）／（Ｑ１－Ｑ２）｝
上式において距離ｄの単位は、例えば、メートル（ｍ）である。ｃは光速であり、その単位は、例えば、メートル毎秒（ｍ／ｓ）である。ａｒｃｔａｎは、正接関数の逆関数である。「（Ｑ３－Ｑ４）／（Ｑ１－Ｑ２）」の値は、照射光と反射光との位相差を示す。πは、円周率を示す。また、ｆは照射光の周波数であり、その単位は、例えば、メガヘルツ（ＭＨｚ）である。
図１７は、本技術の実施の形態の適用例である電子機器８００の外観構成例を示す図である。
この電子機器８００は、筐体８０１に収められ、側面に電源ボタン８４０を備え、表面に表示部８８０およびシャッタボタン８３０を備える。また、裏面には撮像部８１０および半導体レーザ駆動装置８２０の光学領域が設けられる。
これにより、表示部８８０には、通常の撮像画像８８１を表示するだけでなく、ＴｏＦを利用した測距結果に応じた奥行画像８８２を表示することができる。
なお、この適用例では、電子機器８００として、スマートフォンのような携帯端末について例示したが、電子機器８００はこれに限定されるものではなく、例えばデジタルカメラやゲーム機やウェアラブル機器などであってもよい。
なお、上述の実施の形態は本技術を具現化するための一例を示したものであり、実施の形態における事項と、特許請求の範囲における発明特定事項とはそれぞれ対応関係を有する。同様に、特許請求の範囲における発明特定事項と、これと同一名称を付した本技術の実施の形態における事項とはそれぞれ対応関係を有する。ただし、本技術は実施の形態に限定されるものではなく、その要旨を逸脱しない範囲において実施の形態に種々の変形を施すことにより具現化することができる。
なお、本明細書に記載された効果はあくまで例示であって、限定されるものではなく、また、他の効果があってもよい。
なお、本技術は以下のような構成もとることができる。
（１）レーザドライバを内蔵する基板と、
前記基板の一方の面に実装された半導体レーザと、
前記レーザドライバと前記半導体レーザとを０．５ナノヘンリー以下の配線インダクタンスにより電気接続する接続配線と、
前記レーザドライバと前記基板の他方の面との間に設けられて前記レーザドライバで生じた熱を前記他方の面へ放出するドライバ側サーマルビアと
を具備する半導体レーザ駆動装置。
（２）前記基板の前記一方の面とは反対の面において外部との接続端子をさらに具備し、
前記ドライバ側サーマルビアの一端は、前記接続端子に接続される
前記（１）記載の半導体レーザ駆動装置。
（３）前記基板は、絶縁層および導体を含み、
前記導体と前記レーザドライバとの間には前記絶縁層が配置され、
前記ドライバ側サーマルビアの他端は、前記導体に接続される
前記（２）記載の半導体レーザ駆動装置。
（４）前記レーザドライバの所定平面に形成された金属膜をさらに具備し、
前記ドライバ側サーマルビアの他端は、前記金属膜に接続される
前記（２）記載の半導体レーザ駆動装置。
（５）前記接続端子は、半田ボール、銅コアボール、銅ピラーバンプ、および、ランドグリッドアレイの少なくとも何れか１つにより形成される
前記（２）から（４）のいずれかに記載の半導体レーザ駆動装置。
（６）前記接続配線は、０．５ミリメートル以下の長さを備える
前記（１）から（５）のいずれかに記載の半導体レーザ駆動装置。
（７）前記接続配線は、前記基板に設けられる接続ビアを介する
前記（１）から（６）のいずれかに記載の半導体レーザ駆動装置。
（８）前記半導体レーザは、その一部が前記レーザドライバの上方に重ねて配置される
前記（１）から（７）のいずれかに記載の半導体レーザ駆動装置。
（９）前記半導体レーザは、その面積の５０％以下の部分が前記レーザドライバの上方に重ねて配置される
前記（８）記載の半導体レーザ駆動装置。
（１０）前記基板は、前記半導体レーザが実装された位置においてレーザ側サーマルビアを備える
前記（１）から（９）のいずれかに記載の半導体レーザ駆動装置。
（１１）前記基板の前記一方の面において前記半導体レーザを含む領域を囲う外壁と、
前記外壁に囲まれた領域の上方を覆う拡散板と
をさらに具備する前記（１）から（１０）のいずれかに記載の半導体レーザ駆動装置。
（１２）前記基板の前記一方の面に実装されて前記半導体レーザから照射されたレーザ光の光強度を監視するフォトダイオードをさらに具備する前記（１）から（１１）のいずれかに記載の半導体レーザ駆動装置。
（１３）レーザドライバを内蔵する基板と、
前記基板の一方の面に実装された半導体レーザと、
前記レーザドライバと前記半導体レーザとを０．５ナノヘンリー以下の配線インダクタンスにより電気接続する接続配線と、
前記レーザドライバと前記基板の他方の面との間に設けられて前記レーザドライバで生じた熱を前記他方の面へ放出するドライバ側サーマルビアと
を具備する電子機器。
１０、８２０ 半導体レーザ駆動装置
１００ 基板
１０１ 接続ビア
１０２、１０４ サーマルビア
１０３ 導体
１０５ 接続端子
１０６ 金属膜
１１０ 支持板
１２０ 接着性樹脂層
１３０ ピーラブル銅箔
１３１ キャリア銅箔
１３２ 極薄銅箔
１４０、１８０ ソルダーレジスト
１５０ 配線パターン
１６１～１６３ 層間絶縁性樹脂
１７０～１７２ ビアホール
２００ レーザドライバ
２１０ Ｉ／Ｏパッド
２２０ 保護絶縁層
２３０ 表面保護膜
２４０ 密着層／シード層
２５０ フォトレジスト
２６０ 銅ランドおよび銅配線層（ＲＤＬ）
２９０ ダイアタッチフィルム（ＤＡＦ）
３００ 半導体レーザ
４００ フォトダイオード
５００ 受動部品
６００ 側壁
７００ 拡散板
８００ 電子機器
８０１ 筐体
８１０ 撮像部
８３０ シャッタボタン
８４０ 電源ボタン
８５０ 制御部
８６０ 記憶部
８７０ 無線通信部
８８０ 表示部
８９０ バッテリ

Claims (9)

  1. レーザドライバを内蔵する基板と、
    前記基板の一方の面に実装された半導体レーザと、
    前記レーザドライバと前記半導体レーザとを０．５ナノヘンリー以下の配線インダクタンスにより電気接続する接続配線と、
    前記レーザドライバと前記基板の他方の面との間に設けられて前記レーザドライバで生じた熱を前記他方の面へ放出する複数のドライバ側サーマルビアと
    を具備し、
    前記他方の面において外部との接続端子をさらに具備し、
    前記複数のドライバ側サーマルビアのそれぞれの一端は、前記接続端子に接続され、
    前記レーザドライバの所定平面に形成された金属膜をさらに具備し、
    前記複数のドライバ側サーマルビアのそれぞれの他端は、前記金属膜に共通に接続される
    半導体レーザ駆動装置。
  2. 前記接続端子は、半田ボール、銅コアボール、銅ピラーバンプ、および、ランドグリッドアレイの少なくとも何れか１つにより形成される
    請求項１記載の半導体レーザ駆動装置。
  3. 前記接続配線は、０．５ミリメートル以下の長さを備える
    請求項１記載の半導体レーザ駆動装置。
  4. 前記接続配線は、前記基板に設けられる接続ビアを介する
    請求項１記載の半導体レーザ駆動装置。
  5. 前記半導体レーザは、その一部が前記レーザドライバの上方に重ねて配置される
    請求項１記載の半導体レーザ駆動装置。
  6. 前記半導体レーザは、その面積の５０％以下の部分が前記レーザドライバの上方に重ねて配置される
    請求項５記載の半導体レーザ駆動装置。
  7. 前記基板は、前記半導体レーザが実装された位置においてレーザ側サーマルビアを備える
    請求項１記載の半導体レーザ駆動装置。
  8. 前記基板の前記一方の面において前記半導体レーザを含む領域を囲う外壁と、
    前記外壁に囲まれた領域の上方を覆う拡散板と
    をさらに具備する請求項１記載の半導体レーザ駆動装置。
  9. 前記基板の前記一方の面に実装されて前記半導体レーザから照射されたレーザ光の光強度を監視するフォトダイオードをさらに具備する請求項１記載の半導体レーザ駆動装置。
JP2019144174A 2019-08-06 2019-08-06 半導体レーザ駆動装置、および、電子機器 Active JP7356287B2 (ja)

Priority Applications (5)

Application Number Priority Date Filing Date Title
JP2019144174A JP7356287B2 (ja) 2019-08-06 2019-08-06 半導体レーザ駆動装置、および、電子機器
EP20742950.7A EP4010952A1 (en) 2019-08-06 2020-07-01 Light emitting device, and electronic apparatus
CN202080055289.0A CN114556722A (zh) 2019-08-06 2020-07-01 发光设备与电子装置
US17/626,278 US20220293545A1 (en) 2019-08-06 2020-07-01 Light emitting device, and electronic apparatus
PCT/JP2020/025772 WO2021024652A1 (en) 2019-08-06 2020-07-01 Light emitting device, and electronic apparatus

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2019144174A JP7356287B2 (ja) 2019-08-06 2019-08-06 半導体レーザ駆動装置、および、電子機器

Publications (2)

Publication Number Publication Date
JP2021027182A JP2021027182A (ja) 2021-02-22
JP7356287B2 true JP7356287B2 (ja) 2023-10-04

Family

ID=71670335

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2019144174A Active JP7356287B2 (ja) 2019-08-06 2019-08-06 半導体レーザ駆動装置、および、電子機器

Country Status (5)

Country Link
US (1) US20220293545A1 (ja)
EP (1) EP4010952A1 (ja)
JP (1) JP7356287B2 (ja)
CN (1) CN114556722A (ja)
WO (1) WO2021024652A1 (ja)

Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001339077A (ja) 2000-03-24 2001-12-07 Matsushita Electric Ind Co Ltd 半導体素子実装装置および光通信装置
JP2002232062A (ja) 2001-02-02 2002-08-16 Ricoh Co Ltd 光電子集積素子
JP2010087498A (ja) 2008-10-02 2010-04-15 Korea Electronics Telecommun 双方向光送受信装置
JP2012227514A (ja) 2011-04-08 2012-11-15 Sony Corp 画素チップ、表示パネル、照明パネル、表示装置および照明装置
JP2015092524A (ja) 2013-11-08 2015-05-14 日立金属株式会社 電子部品の放熱構造
JP2016122701A (ja) 2014-12-24 2016-07-07 日立金属株式会社 電子部品の放熱構造及びそれを有する通信モジュール
JP2018129417A (ja) 2017-02-09 2018-08-16 ＡＰＲＥＳＩＡ Ｓｙｓｔｅｍｓ株式会社 並列光モジュール
US20180278011A1 (en) 2017-03-23 2018-09-27 Infineon Technologies Ag Laser diode module
JP2019041201A (ja) 2017-08-24 2019-03-14 ソニーセミコンダクタソリューションズ株式会社 駆動装置、駆動方法、及び、発光装置

Family Cites Families (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6684007B2 (en) * 1998-10-09 2004-01-27 Fujitsu Limited Optical coupling structures and the fabrication processes
JP5065062B2 (ja) 2008-01-16 2012-10-31 古河電気工業株式会社 光モジュール
JP5050076B2 (ja) * 2010-04-13 2012-10-17 株式会社日立製作所 光通信モジュールおよび光通信装置
US20130163627A1 (en) * 2011-12-24 2013-06-27 Princeton Optronics Laser Illuminator System
US11962123B2 (en) * 2018-04-19 2024-04-16 Sony Semiconductor Solutions Corporation Semiconductor laser drive device and method of manufacturing the same

Patent Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001339077A (ja) 2000-03-24 2001-12-07 Matsushita Electric Ind Co Ltd 半導体素子実装装置および光通信装置
JP2002232062A (ja) 2001-02-02 2002-08-16 Ricoh Co Ltd 光電子集積素子
JP2010087498A (ja) 2008-10-02 2010-04-15 Korea Electronics Telecommun 双方向光送受信装置
JP2012227514A (ja) 2011-04-08 2012-11-15 Sony Corp 画素チップ、表示パネル、照明パネル、表示装置および照明装置
JP2015092524A (ja) 2013-11-08 2015-05-14 日立金属株式会社 電子部品の放熱構造
JP2016122701A (ja) 2014-12-24 2016-07-07 日立金属株式会社 電子部品の放熱構造及びそれを有する通信モジュール
JP2018129417A (ja) 2017-02-09 2018-08-16 ＡＰＲＥＳＩＡ Ｓｙｓｔｅｍｓ株式会社 並列光モジュール
US20180278011A1 (en) 2017-03-23 2018-09-27 Infineon Technologies Ag Laser diode module
JP2019041201A (ja) 2017-08-24 2019-03-14 ソニーセミコンダクタソリューションズ株式会社 駆動装置、駆動方法、及び、発光装置

Non-Patent Citations (1)

* Cited by examiner, † Cited by third party
Title
GOLDFARB,M.E. et al.，"Modeling via hole grounds in microstrip"，IEEE Microwave and Guided Wave Letters，1991年06月，Vol. 1, No. 6，p.135-137，DOI: 10.1109/75.91090

Also Published As

Publication number Publication date
WO2021024652A1 (en) 2021-02-11
JP2021027182A (ja) 2021-02-22
CN114556722A (zh) 2022-05-27
EP4010952A1 (en) 2022-06-15
US20220293545A1 (en) 2022-09-15

Similar Documents

Publication Publication Date Title
JP7499391B2 (ja) 半導体レーザ駆動装置および電子機器
WO2021033439A1 (ja) 半導体レーザ駆動装置、電子機器、および、半導体レーザ駆動装置の製造方法
WO2021059708A1 (en) Semiconductor laser drive device, electronic equipment, and method for manufacturing semiconductor laser drive device
WO2021065163A1 (ja) 半導体レーザ駆動装置、電子機器、および、半導体レーザ駆動装置の製造方法
WO2021039199A1 (ja) 半導体レーザ駆動装置、電子機器、および、半導体レーザ駆動装置の製造方法
JP2024019475A (ja) 測距装置、電子機器、および、測距装置の製造方法
WO2021019913A1 (ja) 半導体レーザ駆動装置、電子機器、および、半導体レーザ駆動装置の製造方法
JP7356287B2 (ja) 半導体レーザ駆動装置、および、電子機器
WO2021044816A1 (ja) 半導体レーザ駆動装置、電子機器、および、半導体レーザ駆動装置の製造方法
WO2021019914A1 (ja) 半導体レーザ駆動装置、電子機器、および、半導体レーザ駆動装置の製造方法

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20220622

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20230222

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20230228

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20230315

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20230509

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20230524

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20230808

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20230822

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20230829

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20230922

R150 Certificate of patent or registration of utility model

Ref document number: 7356287

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150