JP7252221B2 - 微小電気機械コンポーネントおよびその製造方法 - Google Patents

微小電気機械コンポーネントおよびその製造方法 Download PDF

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Description

本発明は、微小電気機械コンポーネントおよびその製造方法に関する。
本発明は、CMOS回路上に配置された微小電気機械コンポーネント(MEMSコンポーネント)に適用されることを意図している。MEMSコンポーネントの製造では、さまざまな微小機械製造方法、特に犠牲層が使用される。後者はしばしば二酸化ケイ素(silicon dioxide)から製造される。MEMSコンポーネントの可動性を実現するために、犠牲層を部分的に除去する必要がある(リリースプロセス)。二酸化ケイ素の場合、これはフッ化水素酸(HF;hydrofluoric acid)を使用したエッチングによって達成でき、フッ化水素酸は、液体または気体の何れかの形で使用される。MEMSコンポーネントがCMOS回路に配置されている場合、異なる金属層間のゲート酸化物または絶縁体としての機能を確保するために、同様にCMOS回路に存在する二酸化ケイ素層をフッ化水素酸による攻撃から保護する必要がある。特に、CMOS部分では、例えばボロンリンガラス(BPSG;borophosphosilicate glass)からなるドープされた二酸化ケイ素層がよく使用される。後者は、犠牲層内のドープされていないケイ酸塩ガラス(USG;undoped silicate glass)よりも著しく高いエッチング速度を示すため、フッ化水素酸を使用したエッチング中に特に影響を受けやすくなる。エッチング攻撃がCMOS領域内で発生すると、短絡または層間剥離が発生する可能性がある。外縁からの攻撃の場合、過度に大きな層間剥離が発生すると、MEMSコンポーネントの電気コンタクト(ボンドパッド)および機能部品が、使用されているCMOS回路から分離する可能性がある。この場合、ワイヤボンディング、そして、この方法で影響を受けるMEMSコンポーネントの使用はできなくなる。したがって、MEMSコンポーネントのCMOS領域は、リリースプロセス中に発生する可能性のある攻撃から効果的に保護される必要がある。
MEMSコンポーネントのMEMS部分である、CMOS回路の上面への攻撃の防止を調査する多くの研究がある。これまで、CMOS回路の横方向の保護はほとんど無視されており、一般的な保護または上からの保護、つまり上にあるMEMS部品の方向からの保護のみが取り組まれてきた。米国特許出願公開第2016/0068388号明細書では、CMOSの保護に取り組んでおり、表面を覆う追加の金属層を提案している。 これはシンプルで、おそらくよく使われる方法である。チタン、窒化チタン(titanium nitride)、アルミニウムおよびアルミニウム-銅(aluminium-copper)が材料として提案された。ただし、米国特許出願公開第2016/0068388号明細書では、これらの材料はフッ化水素酸に対して完全な耐性を示すのではなく、むしろ腐食し、その結果、特定の期間のみ効果的な保護を確保できることに注意されている。したがって、厚さは十分に厚くなるように選択する必要がある。
米国特許出願公開第2016/0068388号明細書
したがって、本発明の目的は、エッチングプロセス(リリースプロセス)によって二酸化ケイ素を犠牲材料として除去することにより、微小電気機械エレメントを自由に可動とするように露出するプロセスで、特に、この場合における層間剥離を回避するため、MEMSコンポーネントのCMOS回路の改善された保護の可能性を特定することである。
この目的は、本発明によれば、請求項1の特徴を有するコンポーネントによって達成される。請求項6は、製造方法を定義する。本発明の有利な構成および発展は、従属請求項で参照される特徴を用いて実現することができる。
本発明に係る微小電気機械コンポーネントでは、少なくとも1つの微小電気機械エレメント、電気コンタクトエレメント、絶縁層、および二酸化ケイ素で形成された犠牲層が、CMOS回路基板の表面上に形成される。この場合、従来技術から知られているように、微小電気機械エレメントは、少なくとも1つの自由度で自由に可動に配置される。本発明によれば、微小電気機械コンポーネントの外縁において、CMOS回路のすべてのエレメントの周囲に半径方向に(radially)延在し、フッ化水素酸に耐性があり、シリコンまたは酸化アルミニウムで形成される気密および/または液密なクローズド層がCMOS回路基板の表面に形成されている。
前記クローズド層は、周囲に半径方向に延在する保護リングを形成し、エッチング剤、特にフッ化水素酸が、特にCMOS回路の重要な領域を攻撃することを防ぐ。層材料は、少なくとも犠牲層材料が十分な程度まで除去され、それぞれの微小電気機械エレメントの可動性が達成されるまで、エッチングによる犠牲層材料の除去の間、フッ化水素酸に対して耐性でなければならない。
好ましくは、前記クローズド層はアモルファスシリコン(aSi)、好ましくはドープされたアモルファスシリコンで形成されるべきである。特に、ボロンはドーピングに使用可能である。しかしながら、代替として、酸化アルミニウム、ゲルマニウム、またはシリコンとゲルマニウムから構成される化合物も考えられる。
二酸化ケイ素は不純物のない二酸化ケイ素である必要はない。二酸化ケイ素は、ドーピングまたは添加剤を含むこともでき、したがって、ボロンリンガラス(borophosphosilicate glass)を使用してもよい。
また、好ましくは、酸化アルミニウムからなるバリア層が、微小電気機械エレメントが可動に配置される微小電気機械コンポーネントの表面に形成される。前記バリア層は、エッチング攻撃に対して、特にバリア層の下の犠牲層内に配置された電気コンタクトエレメントを保護することができる。
好ましくは、周囲に半径方向に延在し、シリコンまたは酸化アルミニウムで形成される層は、より高い高さを有することができ、これにより、当該層は、CMOS回路基板の表面を超えて横方向に突出し、使用されるエッチング剤による攻撃に対する横方向の保護も提供できる。
周囲に半径方向に延在する層は、少なくともCMOS層構造の高さに対応する高さを有するべきである。当該層は、CMOS回路の周囲に保護リングを形成できるように形成されてもよい。この場合、当該層は、CMOS回路基板の表面から、直接、微小電気機械エレメントの下側までのバリア層まで形成されてもよい。
シリコン、酸化アルミニウム、ゲルマニウム、またはシリコンとゲルマニウムの化合物で形成された層が、少なくとも1つのさらなる層でオーバーコートされてもよい。少なくとも1つのさらなる層は、好ましくは金属、特に好ましくはチタン、アルミニウム、アルミニウム-銅合金(aluminium-copper alloy)またはチタン-アルミニウム合金(titanium-aluminium alloy)または窒化チタン(titanium nitride)で形成されてもよい。上記のさらなる層もまた、犠牲層内に配置されたCMOS回路の部分および電気コンタクトエレメントを、特にMEMSコンポーネントの縁部からのエッチング攻撃から保護することができる。したがって、シリコンまたは酸化アルミニウムで形成された層は、主にCMOS回路基板の表面を保護する。
微小電気機械エレメントは、例えば、旋回可能な反射エレメント(マイクロミラー)または反射膜であり得る。
本発明に係るMEMSコンポーネントの製造の手順は、二酸化ケイ素で形成された絶縁体層がCMOS回路基板の表面にアプライされ、当該プロセスにおいて、従来技術から知られた、局所的に規定された方法で、電気コンタクトエレメントまたは導電体トラックが絶縁体層に埋め込まれるようなものである。本発明によれば、外縁の絶縁体層において、CMOS回路基板の表面まで延びる少なくとも1つのトレンチが、CMOS回路のすべてのエレメントの周囲に半径方向に延びるように形成される。その後、トレンチは、少なくともその底部領域において、シリコンまたは酸化アルミニウムで形成された液密および/または気密のクローズド層で満たされる。密封性は、犠牲層材料を除去するために使用される際の、エッチング剤、特にフッ化水素酸の物質の状態を考慮に入れるべきである。さらに、周囲に延在する堅い層を構成する材料は、それ自体、使用されるフッ化水素酸に対して耐性でなければならない。
タイトクローズ層は、好ましくはアモルファスシリコン、特に好ましくはホウ素とシリコンとの化合物またはゲルマニウムとシリコンとの化合物で形成されてもよい。
その後、方法は、オプションで、さらなる電気コンタクトエレメント、導電体トラックまたは電極を形成し、犠牲層も形成する。犠牲層は、同様に、二酸化ケイ素で形成される。犠牲層材料は、絶縁体層の材料と同一であってもよい。しかしながら、2つの材料は、それらが異なってドープされることにより、または他の物質をさらに含む二酸化ケイ素により、異なる整合性(consistency)を有していてもよい。絶縁体および/または犠牲層を形成するために使用される二酸化ケイ素は、ガラスについてそれ自体既知の添加剤、特にホウ素およびリンを含んでいてもよい。
続いて、周囲に延在する保護層が設けられたこのCMOS回路上に、任意の所望のMEMSエレメントがアプライされる。
その後、エッチング法によって犠牲層材料が除去され、その結果、少なくとも1つの微小電気機械エレメントの可動性が達成される。
トレンチは、シリコンまたは酸化アルミニウムでほぼ完全に、シリコンで好ましくは完全に充填されてもよい。結果として、エッチング攻撃に対する側面保護をさらに改善することができる。
絶縁体層は、連続して複数の方法ステップで段階的に形成されてもよい。これらの方法ステップの間に、それ自体既知の方法で、電気コンタクトエレメントおよび/または電気導体トラックを形成し、絶縁体層材料に埋め込んでもよい。電気コンタクトエレメントおよび電極を犠牲層に埋め込んで、エッチングによって再び露出させてもよい。
代替として、または追加として、前記クローズド層は、トレンチ内において、好ましくは金属、特に好ましくはチタン、窒化チタン(titanium nitride)、アルミニウム、アルミニウム-銅合金(aluminium-copper alloy)またはチタン-アルミニウム合金(titanium-aluminium alloy)で形成される少なくとも1つのさらなる層で覆われてもよい。
絶縁体層と犠牲層の間に、酸化アルミニウムまたはシリコン、特にaSiからなるクローズドバリア層と、および少なくとも1つの微小電気機械エレメントの方向に面するバリア層の表面上に、微小電気機械エレメントの作動に必要なさらなる電気コンタクトエレメントおよび電極とを形成してもよく、これらは、バリア層の下に配置された電気コンタクトエレメントに導電的に接続される。その後、バリア層の上方の犠牲層の材料をエッチングにより除去し、その結果、微小電気機械エレメントの可動性が達成される。
トレンチ内のシリコンまたは酸化アルミニウムは、PE-CVD技術、スパッタリングまたは原子層堆積(ALD)によって堆積されてもよく、これにより、前記クローズド層を形成することができる。
ホウ素をドープしたアモルファスシリコンaSiBまたは酸化アルミニウム、ゲルマニウム、またはシリコンとゲルマニウムの化合物aSiGeを材料として使用すると、金属よりも液体状または気体状のフッ化水素酸に対して優れてまたは完全に不活性であり、これにより、事実上無制限の時間にわたって、リリースプロセスにおける望ましい保護効果を確実にすることができる。
さらなる利点は、シリコン、特にaSiB、ゲルマニウム、またはシリコンとゲルマニウムの化合物aSiGeの、トレンチを充填する能力によって達成される。シリコン、ゲルマニウム、またはシリコンとゲルマニウムの化合物は、PE-CVD技術を使用して堆積され、リング状の保護として提供されるトレンチを完全にボイドなしで充填することができる。その後、シリコン、特にaSiB、またはゲルマニウムまたはシリコンとゲルマニウムの化合物aSiGeを平坦化することができる。これとは対照的に、これまでに使用され、すでに述べた金属層は、PVD法によって堆積され、プロセスにおいてトレンチを完全に充填するのではなく、底部と側壁のみを充填する。この場合、これらの層の厚さは、通常、構造化されていない領域に堆積された所望の厚さよりも大幅に薄い。特にトレンチ底部から側壁への移行部では、層厚が最小となり、局所的な機械的条件の結果として、マイクロクラックの形成がより多く発生する。材料の耐久性が低いことに加えて、前記マイクロクラックは追加のリークを構成し、金属で充填されたトレンチの保護効果を低下させる。このような問題は、特にコンポーネントの角部で観察され、層で形成された保護リングの必要とされる曲率半径の結果としてアンダーカットの発生がさらに増加する。対照的に、シリコン、特にaSiB、ゲルマニウム、またはシリコンとゲルマニウムで形成された化合物で完全に満たされたトレンチを使用すると、層で形成されたシリコンで満たされた保護リングの幅と高さの合計が大幅に広く、高くなるため、リークは予期されない。
本発明に係るMEMSコンポーネントの製造中、これまで通例であったような、それ自体既知の方法に頼ることが可能である。
本発明は、実施例として以下により詳細に説明される。
図1Aは、本発明に係るMEMSコンポーネントの一実施例の断面図を示している。この図では、微小電気機械エレメントはまだ自由に動くことができない。 図1Bは、本発明に係るMEMSコンポーネントの他の実施例の断面図を示している。この図では、微小電気機械エレメントはまだ自由に動くことができない。 図2は、標準的なCMOS回路基板の断面図を示している。 図3は、CMOS回路基板の断面図を示している。この図では、CMOS回路基板の表面のCMOSエレメントは、二酸化ケイ素からなる絶縁体層の領域で覆われている。 図4は、図3のCMOS回路の断面図を示している。この図では、絶縁層に穿孔(ビア)が形成されている。 図5は、図4に示す実施例の断面図を示している。この図では、メタライゼーション(metallization)および金属の構造化が、CMOSおよび電気コンタクトエレメント上の電気スルーコンタクトを形成するために実施されている。 図6は、図5に示す実施例の断面図を示している。この図では、穿孔によって、CMOS回路のエレメントの周囲の半径方向の外縁にある電気スルーコンタクト(ビア)を介して、円周方向に延在する半径方向のトレンチがシリコンウェーハまで形成されている。 図7は、図6の絶縁層を備えたCMOS回路の断面図を示している。このプロセスでは、表面がaSiBでコーティングされ、トレンチがaSiBで充填されている。 図8は、図7に示す実施例の断面図を示している。この図では、堆積されたaSiBの一部が、トレンチ領域を除いて、再び除去されている。 図9は、図8に示す実施例の断面図を示している。この図では、さらなる領域が、aSiBで満たされたトレンチを覆うように、表面上に二酸化ケイ素からなる絶縁体層で形成されている。 図10は、図9に示す実施例の断面図を示している。この図では、絶縁体層の表面が平坦化されている。 図11は、図10に示す実施例の断面図を示している。この図では、平坦化された表面に穿孔(ビア)が形成されており、シリコン層と接触する金属層が表面および前記穿孔に形成されている。 図12は、図11に示す実施例の断面図を示している。この図では、局所的に規定された金属層の除去により、電気コンタクトエレメントおよび導電体トラックが形成されている。 図13は、図12に示す実施例の断面図を示している。この図では、絶縁層のさらなる領域が形成され、電気コンタクトエレメントがその中に埋め込まれている。 図14は、図13に示す実施例の断面図を示している。この図では、絶縁層の表面の平坦化が実施されている。 図15は、図14に示す実施例の断面図を示している。この図では、酸化アルミニウムまたはaSiからなるバリア層が犠牲層の平坦化された表面上に形成されている。 図16は、図15に示す実施例の断面図を示している。この図では、穿孔が、酸化アルミニウムまたはaSiから構成されるバリア層を通して局所的に規定された方法で形成されている。 図17は、図16に示す実施例の断面図を示している。この図では、絶縁層内に配置された電気コンタクトエレメントまで穿孔が導入されている。 図18は、図17に示す実施例の断面図を示している。この図では、メタライゼーションが表面に施されており、電気コンタクトエレメントまで電気スルーコンタクトが形成されている。 図19は、図18に示す実施例の断面図を示している。この図では、最終的なメタライゼーションが局所的に規定された方法で削除されている。 図20は、図19に示す実施例の断面図を示している。この図では、メタライズされたCMOS回路の表面にMEMSエレメントの犠牲層が形成されている。 図21は、図20に示す実施例の断面図を示している。この図では、犠牲層の表面が平坦化されている。 図22は、図21に示す実施例の断面図を示している。この図では、犠牲層より前に形成された領域において、電気コンタクトエレメントまで穿孔が形成されている。 図23は、図22に示す実施例の断面図を示している。この図では、微小電気機械エレメントを形成するための材料が、最後に形成された穿孔まで、犠牲層より前にアプライされた領域の平坦化された表面にアプライされている。 図24は、図23に示す実施例の断面図を示している。この図では、微小電気機械エレメントを形成するための材料の局所的に規定された除去が実施されている。 図25は、本発明に係るMEMSコンポーネントの完成した製造例の断面図を示している。この図では、犠牲層の領域が除去されており、その結果、微小電気機械エレメントは可動となっている。
以下の図を用いて、本発明に係るMEMSコンポーネントの実施例を方法ステップで順を追って製造する方法を明らかにすることを意図する。
図1Aは、微小電気機械エレメント5がまだ自由に動くことができない例を示している。この場合、CMOS回路基板1の表面上にMEMSコンポーネントの上部領域に犠牲層2.1が形成され、MEMSエレメント5の可動性を達成するために、前記上部領域は除去されることが意図される。その下に、二酸化ケイ素からなる絶縁体層2.2がCMOS回路の領域に形成され、複数の電気コンタクトエレメント3が前記絶縁体層に埋め込まれている。MEMSコンポーネントの半径方向外縁において、aSiBからなる層4がCMOS回路基板1の表面上に周方向に延在するように形成され、当該表面の他の部分は犠牲層材料および絶縁体層材料によって囲まれている。
微小電気機械エレメント5が依然として接触している犠牲層2.1の表面から離れたところに、酸化アルミニウムで作られたバリア層7が形成され、バリア層7は、電気スルーコンタクト8が電気コンタクトエレメント3に通じる貫通穴を有する。この実施例では、微小電気機械エレメント5は、電磁放射を反射する旋回可能なエレメント(pivotable element)であることを意図している。
図1Bに示す実施例は、単に層4が形成される方法において、図1Aに示す実施例とは異なる。当該層4はバリア層7まで導かれる。
図2は、製造の開始点として標準的に利用可能なCMOSエレメント15を有するCMOS回路基板1を示す。
図3は、二酸化ケイ素からなる絶縁体層2.2の領域が、PE-CVD法によってCMOS回路基板1の表面上にどのように堆積されたかを示している。
このようにして形成された犠牲層2に、反応性イオンエッチングによって局所的に規定された方法でコンタクトホール(ビア)9が形成され、前記コンタクトホールは、絶縁体層2.2のこれまで形成された領域の表面からCMOS回路基板1の電気コンタクト(electrical contacts)まで導かれている(図4)。
さらなる電気コンタクト3と電気スルーコンタクト10は、スパッタリングによる金属の堆積と、図5に示すリソグラフィーのパターン形成によって形成された。
図6は、図5に示す半完成品が、MEMSコンポーネントの半径方向外縁の絶縁体層2.2の材料に、反応性イオンエッチングによって円周方向に延在する半径方向のトレンチ6を形成することによって、さらに処理された様子を示しており、前記トレンチはCMOS回路基板1の表面まで延びている。
図7は、PE-CVD法によって、表面全体がどのようにaSiB4.1でコーティングされたかを示している。また、当該プロセスにおいて、トレンチ6は、aSiB4.1で完全に充填された。
その後、aSiB4.1は、リソグラフィーによって局所的に規定された方法で、および反応性イオンエッチングによって局所的に規定された方法で除去され、図8に示す層4として後の保護リングの領域にのみ残っている。層4の表面は、この実施例のようにパターン化された方法で形成される必要はなく、図1Bに示されているように、平坦かつ平面であってもよい。
その後、絶縁体層2.2の領域が、PE-CVD法によって再び堆積され、その結果、表面は二酸化ケイ素で完全に形成され、層4も二酸化ケイ素で覆われる(図9)。
図10は、それまでに形成された絶縁体層2.2の表面、および層4を形成するaSiBが化学機械研磨によってどのように平坦化されているかを示している。
それまでに形成された絶縁体層2.2の平坦化された表面上に、ビア10がエッチングされ、AlSiCuからなる連続層11(連続層11は層4のaSiBと接触する)が、スパッタリングによって形成された(図11)。
図12は、どのように、層11の一部がリソグラフィー及びエッチングにより局所的に規定された方法で除去され、これにより、電気コンタクトエレメントおよび/または導体トラック3が形成されたかを示す。
図13および図14から、絶縁層2.2のさらなる領域がPE-CVD法によって表面上に形成され、最後に製造された電気コンタクトエレメント3がその中に埋め込まれていることがわかる。その後、絶縁体層2.2の表面は、化学機械研磨によって再び平坦化された。
図15は、絶縁体層2.2の表面全体上への酸化アルミニウムからなるバリア層7の形成を示している。バリア層7は、ALD(原子層堆積(atomic layer deposition))によって形成することができる。それはクローズド層(a closed layer)を形成するはずである。
図16によれば、穿孔(perforations)7.1は、反応性イオンエッチングによって局所的に規定された方法でバリア層7に形成される。
穿孔7.1は、反応性イオンエッチングによる、絶縁層材料の局所的に規定された除去によりさらに深くされ、その結果、電気コンタクトエレメント3に到達する拡大ビア7.2を形成することができる。これは、図17に示されている。
図18によれば、金属層12がスパッタリングによって再び表面にアプライされ、前記金属層は、最後に形成された電気コンタクトエレメント3へのスルーコンタクト8を形成するために使用される。この目的のために、AlSiCu合金またはTiAl合金が再び使用されてもよい。

図19では、金属層12の局所的に規定された除去がリソグラフィーとエッチングによってどのように行われることが意図されているかを明らかにすることを目的としている。この除去により、バリア層7の表面にさらに電気コンタクトエレメント3および電極13が形成される。
微小電気機械エレメント5を形成するために、PE-CVD技術を使用して、表面にさらに犠牲層材料を堆積する。その結果、犠牲層2.1の材料によって、最後に形成された電気コンタクトエレメント3、電極13、バリア層7が囲まれる(図20)。
図21によれば、犠牲層2.1の表面は、化学機械研磨によって再び平坦化される。
図22から、反応性イオンエッチングによって、表面から、犠牲層2.1に埋め込まれるとともにバリア層7の上に配置された電気コンタクトエレメント3まで、犠牲層材料を貫通して、さらなる穿孔14が形成されることがわかる。
その後、微小電気機械エレメント5を形成するための材料5.1の層が形成され、これにより穿孔14が材料5.1で満たされ、その結果、微小電気機械エレメント5のための導電性材料の場合、対応する電気コンタクトエレメント3への導電性接続を形成することができる。この層は、金属の場合はスパッタリングによって、例えばシリコンなどの他の材料の場合はPE-CVD法によって形成できる(図23)。
微小電気機械エレメント5を形成することを目的とする材料の一部は、リソグラフィーおよびエッチングによって再び除去することができ、その結果、微小電気機械エレメント5の寸法(dimensioning)および幾何学的形状(geometric shape)に影響を与えることができる(図24)。
その後、表面で犠牲層材料がフッ化水素酸を使用した液相エッチングまたは気相エッチング(wet or vapor phase etching)によって除去され、その結果、この場合旋回可能な反射エレメントとして具体化された微小電気機械エレメント5が、少なくとも1つの軸を中心に自由に動くことができるように旋回可能になる。ここで、外縁で層4の一部を露出させることも可能であるが、これはそうである必要はない。
このように処理された本発明に係るMEMSコンポーネントの実施例は、図25に示される。

Claims (11)

  1. 少なくとも1つの微小電気機械エレメント(5)と、電気コンタクトエレメント(3)と、絶縁層(2.2)と、およびその上に二酸化ケイ素で形成される犠牲層(2.1)とが、CMOS回路基板(1)の表面上に形成され、前記微小電気機械エレメント(5)は少なくとも1つの自由度で自由に可動に配置され、局所的に規定された方法で除去された前記犠牲層(2.1)により、前記少なくとも1つの微小電気機械エレメント(5)は可動であり、
    微小電気機械コンポーネントの外縁で、前記CMOS回路のすべてのエレメントの周囲に半径方向(radially)に延在し、フッ化水素酸に耐性があり、シリコン、ゲルマニウム、または、酸化アルミニウムで形成された気密および/または液密のクローズド層(closed layer)(4)が前記CMOS回路基板(1)の表面に形成されていることを特徴とする、微小電気機械コンポーネント。
  2. 前記クローズド層(4)がアモルファスシリコン(amorphous silicon)で形成されることを特徴とする、請求項1に記載の微小電気機械コンポーネント。
  3. 前記クローズド層(4)が、ドープされたアモルファスシリコン(doped amorphous silicon)、特にホウ素またはゲルマニウムがドープされたアモルファスシリコン(boron or germanium doped amorphous silicon)、またはシリコンとゲルマニウムの化合物(chemical compound of silicon and germanium)で形成されることを特徴とする、請求項1または2に記載の微小電気機械コンポーネント。
  4. 前記微小電気機械エレメント(5)が可動に配置される前記微小電気機械コンポーネントの表面に、酸化アルミニウム(aluminium oxide)からなるバリア層(7)が形成されることを特徴とする、請求項1~3の何れか一項に記載の微小電気機械コンポーネント。
  5. 前記クローズド層(4)が少なくとも1つのさらなる層でオーバーコートされ、前記少なくとも1つのさらなる層は、好ましくは金属、特に好ましくはチタン、アルミニウム、アルミニウム-銅合金(aluminium-copper alloy)またはチタン-アルミニウム合金(titanium-aluminium alloy)または窒化チタン(titanium nitride)で形成されることを特徴とする、請求項1~4の何れか一項に記載の微小電気機械コンポーネント。
  6. 請求項1~5の何れか一項に記載の微小電気機械コンポーネントを製造する方法であって、
    二酸化ケイ素を含む絶縁体層(2.2)がCMOS回路基板(1)の表面にアプライされ、そのプロセスで電気コンタクトエレメント(3)が局所的に規定された方法で前記絶縁体層(2.2)に埋め込まれ、
    外縁の前記絶縁体層(2.2)には、前記CMOS回路基板(1)の表面まで延びる少なくとも1つのトレンチ(6)が、前記CMOS回路のすべてのエレメントの周囲に半径方向に延びるように形成され、
    前記トレンチ(6)は、少なくともその底部領域において、シリコン(silicon)、ゲルマニウム(germanium)、シリコンとゲルマニウムの化合物(chemical compound of silicon and germanium)または酸化アルミニウム(aluminium oxide)で形成されるクローズド層(4)で満たされ、
    続いて、二酸化ケイ素で形成される犠牲層(2.1)をアプライし、その上に少なくとも1つの微小機械エレメント(5)が形成される材料を形成し、
    次いで、エッチング法により、前記犠牲層(2.1)は、フッ化水素酸を使用して局所的に規定された方法で除去され、その結果、前記少なくとも1つの微小電気機械エレメント(5)可動になる、製造方法。
  7. 前記トレンチ(6)が、ほぼ完全に、好ましくは完全に、シリコン、ゲルマニウムまたは酸化アルミニウムで充填されることを特徴とする、請求項6に記載の製造方法。
  8. 前記クローズド層(4)が、前記トレンチ内(6)において、好ましくは金属、特に好ましくはチタン、チタン-アルミニウム合金(titanium-aluminium alloy)またはアルミニウム-銅合金(aluminium-copper alloy)または窒化チタン(titanium nitride)で形成される少なくとも1つのさらなる層で覆われることを特徴とする、請求項6に記載の製造方法。
  9. 前記犠牲層(2)において、酸化アルミニウム(aluminium oxide)からなるクローズドバリア層(closed barrier layer)(7)と、前記少なくとも1つの微小電気機械エレメント(5)の方向に面する前記バリア層(7)の表面上に前記微小電気機械エレメント(5)の作動に必要なさらなる電気コンタクトエレメント(3)および/または電極(13)とが形成され、これらが前記バリア層(7)の下に配置された電気コンタクトエレメント(3)に導電的に接続されており、
    その後、前記バリア層(7)の上の犠牲層(2.1)の材料をエッチングにより除去し、その結果、前記微小電気機械エレメント(5)可動になる、請求項6乃至8の何れか一項に記載の製造方法。
  10. 前記犠牲層(2.1)が形成される材料の局所的に規定された除去のために、液体または気体のフッ化水素酸がエッチングプロセスのために使用されることを特徴とする、請求項6乃至9の何れか一項に記載の製造方法。
  11. シリコンまたは酸化アルミニウムが、PE-CVD技術、スパッタリングまたはALDによって前記トレンチ(6)に堆積され、前記クローズド層(4)がそれとともに形成されることを特徴とする、請求項6乃至10の何れか一項に記載の製造方法。
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Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN112368233A (zh) * 2018-07-04 2021-02-12 依格耐特有限公司 具有止蚀层的mems显示装置

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2007134453A (ja) 2005-11-09 2007-05-31 Sony Corp マイクロマシン混載の電子回路装置、およびマイクロマシン混載の電子回路装置の製造方法

Family Cites Families (26)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE4418207C1 (de) * 1994-05-25 1995-06-22 Siemens Ag Thermischer Sensor/Aktuator in Halbleitermaterial
US6440766B1 (en) * 2000-02-16 2002-08-27 Analog Devices Imi, Inc. Microfabrication using germanium-based release masks
DE10017976A1 (de) * 2000-04-11 2001-10-18 Bosch Gmbh Robert Mikromechanisches Bauelement und entsprechendes Herstellungsverfahren
US20040157426A1 (en) * 2003-02-07 2004-08-12 Luc Ouellet Fabrication of advanced silicon-based MEMS devices
US6861277B1 (en) * 2003-10-02 2005-03-01 Hewlett-Packard Development Company, L.P. Method of forming MEMS device
GB0330010D0 (en) * 2003-12-24 2004-01-28 Cavendish Kinetics Ltd Method for containing a device and a corresponding device
US8576474B2 (en) * 2004-08-14 2013-11-05 Fusao Ishii MEMS devices with an etch stop layer
DE102005053765B4 (de) * 2005-11-10 2016-04-14 Epcos Ag MEMS-Package und Verfahren zur Herstellung
US7568399B2 (en) * 2006-01-05 2009-08-04 Integrated Sensing Systems, Inc. Microfluidic device
KR100758641B1 (ko) * 2006-04-28 2007-09-13 재단법인서울대학교산학협력재단 Cmos 회로가 집적된 실리콘 기판 상에 미세구조물을 형성하는 방법 및 상기 방법에 의하여 형성된 미세 구조물을 포함하는 mems 소자
HUP0600488A2 (en) * 2006-06-13 2008-05-28 Mta Mueszaki Fiz Es Anyagtudom Method for producing micromechanical elements can be integrated into cmos technology, carrying monolith si and monolith sio produced by porous si micromanufacturing process
US7821010B2 (en) * 2006-06-28 2010-10-26 Spatial Photonics, Inc. Low temperature fabrication of conductive micro structures
US7863752B2 (en) * 2009-02-25 2011-01-04 Capella Photonics, Inc. MEMS device with integrated via and spacer
US20100289065A1 (en) * 2009-05-12 2010-11-18 Pixart Imaging Incorporation Mems integrated chip with cross-area interconnection
TW201132578A (en) * 2009-08-24 2011-10-01 Cavendish Kinetics Inc Fabrication of a floating rocker MEMS device for light modulation
CN102001613B (zh) * 2009-09-02 2014-10-22 原相科技股份有限公司 微电子装置及制造方法、微机电封装结构及封装方法
JP2011218463A (ja) * 2010-04-06 2011-11-04 Seiko Epson Corp 電子装置の製造方法
US8368152B2 (en) * 2011-04-18 2013-02-05 Taiwan Semiconductor Manufacturing Company, Ltd. MEMS device etch stop
US8440523B1 (en) * 2011-12-07 2013-05-14 International Business Machines Corporation Micromechanical device and methods to fabricate same using hard mask resistant to structure release etch
US20130161702A1 (en) * 2011-12-25 2013-06-27 Kun-Lung Chen Integrated mems device
EP2629084B1 (en) * 2012-02-17 2018-05-02 ams international AG Integrated circuit and manufacturing method
US10497747B2 (en) * 2012-11-28 2019-12-03 Invensense, Inc. Integrated piezoelectric microelectromechanical ultrasound transducer (PMUT) on integrated circuit (IC) for fingerprint sensing
US9487396B2 (en) 2014-09-04 2016-11-08 Invensense, Inc. Release chemical protection for integrated complementary metal-oxide-semiconductor (CMOS) and micro-electro-mechanical (MEMS) devices
JP2016099114A (ja) * 2014-11-18 2016-05-30 セイコーエプソン株式会社 電子デバイス、物理量センサー、圧力センサー、高度計、電子機器および移動体
US9862592B2 (en) * 2015-03-13 2018-01-09 Taiwan Semiconductor Manufacturing Co., Ltd. MEMS transducer and method for manufacturing the same
US9656855B1 (en) * 2016-02-26 2017-05-23 Taiwan Semiconductor Manufacturing Company, Ltd. Semiconductor structure and manufacturing method thereof

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2007134453A (ja) 2005-11-09 2007-05-31 Sony Corp マイクロマシン混載の電子回路装置、およびマイクロマシン混載の電子回路装置の製造方法

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