JP6785802B2 - パターン化ウェハ幾何計測を用いたプロセス誘起非対称性の検出、定量及び制御 - Google Patents
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- 238000000034 method Methods 0.000 title claims description 81
- 238000005259 measurement Methods 0.000 title claims description 54
- 238000001514 detection method Methods 0.000 title claims description 14
- 238000011002 quantification Methods 0.000 title claims description 7
- 235000012431 wafers Nutrition 0.000 claims description 128
- 238000004519 manufacturing process Methods 0.000 claims description 41
- 230000000694 effects Effects 0.000 claims description 23
- 238000004458 analytical method Methods 0.000 claims description 11
- 238000001914 filtration Methods 0.000 claims description 11
- 239000004065 semiconductor Substances 0.000 description 13
- 238000012545 processing Methods 0.000 description 10
- 238000004886 process control Methods 0.000 description 7
- 238000012937 correction Methods 0.000 description 6
- 238000010586 diagram Methods 0.000 description 6
- 238000001459 lithography Methods 0.000 description 5
- 238000004364 calculation method Methods 0.000 description 4
- 238000011143 downstream manufacturing Methods 0.000 description 3
- 238000005457 optimization Methods 0.000 description 3
- 239000000758 substrate Substances 0.000 description 3
- 230000008021 deposition Effects 0.000 description 2
- 238000000151 deposition Methods 0.000 description 2
- 238000005516 engineering process Methods 0.000 description 2
- 239000000463 material Substances 0.000 description 2
- 238000005498 polishing Methods 0.000 description 2
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 1
- 238000000137 annealing Methods 0.000 description 1
- 238000013461 design Methods 0.000 description 1
- 230000005489 elastic deformation Effects 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 230000005484 gravity Effects 0.000 description 1
- 238000005468 ion implantation Methods 0.000 description 1
- 239000012528 membrane Substances 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 238000012544 monitoring process Methods 0.000 description 1
- 230000000750 progressive effect Effects 0.000 description 1
- 238000005070 sampling Methods 0.000 description 1
- 229910052710 silicon Inorganic materials 0.000 description 1
- 239000010703 silicon Substances 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
- 239000010409 thin film Substances 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L22/00—Testing or measuring during manufacture or treatment; Reliability measurements, i.e. testing of parts without further processing to modify the parts as such; Structural arrangements therefor
- H01L22/10—Measuring as part of the manufacturing process
- H01L22/12—Measuring as part of the manufacturing process for structural parameters, e.g. thickness, line width, refractive index, temperature, warp, bond strength, defects, optical inspection, electrical measurement of structural dimensions, metallurgic measurement of diffusions
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- G—PHYSICS
- G03—PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
- G03F—PHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
- G03F7/00—Photomechanical, e.g. photolithographic, production of textured or patterned surfaces, e.g. printing surfaces; Materials therefor, e.g. comprising photoresists; Apparatus specially adapted therefor
- G03F7/70—Microphotolithographic exposure; Apparatus therefor
- G03F7/70483—Information management; Active and passive control; Testing; Wafer monitoring, e.g. pattern monitoring
- G03F7/70605—Workpiece metrology
- G03F7/70616—Monitoring the printed patterns
- G03F7/70633—Overlay, i.e. relative alignment between patterns printed by separate exposures in different layers, or in the same layer in multiple exposures or stitching
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F30/00—Computer-aided design [CAD]
- G06F30/30—Circuit design
- G06F30/39—Circuit design at the physical level
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F30/00—Computer-aided design [CAD]
- G06F30/30—Circuit design
- G06F30/39—Circuit design at the physical level
- G06F30/398—Design verification or optimisation, e.g. using design rule check [DRC], layout versus schematics [LVS] or finite element methods [FEM]
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/027—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34
- H01L21/0271—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising organic layers
- H01L21/0273—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising organic layers characterised by the treatment of photoresist layers
- H01L21/0274—Photolithographic processes
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L22/00—Testing or measuring during manufacture or treatment; Reliability measurements, i.e. testing of parts without further processing to modify the parts as such; Structural arrangements therefor
- H01L22/20—Sequence of activities consisting of a plurality of measurements, corrections, marking or sorting steps
- H01L22/26—Acting in response to an ongoing measurement without interruption of processing, e.g. endpoint detection, in-situ thickness measurement
-
- G—PHYSICS
- G03—PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
- G03F—PHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
- G03F1/00—Originals for photomechanical production of textured or patterned surfaces, e.g., masks, photo-masks, reticles; Mask blanks or pellicles therefor; Containers specially adapted therefor; Preparation thereof
- G03F1/38—Masks having auxiliary features, e.g. special coatings or marks for alignment or testing; Preparation thereof
- G03F1/44—Testing or measuring features, e.g. grid patterns, focus monitors, sawtooth scales or notched scales
-
- G—PHYSICS
- G03—PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
- G03F—PHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
- G03F7/00—Photomechanical, e.g. photolithographic, production of textured or patterned surfaces, e.g. printing surfaces; Materials therefor, e.g. comprising photoresists; Apparatus specially adapted therefor
- G03F7/70—Microphotolithographic exposure; Apparatus therefor
- G03F7/70483—Information management; Active and passive control; Testing; Wafer monitoring, e.g. pattern monitoring
- G03F7/70491—Information management, e.g. software; Active and passive control, e.g. details of controlling exposure processes or exposure tool monitoring processes
- G03F7/705—Modelling or simulating from physical phenomena up to complete wafer processes or whole workflow in wafer productions
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F2119/00—Details relating to the type or aim of the analysis or the optimisation
- G06F2119/18—Manufacturability analysis or optimisation for manufacturability
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02P—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN THE PRODUCTION OR PROCESSING OF GOODS
- Y02P90/00—Enabling technologies with a potential contribution to greenhouse gas [GHG] emissions mitigation
- Y02P90/02—Total factory control, e.g. smart factories, flexible manufacturing systems [FMS] or integrated manufacturing systems [IMS]
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- Engineering & Computer Science (AREA)
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- General Physics & Mathematics (AREA)
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- General Engineering & Computer Science (AREA)
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- Manufacturing & Machinery (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
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Description
本願は2015年6月22日付米国暫定特許出願第62/183105号に基づき米国特許法第119条(e)の規定による利益を主張する出願である。この参照を以て当該米国暫定特許出願第62/183105号の全容を本願に繰り入れる。
Claims (23)
- ウェハが製造プロセスに供される前にそのウェハの第1組のウェハ幾何計測結果(wafer geometry measurements)を取得するステップと、
上記製造プロセスの後に上記ウェハの第2組のウェハ幾何計測結果を取得するステップと、
第1組のウェハ幾何計測結果及び第2組のウェハ幾何計測結果に基づき幾何変化マップ(geometry-change map)を算出するステップと、
上記製造プロセスによってウェハ幾何に誘起された非対称成分を検出すべく幾何変化マップを分析するステップと、
上記製造プロセスによって誘起された非対称オーバレイ誤差を、ウェハ幾何にて検出された上記非対称成分に基づき推定するステップと、
を有し、上記分析ステップが、更に、
幾何変化マップに少なくとも部分的に基づき上記ウェハの面内歪みを算出するステップと、
上記ウェハの面内歪みから対称成分を除去することで濾過面内歪みマップ(filtered in-plane distortion map)を生成するステップと、
濾過面内歪みマップに少なくとも部分的に基づき上記非対称成分を検出するステップと、
を含む方法。 - 請求項1記載の方法であって、更に、
第1組のウェハ幾何計測結果及び第2組のウェハ幾何計測結果に基づき局所形状曲率マップ(local shape curvature map)を生成するステップと、
局所形状曲率マップに少なくとも部分的に基づき上記非対称成分を検出するステップと、
を有する方法。 - 請求項2記載の方法であって、上記非対称成分検出ステップが、更に、
局所形状曲率マップから対称成分を除去することで濾過局所形状曲率マップ(filtered local shape curvature map)を生成するステップと、
濾過局所形状曲率マップに少なくとも部分的に基づき上記非対称成分を検出するステップと、
を含む方法。 - 請求項3記載の方法であって、更に、
オーバレイに対する上記非対称成分の影響を定量するステップを有する方法。 - 請求項4記載の方法であって、上記定量ステップが、更に、
局所形状曲率マップ内に含まれる非対称成分のウェイトに基づき非対称性因数(asymmetry factor)を特定するステップと、
上記ウェハの面内歪みの規模を判別するステップと、
オーバレイに対する上記非対称成分の影響を、非対称性因数と上記ウェハの面内歪みの規模との積に基づき定量するステップと、
を含む方法。 - 請求項5記載の方法であって、更に、
濾過面内歪みマップ、濾過局所形状曲率マップ、並びにオーバレイに対する上記非対称成分の影響、のうち少なくとも1個に基づき、上記ウェハを複数個のウェハグループのうち1個へと分類するステップを有する方法。 - 請求項5記載の方法であって、更に、
上記製造プロセスを実行した製造プロセスツールを制御するフィードバック制御手段に、濾過面内歪みマップ、濾過局所形状曲率マップ、並びにオーバレイに対する上記非対称成分の影響、のうち少なくとも1個を通知するステップを、有する方法。 - 請求項5記載の方法であって、更に、
後続の製造プロセスツールを制御するフィードフォワード制御手段に、濾過面内歪みマップ、濾過局所形状曲率マップ、並びにオーバレイに対する上記非対称成分の影響、のうち少なくとも1個を通知するステップを、有する方法。 - ウェハが製造プロセスに供される前にそのウェハの第1組のウェハ幾何計測結果を取得するステップと、
上記製造プロセスの後に上記ウェハの第2組のウェハ幾何計測結果を取得するステップと、
第1組のウェハ幾何計測結果及び第2組のウェハ幾何計測結果に基づき幾何変化マップを算出するステップと、
幾何変化マップに少なくとも部分的に基づき上記ウェハの面内歪みマップ及び局所形状曲率マップのうち少なくとも一方を生成するステップと、
上記ウェハの面内歪みマップ及び局所形状曲率マップのうち少なくとも一方に少なくとも部分的に基づきプロセス誘起非対称成分(process-induced asymmetric component)を検出するステップと、
を有する方法。 - 請求項9記載の方法であって、上記プロセス誘起非対称成分検出ステップが、更に、
局所形状曲率マップから対称成分を除去することで濾過局所形状曲率マップを生成するステップと、
濾過局所形状曲率マップに少なくとも部分的に基づきプロセス誘起非対称成分を検出するステップと、
を含む方法。 - 請求項10記載の方法であって、更に、
オーバレイに対するプロセス誘起非対称成分の影響を定量するステップを有する方法。 - 請求項11記載の方法であって、オーバレイに対するプロセス誘起非対称成分の影響を定量する上記ステップが、更に、
局所形状曲率マップ内に含まれる非対称成分のウェイトに基づき非対称性因数を特定するステップと、
第1組のウェハ幾何計測結果及び第2組のウェハ幾何計測結果に基づき高周波因数(high-frequency factor)を特定するステップと、
オーバレイに対するプロセス誘起非対称成分の影響を、非対称性因数と高周波因数との積に基づき定量するステップと、
を含む方法。 - 請求項12記載の方法であって、上記高周波因数が上記ウェハの面内歪みの規模を含む方法。
- 請求項11記載の方法であって、更に、
オーバレイに対するプロセス誘起非対称成分の影響を、上記製造プロセスを実行した製造プロセスツールを制御するフィードバック制御手段に通知するステップを、有する方法。 - 請求項11記載の方法であって、更に、
オーバレイに対するプロセス誘起非対称成分の影響を、後続の製造プロセスツールを制御するフィードフォワード制御手段に通知するステップを、有する方法。 - ウェハが製造プロセスに供される前にそのウェハの第1組のウェハ幾何計測結果を取得するよう、且つその製造プロセスの後にそのウェハの第2組のウェハ幾何計測結果を取得するよう、構成された幾何計測ツールと、
上記幾何計測ツールと通信するプロセッサと、
を備え、上記プロセッサが、
第1組のウェハ幾何計測結果及び第2組のウェハ幾何計測結果に基づき幾何変化マップを算出するよう、
上記製造プロセスによってウェハ幾何に誘起された非対称成分を検出すべく幾何変化マップを分析するよう、且つ
上記製造プロセスによって誘起された非対称オーバレイ誤差を、ウェハ幾何にて検出された上記非対称成分に基づき推定するよう、
構成され、上記プロセッサが、更に、
幾何変化マップに少なくとも部分的に基づき上記ウェハの面内歪みを算出するよう、
上記ウェハの面内歪みから対称成分を除去することで濾過面内歪みマップを生成するよう、且つ
濾過面内歪みマップに少なくとも部分的に基づき上記非対称成分を検出するよう、
構成されているシステム。 - 請求項16記載のシステムであって、上記プロセッサが、更に、
第1組のウェハ幾何計測結果及び第2組のウェハ幾何計測結果に基づき局所形状曲率マップを生成するよう、且つ
局所形状曲率マップに少なくとも部分的に基づき上記非対称成分を検出するよう、
構成されているシステム。 - 請求項17記載のシステムであって、上記プロセッサが、更に、
局所形状曲率マップから対称成分を除去することで濾過局所形状曲率マップを生成するよう、且つ
濾過局所形状曲率マップに少なくとも部分的に基づき上記非対称成分を検出するよう、
構成されているシステム。 - 請求項18記載のシステムであって、上記プロセッサが、更に、
オーバレイに対する上記非対称成分の影響を定量するよう、構成されているシステム。 - 請求項19記載のシステムであって、上記プロセッサが、更に、
局所形状曲率マップ内に含まれる非対称成分のウェイトに基づき非対称性因数を特定するよう、
上記ウェハの面内歪みの規模を判別するよう、且つ
オーバレイに対する上記非対称成分の影響を、非対称性因数と上記ウェハの面内歪みの規模との積に基づき定量するよう、
構成されているシステム。 - 請求項20記載のシステムであって、上記プロセッサが、更に、
濾過面内歪みマップ、濾過局所形状曲率マップ、並びにオーバレイに対する上記非対称成分の影響、のうち少なくとも1個に基づき、上記ウェハを複数個のウェハグループのうち1個へと分類するよう、構成されているシステム。 - 請求項20記載のシステムであって、上記プロセッサが、更に、
上記製造プロセスを実行した製造プロセスツールを制御するフィードバック制御手段に、濾過面内歪みマップ、濾過局所形状曲率マップ、並びにオーバレイに対する上記非対称成分の影響、のうち少なくとも1個を通知するよう、構成されているシステム。 - 請求項20記載のシステムであって、上記プロセッサが、更に、
後続の製造プロセスツールを制御するフィードフォワード制御手段に、濾過面内歪みマップ、濾過局所形状曲率マップ、並びにオーバレイに対する上記非対称成分の影響、のうち少なくとも1個を通知するよう、構成されているシステム。
Applications Claiming Priority (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US201562183105P | 2015-06-22 | 2015-06-22 | |
US62/183,105 | 2015-06-22 | ||
US14/867,226 US9779202B2 (en) | 2015-06-22 | 2015-09-28 | Process-induced asymmetry detection, quantification, and control using patterned wafer geometry measurements |
US14/867,226 | 2015-09-28 | ||
PCT/US2016/036460 WO2016209625A1 (en) | 2015-06-22 | 2016-06-08 | Process-induced asymmetry detection, quantification, and control using patterned wafer geometry measurements |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2018524811A JP2018524811A (ja) | 2018-08-30 |
JP6785802B2 true JP6785802B2 (ja) | 2020-11-18 |
Family
ID=57586073
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2017566282A Active JP6785802B2 (ja) | 2015-06-22 | 2016-06-08 | パターン化ウェハ幾何計測を用いたプロセス誘起非対称性の検出、定量及び制御 |
Country Status (7)
Country | Link |
---|---|
US (1) | US9779202B2 (ja) |
JP (1) | JP6785802B2 (ja) |
KR (1) | KR102356946B1 (ja) |
CN (1) | CN107683475B (ja) |
DE (1) | DE112016002803T5 (ja) |
TW (1) | TWI697971B (ja) |
WO (1) | WO2016209625A1 (ja) |
Families Citing this family (15)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20170199511A1 (en) * | 2016-01-12 | 2017-07-13 | Globalfoundries Inc. | Signal detection metholodogy for fabrication control |
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CN110998449B (zh) | 2017-08-07 | 2022-03-01 | Asml荷兰有限公司 | 计算量测 |
US11282695B2 (en) | 2017-09-26 | 2022-03-22 | Samsung Electronics Co., Ltd. | Systems and methods for wafer map analysis |
EP3743771A1 (en) | 2018-01-24 | 2020-12-02 | ASML Netherlands B.V. | Computational metrology based sampling scheme |
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---|---|---|---|---|
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-
2015
- 2015-09-28 US US14/867,226 patent/US9779202B2/en active Active
-
2016
- 2016-06-08 DE DE112016002803.2T patent/DE112016002803T5/de active Pending
- 2016-06-08 CN CN201680032550.9A patent/CN107683475B/zh active Active
- 2016-06-08 KR KR1020187002047A patent/KR102356946B1/ko active IP Right Grant
- 2016-06-08 WO PCT/US2016/036460 patent/WO2016209625A1/en active Application Filing
- 2016-06-08 JP JP2017566282A patent/JP6785802B2/ja active Active
- 2016-06-21 TW TW105119461A patent/TWI697971B/zh active
Also Published As
Publication number | Publication date |
---|---|
KR102356946B1 (ko) | 2022-01-27 |
CN107683475A (zh) | 2018-02-09 |
KR20180011357A (ko) | 2018-01-31 |
CN107683475B (zh) | 2019-05-21 |
US9779202B2 (en) | 2017-10-03 |
TWI697971B (zh) | 2020-07-01 |
DE112016002803T5 (de) | 2018-03-29 |
JP2018524811A (ja) | 2018-08-30 |
WO2016209625A1 (en) | 2016-12-29 |
TW201712771A (zh) | 2017-04-01 |
US20160371423A1 (en) | 2016-12-22 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20190529 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20200622 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20200630 |
|
A521 | Request for written amendment filed |
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|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20201006 |
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A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20201027 |
|
R150 | Certificate of patent or registration of utility model |
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|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |