JP6615075B2 - 半導体デバイス用基板、半導体デバイス、及び、半導体デバイス用基板の製造方法 - Google Patents
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Description
なお、半導体デバイス用基板上にソース電極S、ドレイン電極D、ゲート電極Gを設けることにより、半導体デバイスが得られる。
高抵抗化に用いたFeが上部のチャネル層に導入されないようにする構造が、例えば、特許文献2−4に開示されている。
また、上記の問題を解決するために、バッファ層に炭素を含有させることで、高温動作時の横方向のリーク電流を抑制できるが、炭素の平均濃度を上げ過ぎると、バッファ層の結晶性が低下し、電流コラプス現象が悪化しやすくなるという問題があった。
ここで、シリコン系基板12は、例えば、Si又はSiCからなる基板である。
シリコン系基板12と、バッファ層15の間にAlNからなる初期層13を設けてもよい。
ここで、第1の領域15aを、鉄がガスドーピングされた領域とすることができる。
バッファ層15を高耐圧化するためには、炭素よりも鉄を混入させた方がよい。しかしながら、鉄濃度は炭素濃度よりも急峻に降下させることはできない。そこで、バッファ層15の上面での鉄濃度を十分低下させるため、第1の領域の鉄濃度を第2の領域の鉄濃度より高くする。一方、炭素濃度は比較的急峻に濃度変化させることができるので、第2の領域の炭素濃度を第1の領域の炭素濃度より高くする。これにより、第2の領域で鉄の濃度を下げたことによって耐圧の低下を抑制できる。
さらに第2の領域15bの厚さは1.5μm以下とすることで、クラックを抑制しつつ、結晶性が高く、高温動作時の横方向リーク電流を良好に抑制できる。
図4に示す半導体デバイス11は、図1を用いて上記で説明した半導体デバイス用基板10の上に、ソース電極30、ドレイン電極31、及び、ゲート電極32を設けたものである。半導体デバイス11は、例えば、高電子移動度トランジスタ(HEMT)である。
ソース電極30及びドレイン電極31は、チャネル層26とバリア層27との間の境界面の近傍に形成される二次元電子ガス層28に電気的に接続され、ソース電極30から、二次元電子ガス層28を介して、ドレイン電極31に電流が流れるように配置されている。ソース電極30とドレイン電極31との間に流れる電流は、ゲート電極32に印加される電位によってコントロールすることができる。
なお、本発明は、HEMT以外の横型デバイス(MOSFET等)にも適用することができる。
このバッファ層15を形成する工程は、炭素と鉄を含む第1の領域15aを形成する工程と、第1の領域15a上に、第1の領域15aよりも鉄の平均濃度が低く、第1の領域15aよりも炭素の平均濃度が高い第2の領域15bを形成する工程とを含んでいる。
また、バッファ層15を形成する工程において、第2の領域15bの炭素の平均濃度を、前記第1の領域の鉄の平均濃度より低くする。
ここで、第1の領域15aの形成が終了した時点で、鉄のドーピングを止めて、これ以降に形成される膜中の鉄濃度を基板12側からデバイス能動層29側に向かって減少させることができる。鉄のドーピングを止めた後、成長温度を下げて炭素の平均濃度が高い第2の領域を形成する。なお、鉄のドーピングを止めてしばらく窒化物半導体層を形成した後に成長温度を下げて第2の領域を形成することで、図3の第3の領域15cを、第1の領域15aと第2の領域15bの間に設けることができる。
また、炭素の添加は、窒化物系半導体層をMOVPE(有機金属気相成長)法によって成長させるときに、原料ガス(TMG(トリメチルガリウム)等)に含まれる炭素が膜中に取り込まれることによって行われるものであるが、プロパン等のドーピングガスによって行うこともできる。
具体的には、高抵抗層16上に、GaNからなるチャネル層26と、AlGaNからなるバリア層27をこの順にMOVPE法により形成する。チャネル層26の膜厚は例えば、50〜4000nmであり、バリア層27の膜厚は例えば、10〜50nmである。
このようにして、図1の半導体デバイス用基板10が得られる。
図5、6で説明した半導体デバイス用基板の製造方法を用いて、半導体デバイス用基板を作製した。ただし、初期層として基板12上にAlNからなる初期層13を形成し、初期層13上に第1の領域15aとして、Feドープした層(鉄濃度:1×1018atoms/cm3以上)を形成した。第1の領域15aは、図2(b)に示すような積層構造とし、AlN層17とGaN層18とが8ペア交互に積層された積層体19と、GaN挿入層20が6ペア交互に積層された積層構造とした。
なお、第2の領域15bの炭素濃度を高くするために、第2の領域15bの成長温度を第1の領域15aの成長温度より50度低くした。このとき、第2の領域15bの成長温度に合わせて成長レート変動を補正し、第2の領域15bにおける膜厚比率を第1の領域15aにおける膜厚比率と同じになるように調整した。
12…シリコン系基板(基板)、 13…初期層、
15、15’、15”…バッファ層、 15a…第1の領域、 15b…第2の領域、
15c…第3の領域、 16…高抵抗層、 17…第1の層(AlN層)、
18…第2の層(GaN層)、 19…積層体、 20…GaN挿入層、
26…チャネル層、 27…バリア層、 28…2次元電子ガス層、
29…デバイス能動層、 30…ソース電極、 31…ドレイン電極、
32…ゲート電極、
111…シリコン基板、 112…第1の半導体層、 113…第2の半導体層、
114…バッファ層、 115…チャネル層、 116…バリア層、
S…ソース電極、 D…ドレイン電極、 G…ゲート電極。
Claims (14)
- 基板と、
該基板上に設けられ、窒化物半導体からなるバッファ層と、
前記バッファ層上に設けられた窒化物半導体層からなるデバイス能動層と
を有する半導体デバイス用基板であって、
前記バッファ層は
炭素と鉄を含む第1の領域と、
前記第1の領域上にあって、前記第1の領域よりも鉄の平均濃度が低く、前記第1の領域よりも炭素の平均濃度が高い第2の領域と
を有し、
前記第2の領域の炭素の平均濃度は前記第1の領域の鉄の平均濃度より低く、
前記第1の領域及び前記第2の領域はAl又はGa又はその両方を含み、前記第1の領域の平均Al濃度は、前記第2の領域の平均Al濃度より低いことを特徴とする半導体デバイス用基板。 - 基板と、
該基板上に設けられ、窒化物半導体からなるバッファ層と、
前記バッファ層上に設けられた窒化物半導体層からなるデバイス能動層と
を有する半導体デバイス用基板であって、
前記バッファ層は
炭素と鉄を含む第1の領域と、
前記第1の領域上にあって、前記第1の領域よりも鉄の平均濃度が低く、前記第1の領域よりも炭素の平均濃度が高い第2の領域と
を有し、
前記第2の領域の炭素の平均濃度は前記第1の領域の鉄の平均濃度より低く、
前記第2の領域の炭素の平均濃度と鉄の平均濃度の和、及び、前記第1の領域の炭素の平均濃度と鉄の平均濃度の和より小さい炭素の平均濃度と鉄の平均濃度の和を有する第3の領域を前記第1の領域と前記第2の領域との間に備えることを特徴とする半導体デバイス用基板。 - 前記第1の領域は前記バッファ層の下面を含み、
前記第2の領域は前記バッファ層の上面を含むことを特徴とする請求項1又は請求項2に記載の半導体デバイス用基板。 - 前記第1の領域における炭素の平均濃度と鉄の平均濃度の和は、前記第2の領域における炭素の平均濃度と鉄の平均濃度の和よりも大きいことを特徴とする請求項1から請求項3のいずれか1項に記載の半導体デバイス用基板。
- 前記第1の領域は前記第2の領域よりも厚いことを特徴とする請求項1から請求項4のいずれか1項に記載の半導体デバイス用基板。
- 前記第1の領域は組成の異なる複数の窒化物半導体層を含むことを特徴とする請求項1から請求項5のいずれか1項に記載の半導体デバイス用基板。
- 前記第2の領域は組成の異なる複数の窒化物半導体層を含むことを特徴とする請求項1から請求項6のいずれか1項に記載の半導体デバイス用基板。
- 前記第1の領域及び前記第2の領域の厚さは、それぞれ400nm以上であることを特徴とする請求項1から請求項7のいずれか1項に記載の半導体デバイス用基板。
- 前記第2の領域における鉄の平均濃度は1×1016atoms/cm3以下であり、
前記第1の領域における鉄の平均濃度は1×1018atoms/cm3以上であることを特徴とする請求項1から請求項8のいずれか1項に記載の半導体デバイス用基板。 - 前記デバイス能動層は、前記第2の領域よりも炭素の平均濃度が低く、前記第1の領域よりも鉄の平均濃度が低い窒化物半導体からなるチャネル層を含み、
前記デバイス能動層と前記バッファ層との間に、炭素の平均濃度が前記第2の領域以上であり、前記第1の領域よりも鉄の平均濃度が低い窒化物半導体からなる高抵抗層を備えることを特徴とする請求項1から請求項9のいずれか1項に記載の半導体デバイス用基板。 - 請求項10に記載の半導体デバイス用基板を有し、
前記デバイス能動層は、前記チャネル層とバンドギャップの異なる窒化物半導体からなるバリア層を前記チャネル層上に含み、
前記チャネル層と、前記バリア層との間の境界面の近傍に形成される2次元電子ガス層に電気的に接続される電極をさらに有することを特徴とする半導体デバイス。 - 基板上に窒化物半導体からなるバッファ層を形成する工程と、
前記バッファ層上に窒化物半導体からなるデバイス能動層を形成する工程と
を有する半導体デバイス用基板の製造方法であって、
前記バッファ層を形成する工程は、
炭素と鉄と、Al又はGa又はその両方とを含む第1の領域を形成する工程と、
前記第1の領域上に、Al又はGa又はその両方を含み、前記第1の領域よりも鉄の平均濃度が低く、前記第1の領域よりも炭素の平均濃度が高い第2の領域を形成する工程と
を含み、
前記第2の領域の炭素の平均濃度を、前記第1の領域の鉄の平均濃度より低くし、
前記第1の領域の平均Al濃度を、前記第2の領域の平均Al濃度より低くすることを特徴とする半導体デバイス用基板の製造方法。 - 基板上に窒化物半導体からなるバッファ層を形成する工程と、
前記バッファ層上に窒化物半導体からなるデバイス能動層を形成する工程と
を有する半導体デバイス用基板の製造方法であって、
前記バッファ層を形成する工程は、
炭素と鉄を含む第1の領域を形成する工程と、
前記第1の領域上に、前記第1の領域よりも鉄の平均濃度が低く、前記第1の領域よりも炭素の平均濃度が高い第2の領域を形成する工程と
を含み、
前記第2の領域の炭素の平均濃度を、前記第1の領域の鉄の平均濃度より低くし、
さらに、前記第2の領域の炭素の平均濃度と鉄の平均濃度の和、及び、前記第1の領域の炭素の平均濃度と鉄の平均濃度の和より小さい炭素の平均濃度と鉄の平均濃度の和を有する第3の領域を前記第1の領域と前記第2の領域との間に形成する工程を有することを特徴とする半導体デバイス用基板の製造方法。 - 前記第2の領域の成長温度を、前記第1の領域の成長温度よりも低くすることを特徴とする請求項12又は請求項13に記載の半導体デバイス用基板の製造方法。
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