JP6567078B2 - 画素タイル構造およびレイアウト - Google Patents
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Description
本願は、2015年1月12日付け出願の米国仮特許出願第62/102,534号に基づく優先権を主張するものであり、この出願の開示内容を全て本願に援用する。
本発明はディスプレイ技術に広く関し、特に、画素タイル構造およびレイアウトに関する。
高い空間解像度、広い色域および高輝度範囲を有する大型のディスプレイパネルを作製することは、多くのディスプレイ製造者にとって、困難なことであると認識されてきた。比較的高価な光学部品、音声部品、電子部品および機械部品を比較的多数含むこと、およびそれら全てを1つのディスプレイシステムの多数の画素において集積することの複雑さから、ハイエンドのディスプレイシステムを製造するコストは典型的に非常に高い。
添付図面の各図において、本発明を限定する事なく例示する。各図において、同様の部材に同様の参照符号を付している。
画素タイル構造およびレイアウトに関する可能な実施形態の例を、本明細書に記載する。以下の説明においては、便宜上、本発明を完全に理解できるように、多数の詳細事項を説明する。ただし、これらの詳細事項抜きでも本発明を実施可能であることは明白であろう。他方、本発明の説明を不必要に煩雑にしたり、不明瞭にしたり、難読化したりしないように、周知の構造およびデバイスの細かな詳細までは説明しない。
1.一般的概要
2.構造の概要
3.タイル配置システムの一例
4.画素レベルの視覚特性の変化
5.サブ画素レベルの視覚特性の変化
6.異なるタイプの画像描画面
7.流体自己整合配置によるランダムずれ
8.ディスプレイシステム例
9.処理フロー例
10.実装メカニズム−ハードウェア概要
11.均等物、拡張例、変形例、その他
本概要は、本発明の可能な一実施形態が有するいくつかの側面につき、基本的説明を提示する。本概要は、可能な実施形態が有する諸側面についての広範かつ網羅的な要約ではない、ということに留意すべきである。さらに留意すべきは、本概要は、可能な実施形態が有する任意の特に重要な側面や要素を示すものとして理解されるようには意図されておらず、また、その特定の可能な実施形態あるいは広く本発明の全体の、何らの範囲を規定するものとして理解されるようにも意図されていない。本概要は、単に、可能な実施形態例に関するいくつかの概念を凝縮された簡素な形式で提示するものであって、以下に続く、可能な諸実施形態例についてのより詳細な説明に対する単なる概念的な前置きとして理解されるべきである。
図1Aは、一例としての画像描画面100を示す。本明細書に記載の画像描画面は、2つ以上の画素タイルを有し得る。例示目的として、図1Aに示すように、画像描画面(100)は、2つの画素タイル102−1および102−2を有する。本明細書に記載の画素タイル(例えば102−1、102−2など)は、四角形状、三角形状、楕円形状、多角形状などの多様な幾何学形状のいずれかを有し得る。いくつかの実施形態において、本明細書に記載の画像描画面(例えば100)は、同じ幾何学形状の画素タイルを有し得る。いくつかの実施形態において、本明細書に記載の画像描画面(例えば100)は、少なくとも2つの異なる幾何学形状の画素タイルを有し得る。
図2は、画素タイル間の位置ずれに由来する視覚的アーチファクトが無いか少ない画像描画面を、作製するように構成されたタイル配置システム200の一例を示す。いくつかの実施形態において、タイル配置システム(200)は、画像描画面を作製するための全体的な制御動作を行うように構成された配置制御器202、画像描画面内の画素タイルの各々の中における画素レベルまたはサブ画素レベルの配置操作を行うように構成されたサブタイル配置モジュール204、画像描画面内におけるタイルレベルの配置操作を行うように構成されたタイル配置モジュール206、などを有する。
図3Aは、画素タイル(302)中の画素(例えば304−1、304−2、304−3、304−4など)の、不均一、不均等またはランダムなずれ(例えば312−1、312−2、312−3、312−4など)を例示する。いくつかの実施形態において、画素タイル(302)中の画素(例えば304−1、304−2、304−3、304−4など)は、各割り当て位置(例えば306−1、306−2、306−3、306−4など)に対応し得る。非限定的な一実施形態において、割り当て位置は、X軸およびY軸に沿った、一対の座標値によって表され得る。本明細書に記載の画素タイル中の画素の割り当て位置は、マトリクス、対角線、多角形、円などの規則的パターンを形成していてもよいし、していなくてもよい。各割り当て位置(例えば306−1、306−2、306−3、306−4など)に対してのずれ(例えば312−1、312−2、312−3、312−4など)は、タイル配置システム(例えば図2の200など)が備えるサブタイル配置モジュール(例えば図2の204など)によって生成され得る。画素(例えば304−1、304−2、304−3、304−4など)のずれ(例えば312−1、312−2、312−3、312−4など)は、画素(例えば304−1、304−2、304−3、304−4など)の各割り当て位置(例えば306−1、306−2、306−3、306−4など)に対して測定されることができる。
図4Aは、画素タイル(402)中のサブ画素(例えば410−1、410−2、410−3、410−4など)の不均一、不均等またはランダムなずれ(例えば412−1、412−2、412−3、412−4など)を例示する。図示されるように、サブ画素タイル(402)中のサブ画素(例えば410−1、410−2、410−3、410−4など)は、画素タイル(402)中の異なる画素(例えば404−1、404−2、404−3、404−4など)に属し得る。サブ画素(例えば410−1、410−2、410−3、410−4など)は、各割り当て位置(例えば406−1、406−2、406−3、406−4など)に対応する。非限定的な一実施形態において、割り当て位置は、X軸およびY軸に沿った、一対の座標値によって表され得る。本明細書に記載のサブ画素タイル中のサブ画素の割り当て位置は、マトリクス、対角線、多角形、円などの規則的パターンを形成していてもよいし、していなくてもよい。各割り当て位置(例えば406−1、406−2、406−3、406−4など)に対してのずれ(例えば412−1、412−2、412−3、412−4など)は、サブタイル配置システム(例えば図2の200など)のサブ画素レベルまたはサブサブ画素配置モジュール(例えば図2の204など)によって生成することができる。サブ画素(例えば410−1、410−2、410−3、410−4など)のランダムずれ(例えば412−1、412−2、412−3、412−4など)は、サブ画素(例えば410−1、410−2、410−3、410−4など)の各割り当て位置(例えば406−1、406−2、406−3、406−4など)に対して測定されることができる。
図5Aは、本明細書に記載の1つの画素タイルの少なくとも一部を形成するために用いられ得る、一例としてのシャドーマスク500を例示する。シャドーマスク(500)は、色素、蛍光材料、量子ドットなどを配置または堆積するために用いることができる、変調光を光方向504に沿って出射するように構成されたセル(例えば502−1、502−2、502−3など)を有している。
いくつかの実施形態において、本明細書に記載の画素またはサブ画素の不均一、不均等またはランダムなずれは、流体自己整合配置(FSA)技術によって実施し得る。追加的、選択的、または代替的に、本明細書に記載の画素またはサブ画素のずれは、ロールツーロール(例えばウェブなど)処理によって実施され得、これは、FSAプロセスとともに稼働されることで大量生産を行い得る。
図8は、本明細書に記載の1つ以上のタイプの画像描画面とともに動作し得る、一例としてのディスプレイシステムを例示している。いくつかの実施形態において、ディスプレイ論理回路802は、画像を画像描画面(800)に描画するために、ディスプレイシステム(800)の画像描画面800における変調光の生成を制御するように構成された、光制御論理回路804を有し得る。ディスプレイ論理回路(802)は、画像データソース806(例えばセットトップボックス、ネットワーク化サーバ、記憶媒体その他など)と動作可能に結合され得、また画像データソース(806)から画像データを受け取るように構成される。画像データは、無線放送、またはイーサネット、High−Definition Multimedia Interface(HDMI)、無線ネットワークインターフェース、機器(例えばセットトップボックス、サーバ、記憶媒体など)からなどを含む様々な方法で、画像データソース(806)により提供され得る。内部または外部ソースから受け取られた画像フレームは、ディスプレイ論理回路(802)によって、ディスプレイシステムの画像描画面800における変調光の生成を制御するために用いられ得る。画像フレームは、本明細書に記載の画像描画面上の様々な解像度の様々なフレームにおける、個々のまたはまとめた画素値を導出するために、ディスプレイ論理回路(802)によって用いられ得る。
図6は、一例としての処理フローを例示している。いくつかの実施形態において、図2のタイル配置システム200などの、1つ以上のコンピューティングデバイスまたはコンポーネントが、この処理フローを実行し得る。ブロック610において、タイル配置システム(200)が、画像描画面の部分として用いられる複数の画素タイルのうちの、各画素タイルに適用される総合ずれ許容値を決定する。ここで、前記複数の画素タイルのうちの各画素タイルは複数のサブ画素を含む。
ある実施形態によれば、本明細書に記載された技術は、1つ以上の専用の計算装置により実施される。専用の計算装置は、ハードワイヤ接続されて当該技術を実行してもよく、当該技術を実行するように持続的にプログラムされた1つ以上の特定用途向け集積回路(ASIC)またはフィールドプログラマブルゲートアレイ(FPGA))等のデジタル電子装置を含んでもよく、ファームウェア、メモリ、他の記憶装置または組合せ内のプログラム命令に従って当該技術を実行するようにプログラムされた1つ以上の汎用のハードウェアプロセッサを含んでもよい。このような専用の計算装置はまた、カスタムハードワイヤードロジック、ASICまたはFPGAを、カスタムプログラミングと組み合わせて、当該技術を実現してもよい。専用の計算装置は、デスクトップコンピュータシステム、携帯型コンピュータシステム、手持ち型装置、ネットワーク装置、または、当該技術を実施するためのハードワイヤードロジックおよび/またはプログラムロジックを組み込んだ他の装置であり得る。
上記詳細な説明において、態様によって変わり得る多数の具体的な詳細を参照しながら、本発明の実施形態を説明した。したがって、本発明が如何なるものかおよび出願人は本発明が如何なるものであると意図しているかについての唯一且つ排他的な指標は、後の修正を含む、これら請求項が生じる具体的な形態の、本願から生じる1組の請求項である。請求項に含まれる用語について本明細書に明示的に記載された定義はいずれも、請求項で使用された用語の意味を決定するものである。よって、請求項に明示的に記載されていない限定事項、構成要素、特性、特徴、利点または属性は、いかなる形であれ請求の範囲を限定するものではない。したがって、明細書および図面は、限定的ではなく例示的なものであると認識されるべきものである。
Claims (21)
- 複数の画素タイルから画像描画面を作製するための方法であって、
前記複数の画素タイルの各々は複数の画素を有し、前記複数の画素の各々は複数のサブ画素を有し、
前記複数の画素タイルの各々は、前記画素タイル中の前記複数のサブ画素が前記画像描画面を形成する規則的パターンに並べられるような、配置に構成されており、前記画素タイル間の位置ずれは、前記複数のサブ画素の前記規則的パターンからの逸脱を起こさせ、前記方法は、
前記画像描画面の部分として用いられる複数の画素タイルのうちの、各画素タイルに適用される総合ずれ許容値を決定することであって、
前記総合ずれ許容値は、前記画素タイルを前記画像描画面を形成するように配置したとき生成される複数の測定された画素タイルレベルの位置ずれのうちの、最大値、平均値、中央値、および統計値のうちの1つであることと、
前記総合ずれ許容値の範囲内で、前記複数の画素タイルの各画素タイルにおける、前記複数の画素の各々内の前記複数のサブ画素の不均一なずれを生成することと、
前記複数の画素を組み合わせて前記画像描画面を作製すること、
を包含する、方法。 - 前記複数のサブ画素の前記不均一なずれは、前記複数のサブ画素の、前記複数のサブ画素の割り当て位置からのランダムずれを表しており、前記割り当て位置は規則的パターンを形成する、請求項1に記載の方法。
- 前記複数の画素のうちの1画素中の前記複数のサブ画素は、前記画素中の前記サブ画素間において可変的な空間的関係を有する、請求項1に記載の方法。
- 前記複数の画素タイルのうち少なくとも1つの画素タイルは、前記少なくとも1つの画素タイル内の画素の可変の密度、高さ、幅、またはピッチを含む、請求項1に記載の方法。
- 前記複数の画素タイルのうち少なくとも1つの画素タイルは、前記少なくとも1つの画素タイル内の前記複数のサブ画素の可変の密度、高さ、幅、またはピッチを含む、請求項1に記載の方法。
- 前記総合ずれ許容値は、個々のサブ画素を前記複数の画素タイルのうちの1画素タイルに配置するために用いられる物理的デバイスの、誤差を表す、請求項1に記載の方法。
- 前記物理的デバイスは、レーザ、画素配置モジュール、サブ画素配置モジュール、またはシャドーマスクのうち1つ以上である、請求項6に記載の方法。
- 前記物理的デバイスはナノチューブ群であり、前記ナノチューブ群を用いて個々のサブ画素を前記複数の画素タイルのうちの1画素タイルに配置することは、各画素タイルに対して基板を用意し、前記基板上にまたは前記基板からナノチューブ群を成長させることを包含し、前記ナノチューブ群は、前記ナノチューブ群の各々の両端に電圧を印加したとき前記ナノチューブ群の光方向に沿って変調光を出射するように構成されている、請求項6に記載の方法。
- 前記ナノチューブ群を用いて個々のサブ画素を前記複数の画素タイルのうちの1画素タイルに配置することはさらに、前記基板を導電性フィルムでコーティングすることにより、第1の極性の共通電極を設けることを包含し、各画素タイルの前記ナノチューブ群の各々の他端において、複数のつながっていない金属製小塊のうちの1つの金属製小塊を前記導電性フィルムと対向して配置することにより、前記共通電極の前記第1の極性の反対である第2の極性の画素電極を設ける、請求項8に記載の方法。
- 前記総合ずれ許容値は、個々の画素タイルを前記画像描画面に配置するために用いられるタイル配置システムの、誤差を表す、請求項1に記載の方法。
- 少なくとも1つの画素タイルは、色素、蛍光材料、量子ドット、ナノチューブ、発光ダイオード、または有機発光ダイオードのうち1つ以上を含む、請求項1に記載の方法。
- 基板に、固有の形状を有する凹部の1以上のパターンをエンボス加工することと、
前記固有の形状を有する凹部の1以上のパターンに、対応する固有の形状のカラー発光ダイオードチップを埋めることと、
その後前記基板を前記複数の画素タイルに単体化することと、
をさらに包含する、請求項1に記載の方法。 - 前記凹部は、1つ以上の流体自己整合配置プロセスにおいて、前記カラー発光ダイオードチップで埋められる、請求項12に記載の方法。
- 前記凹部は、1つ以上のロールツーロール処理において、前記基板に作製される、請求項12に記載の方法。
- 前記カラー発光ダイオードチップは、他の特定の色の他のカラー発光ダイオードチップの有する他の固有の形状とは異なる、特定の固有の形状を有する、特定の色のカラー発光ダイオードチップを含む、請求項12に記載の方法。
- 前記物理的デバイスは1つ以上のレーザであり、前記1つ以上のレーザを用いて前記複数の画素タイルのうちの各画素タイルにおける前記複数のサブ画素の不均一なずれを生成することは、各割り当て位置に対しての前記複数のサブ画素のランダムずれを生成するために、前記1つ以上のレーザを各々空間的振動体と機械的に結合することを包含する、請求項6に記載の方法。
- 前記空間的振動体は圧電振動体または音響的振動体である、請求項16に記載の方法。
- 請求項1〜17のうちいずれかに記載の方法により作製された画像描画面を有する、ディスプレイシステム。
- 複数の画素タイルから画像描画面を作製するために制御動作を行うように構成された配置制御器と、
前記配置制御器の前記制御動作にもとづき、前記複数の画素タイルの各々内においてサブ画素レベルの配置操作を行うように構成された、サブタイル配置モジュールと、
前記配置制御器の前記制御動作にもとづき、前記画像描画面に対しタイルレベルの配置操作を行うように構成された、タイル配置モジュールと、
を有するタイル配置システムであって、
前記タイル配置システムは請求項1〜17のいずれかを行うように構成されている、タイル配置システム。 - ソフトウェア命令を格納した非一時的なコンピュータ読み取り可能である記憶媒体であって、前記ソフトウェア命令が請求項19に記載の前記タイル配置システムの配置制御器の1つ以上のプロセッサによって実行されたとき、請求項1〜17のいずれかに記載の方法を前記タイル配置システムにより行わせる、記憶媒体。
- 1つ以上のプロセッサと1組の命令を格納した1つ以上の記憶媒体とを有する請求項19に記載の前記タイル配置システムの前記配置制御器であって、前記1組の命令は、前記1つ以上のプロセッサによって実行されたとき、請求項1〜17のいずれかに記載の方法を前記タイル配置システムにより行わせる、配置制御器。
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