JP6564601B2 - インバータ装置 - Google Patents
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Description
[数1]
VCEU1=VP−VU (1)
[数2]
VCEU2=VU (2)
なお、図2ではU相の電圧のみを定義しているが、このほかにV相の電圧としてVCEV1、VCEV2、W相の電圧としてVCEW1、VCEW2がある。
2:交流電源
3:コンバータ部
4:平滑コンデンサ
5:インバータ部
6:インバータ駆動信号出力部
7:原動機(負荷)
8:接続点
9:続接点
10:接続点
11:接続点
12:接続点
13:インバータ制御部
14:パワー半導体素子コレクタ・エミッタ間電圧検出回路
15:判定部
16:インバータ保護運転制御指令信号生成部
17:インバータ駆動信号生成部
18:判定結果報知信号生成部
19:報知手段
20:パワー半導体素子コレクタ・エミッタ間電圧検出部
21:給電部
22:給電部
23:IGBT駆動部
24:IGBT1
25:IGBT2
26:接続点
27:接続点
28:接続点
La:正常遷移
Lb:異常遷移
36U1:状態1のU相コレクタ・エミッタ間電圧データ格納テーブル
36U2:状態2のU相コレクタ・エミッタ間電圧データ格納テーブル
36U3:状態3のU相コレクタ・エミッタ間電圧データ格納テーブル
Claims (7)
- 半導体素子が直列接続されて構成される複数のレグの両端は直流電源に接続され、各レグの半導体素子間と交流負荷の各相とが接続されることで前記交流負荷に前記直流電源を交流電源に変換して電力供給するインバータ装置であって、
前記半導体素子の導通時の電圧が以前の導通時の電圧よりも所定以上の割合で増加した場合、前記半導体素子の異常と判定するとともに、
インバータ装置の起動の都度求めた前記半導体素子の導通時電圧を、FIFO形式のメモリに順次記憶して記憶したn個の導通時電圧から、通電時電圧の移動平均を求め、次回検知の導通時電圧と移動平均の比較により前記半導体素子の異常を判別することを特徴とするインバータ装置。 - 請求項1に記載のインバータ装置であって、
前記レグのレグ両端間電圧を第1の電圧、前記レグの一方端と当該レグの半導体素子間の電圧を第2の電圧とし、前記レグの他方端と当該レグの半導体素子間に接続された第1の半導体素子が導通状態において前記第1の電圧と第2の電圧の差電圧を求め、当該差電圧を前記半導体素子の導通時電圧として前記半導体素子の異常を判別することを特徴とするインバータ装置。 - 請求項1に記載のインバータ装置であって、
レグ構成された半導体素子に点弧信号を継続して与える点弧期間と、半導体素子に点弧信号を継続して与えない無点弧期間を有し、前記インバータ装置の起動とは無点弧期間から点弧期間に移動した状態をいうことを特徴とするインバータ装置。 - 請求項1に記載のインバータ装置であって、
パワー半導体素子として6個のIGBTで構成されていることを特徴とするインバータ装置。 - 請求項2に記載のインバータ装置であって、
第1の電圧及び第2の電圧を分圧して得ることを特徴とするインバータ装置。 - 請求項1に記載のインバータ装置であって、
インバータ装置の起動の都度求めた前記半導体素子の導通時電圧を、FIFO形式のメモリに順次記憶して記憶したn個の導通時電圧から、通電時電圧の移動平均を求め、移動平均と基準値の比較により前記半導体素子の異常を判別することを特徴とするインバータ装置。 - 請求項1に記載のインバータ装置であって、
前記半導体素子の異常を判別したときに、異常発生を外部報知し、または前記半導体素子に流れる電流を制限して運転継続することを特徴とするインバータ装置。
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