JP6556601B2 - 半導体装置およびその製造方法 - Google Patents
半導体装置およびその製造方法 Download PDFInfo
- Publication number
- JP6556601B2 JP6556601B2 JP2015221671A JP2015221671A JP6556601B2 JP 6556601 B2 JP6556601 B2 JP 6556601B2 JP 2015221671 A JP2015221671 A JP 2015221671A JP 2015221671 A JP2015221671 A JP 2015221671A JP 6556601 B2 JP6556601 B2 JP 6556601B2
- Authority
- JP
- Japan
- Prior art keywords
- film
- insulating film
- region
- gate electrode
- semiconductor substrate
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
- 239000004065 semiconductor Substances 0.000 title claims description 505
- 238000004519 manufacturing process Methods 0.000 title claims description 104
- 229910052751 metal Inorganic materials 0.000 claims description 202
- 239000002184 metal Substances 0.000 claims description 202
- 239000000758 substrate Substances 0.000 claims description 133
- 238000000034 method Methods 0.000 claims description 114
- 229910052581 Si3N4 Inorganic materials 0.000 claims description 76
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 claims description 76
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 claims description 63
- 229910052814 silicon oxide Inorganic materials 0.000 claims description 63
- 238000002955 isolation Methods 0.000 claims description 53
- 229910021332 silicide Inorganic materials 0.000 claims description 46
- FVBUAEGBCNSCDD-UHFFFAOYSA-N silicide(4-) Chemical compound [Si-4] FVBUAEGBCNSCDD-UHFFFAOYSA-N 0.000 claims description 46
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims description 44
- 229910052710 silicon Inorganic materials 0.000 claims description 44
- 239000010703 silicon Substances 0.000 claims description 44
- 238000005530 etching Methods 0.000 claims description 39
- 150000004767 nitrides Chemical class 0.000 claims description 15
- 238000003860 storage Methods 0.000 claims description 13
- 238000000059 patterning Methods 0.000 claims description 5
- 238000005498 polishing Methods 0.000 claims description 3
- 238000009413 insulation Methods 0.000 claims 1
- 239000010410 layer Substances 0.000 description 72
- 125000006850 spacer group Chemical group 0.000 description 54
- 239000012535 impurity Substances 0.000 description 51
- 230000008569 process Effects 0.000 description 44
- 230000000052 comparative effect Effects 0.000 description 25
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 25
- 238000005229 chemical vapour deposition Methods 0.000 description 23
- 239000004020 conductor Substances 0.000 description 23
- 230000006870 function Effects 0.000 description 23
- 238000001312 dry etching Methods 0.000 description 21
- 125000001475 halogen functional group Chemical group 0.000 description 17
- 238000005468 ion implantation Methods 0.000 description 16
- 239000011229 interlayer Substances 0.000 description 15
- 238000007254 oxidation reaction Methods 0.000 description 15
- 238000010586 diagram Methods 0.000 description 14
- 230000003647 oxidation Effects 0.000 description 14
- NRTOMJZYCJJWKI-UHFFFAOYSA-N Titanium nitride Chemical compound [Ti]#N NRTOMJZYCJJWKI-UHFFFAOYSA-N 0.000 description 13
- 230000015572 biosynthetic process Effects 0.000 description 13
- 229920005591 polysilicon Polymers 0.000 description 13
- 230000004888 barrier function Effects 0.000 description 12
- 229910021334 nickel silicide Inorganic materials 0.000 description 12
- RUFLMLWJRZAWLJ-UHFFFAOYSA-N nickel silicide Chemical compound [Ni]=[Si]=[Ni] RUFLMLWJRZAWLJ-UHFFFAOYSA-N 0.000 description 12
- 239000000463 material Substances 0.000 description 11
- 229910052721 tungsten Inorganic materials 0.000 description 11
- 239000010937 tungsten Substances 0.000 description 11
- 238000000206 photolithography Methods 0.000 description 10
- 230000015556 catabolic process Effects 0.000 description 9
- 239000010949 copper Substances 0.000 description 9
- 238000004544 sputter deposition Methods 0.000 description 9
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 9
- 229910017052 cobalt Inorganic materials 0.000 description 8
- 239000010941 cobalt Substances 0.000 description 8
- GUTLYIVDDKVIGB-UHFFFAOYSA-N cobalt atom Chemical compound [Co] GUTLYIVDDKVIGB-UHFFFAOYSA-N 0.000 description 8
- 238000002347 injection Methods 0.000 description 8
- 239000007924 injection Substances 0.000 description 8
- 230000002093 peripheral effect Effects 0.000 description 8
- 238000002513 implantation Methods 0.000 description 7
- 150000002500 ions Chemical class 0.000 description 7
- PXHVJJICTQNCMI-UHFFFAOYSA-N Nickel Chemical compound [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 description 6
- 229910052782 aluminium Inorganic materials 0.000 description 6
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 6
- 229910021417 amorphous silicon Inorganic materials 0.000 description 6
- 230000000694 effects Effects 0.000 description 6
- 238000010438 heat treatment Methods 0.000 description 6
- MRELNEQAGSRDBK-UHFFFAOYSA-N lanthanum(3+);oxygen(2-) Chemical compound [O-2].[O-2].[O-2].[La+3].[La+3] MRELNEQAGSRDBK-UHFFFAOYSA-N 0.000 description 6
- NFFIWVVINABMKP-UHFFFAOYSA-N methylidynetantalum Chemical compound [Ta]#C NFFIWVVINABMKP-UHFFFAOYSA-N 0.000 description 6
- 229910003468 tantalcarbide Inorganic materials 0.000 description 6
- MZLGASXMSKOWSE-UHFFFAOYSA-N tantalum nitride Chemical compound [Ta]#N MZLGASXMSKOWSE-UHFFFAOYSA-N 0.000 description 6
- -1 tantalum nitride nitride Chemical class 0.000 description 6
- MTPVUVINMAGMJL-UHFFFAOYSA-N trimethyl(1,1,2,2,2-pentafluoroethyl)silane Chemical compound C[Si](C)(C)C(F)(F)C(F)(F)F MTPVUVINMAGMJL-UHFFFAOYSA-N 0.000 description 6
- 238000001039 wet etching Methods 0.000 description 6
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 5
- 229910052785 arsenic Inorganic materials 0.000 description 5
- RQNWIZPPADIBDY-UHFFFAOYSA-N arsenic atom Chemical compound [As] RQNWIZPPADIBDY-UHFFFAOYSA-N 0.000 description 5
- 238000000231 atomic layer deposition Methods 0.000 description 5
- TWNQGVIAIRXVLR-UHFFFAOYSA-N oxo(oxoalumanyloxy)alumane Chemical compound O=[Al]O[Al]=O TWNQGVIAIRXVLR-UHFFFAOYSA-N 0.000 description 5
- BPUBBGLMJRNUCC-UHFFFAOYSA-N oxygen(2-);tantalum(5+) Chemical compound [O-2].[O-2].[O-2].[O-2].[O-2].[Ta+5].[Ta+5] BPUBBGLMJRNUCC-UHFFFAOYSA-N 0.000 description 5
- 229910052698 phosphorus Inorganic materials 0.000 description 5
- 239000011574 phosphorus Substances 0.000 description 5
- 101000610557 Homo sapiens U4/U6 small nuclear ribonucleoprotein Prp31 Proteins 0.000 description 4
- 101001109965 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) 60S ribosomal protein L7-A Proteins 0.000 description 4
- 101001109960 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) 60S ribosomal protein L7-B Proteins 0.000 description 4
- 102100040118 U4/U6 small nuclear ribonucleoprotein Prp31 Human genes 0.000 description 4
- 230000001965 increasing effect Effects 0.000 description 4
- 229910044991 metal oxide Inorganic materials 0.000 description 4
- 150000004706 metal oxides Chemical class 0.000 description 4
- RVTZCBVAJQQJTK-UHFFFAOYSA-N oxygen(2-);zirconium(4+) Chemical compound [O-2].[O-2].[Zr+4] RVTZCBVAJQQJTK-UHFFFAOYSA-N 0.000 description 4
- 239000010936 titanium Substances 0.000 description 4
- UONOETXJSWQNOL-UHFFFAOYSA-N tungsten carbide Chemical compound [W+]#[C-] UONOETXJSWQNOL-UHFFFAOYSA-N 0.000 description 4
- 229910001928 zirconium oxide Inorganic materials 0.000 description 4
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 3
- KRHYYFGTRYWZRS-UHFFFAOYSA-N Fluorane Chemical compound F KRHYYFGTRYWZRS-UHFFFAOYSA-N 0.000 description 3
- 229910052802 copper Inorganic materials 0.000 description 3
- 229910000449 hafnium oxide Inorganic materials 0.000 description 3
- WIHZLLGSGQNAGK-UHFFFAOYSA-N hafnium(4+);oxygen(2-) Chemical compound [O-2].[O-2].[Hf+4] WIHZLLGSGQNAGK-UHFFFAOYSA-N 0.000 description 3
- 239000002784 hot electron Substances 0.000 description 3
- 238000005240 physical vapour deposition Methods 0.000 description 3
- 238000007747 plating Methods 0.000 description 3
- 229910001936 tantalum oxide Inorganic materials 0.000 description 3
- ITWBWJFEJCHKSN-UHFFFAOYSA-N 1,4,7-triazonane Chemical compound C1CNCCNCCN1 ITWBWJFEJCHKSN-UHFFFAOYSA-N 0.000 description 2
- 229910018072 Al 2 O 3 Inorganic materials 0.000 description 2
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 description 2
- 229910001260 Pt alloy Inorganic materials 0.000 description 2
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 description 2
- IVHJCRXBQPGLOV-UHFFFAOYSA-N azanylidynetungsten Chemical compound [W]#N IVHJCRXBQPGLOV-UHFFFAOYSA-N 0.000 description 2
- 230000000903 blocking effect Effects 0.000 description 2
- 229910052796 boron Inorganic materials 0.000 description 2
- CJNBYAVZURUTKZ-UHFFFAOYSA-N hafnium(iv) oxide Chemical compound O=[Hf]=O CJNBYAVZURUTKZ-UHFFFAOYSA-N 0.000 description 2
- 239000012212 insulator Substances 0.000 description 2
- 238000012986 modification Methods 0.000 description 2
- 230000004048 modification Effects 0.000 description 2
- 229910021421 monocrystalline silicon Inorganic materials 0.000 description 2
- 229910052759 nickel Inorganic materials 0.000 description 2
- PCLURTMBFDTLSK-UHFFFAOYSA-N nickel platinum Chemical compound [Ni].[Pt] PCLURTMBFDTLSK-UHFFFAOYSA-N 0.000 description 2
- 238000005036 potential barrier Methods 0.000 description 2
- 229910052719 titanium Inorganic materials 0.000 description 2
- 230000005641 tunneling Effects 0.000 description 2
- 230000003213 activating effect Effects 0.000 description 1
- 230000004913 activation Effects 0.000 description 1
- PNEYBMLMFCGWSK-UHFFFAOYSA-N aluminium oxide Inorganic materials [O-2].[O-2].[O-2].[Al+3].[Al+3] PNEYBMLMFCGWSK-UHFFFAOYSA-N 0.000 description 1
- 238000000137 annealing Methods 0.000 description 1
- 239000007864 aqueous solution Substances 0.000 description 1
- 230000000295 complement effect Effects 0.000 description 1
- 239000000470 constituent Substances 0.000 description 1
- 230000009977 dual effect Effects 0.000 description 1
- 230000005684 electric field Effects 0.000 description 1
- 238000009713 electroplating Methods 0.000 description 1
- 230000002708 enhancing effect Effects 0.000 description 1
- 230000001747 exhibiting effect Effects 0.000 description 1
- 230000005669 field effect Effects 0.000 description 1
- 230000012447 hatching Effects 0.000 description 1
- 239000012528 membrane Substances 0.000 description 1
- QPJSUIGXIBEQAC-UHFFFAOYSA-N n-(2,4-dichloro-5-propan-2-yloxyphenyl)acetamide Chemical compound CC(C)OC1=CC(NC(C)=O)=C(Cl)C=C1Cl QPJSUIGXIBEQAC-UHFFFAOYSA-N 0.000 description 1
- 238000005121 nitriding Methods 0.000 description 1
- 238000005192 partition Methods 0.000 description 1
- 230000000149 penetrating effect Effects 0.000 description 1
- 230000003252 repetitive effect Effects 0.000 description 1
- 239000000243 solution Substances 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
- 229910052715 tantalum Inorganic materials 0.000 description 1
- GUVRBAGPIYLISA-UHFFFAOYSA-N tantalum atom Chemical compound [Ta] GUVRBAGPIYLISA-UHFFFAOYSA-N 0.000 description 1
Images
Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10B—ELECTRONIC MEMORY DEVICES
- H10B43/00—EEPROM devices comprising charge-trapping gate insulators
- H10B43/30—EEPROM devices comprising charge-trapping gate insulators characterised by the memory core region
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11C—STATIC STORES
- G11C16/00—Erasable programmable read-only memories
- G11C16/02—Erasable programmable read-only memories electrically programmable
- G11C16/04—Erasable programmable read-only memories electrically programmable using variable threshold transistors, e.g. FAMOS
- G11C16/0466—Erasable programmable read-only memories electrically programmable using variable threshold transistors, e.g. FAMOS comprising cells with charge storage in an insulating layer, e.g. metal-nitride-oxide-silicon [MNOS], silicon-oxide-nitride-oxide-silicon [SONOS]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/41—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions
- H01L29/423—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions not carrying the current to be rectified, amplified or switched
- H01L29/42312—Gate electrodes for field effect devices
- H01L29/42316—Gate electrodes for field effect devices for field-effect transistors
- H01L29/4232—Gate electrodes for field effect devices for field-effect transistors with insulated gate
- H01L29/4234—Gate electrodes for transistors with charge trapping gate insulator
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/41—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions
- H01L29/423—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions not carrying the current to be rectified, amplified or switched
- H01L29/42312—Gate electrodes for field effect devices
- H01L29/42316—Gate electrodes for field effect devices for field-effect transistors
- H01L29/4232—Gate electrodes for field effect devices for field-effect transistors with insulated gate
- H01L29/4234—Gate electrodes for transistors with charge trapping gate insulator
- H01L29/42344—Gate electrodes for transistors with charge trapping gate insulator with at least one additional gate, e.g. program gate, erase gate or select gate
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10B—ELECTRONIC MEMORY DEVICES
- H10B41/00—Electrically erasable-and-programmable ROM [EEPROM] devices comprising floating gates
- H10B41/40—Electrically erasable-and-programmable ROM [EEPROM] devices comprising floating gates characterised by the peripheral circuit region
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10B—ELECTRONIC MEMORY DEVICES
- H10B43/00—EEPROM devices comprising charge-trapping gate insulators
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10B—ELECTRONIC MEMORY DEVICES
- H10B43/00—EEPROM devices comprising charge-trapping gate insulators
- H10B43/40—EEPROM devices comprising charge-trapping gate insulators characterised by the peripheral circuit region
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10B—ELECTRONIC MEMORY DEVICES
- H10B43/00—EEPROM devices comprising charge-trapping gate insulators
- H10B43/50—EEPROM devices comprising charge-trapping gate insulators characterised by the boundary region between the core and peripheral circuit regions
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11C—STATIC STORES
- G11C16/00—Erasable programmable read-only memories
- G11C16/02—Erasable programmable read-only memories electrically programmable
- G11C16/06—Auxiliary circuits, e.g. for writing into memory
- G11C16/30—Power supply circuits
Landscapes
- Microelectronics & Electronic Packaging (AREA)
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Physics & Mathematics (AREA)
- Ceramic Engineering (AREA)
- Computer Hardware Design (AREA)
- Semiconductor Memories (AREA)
- Non-Volatile Memory (AREA)
- Electrodes Of Semiconductors (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
- Metal-Oxide And Bipolar Metal-Oxide Semiconductor Integrated Circuits (AREA)
Description
<半導体装置のレイアウト構成例>
初めに、本実施の形態1の半導体装置のレイアウト構成例について説明する。図1は、実施の形態1の半導体装置のレイアウト構成例を示す図である。
次に、本実施の形態1の半導体装置の構造について説明する。図2は、実施の形態1の半導体装置の要部断面図である。また、本実施の形態1においては、メモリセル、高電圧MISFET、低電圧MISFETがnチャネル型の場合について説明する。導電型を逆にしてpチャネル型とすることもできる。
次に、本実施の形態1の半導体装置の製造方法について説明する。図3〜図5は、実施の形態1の半導体装置の製造工程の一部を示すプロセスフロー図である。図6〜図33は、実施の形態1の半導体装置の製造工程中の要部断面図である。図6〜図33の断面図には、メモリセル領域1A、高電圧MISFET領域1Bおよび低電圧MISFET領域1Cの要部断面図が示されている。また、図6〜図33の断面図には、境界領域1D、1Eおよび1Fの要部断面図が示されている。
ステップS22では、半導体基板1の主面1a全面に、ゲート電極GEL(後述する図31参照)用の導電膜26を形成する。このとき、ステップS21で形成された凹部CC1の底部に露出している金属膜部14a上に、金属膜部14aに接するように、導電膜26を形成する。そして、導電膜26により凹部CC1内を埋め込む。
次に、比較例1の半導体装置の製造方法について説明する。図34は、比較例1の半導体装置の製造工程中の要部断面図である。図35は、比較例1の半導体装置の要部平面図である。
次に、比較例2の半導体装置の製造方法について説明する。図36は、比較例2の半導体装置の製造工程の一部を示すプロセスフロー図である。図37は、比較例2の半導体装置のレイアウト構成例を示す図である。
一方、本実施の形態1の半導体装置の製造工程では、メモリセル領域1Aで制御ゲート電極CGおよびメモリゲート電極MGを形成した後、高電圧MISFET領域1Bおよび低電圧MISFET領域1Cで、高誘電率膜からなる絶縁膜13上に、金属窒化物を含む金属膜14を介して、シリコン膜からなる導電膜15を形成する。次に、導電膜15および金属膜14をパターニングし、高電圧MISFET領域1Bで、金属膜14および導電膜15を含むゲート電極GEHを形成し、低電圧MISFET領域1Cで、金属膜14を含む金属膜部14a、および、導電膜15を含む導電膜部15aを形成する。次に、低電圧MISFET領域1Cで、導電膜部15aを除去して金属膜部14aを露出させ、露出した金属膜部14a上に導電膜26を形成し、金属膜部14aと導電膜26とを含むゲート電極GELを形成する。
実施の形態1の半導体装置の製造工程では、制御ゲート電極CGおよびメモリゲート電極MGを形成した後、絶縁膜11を形成した。一方、実施の形態2の半導体装置の製造工程では、制御ゲート電極CGおよびメモリゲート電極MGを形成する前に、絶縁膜11を形成する。
図39は、実施の形態2の半導体装置の製造工程の一部を示すプロセスフロー図である。図40〜図51は、実施の形態2の半導体装置の製造工程中の要部断面図である。図40〜図51の断面図には、メモリセル領域1A、高電圧MISFET領域1Bおよび低電圧MISFET領域1Cの要部断面図が示されている。また、図40〜図51の断面図には、境界領域1D、1Eおよび1Fの要部断面図が示されている。
本実施の形態2の半導体装置の製造工程も、実施の形態1の半導体装置の製造工程と同様の工程を有する。また、本実施の形態2の半導体装置も、実施の形態1の半導体装置と同様の構造を有する。そのため、本実施の形態2の製造工程でも、実施の形態1の製造工程と同様に、例えばCMP法を用いて導電膜26(図31参照)を研磨する際に、高電圧MISFET領域1Bで、ディッシングが発生することを防止または抑制することができ、半導体装置の性能を向上させることができる。また、半導体装置を容易に小型化することができる。
1a 主面
1A メモリセル領域
1b 素子分離溝
1B 高電圧MISFET領域
1C 低電圧MISFET領域
1D、1E、1F、1G 境界領域
2 素子分離膜
2a、3 絶縁膜
4 導電膜
4s、5s 側面
5、6 絶縁膜
6a、6c 酸化シリコン膜
6b 窒化シリコン膜
7 導電膜
10H、10Hd、10L MISFET
11、12、13 絶縁膜
14 金属膜
14a 金属膜部
15 導電膜
15a 導電膜部
15s、16s 側面
16 絶縁膜
21a、21b、21c、21d n−型半導体領域
22 サイドウォールスペーサ
23a、23b、23c、23d n+型半導体領域
24 金属シリサイド層
25 絶縁膜
26 導電膜
27 絶縁膜
28 金属シリサイド層
29 層間絶縁膜
30 絶縁膜
AR1〜AR3 活性領域
BP1、BP2 膜部
CC1 凹部
CG 制御ゲート電極
CNT コンタクトホール
CP1、CP2 キャップ絶縁膜
CT 制御トランジスタ
GE1、GE2、GEH、GEL ゲート電極
GI1、GI2、GIc、GIH、GIL、GIm ゲート絶縁膜
IF1〜IF4 絶縁膜
M1 配線
MC メモリセル
MD 半導体領域
MG メモリゲート電極
MS 半導体領域
MT メモリトランジスタ
PG プラグ
PW1〜PW3 p型ウェル
RF1、RF10、RF11、RF2〜RF9 レジスト膜
RP1、RP10、RP11、RP2〜RP9 レジストパターン
SP1 スペーサ
Claims (14)
- (a)半導体基板を用意する工程、
(b)前記半導体基板の主面の第1領域で、前記半導体基板上に第1ゲート絶縁膜を形成し、前記第1ゲート絶縁膜上に、シリコンを含む第1ゲート電極を形成し、前記第1領域で、前記半導体基板上に前記第1ゲート電極と隣り合う第2ゲート電極を形成し、前記第2ゲート電極と前記第1ゲート電極との間、および、前記第2ゲート電極と前記半導体基板との間に、内部に電荷蓄積部を有する第2ゲート絶縁膜を形成する工程、
(c)前記半導体基板の前記主面の第2領域で、前記半導体基板上に第1絶縁膜を形成し、前記半導体基板の前記主面の第3領域で、前記半導体基板上に第2絶縁膜を形成する工程、
(d)前記(b)工程および前記(c)工程の後、前記第1絶縁膜上、および、前記第2絶縁膜上に、第3絶縁膜を形成する工程、
(e)前記第3絶縁膜上に、金属窒化物を含む第1導電膜を形成する工程、
(f)前記第1導電膜上に、シリコンを含む第2導電膜を形成する工程、
(g)前記第2導電膜、前記第1導電膜、前記第3絶縁膜、前記第2絶縁膜および前記第1絶縁膜をパターニングし、前記第2領域で、前記半導体基板上の前記第1絶縁膜および前記第3絶縁膜を含む第3ゲート絶縁膜を形成し、前記第3ゲート絶縁膜上の前記第1導電膜および前記第2導電膜を含む第3ゲート電極を形成し、前記第3領域で、前記半導体基板上の前記第2絶縁膜および前記第3絶縁膜を含む第4ゲート絶縁膜を形成し、前記第4ゲート絶縁膜上の前記第1導電膜を含む第1膜部を形成し、前記第1膜部上の前記第2導電膜を含む第2膜部を形成する工程、
(h)前記(g)工程の後、前記第2膜部を除去して前記第1膜部を露出させる工程、
(i)前記(h)工程の後、露出した前記第1膜部上に、金属を含む第3導電膜を形成し、前記第3領域で、前記第4ゲート絶縁膜上の前記第1膜部および前記第3導電膜を含む第4ゲート電極を形成する工程、
を有し、
前記第1絶縁膜および前記第2絶縁膜のいずれの比誘電率も、窒化シリコンの比誘電率以下であり、
前記第3絶縁膜の比誘電率は、窒化シリコンの比誘電率よりも高く、
前記第2絶縁膜の膜厚は、前記第1絶縁膜の膜厚よりも薄い、半導体装置の製造方法。 - 請求項1記載の半導体装置の製造方法において、
前記(b)工程は、
(b1)前記第1領域で、前記半導体基板上に第4絶縁膜を形成する工程、
(b2)前記第1領域、前記第2領域および前記第3領域で、前記半導体基板上に、前記第4絶縁膜を覆い、かつ、シリコンを含む第4導電膜を形成する工程、
(b3)前記第4導電膜および前記第4絶縁膜をパターニングし、前記第1領域で、前記第4絶縁膜を含む前記第1ゲート絶縁膜を形成し、前記第1ゲート絶縁膜上の前記第4導電膜を含む前記第1ゲート電極を形成し、前記第2領域および前記第3領域で、前記第4導電膜を残す工程、
(b4)前記(b3)工程の後、前記第1領域、前記第2領域および前記第3領域で、前記半導体基板上に、前記第1ゲート電極および前記第4導電膜を覆い、かつ、内部に電荷蓄積部を有する第5絶縁膜を形成する工程、
(b5)前記第5絶縁膜上に、シリコンを含む第5導電膜を形成する工程、
(b6)前記第5導電膜をエッチバックすることにより、前記第1領域で、前記第1ゲート電極の側面に前記第5絶縁膜を介して前記第5導電膜を残して前記第2ゲート電極を形成し、前記第2領域および前記第3領域で、前記第5導電膜を除去する工程、
(b7)前記(b6)工程の後、前記第1領域、前記第2領域および前記第3領域で、前記第2ゲート電極から露出した前記第5絶縁膜を除去し、前記第2ゲート電極と前記第1ゲート電極との間、および、前記第2ゲート電極と前記半導体基板との間の前記第5絶縁膜を含む前記第2ゲート絶縁膜を形成する工程、
(b8)前記(b7)工程の後、前記第2領域および前記第3領域で、前記第4導電膜を除去する工程、
を含む、半導体装置の製造方法。 - 請求項2記載の半導体装置の製造方法において、
前記第2領域は、前記第1領域と隣り合い、
前記(b1)工程では、前記半導体基板上の前記主面の第4領域であって、前記第1領域と前記第2領域との間に配置された前記第4領域で、前記半導体基板の上方に前記第4絶縁膜を形成し、
前記(b2)工程では、前記第4領域で、前記半導体基板上に前記第4導電膜を形成し、
前記(b8)工程では、前記第4領域で、前記第4絶縁膜と、前記第4絶縁膜上の前記第4導電膜と、を含む第3膜部を形成し、
前記(c)工程では、前記半導体基板の前記主面の第5領域であって、前記第4領域と前記第2領域との間に配置された前記第5領域で、前記半導体基板上に前記第1絶縁膜を形成し、
前記(g)工程では、前記第5領域で、前記第1絶縁膜と、前記第1絶縁膜上の前記第3絶縁膜と、前記第3絶縁膜上の前記第1導電膜と、前記第1導電膜上の前記第2導電膜と、を含む第4膜部を形成する、半導体装置の製造方法。 - 請求項3記載の半導体装置の製造方法において、
(j)前記第4領域および前記第5領域で、前記半導体基板の前記主面に素子分離溝を形成する工程、
(k)前記素子分離溝に埋め込まれた第6絶縁膜を含む素子分離膜を形成する工程、
を有し、
前記(b1)工程では、前記第4領域で、前記素子分離膜上に前記第4絶縁膜を形成し、
前記(c)工程では、前記第5領域で、前記素子分離膜上に前記第1絶縁膜を形成する、半導体装置の製造方法。 - 請求項2記載の半導体装置の製造方法において、
前記(b1)工程では、前記第2領域および前記第3領域で、前記半導体基板上に前記第4絶縁膜を形成し、
前記(b3)工程では、前記第2領域および前記第3領域で、前記第4絶縁膜を残し、
前記(b8)工程では、前記第2領域および前記第3領域で、前記第4絶縁膜を除去し、
前記(c)工程では、前記(b8)工程の後、前記第1絶縁膜および前記第2絶縁膜を形成する、半導体装置の製造方法。 - 請求項1記載の半導体装置の製造方法において、
(l)前記(i)工程の後、前記第1ゲート電極上に第1金属シリサイド層を形成し、前記第2ゲート電極上に第2金属シリサイド層を形成し、前記第3ゲート電極上に第3金属シリサイド層を形成する工程、
を有する、半導体装置の製造方法。 - 請求項1記載の半導体装置の製造方法において、
前記(h)工程は、
(h1)前記第2膜部を覆う第7絶縁膜を形成する工程、
(h2)前記第7絶縁膜を研磨して、前記第2膜部の上面を露出させる工程、
(h3)前記(h2)工程の後、前記第2膜部を除去して凹部を形成し、前記凹部の底部で前記第1膜部を露出させる工程、
を含む、半導体装置の製造方法。 - 請求項2記載の半導体装置の製造方法において、
前記第5絶縁膜は、第1酸化シリコン膜と、前記第1酸化シリコン膜上の第1窒化シリコン膜と、前記第1窒化シリコン膜上の第2酸化シリコン膜と、を含み、
前記(b4)工程は、
(b9)前記第1領域、前記第2領域および前記第3領域で、前記半導体基板上に、前記第1ゲート電極および前記第4導電膜を覆う前記第1酸化シリコン膜を形成する工程、
(b10)前記第1酸化シリコン膜上に、前記第1窒化シリコン膜を形成する工程、
(b11)前記第1窒化シリコン膜上に、前記第2酸化シリコン膜を形成する工程、
を含む、半導体装置の製造方法。 - 請求項1記載の半導体装置の製造方法において、
前記第1ゲート絶縁膜と前記第1ゲート電極と前記第2ゲート絶縁膜と前記第2ゲート電極とにより不揮発性メモリが形成され、
前記第3ゲート絶縁膜と前記第3ゲート電極とにより第1トランジスタが形成され、
前記第4ゲート絶縁膜と前記第4ゲート電極とにより第2トランジスタが形成される、半導体装置の製造方法。 - 半導体基板と、
前記半導体基板の主面の第1領域で、前記半導体基板上に形成された第1ゲート絶縁膜と、
前記第1ゲート絶縁膜上に形成され、かつ、シリコンを含む第1ゲート電極と、
前記第1領域で、前記半導体基板上に形成され、かつ、前記第1ゲート電極と隣り合う第2ゲート電極と、
前記第2ゲート電極と前記第1ゲート電極との間、および、前記第2ゲート電極と前記半導体基板との間に形成され、かつ、内部に電荷蓄積部を有する第2ゲート絶縁膜と、
前記半導体基板の前記主面の第2領域で、前記半導体基板上に形成された第3ゲート絶縁膜と、
前記第3ゲート絶縁膜上に形成された第3ゲート電極と、
前記半導体基板の前記主面の第3領域で、前記半導体基板上に形成された第4ゲート絶縁膜と、
前記第4ゲート絶縁膜上に形成された第4ゲート電極と、
を有し、
前記第3ゲート絶縁膜は、
前記第2領域で、前記半導体基板上に形成された第1絶縁膜と、
前記第1絶縁膜上に形成された第2絶縁膜と、
を含み、
前記第3ゲート電極は、
前記第2絶縁膜上に形成され、かつ、金属窒化物を含む第1導電膜と、
前記第1導電膜上に形成され、かつ、シリコンを含む第2導電膜と、
を含み、
前記第4ゲート絶縁膜は、
前記第3領域で、前記半導体基板上に形成された第3絶縁膜と、
前記第3絶縁膜上に形成された第4絶縁膜と、
を含み、
前記第4ゲート電極は、
前記第4絶縁膜上に形成され、かつ、金属窒化物を含む第3導電膜と、
前記第3導電膜上に形成され、かつ、金属を含む第4導電膜と、
を含み、
前記第1絶縁膜および前記第3絶縁膜のいずれの比誘電率も、窒化シリコンの比誘電率以下であり、
前記第2絶縁膜および前記第4絶縁膜のいずれの比誘電率も、窒化シリコンの比誘電率よりも高く、
前記第3絶縁膜の膜厚は、前記第1絶縁膜の膜厚よりも薄い、半導体装置。 - 請求項10記載の半導体装置において、
前記半導体基板の前記主面の第4領域で、前記半導体基板の上方に形成された第1膜部と、
前記半導体基板の前記主面の第5領域で、前記半導体基板の上方に形成された第2膜部と、
を有し、
前記第2領域は、前記第1領域と隣り合い、
前記第4領域は、前記第1領域と前記第2領域との間に配置され、
前記第5領域は、前記第4領域と前記第2領域との間に配置され、
前記第1膜部は、
前記第4領域で、前記半導体基板の上方に形成された第5絶縁膜と、
前記第5絶縁膜上に形成された、シリコンを含む第5導電膜と、
を含み、
前記第2膜部は、
前記第5領域で、前記半導体基板の上方に形成された第6絶縁膜と、
前記第6絶縁膜上に形成された第7絶縁膜と、
前記第7絶縁膜上に形成され、かつ、金属窒化物を含む第6導電膜と、
前記第6導電膜上に形成され、かつ、シリコンを含む第7導電膜と、
を含み、
前記第6絶縁膜の比誘電率は、窒化シリコンの比誘電率以下であり、
前記第7絶縁膜の比誘電率は、窒化シリコンの比誘電率よりも高い、半導体装置。 - 請求項11記載の半導体装置において、
前記第4領域および前記第5領域で、前記半導体基板の前記主面に形成された素子分離溝と、
前記素子分離溝に埋め込まれた第8絶縁膜を含む素子分離膜と、
を有し、
前記第1膜部および前記第2膜部は、前記素子分離膜上に形成されている、半導体装置。 - 請求項10記載の半導体装置において、
前記第1ゲート電極上に形成された第1金属シリサイド層と、
前記第2ゲート電極上に形成された第2金属シリサイド層と、
前記第3ゲート電極上に形成された第3金属シリサイド層と、
を有する、半導体装置。 - 請求項10記載の半導体装置において、
前記第1ゲート絶縁膜と前記第1ゲート電極と前記第2ゲート絶縁膜と前記第2ゲート電極とにより不揮発性メモリが形成され、
前記第3ゲート絶縁膜と前記第3ゲート電極とにより第1トランジスタが形成され、
前記第4ゲート絶縁膜と前記第4ゲート電極とにより第2トランジスタが形成されている、半導体装置。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2015221671A JP6556601B2 (ja) | 2015-11-11 | 2015-11-11 | 半導体装置およびその製造方法 |
US15/266,914 US9768187B2 (en) | 2015-11-11 | 2016-09-15 | Method of manufacturing split-gate non-volatile memory with hi-voltage and low-voltage peripheral circuitry |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2015221671A JP6556601B2 (ja) | 2015-11-11 | 2015-11-11 | 半導体装置およびその製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2017092290A JP2017092290A (ja) | 2017-05-25 |
JP6556601B2 true JP6556601B2 (ja) | 2019-08-07 |
Family
ID=58664351
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2015221671A Active JP6556601B2 (ja) | 2015-11-11 | 2015-11-11 | 半導体装置およびその製造方法 |
Country Status (2)
Country | Link |
---|---|
US (1) | US9768187B2 (ja) |
JP (1) | JP6556601B2 (ja) |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US9659953B2 (en) | 2014-07-07 | 2017-05-23 | Taiwan Semiconductor Manufacturing Co., Ltd. | HKMG high voltage CMOS for embedded non-volatile memory |
KR102342550B1 (ko) * | 2017-06-09 | 2021-12-23 | 삼성전자주식회사 | 반도체 장치 |
US10872898B2 (en) * | 2017-07-19 | 2020-12-22 | Cypress Semiconductor Corporation | Embedded non-volatile memory device and fabrication method of the same |
US10553583B2 (en) | 2017-08-28 | 2020-02-04 | Taiwan Semiconductor Manufacturing Co., Ltd. | Boundary region for high-k-metal-gate(HKMG) integration technology |
CN110620115B (zh) * | 2019-05-23 | 2022-03-18 | 上海华力集成电路制造有限公司 | 1.5t sonos闪存的制造方法 |
Family Cites Families (14)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP5007017B2 (ja) * | 2004-06-30 | 2012-08-22 | ルネサスエレクトロニクス株式会社 | 半導体装置の製造方法 |
JP2007109800A (ja) * | 2005-10-12 | 2007-04-26 | Renesas Technology Corp | 半導体素子の製造方法 |
JP5314873B2 (ja) * | 2007-10-05 | 2013-10-16 | ルネサスエレクトロニクス株式会社 | 半導体装置 |
JP2010067645A (ja) * | 2008-09-08 | 2010-03-25 | Renesas Technology Corp | 半導体装置およびその製造方法 |
JP2010183022A (ja) * | 2009-02-09 | 2010-08-19 | Renesas Electronics Corp | 半導体装置およびその製造方法 |
JP5268792B2 (ja) * | 2009-06-12 | 2013-08-21 | パナソニック株式会社 | 半導体装置 |
JP5550286B2 (ja) | 2009-08-26 | 2014-07-16 | ルネサスエレクトロニクス株式会社 | 半導体装置の製造方法 |
KR101787488B1 (ko) * | 2011-03-24 | 2017-10-19 | 삼성전자주식회사 | 비휘발성 메모리 장치 및 이의 제조 방법 |
JP6026913B2 (ja) | 2013-02-12 | 2016-11-16 | ルネサスエレクトロニクス株式会社 | 半導体装置の製造方法 |
JP6120609B2 (ja) * | 2013-02-25 | 2017-04-26 | ルネサスエレクトロニクス株式会社 | 半導体装置の製造方法および半導体装置 |
JP2014204041A (ja) | 2013-04-08 | 2014-10-27 | ルネサスエレクトロニクス株式会社 | 半導体装置の製造方法 |
US9257554B2 (en) * | 2013-08-13 | 2016-02-09 | Globalfoundries Singapore Pte. Ltd. | Split gate embedded memory technology and method of manufacturing thereof |
JP6407609B2 (ja) * | 2014-08-01 | 2018-10-17 | ルネサスエレクトロニクス株式会社 | 半導体装置の製造方法 |
JP2017037986A (ja) * | 2015-08-11 | 2017-02-16 | ルネサスエレクトロニクス株式会社 | 半導体装置 |
-
2015
- 2015-11-11 JP JP2015221671A patent/JP6556601B2/ja active Active
-
2016
- 2016-09-15 US US15/266,914 patent/US9768187B2/en active Active
Also Published As
Publication number | Publication date |
---|---|
US9768187B2 (en) | 2017-09-19 |
US20170133394A1 (en) | 2017-05-11 |
JP2017092290A (ja) | 2017-05-25 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US10263005B2 (en) | Method of manufacturing a semiconductor device | |
US9831259B2 (en) | Semiconductor device | |
JP5734744B2 (ja) | 半導体装置およびその製造方法 | |
JP6359386B2 (ja) | 半導体装置の製造方法および半導体装置 | |
US9905429B2 (en) | Semiconductor device and a manufacturing method thereof | |
US20160064507A1 (en) | Semiconductor device and method of manufacturing same | |
JP6407609B2 (ja) | 半導体装置の製造方法 | |
US10121895B2 (en) | Method for producing semiconductor device and semiconductor device | |
JP6556601B2 (ja) | 半導体装置およびその製造方法 | |
JP6620046B2 (ja) | 半導体装置の製造方法および半導体装置 | |
JP6670719B2 (ja) | 半導体装置の製造方法 | |
KR20160018417A (ko) | 반도체 장치의 제조 방법 | |
US9837427B2 (en) | Semiconductor device and method of manufacturing the same | |
US9831318B2 (en) | Semiconductor device and a manufacturing method thereof | |
JP2014229844A (ja) | 半導体装置 | |
JP2018182156A (ja) | 半導体装置およびその製造方法 | |
JP2016051740A (ja) | 半導体装置の製造方法 | |
JP2012069652A (ja) | 半導体装置およびその製造方法 | |
JP2012094790A (ja) | 半導体装置およびその製造方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20180510 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20190124 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20190129 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20190328 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20190702 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20190710 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 6556601 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |