JP6362499B2 - 電源装置およびその制御方法 - Google Patents
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Description
図1には、本発明の第1の実施形態における電源装置10の一例としてのブロック図を示す。また、図2、図3には、第1の実施形態の電源装置10に適用できる制御タイミングチャートを示す。図4には、第1の実施形態の駆動制御部112が使用する設定テーブルを示す。以下に本実施形態の電源装置10の構成およびその動作について、図1から図4を用いて説明する。
U=1/2・LP・IRP2 (1)
f=1/(2π√(LP・CP)) (2)
図5は、本発明の第2の実施形態における電源装置10の構成ブロック図を示している。以下に第2の実施形態の電源装置10の具体的な動作を図5の構成を用いて説明する。なお、図1の例と同じ動作をする構成要素の説明については省略する。
Claims (8)
- 駆動電力の電力源となる電池と、
前記電池の出力に接続された第1のFET素子と、
前記第1のFET素子の出力に接続された第2のFET素子と、
前記第2のFET素子のバックゲート電位を、グランド電位と、前記第1のFET素子と前記第2のFET素子との間の接続点の電位とに、切替選択するための切替部と、
前記切替部の切替選択を制御することにより、前記切替部が前記バックゲート電位を前記グランド電位と前記接続点の電位の何れかに切り替えた状態を維持する時間を可変制御する制御部とを有することを特徴とする電源装置。 - 前記制御部は、前記切替部が前記第2のFET素子の前記バックゲート電位を前記接続点の電位に切り替えた状態を維持する時間を可変制御することを特徴とする請求項1記載の電源装置。
- 前記第1のFET素子はP型のFET素子であり、
前記第2のFET素子はN型のFET素子であり、
前記制御部は、前記第1のFET素子のゲート駆動電圧と前記第2のFET素子のゲート駆動電圧が共にハイ電圧レベルであった後、前記第2のFET素子のゲート駆動電圧がハイ電圧レベルからロー電圧レベルへ切り替えられる立ち下がりの時点から、前記第1のFET素子のゲート駆動電圧がハイ電圧レベルからロー電圧レベルへ切り替えられる立ち下がりの時点までの間の所定の期間の内で、前記第2のFET素子の前記バックゲート電位を前記接続点の電位に切り替えた状態を維持する時間を可変制御することを特徴とする請求項2記載の電源装置。 - 前記制御部は、前記切替部が前記切り替え状態を維持する時間を、前記第2のFET素子を流れる電流値に応じて可変制御することを特徴とする請求項1乃至請求項3のうち何れか1項に記載の電源装置。
- 前記駆動電力は、複数の駆動モードの中から選ばれた駆動モードで動作する電子機器へ供給され、
前記制御部は、前記切替部が前記切り替え状態を維持する時間を、前記電子機器の駆動モードと、負荷との、少なくとも一つに応じて、可変制御することを特徴とする請求項1乃至請求項4のうち何れか1項に記載の電源装置。 - 前記制御部は、前記負荷が大きくなるときには前記切替部にて前記バックゲート電位を前記接続点の電位に切り替えた状態を維持する時間を長く制御し、前記負荷が小さくなるときには前記切替部にて前記バックゲート電位を前記接続点の電位に切り替えた状態を維持する時間を短く制御することを特徴とする請求項5記載の電源装置。
- 前記制御部は、前記切替部での前記切り替え状態を維持する時間を設定するための所定の設定時間の値を格納する記憶部を有し、当該記憶部から出力した設定時間の値により前記切り替え状態を維持する時間を制御することを特徴とする請求項1乃至請求項6のうち何れか1項に記載の電源装置。
- 駆動電力の電力源となる電池と、
前記電池の出力に接続された第1のFET素子と、
前記第1のFET素子の出力に接続された第2のFET素子と、
前記第2のFET素子のバックゲート電位を、グランド電位と、前記第1のFET素子と前記第2のFET素子との間の接続点の電位とに、切替選択するための切替部と、
前記切替部の切替選択を制御する制御部とを有する電源装置の制御方法であって、
前記制御部が、前記切替部が前記バックゲート電位を前記グランド電位と前記接続点の電位の何れかに切り替えた状態を維持する時間を可変制御することを特徴とする電源装置の制御方法。
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