JP5966243B2 - ストレージ装置及びストレージ装置の制御方法 - Google Patents
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Description
次に、実施例1に係るストレージ装置の変形例について説明する。実施例1では、データにパリティの異常が発生した場合、単に異常が発生したデータの再送信を行っていたが、本変形例ではCM1とCM2との間のパスのデータ転送の負荷を軽減した後に、データの再送信を行う。
次に、実施例2に係るストレージ装置の変形例について説明する。本変形例に係るストレージ装置は、CM1及びCM2がいずれもダウンした場合にメモリの内容を維持しつつ再起動する機能を有している。そこで、本実施形態に係るストレージ装置は、この機能を用いてCM1及びCM2を再起動した後、再送信に失敗したデータをハードディスク経由でCM1のメモリに移す。図6は、実施例2の変形例に係るストレージ装置のデータ二重化におけるパリティエラー発生時の処理のシーケンス図である。そこで、図6を参照して、本変形例に係るストレージ装置のデータ二重化におけるパリティエラー発生時の処理の流れについて説明する。
2 コントローラモジュール(CM)
3 ハードディスク
4 パス
5 パス
11、21 障害検出部
12、22 制御部
13 データ書込部
14、24 バス接続部(PCIeブリッジ)
15、25 揮発性記憶部(メモリ)
16 読出部
17 低速受信部
23 データ送信部
26 書込部
27 低速送信部
30 ディスク装置
101、201 CPU
102、202 低速バスコントローラ
103、203 PCIeブリッジ
104、204 DMAコントローラ
105、205 メモリコントローラ
106、206 メモリ
107、207 I/Oコントローラ
Claims (7)
- 第1データコントローラと第2データコントローラとを有するストレージ装置であって、
前記第1データコントローラは、
外部から入力されたデータ及び前記第2データコントローラから送信されたデータを記憶する第1記憶部と、
前記第1データコントローラのデータの伝送経路と前記第2データコントローラのデータの伝送経路とを接続する第1バス接続部と、
前記第1バス接続部を介して前記第1記憶部に記憶された外部から入力されたデータを前記第2データコントローラへ送信するデータ送信部と、
前記第1バス接続部のデータの送信における障害を検出し、送信時に障害を発生させたデータを前記データ送信部に再送信させる第1障害検出部とを備え、
前記第2データコントローラは、
外部から入力されたデータ及び前記第1データコントローラから送信されたデータを記憶する第2記憶部と、
前記第1データコントローラのデータの伝送経路と前記第2データコントローラのデータの伝送経路とを接続する第2バス接続部と、
前記第2バス接続部を介して前記第2記憶部に記憶された外部から入力されたデータを前記第1データコントローラへ送信する第2データ送信部と、
前記第2バス接続部を介して前記データ送信部により送信されたデータを取得し、前記第2記憶部に書き込むデータ書込部と、
前記第2バス接続部及び前記データ書込部における障害を検出し、検出した前記障害を発生させたデータの送信元を特定し、特定した前記送信元が前記第1データコントローラか否かを判定する第2障害検出部と、
前記送信元が前記第1データコントローラの場合、前記第2データ送信部から前記第1データコントローラへのデータ送信を停止させ、データが前記データ送信部から再送信されるまで待機させ、再送信されてくるデータを受信して書き込むように前記第2バス接続部及び前記データ書込部を制御する制御部とを備えた
ことを特徴とするストレージ装置。 - 前記ストレージ装置はディスク装置をさらに備え、
前記第1データコントローラは、前記ディスク装置にデータを書き込む書込部と、
前記データ送信部によるデータの再送信においても前記第1障害検出部により障害の発生が検出された場合、送信時に障害を発生させたデータを前記ディスク装置に書き込ませるよう前記書込部を制御する書込制御部をさらに備え、
前記第2データコントローラは、前記ディスク装置に記憶されているデータを読み出し前記第2記憶部に記憶させる読出部をさらに備え、
前記制御部は、前記データ送信部からデータが再送信されたときに、前記第2バス接続部及び前記データ書込部において前記第1データコントローラを送信元とするデータによる障害が発生したか否かを判定し、障害が発生している場合には、前記ディスク装置に記憶されている前記書込部が書き込んだデータを読み出し前記第2記憶部に書き込むよう前記読出部を制御する
ことを特徴とする請求項1に記載のストレージ装置。 - 前記第1データコントローラは、前記第1バス接続部と前記第2バス接続部との間の伝送経路よりも転送速度の遅い低速伝送経路を用いて前記第2データコントローラにデータを送信する低速送信部をさらに備え、
前記第2データコントローラは、前記低速伝送経路を介して前記低速送信部により送信されたデータを受信する低速受信部をさらに備え、
前記第1障害検出部は、前記第1バス接続部のデータの送信における障害の発生を検出すると、送信時に障害を発生させたデータのサイズが所定値以下か否かを判定し、前記所定値以下の場合には前記低速送信部にデータを送信させ、前記所定値より大きい場合には送信時に障害を発生させたデータを前記データ送信部に再送信させ、
前記制御部は、送信時に障害を発生させたデータを前記低速受信部が受信している場合には該データを前記第2記憶部に記憶させる
ことを特徴とする請求項1又は請求項2に記載のストレージ装置。 - 前記第2データコントローラは、第2バス接続部を介して前記第2記憶部に記憶されている外部から入力されたデータを前記第1データコントローラへ送信する送信部をさらに備え、
前記制御部は、前記第2バス接続部及び前記データ書込部において発生した障害が前記第1データコントローラによるものの場合、前記送信部のデータ送信を禁止する
ことを特徴とする請求項1〜請求項3のいずれか一つに記載のストレージ装置。 - 第1データコントローラと第2データコントローラとを有するストレージ装置の制御方法であって、
前記第1データコントローラは、外部から入力されたデータ及び前記第2データコントローラから送信されたデータを前記第1データコントローラのメモリに記憶し、
前記第1データコントローラは、前記第1データコントローラのメモリに記憶された外部から入力されたデータを読み出し、前記第1データコントローラのPCIeブリッジを介して前記第2データコントローラに送信し、
前記第1データコントローラは、前記データの送信における前記第1データコントローラのPCIeブリッジの障害を検出し、
前記第2データコントローラは、前記第2データコントローラのPCIeブリッジを介して前記第1データコントローラから送信されたデータを受信し、
前記第2データコントローラは、受信したデータ及び外部から入力されたデータを前記第2データコントローラのメモリに書き込み、
前記第2データコントローラは、 前記第2データコントローラのメモリに記憶された外部から入力されたデータを読み出し、前記第2データコントローラのPCIeブリッジを介して前記第1データコントローラに送信し、
前記第2データコントローラは、受信したデータをメモリに書き込むときに、前記第2データコントローラのメモリコントローラ及びPCIeブリッジで障害が発生した場合、検出した前記障害を発生させたデータの送信元を特定し、特定した前記送信元が前記第1データコントローラか否かを判定し、
前記第1データコントローラ及び前記第2データコントローラにおいて障害が検出され、且つ前記送信元が前記第1データコントローラの場合、前記第2データコントローラは、前記第1データコントローラへのデータ送信を停止し、前記第1データコントローラは、送信時に障害を発生させたデータを前記第1データコントローラのPCIeブリッジを介して再送信し、前記第2データコントローラは、データが前記第1データコントローラから再送信されるまで待機し、前記第1データコントローラのPCIeブリッジから再送信されてくるデータを前記第2データコントローラのPCIeブリッジを介して受信する
ことを特徴とするストレージ装置の制御方法。 - 前記制御部は、前記送信元が前記第1データコントローラ以外の場合又は所定の障害以外の場合、前記第2データコントローラの動作を停止することを特徴とする請求項1〜4のいずれか一つに記載のストレージ装置。
- 前記第1データコントローラは、
不揮発性の第3記憶部と、
前記第1記憶部のデータを第3記憶に移動させるデータ移動部とをさらに備え、
前記制御部は、前記データ送信部からデータが再送信されたときに、前記第2バス接続部及び前記データ書込部において前記第1データコントローラを送信元とするデータによる障害が発生したか否かを判定し、障害が発生している場合、前記データ移動部に前記第1記憶部のデータを前記第3記憶部に移動させ、前記第1データコントローラ及び前記第2データコントローラを再起動させ、再起動した前記第1データコントローラの前記書込部に前記第3記憶部が格納するデータを前記ディスク装置へ書き込ませ、再起動した前記第2データコントローラの前記読出部に前記ディスク装置が格納するデータを読み出させて前記第2記憶部に書き込ませる
ことを特徴とする請求項2に記載のストレージ装置。
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