JP5894869B2 - トランスインピーダンスアンプ - Google Patents
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Description
LSI デバイス
OMD 光通信モジュール
OF 光通信線路
IFC インタフェースカード
SWC スイッチカード
BKP バックプレーン
SDC 伝送速度変換回路
LGC 論理演算処理回路
CP 半導体チップ
OBK 光素子ブロック
LD レーザダイオード
PD フォトダイオード
LDD レーザダイオードドライバ回路
TIA トランスインピーダンス回路
SDC SerDes
VDD プリアンプの電源端子
VPW トランスインピーダンスアンプの電源端子
PSPY プリアンプの電源回路
PRAMP プリアンプ
PAAMP ポストアンプ
ATC1、ATC2 閾値検出回路
ERAMP 誤差アンプ
OPAMP,OFAMP オペアンプ
R1,R2,R3,R4 抵抗器
C3 コンデンサ
AVD 平均値検出器
OFCAN オフセットキャンセル回路
REG レジスタ
LVC レベルシフト
LAMP 低オフセットアンプ
COMP コンパレータ
JDG 判定回路ブロック
LOGIC 制御論理
CANCTL オフセット値制御ブロック
Claims (11)
- プリアンプ回路と、前記プリアンプ回路の後段に配置した一つないし、複数の差増増幅回路から成るポストアンプ回路と、前記プリアンプ回路の出力電圧の中心電位を検出する閾値検出回路とを有して構成されたトランスインピーダンス回路であって、前記閾値検出回路がローパスフィルタと、前記ローパスフィルタの出力が入力端子に、その出力端子が前記ポストアンプ回路の一方の入力に接続されたオフセット調整回路とを有し、
前記閾値検出回路は、入力端子がポストアンプ回路の出力に、出力端子が前記ローパスフィルタに接続された誤差増幅回路と、前記ローパスフィルタと、前記オフセット調整回路とで構成された負帰還ループを有し、
入力端子に負極側入力が接続されたオペアンプ回路と、前記オペアンプ回路の正極側入力と前記オペアンプ回路の出力端子との間に任意の電位差を設定することが可能なレベルシフト回路を有する前記オフセット調整回路を有し、
前記レベルシフト回路は、入出力端子間に直列接続された2個の抵抗手段と、前記レベルシフト回路の入力端子と出力端子と前記2つの抵抗手段の接続ノードとのそれぞれに所望の電流値が設定可能な第1、第2および第3の定電流源手段とを有して構成され、前記第1、第2および第3の定電流源の電流値を所望に設定することにより、前記レベルシフト回路の入出力間に所望の電位差が設定可能に構成されている
ことを特徴とするトランスインピーダンスアンプ回路。 - 前記ローパスフィルタの入力端子が前記プリアンプ回路の出力に接続されており、かつ、前記ローパスフィルタの出力端子が前記オフセット調整回路を介して前記ポストアンプ回路の一方の入力に接続された前記閾値検出回路を有することを特徴とする請求項1記載のトランスインピーダンス回路。
- 入力端子に負極側入力が接続されたオペアンプ回路と、前記オペアンプ回路の正極側入力と前記オペアンプ回路の出力端子との間に任意の電位差を設定することが可能なレベルシフト回路を有する前記オフセット調整回路を有することを特徴とする請求項2記載のトランスインピーダンス回路。
- 前記レベルシフト回路は、入出力端子間に直列接続された2個の抵抗手段と、前記レベルシフト回路の入力端子と出力端子と前記2つの抵抗手段の接続ノードとのそれぞれに所望の電流値が設定可能な第1、第2および第3の定電流源手段とを有して構成され、前記第1、第2および第3の定電流源の電流値を所望に設定することにより、前記レベルシフト回路の入出力間に所望の電位差が設定可能に構成されていることを特徴とする請求項3のトランスインピーダンス回路。
- 前記第1、第2および第3の定電流源手段の電流値をシリアル制御信号で設定される一つ又は複数個のレジスタ群の情報によって設定する電流調整回路を有することを特徴とする請求項1のトランスインピーダンス回路。
- 前記第1、第2および第3の定電流源手段の電流値をシリアル制御信号で設定される一つ又は複数個のレジスタ群の情報によって設定する電流調整回路を有することを特徴とする請求項4のトランスインピーダンス回路。
- 前記定電流源手段の電流値を設定する一つ又は複数個のレジスタ群と、トランスインピーダンスアンプ回路の出力に接続されたオフセット量検出回路と、前記オフセット量検出回路の出力に接続された制御論理によって設定するオフセット量調整ブロックを有することを特徴とする請求項1のトランスインピーダンスアンプ回路。
- 前記定電流源手段の電流値を設定する一つ又は複数個のレジスタ群と、トランスインピーダンスアンプ回路の出力に接続されたオフセット量検出回路と、前記オフセット量検出回路の出力に接続された制御論理によって設定するオフセット量調整ブロックを有することを特徴とする請求項4のトランスインピーダンスアンプ回路。
- 前記オフセット量検出回路は、低オフセットアンプと、その出力にコンパレータを有することを特徴とする請求項7のトランスインピーダンスアンプ回路。
- 前記オフセット量検出回路は、低オフセットアンプと、その出力にコンパレータを有することを特徴とする請求項8のトランスインピーダンスアンプ回路。
- 前記オフセット調整回路はボルテージフォロア回路を有することを特徴とする請求項1記載のトランスインピーダンスアンプ回路。
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