JP5799462B2 - 低歪み可変利得増幅器(vga) - Google Patents
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Description
2010年11月19日出願の米国仮出願61/415,767号明細書"Low Distortion VGA+MR(低歪みVGA+MR)"の優先権を主張するものであり、前記出願の内容は、参照により本明細書に組み込まれる。
Iasym=(Vinp−Vinm)/2*Rmrg/(Rmrg*R1+R2*R2+R2*Rmrg)
と表すことができ、ここで、Rmrgは、トランジスタMRの抵抗値である。非対称性率は、
Asym%=Iasym/(Vinp−Vinm)/R3
と定義されてもよい。
[項目1]
非対称信号を受信する増幅器と、
前記増幅器の入力ノード及び出力ノードの間に接続される第1抵抗と、
線形レジスタを含み、前記増幅器の前記入力ノードに接続される第2抵抗と、
前記第2抵抗と接続される第3抵抗と
を備え、
前記入力ノードは、前記非対称信号を受信し、
前記出力ノードにおける前記非対称信号を補正するべく、前記増幅器によって提供される非対称性補正量を調整するように前記第3抵抗を変化させ、
前記非対称性補正量は、前記第1抵抗及び前記第2抵抗と前記第3抵抗との組み合わせの関数である、装置。
[項目2]
前記第1抵抗は、トランジスタを含む項目1に記載の装置。
[項目3]
前記線形レジスタは、ポリシリコンで製造されている項目1に記載の装置。
[項目4]
前記非対称信号を修正するべく、前記増幅器の利得を増加させるために、前記第2抵抗を正の抵抗である前記第3抵抗に接続するように、第1期間の間に制御される第1スイッチと、
前記非対称信号を修正するべく、前記増幅器の前記利得を低減させるために、前記第2抵抗を負の抵抗である前記第3抵抗に接続するように、第2期間の間に制御される第2スイッチとを更に備える項目1に記載の装置。
[項目5]
前記第3抵抗は、前記第3抵抗を変化させるレジスタ・デバイダ・ネットワークを含む項目1に記載の装置。
[項目6]
前記非対称信号は、正の非対称信号及び負の非対称信号を含み、
前記第3抵抗は、
前記負の非対称信号と接続された第1レジスタ及び第2レジスタと、
前記正の非対称信号と接続された第3レジスタ及び第4レジスタと、
前記第1レジスタ及び前記第2レジスタの間、並びに、前記第3レジスタ及び前記第4レジスタの間に接続されたトランジスタとを含む項目1に記載の装置。
[項目7]
前記トランジスタがオンの場合に、前記第1レジスタ、前記第2レジスタ及び前記第3レジスタは、前記第2抵抗と並列に接続され、
前記トランジスタがオフの場合に、前記第1レジスタ及び前記第2レジスタ、又は、前記第3レジスタ及び前記第4レジスタは、前記第2抵抗と並列に接続される項目6に記載の装置。
[項目8]
前記第3抵抗を変化させるべく、前記トランジスタのゲートにおける電圧が変更される項目6に記載の装置。
[項目9]
前記トランジスタの前記ゲートにおける前記電圧を減少させると、前記増幅器によって提供される前記非対称性補正量が増加し、
前記トランジスタの前記ゲートにおける前記電圧を増加させると、前記増幅器によって提供される前記非対称性補正量が減少する項目8に記載の装置。
[項目10]
前記トランジスタの前記ゲートにおける前記電圧を減少させると、前記増幅器に入力される電流が増加し、
前記トランジスタの前記ゲートにおける前記電圧を増加させると、前記増幅器に入力される前記電流が減少する項目9に記載の装置。
[項目11]
増幅器の入力ノードと出力ノードとの間に、第1抵抗を接続する段階と、
前記増幅器の前記入力ノードに、線形レジスタを含む第2抵抗を接続する段階と、
前記第2抵抗に第3抵抗を接続する段階と、
前記入力ノードにおいて非対称信号を受信する段階と、
前記出力ノードにおける前記非対称信号を修正するべく、前記増幅器によって提供される非対称性補正量を調整するように、前記第3抵抗を変化させる段階と
を備え、
前記非対称性補正量は、前記第1抵抗及び前記第2抵抗と前記第3抵抗との組み合わせの関数である、方法。
[項目12]
前記第1抵抗は、トランジスタを含む項目11に記載の方法。
[項目13]
前記線形レジスタは、ポリシリコンで製造されている項目11に記載の方法。
[項目14]
前記非対称信号を修正するべく、前記増幅器の利得を増加させるために、前記第2抵抗を正の抵抗である前記第3抵抗に接続するように、第1期間の間に第1スイッチを制御する段階と、
前記非対称信号を修正するべく、前記増幅器の前記利得を低減させるために、前記第2抵抗を負の抵抗である前記第3抵抗に接続するように、第2期間の間に第2スイッチを制御する段階とを更に備える項目11に記載の方法。
[項目15]
前記第3抵抗は、前記第3抵抗を変化させるレジスタ・デバイダ・ネットワークを含む項目11に記載の方法。
[項目16]
前記非対称信号は、正の非対称信号及び負の非対称信号を含み、
前記第3抵抗を接続する段階は、
第1レジスタ及び第2レジスタを前記負の非対称信号に接続する段階と、
第3レジスタ及び第4レジスタを前記正の非対称信号と接続する段階と、
トランジスタを、前記第1レジスタ及び前記第2レジスタの間、並びに、前記第3レジスタ及び前記第4レジスタの間に接続する段階とを含む項目11に記載の方法。
[項目17]
前記トランジスタがオンの場合に、前記第1レジスタ、前記第2レジスタ及び前記第3レジスタは、前記第2抵抗と並列に接続され、
前記トランジスタがオフの場合に、前記第1レジスタ及び前記第2レジスタ、又は、前記第3レジスタ及び前記第4レジスタは、前記第2抵抗と並列に接続される項目16に記載の方法。
[項目18]
前記第3抵抗を変化させるべく、前記トランジスタのゲートにおける電圧を変化させる段階を備える項目16に記載の方法。
[項目19]
前記トランジスタの前記ゲートにおける前記電圧を減少させると、前記増幅器によって提供される前記非対称性補正量が増加し、
前記トランジスタの前記ゲートにおける前記電圧を増加させると、前記増幅器によって提供される前記非対称性補正量が減少する項目18に記載の方法。
[項目20]
前記トランジスタの前記ゲートにおける前記電圧を減少させると、前記増幅器に入力される電流が増加し、
前記トランジスタの前記ゲートにおける前記電圧を増加させると、前記増幅器に入力される前記電流が減少する項目18に記載の方法。
Claims (18)
- 正の非対称信号及び負の非対称信号を含む非対称信号を受信する増幅器と、
前記増幅器の入力ノード及び出力ノードの間に接続される第1抵抗と、
線形レジスタを含み、前記増幅器の前記入力ノードに接続される第2抵抗と、
前記第2抵抗と接続される第3抵抗と
を備え、
前記入力ノードは、前記非対称信号を受信し、
前記出力ノードにおける前記非対称信号を補正するべく、前記増幅器によって提供される非対称性補正量を調整するように前記第3抵抗を変化させ、
前記非対称性補正量は、前記第1抵抗及び前記第2抵抗と前記第3抵抗との組み合わせの関数であり、
前記第3抵抗は、
前記負の非対称信号と接続された第1レジスタ及び第2レジスタと、
前記正の非対称信号と接続された第3レジスタ及び第4レジスタと、
前記第1レジスタ及び前記第2レジスタの間、並びに、前記第3レジスタ及び前記第4レジスタの間に接続されたトランジスタとを含む、装置。 - 前記第1抵抗は、トランジスタを含む請求項1に記載の装置。
- 前記線形レジスタは、ポリシリコンで製造されている請求項1または2に記載の装置。
- 前記非対称信号を修正するべく、前記増幅器の利得を増加させるために、前記第2抵抗を正の抵抗である前記第3抵抗に接続するように、第1期間の間に制御される第1スイッチと、
前記非対称信号を修正するべく、前記増幅器の前記利得を低減させるために、前記第2抵抗を負の抵抗である前記第3抵抗に接続するように、第2期間の間に制御される第2スイッチとを更に備える請求項1から3のいずれか一項に記載の装置。 - 前記第3抵抗は、前記第3抵抗を変化させるレジスタ・デバイダ・ネットワークを含む請求項1から4のいずれか一項に記載の装置。
- 前記トランジスタがオンの場合に、前記第1レジスタ、前記第2レジスタ及び前記第3レジスタは、前記第2抵抗と並列に接続され、
前記トランジスタがオフの場合に、前記第1レジスタ及び前記第2レジスタ、又は、前記第3レジスタ及び前記第4レジスタは、前記第2抵抗と並列に接続される請求項1から5のいずれか一項に記載の装置。 - 前記第3抵抗を変化させるべく、前記トランジスタのゲートにおける電圧が変更される請求項1から6のいずれか一項に記載の装置。
- 前記トランジスタの前記ゲートにおける前記電圧を減少させると、前記増幅器によって提供される前記非対称性補正量が増加し、
前記トランジスタの前記ゲートにおける前記電圧を増加させると、前記増幅器によって提供される前記非対称性補正量が減少する請求項7に記載の装置。 - 前記トランジスタの前記ゲートにおける前記電圧を減少させると、前記増幅器に入力される電流が増加し、
前記トランジスタの前記ゲートにおける前記電圧を増加させると、前記増幅器に入力される前記電流が減少する請求項7または8に記載の装置。 - 増幅器の入力ノードと出力ノードとの間に、第1抵抗を接続する段階と、
前記増幅器の前記入力ノードに、線形レジスタを含む第2抵抗を接続する段階と、
前記第2抵抗に第3抵抗を接続する段階と、
前記入力ノードにおいて、正の非対称信号及び負の非対称信号を含む非対称信号を受信する段階と、
前記出力ノードにおける前記非対称信号を修正するべく、前記増幅器によって提供される非対称性補正量を調整するように、前記第3抵抗を変化させる段階と
を備え、
前記非対称性補正量は、前記第1抵抗及び前記第2抵抗と前記第3抵抗との組み合わせの関数であり、
前記第3抵抗を接続する段階は、
第1レジスタ及び第2レジスタを前記負の非対称信号と接続する段階と、
第3レジスタ及び第4レジスタを前記正の非対称信号と接続する段階と、
トランジスタを、前記第1レジスタ及び前記第2レジスタの間、並びに、前記第3レジスタ及び前記第4レジスタの間に接続する段階とを含む、方法。 - 前記第1抵抗は、トランジスタを含む請求項10に記載の方法。
- 前記線形レジスタは、ポリシリコンで製造されている請求項10または11に記載の方法。
- 前記非対称信号を修正するべく、前記増幅器の利得を増加させるために、前記第2抵抗を正の抵抗である前記第3抵抗に接続するように、第1期間の間に第1スイッチを制御する段階と、
前記非対称信号を修正するべく、前記増幅器の前記利得を低減させるために、前記第2抵抗を負の抵抗である前記第3抵抗に接続するように、第2期間の間に第2スイッチを制御する段階とを更に備える請求項10から12のいずれか一項に記載の方法。 - 前記第3抵抗は、前記第3抵抗を変化させるレジスタ・デバイダ・ネットワークを含む請求項10から13のいずれか一項に記載の方法。
- 前記トランジスタがオンの場合に、前記第1レジスタ、前記第2レジスタ及び前記第3レジスタは、前記第2抵抗と並列に接続され、
前記トランジスタがオフの場合に、前記第1レジスタ及び前記第2レジスタ、又は、前記第3レジスタ及び前記第4レジスタは、前記第2抵抗と並列に接続される請求項10から14のいずれか一項に記載の方法。 - 前記第3抵抗を変化させるべく、前記トランジスタのゲートにおける電圧を変化させる段階を備える請求項10から14のいずれか一項に記載の方法。
- 前記トランジスタの前記ゲートにおける前記電圧を減少させると、前記増幅器によって提供される前記非対称性補正量が増加し、
前記トランジスタの前記ゲートにおける前記電圧を増加させると、前記増幅器によって提供される前記非対称性補正量が減少する請求項16に記載の方法。 - 前記トランジスタの前記ゲートにおける前記電圧を減少させると、前記増幅器に入力される電流が増加し、
前記トランジスタの前記ゲートにおける前記電圧を増加させると、前記増幅器に入力される前記電流が減少する請求項16または17に記載の方法。
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