JP5715587B2 - レギュレータ - Google Patents
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- G05F1/46—Regulating voltage or current wherein the variable actually regulated by the final control device is dc
- G05F1/56—Regulating voltage or current wherein the variable actually regulated by the final control device is dc using semiconductor devices in series with the load as final control devices
- G05F1/575—Regulating voltage or current wherein the variable actually regulated by the final control device is dc using semiconductor devices in series with the load as final control devices characterised by the feedback circuit
Description
図1は第1の実施形態に係る低ドロップアウトレギュレータ(以下、LDOレギュレータ)の内部構成を示す回路図である。図1のLDOレギュレータ1は、差動回路2と、第1カレントミラー回路3と、位相補償回路4と、出力段トランジスタ(第1トランジスタ)5と、電圧分圧回路6と、広帯域制御トランジスタ(第2トランジスタ)7と、位相補償コンデンサ(第1コンデンサ)Ci1と、第1および第2電流源8,9と、出力コンデンサ(第2コンデンサ)Coutとを備えている。
以下に説明する第2の実施形態は、広帯域制御トランジスタ7のゲートの接続先が第1の実施形態と異なることを特徴とする。
以下に説明する第3の実施形態は、差動回路2の反転入力側と非反転入力側を対称構成にすることを特徴とする。
以下に説明する第4の実施形態は、差動回路2の非反転入力側にも広帯域制御トランジスタ7と同様のトランジスタを設けて、出力電圧Voutのオフセット電圧を低減するものである。
以下に説明する第5の実施形態は、位相余裕の微調整を行うものである。
以下に説明する第6の実施形態は、差動回路2をフォールデッド・カスコード型の構成にするものである。
以下に説明する第7の実施形態は、LDOレギュレータ1内のトランジスタの導電型を第1〜第6の実施形態とは逆にして、回路の接続関係も逆にしたものである。
以下に説明する第8の実施形態は、LDOレギュレータ1の低電圧側の基準電圧を負電圧にするものである。
以下に説明する第9の実施形態は、第1の実施形態における広帯域制御トランジスタ7の導電型を逆にしたものである。
Ci1 位相補償コンデンサ、Cout 出力コンデンサ
Claims (13)
- 基準電圧と出力電圧に相関する電圧との電圧差に応じた比較信号を生成する差動回路と、
前記差動回路に電流を供給する第1電流源と、
前記比較信号に応じて、入力電圧を用いて前記出力電圧を調整する第1トランジスタと、
前記差動回路の一対の差動出力線に接続される第1カレントミラー回路と、
前記出力電圧の分圧電圧を生成する電圧分圧回路と、
互いに並列接続される第1コンデンサおよび第2電流源と、
ゲートに入力される前記出力電圧または前記分圧電圧に基づいて、前記一対の差動出力線の一方から、前記第1コンデンサおよび前記第2電流源に電流を流すか否かを制御する第2トランジスタと、を備えることを特徴とするレギュレータ。 - 前記差動回路は、
ソースが共通に接続された一対のトランジスタを有し、
前記一対のトランジスタの一方は、前記分圧電圧または前記出力電圧が入力されるゲートと、前記第2トランジスタのドレインに接続されるドレインと、を有することを特徴とする請求項1に記載のレギュレータ。 - 前記第2トランジスタは、前記出力電圧に重畳された高周波信号に応じた電流を前記一対の差動出力線の一方に流し、
前記第1カレントミラー回路は、前記一対の差動出力線の一方に流れる電流に比例した電流を、前記一対の差動出力線の他方に流し、
前記第1トランジスタは、前記差動回路の差動出力線の他方の電圧に応じて前記出力電圧を制御することを特徴とする請求項1に記載のレギュレータ。 - 前記一対の差動出力線の他方に電流を供給する第3電流源を備えることを特徴とする請求項1乃至3のいずれかに記載のレギュレータ。
- 前記一対の差動出力線の他方と前記第3電流源の一端との間に接続され、ゲートまたはベースには基準電圧が入力され前記第3電流源の一端の電圧を定電圧にする第3トランジスタを備えることを特徴とする請求項4に記載のレギュレータ。
- 一端が前記第3電流源の一端または前記一対の差動出力線の他方に接続され、他端が前記第2トランジスタのゲートまたはベースに接続される第3コンデンサを備えることを特徴とする請求項5に記載のレギュレータ。
- 前記第3コンデンサの容量は、前記第1コンデンサの容量よりも2桁以上小さいことを特徴とする請求項6に記載のレギュレータ。
- 前記第1コンデンサの容量は、前記第1トランジスタのゲートまたはベース容量の1/10より大きいことを特徴とする請求項1乃至7のいずれかに記載のレギュレータ。
- 前記出力電圧を出力する出力電圧線に接続される第2コンデンサを備え、
前記第2コンデンサは、セラミックコンデンサであることを特徴とする請求項1乃至8のいずれかに記載のレギュレータ。 - 前記差動回路と前記第1カレントミラー回路との間の前記一対の差動出力線上に挿入される第2カレントミラー回路を備え、
前記第2トランジスタおよび前記第2電流源は、前記第1カレントミラー回路と前記第2カレントミラー回路との間の一対の差動出力線の一方と基準電圧線との間に直列接続されることを特徴とする請求項1乃至9のいずれかに記載のレギュレータ。 - 前記入力電圧を供給する入力電圧線と前記第1トランジスタのゲートまたはベースとの間に接続される位相補償回路を備えることを特徴とする請求項1乃至10のいずれかに記載のレギュレータ。
- 前記第1および第2電流源、および前記出力電圧を出力する出力電圧線に接続される第2コンデンサの各一端は、接地線または負電圧線に接続され、
前記第1トランジスタおよび前記第1カレントミラー回路の各一端は、前記入力電圧を供給する入力電圧線に接続されることを特徴とする請求項1乃至11のいずれかに記載のレギュレータ。 - 前記第1および第2電流源、および前記出力電圧を出力する出力電圧線に接続される第2コンデンサの各一端は、前記入力電圧を供給する入力電圧線に接続され、
前記第1トランジスタおよび前記第1カレントミラー回路の各一端は接地線に接続されることを特徴とする請求項1乃至11のいずれかに記載のレギュレータ。
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