JP5459878B2 - パリティ共有データ処理のためのシステム及び方法 - Google Patents
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- 238000012545 processing Methods 0.000 title claims description 65
- 238000000034 method Methods 0.000 title claims description 55
- 239000002131 composite material Substances 0.000 claims description 29
- 238000001514 detection method Methods 0.000 claims description 28
- 230000007246 mechanism Effects 0.000 claims description 11
- 239000007787 solid Substances 0.000 claims description 11
- 230000008569 process Effects 0.000 description 25
- 238000012546 transfer Methods 0.000 description 12
- 230000005540 biological transmission Effects 0.000 description 8
- 238000012937 correction Methods 0.000 description 5
- 230000006870 function Effects 0.000 description 5
- 238000010586 diagram Methods 0.000 description 4
- 230000004044 response Effects 0.000 description 3
- 238000013459 approach Methods 0.000 description 2
- 230000008901 benefit Effects 0.000 description 2
- 230000002457 bidirectional effect Effects 0.000 description 2
- 239000011159 matrix material Substances 0.000 description 2
- 238000006243 chemical reaction Methods 0.000 description 1
- 239000000470 constituent Substances 0.000 description 1
- 238000013461 design Methods 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 230000003287 optical effect Effects 0.000 description 1
- 238000003672 processing method Methods 0.000 description 1
- 230000009467 reduction Effects 0.000 description 1
- 230000001960 triggered effect Effects 0.000 description 1
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
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- H03M13/15—Cyclic codes, i.e. cyclic shifts of codewords produce other codewords, e.g. codes defined by a generator polynomial, Bose-Chaudhuri-Hocquenghem [BCH] codes
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- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
- H03M13/03—Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words
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- H03M13/1102—Codes on graphs and decoding on graphs, e.g. low-density parity check [LDPC] codes
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- G11—INFORMATION STORAGE
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- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
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- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
- H03M13/03—Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words
- H03M13/05—Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words using block codes, i.e. a predetermined number of check bits joined to a predetermined number of information bits
- H03M13/11—Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words using block codes, i.e. a predetermined number of check bits joined to a predetermined number of information bits using multiple parity bits
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- H—ELECTRICITY
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- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
- H03M13/29—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes combining two or more codes or code structures, e.g. product codes, generalised product codes, concatenated codes, inner and outer codes
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- H03M13/37—Decoding methods or techniques, not specific to the particular type of coding provided for in groups H03M13/03 - H03M13/35
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- G—PHYSICS
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Description
105 Analog Input アナログ入力
110 Analog Front End Circuit アナログフロントエンド回路
114 Analog to Digital Converter Circuit アナログ/デジタル変換器回路
120 DFIR Circuit DFIR回路
130 Data Detector Circcuit データ検出器回路
142 Local Interleaver Circuit 局所インターリーバー回路
144 Local De-Interleaver Circuit 局所デインターリーバー回路
150 Central Memory Circuit 中央メモリ回路
162、164、166 Subset Decoder Circuit サブセット復号器回路
175 Soft Data Processing Circuit 軟データ処理回路
180 De-Interleaver Circuit デインターリーバー回路
184 Global Interleaver/Deinterleaver Circuit 大域インターリーバー/デインターリーバー回路
190 Hard Decision Circuit 硬判定出力回路
Hard DecisionOutput 硬判定出力
図2
205、210、215 Encoded Sub-Codeword 符号化された部分符号語
220 Composite Encoded Sub-Codeword 符号化された部分符号語の複合体
図3
301 Write Data 書込みデータ
303 Read Data 読取りデータ
310 Read Channel Including Shared Parity Codeword Circuitry 共有パリティデータ符号語回路部を備えた読取りチャネル
320 Interface Contoroller インターフェースコントローラー
366 Hard Disk Controller ハードディスクコントローラー
368 Motor Controller モーターコントローラー
370 Preamp 前置増幅器
372 Spindle Motor スピンドルモーター
376 Read/Write Head 読取り/書込みヘッド
378 Disk Platter ディスクプラッター
図4
410 Input Buffer Circuit 入力バッファー回路
420 Output Buffer Circuit 出力バッファー回路
430 Flash Access Controller Including Shared Parity Codeword Circuitry 共有パリティ符号語回路部を備えたフラッシュアクセスコントローラー
440 Solid State Memory Circuit 固体メモリ回路
図5
510 Transmitter 送信機
520 Transreceiver Including Shared Parity Codeword Circuitry 共有パリティ符号語回路部を備えた送受信機
530 Transfer Medium 転送媒体
図6
605 Receive Analog Input アナログ入力を受信する
610 Convert Analog Input to a Series of Digital Samples アナログ入力を一連のデジタルサンプルに変換する
615 Equalize the Series of Digital Samples to Yield an Equalized Output 一連のデジタルサンプルを等化して、等化出力をもたらす
620 Data Detector Circuit Free? データ検出器回路が空いている?
625 Perform Data Detection on the Equalized Output Guided by aDerivative of a Decoded Output if Available from the Central Memory Circuit toYield a Detected Output 復号された出力が中央メモリ回路から入手可能である場合に該復号された出力から取り出されたものによって導かれた等化出力に対しデータ検出を実行し、検出された出力をもたらす
630 Store a Derivative of the Detected Output to a Central MemoryCircuit 検出された出力から取り出されたものを中央メモリ回路に格納する
640 Data Decoder Circuit Free? データ復号器回路が空いているか?
645 Access a Derivative of a Detected Output from the Central MemoryCircuit 中央メモリ回路からの検出された出力から取り出されたものにアクセスする
650 Disaggregate the Detected Output Into Sub-Codewords and CompositeSub-Codeword 検出された出力を部分符号語及び部分符号語の複合体に分解する
655 Perform Data Decode Algorithm on the Sub-Codewords and ComposeteSub-Codeword to Yield Corresponding Decoded Outputs 部分符号語及び部分符号語の複合体に対しデータ復号アルゴリズムを実行し、対応する復号された出力をもたらす
660 Reconstitute All Sub-Codewords Using the Sub-Codewords and theComposite Sub-Codeward 部分符号語及び部分符号語の複合体を用いて全ての部分符号語を再構成する
665 All Sub-Codewords and Composite Sub-Codewords Converged? 全ての部分符号語及び部分符号語の複合体が収束した?
670 Apply Error Correction Using Reconsituted Sub-Codewords 再構成された部分符号語を用いて誤り訂正を適用する
675 Remaining Errors Corrected? 訂正された誤りが残っている?
680 Provide Combined Sub-Codewords as a Data Output 結合された部分符号語をデータ出力として与える
685 Another Local Iteration? 別の局所反復?
690 Store the Decoded Output to the Central Memory Circuit 復号された出力を中央メモリ回路に格納する
図7
705 Data Input データ入力
710 Sub-Codeword Encoder Circuit 部分符号語符号化器回路
720 Sub-Codeword Combining Circuit 部分符号語結合回路
730 Combined Codeword Writing Circuit 結合符号語書込み回路
735 Codeword 符号語
図8
805 Receive Data Input as User Bits データ入力をユーザービットとして受信する
810 Collect User Bits for a Sub-Codeword 部分符号語のためにユーザービットを収集する
815 Enough User Bits for a Sub-Codeword? 部分符号語に十分なユーザービット?
820 Encode Sub-Codeword 部分符号語を符号化する
825 Enough Sub-Codeword for a Codeword? 符号語に十分な部分符号語?
830 Start Next Sub-Codeward 次の部分符号語を開始する
840 Generate a Composite Sub-Codeword 部分符号語の複合体を生成する
850 Combine the Composite Sub-codeword with Other Encoded Sub-codewordsto Yield an Overall Codeword 部分符号語の複合体を他の符号化された部分符号語と結合して全体符号語をもたらす
符号化された部分符号語215=符号化された部分符号語205+符号化された部分符号語210+部分符号語の複合体220+E3
を用いて符号化された部分符号語215を生成することを含む。次に、サブセット復号器回路166は以下の情報、
符号化された部分符号語215+E3
を復号して元の符号化された部分符号語215を復元することができ、該元の符号化された部分符号語215は、部分復号された出力167として軟データ処理回路175に与えられ、該軟データ処理回路175において、部分復号された出力167が収束した場合、該部分復号された出力167を他の収束した部分復号された出力と結合して出力符号語172をもたらすことができる。
Claims (20)
- データ処理システムであって、
データセットにデータ検出アルゴリズムを適用して、検出された出力をもたらすように動作可能なデータ検出器回路であって、該データセットは、少なくとも第1の符号化された部分符号語及び部分符号語の複合体を含む、データ検出器回路と、
データ復号器回路であって、該第1の符号化された部分符号語にデータ復号アルゴリズムを適用して第1の復号された出力をもたらすように、かつ該部分符号語の複合体に、該第1の符号化された部分符号語からは独立して、該データ復号アルゴリズムを適用して第2の復号された出力をもたらすように動作可能なデータ復号器回路と、
処理回路であって、
該第1の符号化された部分符号語及び該部分符号語の複合体を含むデータの結合から第2の符号化された部分符号語を再構成するように、かつ
少なくとも部分的に、該第1の符号化された部分符号語、該第2の符号化された部分符号語、及び該部分符号語の複合体の結合に基づいて、該第1の符号化された部分符号語及び該第2の符号化された部分符号語のうちの一方における誤りを訂正するように、
動作可能な処理回路と、
を備える、データ処理システム。 - 符号語の複合体は、少なくとも該第1の符号化された部分符号語及び該第2の符号化された部分符号語の数学的結合である、請求項1に記載のデータ処理システム。
- 第1の符号化された部分符号語と該部分符号語の複合体とを含むデータの該結合から該第2の符号化された部分符号語を再構成することは、少なくとも該第1の符号化された部分符号語及び該第2の符号化された部分符号語の該数学的結合を逆に行うことを含む、請求項2に記載のデータ処理システム。
- 少なくとも部分的に、該第1の符号化された部分符号語、該第2の符号化された部分符号語、及び該部分符号語の複合体の結合に基づいて該第1の符号化された部分符号語及び該第2の符号化された部分符号のうちの一方における誤りを訂正することは、
少なくとも該第1の符号化された部分符号語及び該第2の符号化された部分符号語の数学的結合によって正しい数学的関係がもたらされるように該第1の符号化された部分符号語及び該第2の符号化された部分符号語のうちの一方の要素を変更することを含む、請求項3に記載のデータ処理システム。 - 符号語の複合体は、少なくとも該第1の符号化された部分符号語及び該第2の符号化された部分符号語の2を法とした結合である、請求項1に記載のデータ処理システム。
- データ検出アルゴリズムは、最大事後データ検出アルゴリズム及びビタビ検出アルゴリズムからなる群から選択される、請求項1に記載のデータ処理システム。
- データ復号アルゴリズムは、低密度パリティチェックアルゴリズムである、請求項1に記載のデータ処理システム。
- データ復号器回路は、
該データ復号アルゴリズムを該第1の符号化された部分符号語に適用して該第1の復号された出力をもたらすように動作可能な第1の復号回路と、
該データ復号アルゴリズムを該部分符号語の複合体に適用して該第2の復号された出力をもたらすように動作可能な第2の復号回路と、
を備える、請求項1に記載のデータ処理システム。 - 低密度パリティチェックデータ復号器回路は、
復号回路であって、
第1の時間期間中に該データ復号アルゴリズムを該第1の符号化された部分符号語に適用して該第1の復号された出力をもたらすように、かつ
第2の時間期間中に該データ復号アルゴリズムを該部分符号語の複合体に適用して該第2の復号された出力をもたらすように、
動作可能な、復号回路を備える、請求項1に記載のデータ処理システム。 - データ処理システムは、ディスクに基づくストレージデバイス、固体ストレージデバイス、及び受信デバイスからなる群から選択されたデバイスの一部分として実装される、請求項1に記載のデータ処理システム。
- データ処理システムは集積回路の一部分として実装される、請求項1に記載のデータ処理システム。
- データを処理する方法であって、
データ検出回路を用いて第1のデータセットに対しデータ検出アルゴリズムを実行することであって、検出された出力をもたらし、該データセットは、少なくとも第1の符号化された部分符号語及び部分符号語の複合体を含む、実行すること、
該検出された出力から取り出された第2のデータセットに対しデータ復号アルゴリズムを実行することであって、該第1の符号化された部分符号語に対応する第1の復号された出力をもたらす、実行すること、
該第1の復号された出力からは独立して、該検出された出力から取り出された第3のデータセットに対し該データ復号アルゴリズムを実行することであって、該部分符号語の複合体に対応する第2の復号された出力をもたらす、実行すること、
該第2の復号された出力及び該第1の復号された出力を含むデータの結合から第2の符号化された部分符号語を再構成すること、並びに
少なくとも部分的に、該第1の符号化された部分符号語、該第2の符号化された部分符号語、及び該部分符号語の複合体の結合に基づいて、該第1の復号された出力及び該第2の復号された出力のうちの一方における誤りを訂正すること、
を含む、データを処理する方法。 - 符号語の複合体は、少なくとも該第1の符号化された部分符号語及び該第2の符号化された部分符号語の数学的結合である、請求項12に記載の方法。
- 第2の復号された出力と該第1の復号された出力とを含むデータの該結合から該第2の符号化された部分符号語を再構成することは、
少なくとも該第1の符号化された部分符号語及び該第2の符号化された部分符号語の該数学的結合を逆に行うことを含む、請求項13に記載の方法。 - 少なくとも部分的に、該第1の符号化された部分符号語、該第2の符号化された部分符号語、及び該部分符号語の複合体の該結合に基づいて該第1の復号された出力及び該第2の復号された出力のうちの一方における誤りを訂正することは、
少なくとも該第1の符号化された部分符号語及び該第2の符号化された部分符号語の該数学的結合によって正しい数学的関係がもたらされるように該第1の符号化された部分符号語及び該第2の符号化された部分符号語のうちの一方の要素を変更することを含む、請求項14に記載の方法。 - 符号語の複合体は、少なくとも該第1の符号化された部分符号語及び該第2の符号化された部分符号語の2を法とした結合である、請求項12に記載の方法。
- 第2のデータセットに対し該データ復号アルゴリズムを実行することは、該第3のデータセットに対し該データ復号アルゴリズムを実行することと並行して行われる、請求項12に記載の方法。
- 第2のデータセットに対し該データ復号アルゴリズムを実行することは第1の期間中に行われ、該第3のデータセットに対し該データ復号アルゴリズムを実行することは第2の期間中に行われ、該第2の期間は該第1の期間に続く、請求項12に記載の方法。
- ストレージデバイスであって、
ストレージ媒体と、
該ストレージ媒体と関係して配置され、該ストレージ媒体上の情報に対応する感知信号を与えるように動作可能なヘッド機構と、
読取りチャネル回路であって、
該感知信号から取り出されたアナログ信号をサンプリングして一連のデジタルサンプルをもたらすように動作可能なアナログ/デジタル変換器回路と、
該デジタルサンプルを等化してデータセットをもたらすように動作可能な等化器回路と、
該データセットにデータ検出アルゴリズムを適用して、検出された出力をもたらすように動作可能なデータ検出器回路であって、該データセットは、少なくとも第1の符号化された部分符号語及び部分符号語の複合体を含む、データ検出器回路と、
低密度パリティチェックデータ復号器回路であって、該第1の符号化された部分符号語にデータ復号アルゴリズムを適用して第1の復号された出力をもたらすように、かつ該部分符号語の複合体に、該第1の符号化された部分符号語からは独立して、該データ復号アルゴリズムを適用して第2の復号された出力をもたらすように動作可能な低密度パリティチェックデータ復号器回路と、
処理回路であって、
該第1の符号化された部分符号語及び該部分符号語の複合体を含むデータの結合から第2の符号化された部分符号語を再構成するように、かつ
少なくとも部分的に、該第1の符号化された部分符号語、該第2の符号化された部分符号語、及び該部分符号語の複合体の結合に基づいて、該第1の符号化された部分符号語及び該第2の符号化された部分符号語のうちの一方における誤りを訂正するように、
動作可能な処理回路と、
を備える、読取りチャネル回路と、
を備える、ストレージデバイス。 - 符号語の複合体は、少なくとも該第1の符号化された部分符号語及び該第2の符号化された部分符号語の数学的結合である、請求項19に記載のデータ処理システム。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US13/269,832 US8578241B2 (en) | 2011-10-10 | 2011-10-10 | Systems and methods for parity sharing data processing |
US13/269,832 | 2011-10-10 |
Publications (3)
Publication Number | Publication Date |
---|---|
JP2013080548A JP2013080548A (ja) | 2013-05-02 |
JP2013080548A5 JP2013080548A5 (ja) | 2014-01-16 |
JP5459878B2 true JP5459878B2 (ja) | 2014-04-02 |
Family
ID=47221106
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2012090008A Active JP5459878B2 (ja) | 2011-10-03 | 2012-04-11 | パリティ共有データ処理のためのシステム及び方法 |
Country Status (6)
Country | Link |
---|---|
US (1) | US8578241B2 (ja) |
EP (1) | EP2582052A1 (ja) |
JP (1) | JP5459878B2 (ja) |
KR (1) | KR101440189B1 (ja) |
CN (1) | CN103034557B (ja) |
TW (1) | TWI455492B (ja) |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2013085217A (ja) * | 2011-10-10 | 2013-05-09 | Lsi Corp | パリティ共有データ符号化のためのシステム及び方法 |
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2011
- 2011-10-10 US US13/269,832 patent/US8578241B2/en active Active
-
2012
- 2012-04-11 JP JP2012090008A patent/JP5459878B2/ja active Active
- 2012-04-24 KR KR1020120042520A patent/KR101440189B1/ko active IP Right Grant
- 2012-08-10 CN CN201210285368.8A patent/CN103034557B/zh active Active
- 2012-08-10 TW TW101129110A patent/TWI455492B/zh not_active IP Right Cessation
- 2012-09-14 EP EP12184422.9A patent/EP2582052A1/en not_active Withdrawn
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2013085217A (ja) * | 2011-10-10 | 2013-05-09 | Lsi Corp | パリティ共有データ符号化のためのシステム及び方法 |
Also Published As
Publication number | Publication date |
---|---|
EP2582052A1 (en) | 2013-04-17 |
JP2013080548A (ja) | 2013-05-02 |
US20130091397A1 (en) | 2013-04-11 |
TW201316697A (zh) | 2013-04-16 |
CN103034557B (zh) | 2016-08-03 |
CN103034557A (zh) | 2013-04-10 |
TWI455492B (zh) | 2014-10-01 |
KR101440189B1 (ko) | 2014-09-12 |
KR20130038788A (ko) | 2013-04-18 |
US8578241B2 (en) | 2013-11-05 |
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Legal Events
Date | Code | Title | Description |
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A871 | Explanation of circumstances concerning accelerated examination |
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A621 | Written request for application examination |
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|
A975 | Report on accelerated examination |
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|
A131 | Notification of reasons for refusal |
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|
A521 | Request for written amendment filed |
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|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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|
A61 | First payment of annual fees (during grant procedure) |
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|
R150 | Certificate of patent or registration of utility model |
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|
RD02 | Notification of acceptance of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: R3D02 |
|
S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313113 |
|
R350 | Written notification of registration of transfer |
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R250 | Receipt of annual fees |
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|
S111 | Request for change of ownership or part of ownership |
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|
SZ02 | Written request for trust registration |
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|
R350 | Written notification of registration of transfer |
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|
R250 | Receipt of annual fees |
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|
R250 | Receipt of annual fees |
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|
R250 | Receipt of annual fees |
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|
S131 | Request for trust registration of transfer of right |
Free format text: JAPANESE INTERMEDIATE CODE: R313135 |
|
S531 | Written request for registration of change of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313531 |
|
R250 | Receipt of annual fees |
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|
R350 | Written notification of registration of transfer |
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R250 | Receipt of annual fees |
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