JP5449791B2 - データ処理装置および画像処理装置 - Google Patents
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Description
前記制御部からの開始信号に基づいて、前記第1の画像処理部から出力されるブロック単位の画像データを入力して画像処理を実行し、画像処理した画像データをブロック単位で出力し終わると、完了を示す信号を前記制御部に出力するとともに、次のブロック単位の画像データに対して画像処理を行う前に、前記制御部から次の開始信号の入力を必要とする第2の画像処理部と、前記制御部からの開始信号を入力して、前記第2の画像処理部から出力される画像データを入力して前記メモリに画像データを書き込み、書き込みが完了すると、完了を示す信号を前記制御部に出力する出力DMA部と、を備え、前記制御部は、前記第2の画像処理部から前記ブロック単位の画像データが出力し終わる前に、前記完了を示す信号を出力した画像処理部に対して、次のブロック単位の画像データを処理させるための開始信号を出力することを特徴とする。
2…YC処理部
3…NR処理部
4…出力DMA部
5…DMAバス
6…DRAM
10…シーケンサ
Claims (13)
- データを処理する複数のデータ処理部が連結されてパイプライン方式の処理を行うデータ処理装置であって、
データ処理シーケンスを制御する制御部を有し、
前記複数のデータ処理部はそれぞれ、前記制御部からの開始信号に基づいてブロック単位でデータを入力し、処理したデータをブロック単位で出力し終わると、データ処理の完了を示す信号を前記制御部に出力するとともに、次のブロック単位のデータを処理する前に、前記制御部から次の開始信号の入力を必要とするものであって、
前記制御部は、前記複数のデータ処理部のうちの最後段のデータ処理部から前記ブロック単位のデータが出力し終わる前に、前記データ処理の完了を示す信号を出力した前記データ処理部に対して、次のブロック単位のデータを処理させるための開始信号を出力することを特徴とするデータ処理装置。 - 前記複数のデータ処理部は少なくとも第1処理部および第2処理部を備え、
前記第1処理部は、入力されたブロック単位のデータに対して第1のデータ処理を完了すると、第1のデータ処理の完了を示す信号を前記制御部に出力し、
前記第2処理部は、前記第1のデータ処理後のデータをブロック単位で入力し、入力されたデータに対して第2のデータ処理を完了すると、第2のデータ処理の完了を示す信号を前記制御部に出力することを特徴とする請求項1に記載のデータ処理装置。 - 前記制御部は、前記第1処理部または前記第2処理部にそれぞれ必要出力データ数を出力し、
前記第1処理部または前記第2処理部は、それぞれ第1のデータ処理または第2のデータ処理を行ったデータ数が前記必要出力データ数と一致すると、前記第1のデータ処理の完了を示す信号または前記第2のデータ処理の完了を示す信号をそれぞれ出力することを特徴とする請求項2に記載のデータ処理装置。 - 前記制御部は、必要入力データ数を前記第2処理部に出力し、
前記第2処理部は、入力するデータ数が前記必要入力データ数と一致するまでデータの入力を要求するためのデータ入力要求信号を前記第1処理部に出力し、
前記第1処理部は、前記第2処理部からのデータ入力要求信号を入力している間は、前記第2処理部へのデータを出力し、前記データ入力要求信号を入力していないときは、前記第2処理部へのデータの出力を行わないことを特徴とする請求項2または請求項3に記載のデータ処理装置。 - 前記完了を示す信号は、割込み信号であることを特徴とする請求項1から請求項4のいずれか一項に記載のデータ処理装置。
- 前記第1処理部および前記第2処理部の間に設けられ、前記制御部からの開始信号に基づいて前段の処理部からデータを入力して、データ処理を開始し、データ処理後のデータを後段の処理部に出力するとともに、データ処理が完了すると、データ処理の完了を示す信号を前記制御部に出力する処理部
をさらに少なくとも1つ備えることを特徴とする請求項2から請求項4のいずれか一項に記載のデータ処理装置。 - 画像データを処理する複数の画像処理部が連結されてパイプライン方式の処理を行う画像処理装置であって、
画像処理シーケンスを制御する制御部と、
画像データの書き込みおよび読み出しが可能なメモリと、
前記制御部からの開始信号に基づいて前記メモリからブロック単位の画像データの入力を開始し、入力した前記ブロック単位の画像データの出力を完了すると、完了を示す信号を前記制御部に出力する入力DMA部と、
前記制御部からの開始信号に基づいて、前記入力DMA部から出力されるブロック単位の画像データを入力して画像処理を実行し、画像処理した画像データをブロック単位で出力し終わると、完了を示す信号を前記制御部に出力するとともに、次のブロック単位の画像データに対して画像処理を行う前に、前記制御部から次の開始信号の入力を必要とする第1の画像処理部と、
前記制御部からの開始信号に基づいて、前記第1の画像処理部から出力されるブロック単位の画像データを入力して画像処理を実行し、画像処理した画像データをブロック単位で出力し終わると、完了を示す信号を前記制御部に出力するとともに、次のブロック単位の画像データに対して画像処理を行う前に、前記制御部から次の開始信号の入力を必要とする第2の画像処理部と、
前記制御部からの開始信号を入力して、前記第2の画像処理部から出力される画像データを入力して前記メモリに画像データを書き込み、書き込みが完了すると、完了を示す信号を前記制御部に出力する出力DMA部と、
を備え、
前記制御部は、前記第2の画像処理部から前記ブロック単位の画像データが出力し終わる前に、前記完了を示す信号を出力した画像処理部に対して、次のブロック単位の画像データを処理させるための開始信号を出力することを特徴とする画像処理装置。 - 前記制御部は、前記入力DMA部と前記第1の画像処理部と前記第2の画像処理部にそれぞれ必要出力データ数を出力し、
前記入力DMA部、前記第1の画像処理部、および、前記第2の画像処理部は、それぞれ処理を行ったデータ数がそれぞれの必要出力データ数と一致すると、完了を示す信号を前記制御部にそれぞれ出力することを特徴とする請求項7に記載の画像処理装置。 - 前記制御部は、前記第1の画像処理部が処理する画像データ数を示す必要入力データ数を前記第1の画像処理部に出力し、
前記第1の画像処理部は、前記入力DMA部に画像データの要求信号を出力して画像データを入力するとともに入力データ数をカウントし、前記入力データ数が前記必要入力データ数と一致すると、前記入力DMA部への画像データの要求信号の出力を禁止し、
前記入力DMA部は、前記画像データの要求信号が入力されている間は、前記第1の画像処理部に画像データを出力することを特徴とする請求項7または請求項8に記載の画像処理装置。 - 前記制御部は、前記第2の画像処理部が処理する画像データ数を示す必要入力データ数を前記第2の画像処理部に出力し、
前記第2の画像処理部は、前記第1の画像処理部に画像データの要求信号を出力して画像データを入力するとともに入力データ数をカウントし、前記入力データ数が前記必要入力データ数と一致すると、前記第1の画像処理部への画像データの要求信号の出力を禁止し、
前記第1の画像処理部は、前記画像データの要求信号が入力されている間は、前記第2の画像処理部に画像データを出力することを特徴とする請求項7から請求項9のいずれか一項に記載の画像処理装置。 - 前記制御部は、前記出力DMA部が処理する画像データ数を示す必要入力データ数を前記出力DMA部に出力し、
前記出力DMA部は、前記第2の画像出力部に画像データの要求信号を出力して画像データを入力するとともに入力データ数をカウントし、前記入力データ数が前記必要入力データ数と一致すると、前記第2の画像処理部への画像データの要求信号の出力を禁止し、
前記第2の画像処理部は、前記画像データの要求信号が入力されている間は、前記出力DMA部に画像データを出力することを特徴とする請求項7から請求項10のいずれか一項に記載の画像処理装置。 - 前記完了を示す信号は、割込み信号であることを特徴とする請求項7から請求項11のいずれか一項に記載の画像処理装置。
- 前記第1画像処理部および前記第2画像処理部の間に設けられ、前記制御部からの開始信号に基づいて前段の画像処理部から画像データを入力して、画像処理を開始し、画像処理後の画像データを後段の画像処理部に出力するとともに、画像処理が完了すると、画像処理の完了を示す信号を前記制御部に出力する画像処理部
をさらに少なくとも1つ備えることを特徴とする請求項7から請求項12のいずれか一項に記載の画像処理装置。
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