JP5384973B2 - スイッチング電源 - Google Patents
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Description
図1は、本発明が適用できるスイッチング電源の一例である。
図1において、電源入力端子1aと電源入力端子1bとの間に、平滑コンデンサ2が接続され、電源入力端子1aは、入力電源ライン3に接続され、電源入力端子1bは接地されている。また、入力電源ライン3と接地間に、MOS−FET11と、MOS−FET12とが直列に接続されている。
図2は、上述のスイッチング電源回路の電源制御回路7の構成を示すものである。
電源制御回路7は集積回路化されており、図2に示すように、発振器101と、ソフトスタート回路102と、OCP回路103と、電圧検出回路104と、制御回路105とを含んでいる。
図3に示す本発明の実施形態は、上述のスイッチング電源は、スタンバイ時にスイッチング電源をバーストモードで動作させるバースト動作設定回路および、ハイサイド側のスイッチングトランジスタのオン期間の幅と、ローサイド側のスイッチングトランジスタのオン期間の幅とが非対称となるようなスイッチングを行うスイッチング回路として機能し、スタンバイモード時の消費電力の低減を図る。
次に、図2、3を用いて、本実施形態に係るスイッチング電源の動作について説明する。
まず、OCP回路103が、スイッチング用のMOS−FETを流れる電流の位相を検出して、動作モードが通常モードであるか、スタンバイモードであるかを判別する。
その結果、スタンバイモードであると判定した場合には、スイッチ202がオンし、インバータ207の入力がローレベルになると、バーストモードの動作を開始する。バーストモードの動作の開始時には、インバータ207の出力がハイレベルとなり、ANDゲート209の出力がハイレベルになり、MOS−FET230がオンし、Vsenがローレベルとなり、電源制御回路7のゲート出力VGH、VGLが停止する。
2・・・平滑コンデンサ
4・・・トランス
5・・・共振コンデンサ
7・・・電源制御回路
17・・・平滑コンデンサ
20・・・負荷回路
21・・・出力検出回路
22・・・フォトカプラ
101・・・発振器
102・・・ソフトスタート回路
202・・・バーストモード切替スイッチ
207、316・・・インバータ
220、221、311、312・・・コンパレータ
215・・・Dフリップフロップ
243・・・MOS−FET
244・・・抵抗
245・・・抵抗
301 演算増幅器
302から307、315 トランジスタ
313、321、322・・・RSフリップフロップ
314・・・カウンタ
Claims (4)
- 電流共振型のスイッチング電源において、
発振器を連続的に動作させて電源制御を行う通常モードと、前記発振器を間欠的に動作させて電源制御を行うバーストモードとを設定する設定手段と、
前記バーストモードに設定したときに、二次側の出力電圧を検出し、前記二次側の出力電圧が低下すると、スイッチングパルスの発振器の発振動作を開始させ、前記二次側の出力電圧が復帰すると、前記スイッチングパルスの発振器の発振動作を停止させるバースト動作設定手段と、
スイッチングトランジスタに流れる電流の位相を検出して予め任意に設定した基準により、重負荷か軽負荷かを判別する判別手段と、
を備え、
前記スイッチングトランジスタに流れる電流の位相から軽負荷と判別されたときに、前記バーストモードに設定するとともに、ハイサイド側のスイッチングトランジスタのオン期間の幅と、ローサイド側のスイッチングトランジスタのオン期間の幅とが非対称となるようなスイッチングを行うことを特徴とするスイッチング電源。 - 前記判別手段が、発振出力の所定のタイミングで、前記スイッチングトランジスタに流れる電流が正方向か負方向かを検出して、前記スイッチングトランジスタに流れる電流の位相を判別することを特徴とする請求項1に記載のスイッチング電源。
- 前記バースト動作設定手段が、フィードバック電圧を第1の閾値と比較する第1の比較手段と、
前記フィードバック電圧を第2の閾値と比較する第2の比較手段とを備え、
前記二次側の出力電圧が低下して前記フィードバック電圧が前記第1の閾値まで上昇したときに、前記スイッチングパルスの発振器の動作を開始させ、前記二次側の出力電圧が復帰して前記フィードバック電圧が前記第2の閾値まで下降したときに、前記スイッチングパルスの発振器の動作を停止させることを特徴とする請求項1に記載のスイッチング電源。 - 前記バーストモードでスイッチングパルスの発振器の動作を開始させるときに、ソフトスタート時間を通常の起動時より短くすることを特徴とする請求項1に記載のスイッチング電源。
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