JP5263239B2 - 固体撮像素子および撮像装置 - Google Patents
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Description
図1は、一の実施形態での固体撮像素子の構成例を示すブロック図である。一の実施形態での固体撮像素子は、シリコン基板上にCMOS(相補性金属酸化膜半導体)プロセスを使用して形成されたXYアドレス型の固体撮像素子である。一の実施形態の固体撮像素子は、例えば、デジタルスチルカメラやビデオカメラなどの撮像装置に実装される(なお、撮像装置の構成例は後述する)。
非加算読み出しモードで全画素読み出しを行う場合、垂直走査回路13は、読出対象ラインを一番上の行から1行ずつ順次指定してゆく。
次に、第1加算読み出しモードでの固体撮像素子の動作例を説明する。
次に、第2加算読み出しモードでの固体撮像素子の動作例を説明する。なお、第2加算読み出しモードにおいて、上記の第1加算読み出しモードとの重複説明はいずれも省略する。
図16は、他の実施形態における第1信号出力回路15、第2信号出力回路16および加算制御回路17の構成例を示す図である。なお、他の実施形態は一の実施形態の変形例であって、図16は上記の図3に対応する。そのため、他の実施形態の構成について、一の実施形態と共通する構成は重複説明を省略する。
図19は、撮像装置の一例である電子カメラの構成例を示す図である。
上記実施形態の固体撮像素子はベイヤ配列のカラーフィルタの例を説明した。しかし、本発明の固体撮像素子は、ベイヤ配列のカラーフィルタアレイでの加算読み出しに限定されることなく、他の2行2列の4色カラーフィルタアレイ(例えば、マゼンタ、グリーン、シアン及びイエローを用いる補色系カラーフィルタなど)を備える固体撮像素子の加算読み出しに広く応用できる。
Claims (6)
- 入射光を電気信号に変換する複数の画素が行列状に配列され、前記画素から前記電気信号を読み出す第1信号線および第2信号線を含む画素部と、
それぞれが異なる色成分の光を透過させるとともに、2行2列の色配列に従って各画素に配置される複数種類のカラーフィルタと、
前記画素部の読出対象ラインに含まれる一方の色の画素から前記電気信号を加算読み出しする第1信号出力回路と、
前記読出対象ラインに含まれる他方の色の画素から前記電気信号を加算読み出しする第2信号出力回路と、
前記第1信号出力回路および前記第2信号出力回路の間で、前記加算読み出し時に加算する画素のサンプリング位置を前記色配列単位でシフトさせる加算制御回路と、を備え、
前記カラーフィルタの色配列は、奇数番目の読出対象ラインには第1色および第2色が配置され、偶数番目の読出対象ラインには前記第1色および第3色が配置され、前記奇数番目の読出対象ラインの前記第1色と前記偶数番目の読出対象ラインの前記第1色とが交互に配置される色配列であり、
前記第1信号線は、奇数番目の読出対象ラインでの第1色の画素と、偶数番目の読出対象ラインでの第3色の画素とから前記電気信号を読み出し、
前記第2信号線は、奇数番目の読出対象ラインでの第2色の画素と、偶数番目の読出対象ラインでの第1色の画素とから前記電気信号を読み出し、
前記第1信号出力回路は、前記奇数番目の読出対象ラインの読み出し時には前記第1信号線に接続し、前記偶数番目の読出対象ラインの読み出し時には前記第2信号線に接続し、それぞれ前記第1色の信号を読み出すセレクタを含み、
前記第2信号出力回路は、前記奇数番目の読出対象ラインの読み出し時には前記第2信号線に接続して前記第2色の信号を読み出し、前記偶数番目の読出対象ラインの読み出し時には前記第1信号線に接続して前記第3色の信号を読み出すセレクタを含み、
前記加算制御回路は、前記奇数番目の読出対象ラインで加算読み出しをするときと、前記偶数番目の読出対象ラインで加算読み出しをするときとで、前記第1信号出力回路および前記第2信号出力回路で加算読み出しする画素の前記サンプリング位置を前記色配列単位でそれぞれシフトさせる固体撮像素子。 - 請求項1に記載の固体撮像素子において、
前記第1信号出力回路および前記第2信号出力回路は、前記読出対象ラインで加算読み出しする画素を順次指定するシフトレジスタをそれぞれ含み、
前記加算制御回路は、前記第1信号出力回路のシフトレジスタでの読み出し開始位置と、前記第2信号出力回路のシフトレジスタでの読み出し開始位置とをシフトさせる固体撮像素子。 - 請求項2に記載の固体撮像素子において、
前記加算制御回路は、前記読み出し対象ラインが奇数番目または偶数番目のいずれであるかと、前記加算読み出し時の加算画素数とに応じて、前記第1信号出力回路のシフトレジスタと、前記第2信号出力回路のシフトレジスタとにそれぞれ異なるパターンで読出指示信号を与える固体撮像素子。 - 請求項1から請求項3のいずれか1項に記載の固体撮像素子において、
前記加算制御回路は、加算後の画素の重心位置がそれぞれ一致するとともに、加算する画素数が互いに異なる第1加算読み出しモードおよび第2加算読み出しモードを選択可能である固体撮像素子。 - 請求項1から請求項4のいずれか1項に記載の固体撮像素子において、
前記読出対象ラインの一端側に設けられ、前記第1信号出力回路および前記第2信号出力回路で前記加算読み出し時に不足する画素分を補償するダミー画素をさらに備える固体撮像素子。 - 請求項1から請求項5のいずれか1項に記載の固体撮像素子と、
静止画取得時に前記固体撮像素子に全画素読み出しを指示するとともに、動画取得時に前記固体撮像素子に加算読み出しを指示する制御部と、
を備える撮像装置。
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