JP5217037B2 - 共有メモリマルチビデオチャネルディスプレイ装置および方法 - Google Patents
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Description
標準精細(DVD)ビデオレコーダ、標準精細TV(SDTV)、標準精細プレビューディスプレイ、あるいは任意の他の適切なビデオアプリケーションに補助出力を利用しながら、同時にデジタルTVあるいはプロジェクタのようなハイエンドの外部部材270を駆動するのに主要出力信号を利用することができる。ユーザにHDTVディスプレイで番組を視聴させながら、同時に、補助出力信号はユーザにHDTVプログラムを任意の適切なSDTV媒体(例えばDVD)に記録させてよい。
追加して、多数のフィールドライン処理を支援してよいことを理解されたい。
なお、本願明細書には、以下の項目1から項目72が記載されている。
(項目1)
複数のビデオ信号を受信して、上記複数のビデオ信号のうち第1のビデオ信号を選択する、選択回路と、
選択された上記第1のビデオ信号の信号経路中の少なくとも二つのスケーラスロットのうちの一つに第1のスケーラを配置する第1のスケーラ配置モジュールと、を備える、フレームレート変換回路。
(項目2)
上記第1のスケーラは、上記選択された第1のビデオ信号をスケーリングし、スケーリングされた上記第1のビデオ信号を、メモリインタフェースを介してメモリへ書き込む、項目1に記載のフレームレート変換回路。
(項目3)
さらにセレクタを備え、
上記第1のスケーラが、上記選択された第1のビデオ信号を上記セレクタの第1の入力へ出力する、項目2に記載のフレームレート変換回路。
(項目4)
上記第1のスケーラ配置モジュールは、上記選択された第1のビデオ信号の上記信号経路に第2のスケーラを配置し、
上記第2のスケーラは、上記スケーリングされた第1のビデオ信号を、上記メモリインタフェースを介して上記メモリから読み出し、読み出された上記第1のビデオ信号をさらにスケーリングし、さらにスケーリングされた上記第1のビデオ信号を上記セレクタの第2の入力へ供給する、項目3に記載のフレームレート変換回路。
(項目5)
さらに、上記セレクタの上記第1の入力および上記第2の入力のいずれかを出力する、項目4に記載のフレームレート変換回路。
(項目6)
上記第2のスケーラは、上記読み出された第1のビデオ信号を出力する、項目4に記載のフレームレート変換回路。
(項目7)
上記第1のスケーラ配置モジュールは、上記選択された第1のビデオ信号の上記信号経路に、テアレス制御モジュールを配置する、項目2に記載のフレームレート変換回路。
(項目8)
上記複数のビデオ信号から選択された第2のビデオ信号を受信し、上記選択された第2のビデオ信号をスケーリングし、スケーリングされた上記第2のビデオ信号を出力するスケーリング回路をさらに備える、項目1に記載のフレームレート変換回路。
(項目9)
上記第1のスケーラ配置モジュールは、ブランクタイムオプティマイザに、選択されスケーリングされた第1のビデオ信号を出力する、項目1に記載のフレームレート変換回路。
(項目10)
三つのスケーラ配置スロットと、
一つのスケーラと、を備えるスケーラ配置モジュールであって、
上記スケーラを第1のスケーラ配置スロットに配置して、入力ビデオ信号を同期してスケーリングすることと、
上記スケーラを第2のスケーラ配置スロットに配置して、上記入力ビデオ信号をダウンスケーリングして、ダウンスケーリングされた上記ビデオ信号をメモリに書き込むことと、
上記スケーラを第3のスケーラ配置スロットに配置して、上記メモリから読み出されたビデオ信号をアップスケーリングすることと、を選択的に行う、スケーラ配置モジュール。
(項目11)
上記第1のスケーラ配置スロット内の上記スケーラは、上記入力ビデオ信号を出力ビデオ信号にロックする、項目10に記載のスケーラ配置モジュール。
(項目12)
上記スロットのうち少なくとも一つの中にある上記スケーラによりスケーリングされたデータを受信して上記スケーリングされたデータを上記スケーラ配置モジュールから出力する選択回路をさらに備える、項目10に記載のスケーラ配置モジュール。
(項目13)
上記選択回路は、上記スケーラから受信した上記スケーリングされたデータを選択的に出力する、項目12に記載のスケーラ配置モジュール。
(項目14)
書き込みFIFOバッファおよび読み出しFIFOバッファをさらに備え、
上記スロットのうち第1のスロットの中にある上記スケーラは、上記書き込みFIFOバッファを介して上記メモリへ上記スケーリングされたデータを書き込み、上記スロットのうち第2のスロットの中にある上記スケーラは、上記読み出しFIFOバッファを介して上記メモリから上記スケーリングされたデータを読み出す、項目12に記載のスケーラ配置モジュール。
(項目15)
上記選択回路は、上記読み出しFIFOバッファから読み出された上記スケーリングされたデータを受信し、上記スケーラ配置モジュール出力から読み出された上記スケーリングされたデータを出力する、項目14に記載のスケーラ配置モジュール。
(項目16)
二以上のビデオ信号から、メモリアクセス要求を受信する入力と、
各要求の必要帯域幅を決定し、各ビデオ信号要求の上記必要帯域幅に基づきメモリアクセスを配分する回路と、を備えるブランクタイムオプティマイザ。
(項目17)
各要求は、メモリアクセスクロックレートを有し、
上記メモリアクセスは、上記要求の上記メモリアクセスクロックレートとは異なるクロックレートで行われる、項目16に記載のオプティマイザ。
(項目18)
受信された上記要求の各々に対応するデータは、該要求のメモリアクセスクロックレートで、フィールドラインバッファに記憶される、項目17に記載のオプティマイザ。
(項目19)
上記フィールドラインバッファは、上記メモリアクセス要求の各々により共有される、項目18に記載のオプティマイザ。
(項目20)
上記必要帯域幅は、対応する要求のクロックレートに基づいて決定される、項目18に記載のオプティマイザ。
(項目21)
上記対応する要求は、上記フィールドラインバッファから読み出され、上記対応する要求の上記クロックレートとは異なるクロックレートで上記メモリに供給される、項目20に記載のオプティマイザ。
(項目22)
上記回路は、さらに上記アクセス要求の各々が直接上記メモリにアクセスすることを妨げる、項目16に記載のオプティマイザ。
(項目23)
各要求は、フィールドラインの時間間隔部分に対応する、項目16に記載のオプティマイザ。
(項目24)
上記回路はさらに、上記ビデオ信号要求のうちの一つに関連付けられたメモリ操作を、上記要求されたメモリ操作に対応する時間間隔部分より大きい時間間隔部分で行うことにより、上記メモリアクセス帯域幅を配分する、項目23に記載のオプティマイザ。
(項目25)
フレームレートを変換する方法であって、
複数のビデオ信号を受信することと、
上記複数のビデオ信号のうち第1のビデオ信号を選択することと、
選択された上記第1のビデオ信号の信号経路中の少なくとも二つのスケーラスロットのうちの一つに第1のスケーラを配置することと、
選択された上記第1のビデオ信号をスケーリングすることと、を備える、方法。
(項目26)
スケーリングされた上記第1のビデオ信号を、メモリインタフェースを介してメモリへ書き込むことをさらに備える、項目25に記載の方法。
(項目27)
上記スケーリングされた第1のビデオ信号を、セレクタの第1の入力へ供給することをさらに備える、項目26に記載の方法。
(項目28)
選択された上記第1のビデオ信号の上記信号経路に、第2のスケーラを配置することと、
上記スケーリングされた第1のビデオ信号を、上記メモリインタフェースを介して上記メモリから読み出すことと、
読み出された上記第1のビデオ信号をさらにスケーリングすることと、
さらにスケーリングされた上記第1のビデオ信号を上記セレクタの第2の入力へ供給することと、をさらに備える項目27に記載の方法。
(項目29)
上記セレクタの上記第1の入力および上記第2の入力のいずれかを出力することをさらに備える、項目28に記載の方法。
(項目30)
上記読み出された第1のビデオ信号を出力することをさらに備える、項目28に記載の方法。
(項目31)
上記選択された第1のビデオ信号の上記信号経路に、テアレス制御モジュールを配置することをさらに備える、項目26に記載の方法。
(項目32)
上記複数のビデオ信号から第2のビデオ信号を選択し、選択された上記第2のビデオ信号をスケーリングし、スケーリングされた上記第2のビデオ信号を出力することをさらに備える、項目25に記載の方法。
(項目33)
上記選択されスケーリングされた第1のビデオ信号をブランクタイムオプティマイザに出力する、項目25に記載の方法。
(項目34)
スケーラ配置モジュール内の三つのスケーラ配置スロットのうちの一つにスケーラを選択的に配置する方法であって、
入力ビデオ信号を同期してスケーリングすべく、上記スケーラを第1のスケーラ配置スロットに選択的に配置することと、
上記スケーラを第2のスケーラ配置スロットに選択的に配置して、上記入力ビデオ信号をダウンスケーリングして、ダウンスケーリングされた上記ビデオ信号をメモリに書き込むことと、
上記スケーラを第3のスケーラ配置スロットに選択的に配置して、上記メモリから読み出されたビデオ信号をアップスケーリングすることと、を備える、方法。
(項目35)
上記スケーラを第1のスケーラ配置スロットに選択的に配置することにより、上記出力ビデオ信号を入力ビデオ信号にロックする、項目34に記載の方法。
(項目36)
上記スケーラ配置モジュールから、上記第1のスケーラ配置スロットに配置されている第1のスケーラによりスケーリングされたデータと、上記第2のスケーラ配置スロットに配置されている第2のスケーラによりスケーリングされたデータとを、出力として選択的に出力することをさらに備える、項目34に記載の方法。
(項目37)
上記第1のスケーラが供給した上記スケーリングされたデータを選択し、上記第2のスケーラが供給した上記スケーリングされたデータを選択することをさらに備える、項目36に記載の方法。
(項目38)
上記第1のスケーラが供給した上記スケーリングされたデータを上記メモリへの書き込み用にバッファリングし、上記第2のスケーラが供給した上記スケーリングされたデータを上記メモリからの読み出し用にバッファリングすることをさらに備える、項目36に記載の方法。
(項目39)
上記選択することは、バッファリングされた上記スケーリングされたデータを、上記出力として上記スケーラ配置モジュールから選択することをさらに含む、項目38に記載の方法。
(項目40)
二以上のビデオ信号間でメモリアクセスを共有させる方法であって、
上記二以上のビデオ信号の各々からメモリアクセス要求を受信することと、
上記要求に応じて、上記ビデオ信号が各々有する必要帯域幅を決定することと、
上記ビデオ信号が各々有する上記必要帯域幅に基づいて上記メモリアクセスを配分することと、を備える方法。
(項目41)
各要求はクロックレートを有し、
上記メモリアクセスは、上記要求の上記クロックレートとは異なるクロックレートで行われる、項目40に記載の方法。
(項目42)
上記受信された要求の各々に対応するデータを、該要求のクロックレートでフィールドラインバッファに記憶することをさらに備える、項目41に記載の方法。
(項目43)
上記フィールドラインバッファを上記要求の各々により共有させることをさらに備える、項目42に記載の方法。
(項目44)
上記必要帯域幅は、上記要求のクロックレートに基づいて決定される、項目42に記載の方法。
(項目45)
上記フィールドラインバッファから要求を読み出し、読み出した上記要求を上記メモリに、上記読み出した要求のクロックレートとは異なるクロックレートで供給することをさらに備える、項目44に記載の方法。
(項目46)
各要求が直接メモリアクセスすることを妨げることをさらに備える、項目40に記載の方法。
(項目47)
各要求は、フィールドラインの時間間隔部分に対応する、項目40に記載の方法。
(項目48)
上記ビデオ信号要求のうちの一つに関連付けられたメモリ操作を、要求された上記メモリ操作に対応する時間間隔部分より大きい時間間隔部分で行うことにより、上記メモリアクセスを配分することをさらに備える、項目47に記載の方法。
(項目49)
フレームレート変換を行う装置であって、
複数のビデオ信号を受信する手段と、
上記複数のビデオ信号のうち第1のビデオ信号を選択する手段と、
選択された上記第1のビデオ信号の信号経路中の少なくとも二つのスケーラスロットのうちの一つに第1のスケーラ手段を配置する手段と、
選択された上記第1のビデオ信号をスケーリングする手段と、を備える、装置。
(項目50)
スケーリングされた上記第1のビデオ信号を、メモリインタフェース手段を介してメモリ手段へ書き込む手段をさらに備える、項目49に記載の装置。
(項目51)
上記スケーリングされた第1のビデオ信号を、セレクタ手段の第1の入力へ供給する手段をさらに備える、項目50に記載の装置。
(項目52)
選択された上記第1のビデオ信号の上記信号経路に、第2のスケーラ手段を配置する手段と、
上記スケーリングされた第1のビデオ信号を、メモリインタフェース手段を介して上記メモリ手段から読み出す手段と、
読み出された上記第1のビデオ信号をさらにスケーリングする手段と、
さらにスケーリングされた上記第1のビデオ信号を上記セレクタ手段の第2の入力へ供給する手段と、をさらに備える、項目51に記載の装置。
(項目53)
上記セレクタ手段の上記第1の入力および上記第2の入力のいずれかを出力する手段をさらに備える、項目52に記載の装置。
(項目54)
上記読み出された上記第1のビデオ信号を出力する手段をさらに備える、項目52に記載の装置。
(項目55)
上記選択された第1のビデオ信号の上記信号経路に、テアレス制御モジュール手段を配置する手段をさらに備える、項目50に記載の装置。
(項目56)
上記複数のビデオ信号から第2のビデオ信号を選択する手段と、
選択された上記第2のビデオ信号をスケーリングする手段と、
スケーリングされた上記第2のビデオ信号を出力する手段と、をさらに備える、項目49に記載の装置。
(項目57)
上記選択されスケーリングされた上記第1のビデオ信号をブランクタイムオプティマイザに供給する手段をさらに備える、項目49に記載の装置。
(項目58)
スケーラ配置モジュール手段内の三つのスケーラ配置スロット手段のうちの一つにスケーラ手段を選択的に配置する装置であって、
入力ビデオ信号を同期してスケーリングすべく、上記スケーラ手段を第1のスケーラ配置スロットに選択的に配置する手段と、
上記スケーラ手段を第2のスケーラ配置スロットに選択的に配置して、上記入力ビデオ信号をダウンスケーリングして、ダウンスケーリングされた上記ビデオ信号をメモリ手段に書き込む手段と、
上記スケーラ手段を第3のスケーラ配置スロットに選択的に配置して、上記メモリ手段から読み出されたビデオ信号をアップスケーリングする手段と、を備える、装置。
(項目59)
上記第1のスケーラ配置スロットで出力ビデオ信号に上記入力ビデオ信号をロックする手段をさらに備える、項目58に記載の装置。
(項目60)
上記スケーラ配置モジュール手段から、上記第1のスケーラスロットに配置されている第1のスケーラによりスケーリングされたデータと、上記第2のスケーラスロットに配置されている第2のスケーラによりスケーリングされたデータとを、出力として選択的に出力する手段をさらに備える、項目58に記載の装置。
(項目61)
上記第1のスケーラが供給した上記スケーリングされたデータを選択し、上記第2のスケーラが供給した上記スケーリングされたデータを選択する手段をさらに備える、項目60に記載の装置。
(項目62)
スケーリングされたデータを上記メモリ手段への書き込み用にバッファリングする手段と、上記メモリ手段から読み出されたデータをバッファリングする手段とをさらに備える、項目60に記載の装置。
(項目63)
上記選択する手段は、バッファリングされた上記スケーリングされたデータを、上記出力として上記スケーラ配置モジュール手段から選択する手段をさらに含む、項目62に記載の装置。
(項目64)
二以上のビデオ信号間でメモリ手段へのアクセスを共有させる装置であって、
上記二以上のビデオ信号の各々から上記メモリ手段へのアクセス要求を受信する手段と、
上記要求に応じて、上記ビデオ信号が各々有する必要帯域幅を決定する手段と、
上記ビデオ信号が各々有する上記必要帯域幅に基づいて上記メモリ手段へのアクセスを配分する手段と、を備える装置。
(項目65)
各要求はクロックレートを有し、
上記メモリアクセスは、上記要求の上記クロックレートとは異なるクロックレートで行われる、項目64に記載の装置。
(項目66)
上記要求の各々に対応するデータを、該要求のクロックレートでフィールドラインバッファに記憶する手段をさらに備える、項目65に記載の装置。
(項目67)
上記要求の各々をフィールドラインバッファに記憶する手段をさらに備える、項目66に記載の装置。
(項目68)
上記必要帯域幅は、上記要求のクロックレートに基づいて決定される、項目66に記載の装置。
(項目69)
上記フィールドラインバッファ手段から要求を読み出す手段と、読み出した上記要求を上記メモリ手段に、上記読み出した要求のクロックレートとは異なるクロックレートで供給する手段とをさらに備える、項目68に記載の装置。
(項目70)
各要求が直接上記メモリ手段にアクセスすることを妨げる手段をさらに備える、項目64に記載の装置。
(項目71)
各要求は、フィールドラインの時間間隔部分に対応する、項目64に記載の装置。
(項目72)
上記ビデオ信号要求のうちの一つに関連付けられたメモリ操作を、要求された上記メモリ操作に対応する時間間隔部分より大きい時間間隔部分で行う手段により、上記メモリアクセスを配分する手段をさらに備える、項目71に記載の装置。
Claims (16)
- 二以上のビデオチャネルから、メモリアクセスの要求を受信する入力と、
受信された前記要求のそれぞれに対応するデータを、共有されたフィールドラインバッファに記憶し、それぞれの要求の必要帯域幅を決定し、それぞれの要求の前記必要帯域幅に基づきメモリアクセスを配分する回路と、
を備え、
前記メモリアクセスが、前記共有されたフィールドラインバッファを介して開始され、
前記要求のそれぞれは、前記要求に応じたデータアクセスクロックレートを有し、
前記メモリアクセスは、前記要求の前記データアクセスクロックレートとは異なるクロックレートで行われ、
受信された前記要求のそれぞれに対応するデータは、前記要求の前記データアクセスクロックレートで、前記共有されたフィールドラインバッファに記憶される、
ブランクタイムオプティマイザ。 - 前記メモリアクセスは、前記要求の前記データアクセスクロックレートよりも遅いクロックレートで行われる、
請求項1に記載のブランクタイムオプティマイザ。 - 前記回路は、さらに、前記共有されたフィールドラインバッファを用いて前記二以上のビデオチャネルからの信号をオーバレイする、
請求項1又は請求項2に記載のブランクタイムオプティマイザ。 - 前記それぞれの要求の前記必要帯域幅は、対応する要求の前記データアクセスクロックレートに基づいて決定される、
請求項1から請求項3までの何れか一項に記載のブランクタイムオプティマイザ。 - 前記対応する要求は、前記共有されたフィールドラインバッファから読み出され、前記対応する要求の前記データアクセスクロックレートとは異なるクロックレートで前記メモリに供給される、
請求項4に記載のブランクタイムオプティマイザ。 - 前記回路は、さらに、前記要求の各々が前記メモリに直接アクセスすることを妨げる、
請求項1から請求項5までの何れか一項に記載のブランクタイムオプティマイザ。 - 各要求は、フィールドラインの時間間隔部分に対応する、
請求項1から請求項6までの何れか一項に記載のブランクタイムオプティマイザ。 - 前記回路はさらに、前記要求のうちの一つに関連付けられたメモリ操作を、前記要求されたメモリ操作に対応する時間間隔部分より大きい時間間隔部分で行うことにより、メモリアクセスを配分する、
請求項7に記載のブランクタイムオプティマイザ。 - 二以上のビデオチャネル間でメモリアクセスを共有させる方法であって、
前記二以上のビデオチャネルの各々からメモリアクセスの要求を受信する段階と、
受信された前記要求のそれぞれに対応するデータを、共有されたフィールドラインバッファに記憶する段階と、
前記受信された要求のそれぞれの必要帯域幅を決定する段階と、
前記受信された要求のそれぞれの前記必要帯域幅に基づいて前記メモリアクセスを配分する段階と、
を備え、
前記メモリアクセスが、前記共有されたフィールドラインバッファを介して開始され、
前記要求のそれぞれは、前記要求に応じたデータアクセスクロックレートを有し、
前記メモリアクセスは、前記要求の前記データアクセスクロックレートとは異なるクロックレートで行われ、
受信された前記要求のそれぞれに対応するデータは、前記要求の前記データアクセスクロックレートで、前記共有されたフィールドラインバッファに記憶される、
方法。 - 前記メモリアクセスは、前記要求の前記データアクセスクロックレートよりも遅いクロックレートで行われ、
請求項9に記載の方法。 - 前記共有されたフィールドラインバッファを用いて前記二以上のビデオ信号をオーバレイする段階をさらに備える、
請求項9又は請求項10に記載の方法。 - 前記それぞれの要求の前記必要帯域幅は、前記要求の前記データアクセスクロックレートに基づいて決定される、
請求項9から請求項11までの何れか一項に記載の方法。 - 前記共有されたフィールドラインバッファから要求を読み出し、読み出された前記要求を前記メモリに、前記読み出された要求の前記データアクセスクロックレートとは異なるクロックレートで供給する段階をさらに備える、
請求項12に記載の方法。 - 各要求が直接メモリアクセスすることを妨げる段階をさらに備える、
請求項9から請求項13までの何れか一項に記載の方法。 - 各要求は、フィールドラインの時間間隔部分に対応する、
請求項9から請求項14までの何れか一項に記載の方法。 - 前記要求のうちの一つに関連付けられたメモリ操作を、要求された前記メモリ操作に対応する時間間隔部分より大きい時間間隔部分で行うことにより、前記メモリアクセスを配分する段階をさらに備える、
請求項15に記載の方法。
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