JP5181960B2 - シリーズレギュレータおよび電源制御用半導体集積回路 - Google Patents
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Description
CMP1 過電圧監視用のコンパレータ(第1判定回路)
CMP2 低電圧監視用のコンパレータ(第3判定回路)
CMP3 オン/オフ制御信号監視用のコンパレータ(第2判定回路)
Q1 制御用トランジスタ
Claims (6)
- 入力端子と出力端子との間に接続された制御用トランジスタと、
前記制御用トランジスタを駆動制御する制御回路と、
所定の外部端子の電圧を、第1の判定レベルを基準にして監視して入力電圧の過電圧状態を判別する第1判定回路と、
前記所定の外部端子の電圧を、前記第1の判定レベルよりも低い第2の判定レベルを基準にして監視して外部制御信号の状態を判別する第2判定回路と、
を備え、前記第1判定回路の出力に基づいて前記制御用トランジスタをオフ状態にさせ、前記第2判定回路の出力に基づいて前記制御回路の少なくとも一部の動作を停止させるように構成されていることを特徴とする電源制御用半導体集積回路。 - 前記制御回路は、出力電圧を分圧した電圧と所定の参照電圧との電位差に応じた電圧を出力する誤差アンプを備え、前記第2判定回路の出力に基づいて前記誤差アンプの動作を停止させるように構成されていることを特徴とする請求項1に記載の電源制御用半導体集積回路。
- 出力電圧を分圧した電圧を受ける外部端子を備えることを特徴とする請求項2に記載の電源制御用半導体集積回路。
- 前記所定の外部端子の電圧を、前記第1の判定レベルと前記第2の判定レベルの中間の第3の判定レベルを基準にして監視して入力電圧の低電圧状態を判別する第3判定回路を備え、前記第3判定回路の出力に基づいて前記制御用トランジスタをオフ状態にさせるように構成されていることを特徴とする請求項1〜3のいずれかに記載の電源制御用半導体集積回路。
- 請求項1〜4のいずれかに記載の電源制御用半導体集積回路と、前記入力端子に印加される入力電圧を電源電圧とし前記外部制御信号を入力とする論理ゲート回路と、該論理ゲート回路の出力端子と接地点との間に接続され前記入力電圧を分圧する分圧手段と、を備え、前記分圧手段より分圧された電圧が前記所定の外部端子に外部より印加されていることを特徴とするシリーズレギュレータ。
- 請求項1〜4のいずれかに記載の電源制御用半導体集積回路と、該半導体集積回路の外部において前記入力端子と接地点との間に接続され入力電圧を分圧する分圧手段と、前記半導体集積回路の外部において前記所定の外部端子と接地点との間に接続されゲート端子もしくはベース端子に前記外部制御信号が入力されるスイッチ素子と、を備え、前記分圧手段より分圧された電圧が前記所定の外部端子に印加されていることを特徴とするシリーズレギュレータ。
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