JP5142685B2 - メモリシステム - Google Patents
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Description
Claims (5)
- 複数のデータブロックと、前記複数のデータブロックの管理情報を格納する管理ブロックとを含み、各ブロックはデータ消去の単位でありかつ複数のページから構成される、不揮発性メモリと、
前記複数のページにシーケンシャルにデータを書き込むコントローラと、
を具備し、
前記コントローラは、
起動時に電源遮断による前記不揮発性メモリへの影響を確認し、
前記管理ブロック内に電源遮断による影響がない場合、前記管理ブロックのうち書き込み済みの最終ページの次の第1のページにデータを追記し、
前記管理ブロック内に電源遮断による影響がある場合、前記最終ページから予め設定されたページ数だけ離れた第2のページにデータを追記する、
ことを特徴とするメモリシステム。 - 前記コントローラは、前記第1のページのデータを確認し、前記第1のページが消去状態でない場合に、電源遮断による影響があると判断することを特徴とする請求項1に記載のメモリシステム。
- 前記コントローラは、電源遮断による影響がある場合、前記第1のページを無効化することを特徴とする請求項1又は2に記載のメモリシステム。
- 前記複数のページの各々は、無効化されたか否かを示すフラグを格納するビットを含み、
前記コントローラは、ページを無効化する場合に、前記フラグをセットすることを特徴とする請求項3に記載のメモリシステム。 - 前記管理ブロックのデータに対してエラーの有無をチェックするECC回路をさらに具備し、
前記最終ページは、前記管理ブロック内のエラーがないページのうち最上位のページであることを特徴とする請求項1乃至4のいずれかに記載のメモリシステム。
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