JP5126241B2 - 過電圧保護回路、及び過電圧保護方法 - Google Patents
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Description
図2は、本実施形態に係る過電圧保護回路1が適用される電気回路を示す概略図である。この電気回路は、過電圧保護回路1に加え、負荷2、高電圧入力端3(第1電圧入力端)、及び低電圧入力端4(第2電圧入力端)を有している。高電圧入力端3は、高電圧入力ライン20(第1電圧入力ライン)を介して負荷2に接続されており、負荷2に対して高電圧を供給する。低電圧入力端4は、低電圧入力ライン21(第2電圧入力ライン)を介して負荷2に接続されており、負荷2に対して低電圧を供給する。
続いて、第2の実施形態について説明する。図3は、本実施形態に係る過電圧保護回路1を示す構成図である。本実施形態では、制御回路7の具体的構成について説明する。制御回路7の構成以外については、第1の実施形態と同様とすることができるので、詳細な説明は省略する。尚、スイッチ回路8は、制御回路7からロウレベル電圧を取得した場合に、高電圧入力ライン20とサイリスタ6のアノードとを導通させ、ハイレベル電圧を取得した場合に、高電圧入力ライン20とサイリスタ6のアノードとの間を遮断するように構成されている。
続いて、第3の実施形態について説明する。図4は、本実施形態に係る過電圧保護回路1を示す構成図である。本実施形態では、スイッチ回路8の具体的構成について説明する。図4に示されるように、スイッチ回路8は、トランジスタ25、及びPチャネル型MOSFET24を備えている。
続いて、第4の実施形態について説明する。図5は、本実施形態に係る過電圧保護回路1を示す構成図である。本実施形態では、第3の実施形態に対して、スイッチ回路8の具体的構成が変更されている。その他の点については、第3の実施形態と同様の構成を採用することができるので、詳細な説明は省略する。
2 負荷
3 高電圧入力端
4 低電圧入力端
5 過電圧検出回路
6 サイリスタ
7 制御回路
8 スイッチ回路
9 ツェナーダイオード
10 抵抗素子
11 CR積分回路
12 コンパレータ
13 抵抗素子
14 抵抗素子
15 抵抗素子
16 抵抗素子
17 抵抗素子
18 ツェナーダイオード
19 容量素子
20 高電圧入力ライン
21 低電圧入力ライン
23 ヒューズ
24 FET
25 トランジスタ
26 抵抗素子
27 抵抗素子
28 抵抗素子
29 抵抗素子
30 抵抗素子
31 フォトダイオード
32 スイッチ素子
33 ハイレベル電圧供給端子
Claims (5)
- 第1電圧供給端と負荷とを接続する第1入力ラインに設けられ、所定値以上の電流が流れると切断される、過電流遮断回路と、
前記第1入力ラインと、第2電圧供給端と前記負荷とを接続する第2入力ラインとの間に介装される、サイリスタと、
前記サイリスタと前記第1入力ラインとの間に介装され、前記サイリスタと前記第1入力ラインとを導通させるか否かを切り替える、スイッチ回路と、
前記第1入力ラインと前記第2入力ラインとの間の電圧差が予め設定された制限電圧以上になった場合に、前記第1入力ラインを前記サイリスタのゲートと導通させる、過電圧検出回路と、
前記スイッチ回路の動作を制御する、制御回路と、
を具備し、
前記制御手段は、前記サイリスタのゲートにゲートトリガ以上の電圧が印加された期間が、予め設定された制限期間を超えた場合に、前記サイリスタと前記第1入力ラインとを導通させるように、前記スイッチ回路の動作を制御する
過電圧保護回路。 - 請求項1に記載された過電圧保護回路であって、
前記制御回路は、
入力端が前記サイリスタのゲートに接続された、CR積分回路と、
前記CR積分回路の出力端から出力されるCR積分回路出力電圧を予め定められた基準電圧と比較し、比較結果を示す信号をスイッチ回路制御信号として前記スイッチ回路に供給する、コンパレータとを備え、
前記コンパレータは、前記CR積分回路出力電圧が前記基準電圧を超えた場合に、前記スイッチ回路がオン状態になるような信号を、前記スイッチ回路制御信号として供給する
過電圧保護回路。 - 請求項1又は2に記載された過電圧保護回路であって、
前記スイッチ回路は、電界効果型トランジスタを含んでいる
過電圧保護回路。 - 請求項1又は2に記載された過電圧保護回路であって、
前記スイッチ回路は、フォトMOSリレ−回路を有している
過電圧保護回路。 - 第1電圧供給端と負荷とを接続する第1入力ラインと、第2電圧供給端と前記負荷とを接続する第2入力ラインとの間の電圧差が、予め設定された制限電圧以上であるか否かを検出するステップと、
前記電圧差が前記制限電圧以上である場合に、前記第1入力ラインと、第2電圧供給端と負荷とを接続する第2入力ラインにカソードで接続されるサイリスタのゲートとを、導通させるステップと、
前記サイリスタのゲートに前記制限電圧以上の電圧が印加された期間が、予め設定された制限期間を超えた場合に、前記サイリスタのアノードと前記第1入力ラインとを導通させるステップと、
を具備する
過電圧保護方法。
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