JP5120383B2 - 電子チューナおよびこれを用いた高周波受信装置 - Google Patents
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Description
以下、本実施の形態1における高周波受信装置について図面を用いて以下説明する。
以下、本実施の形態2における高周波受信装置について図面を用いて以下説明する。
以下、実施の形態3における高周波受信装置201について図面を用いて説明する。
以下、実施の形態4における高周波受信装置401について図面を用いて説明する。
以下、本実施の形態5における高周波受信装置について図面を用いて説明する。
9,43,113,213 出力端子
11 出力端子
17 混合器
19 合成器
25 混合器
27 合成器
33 発振器
35 移相器
45 DCオフセット検出回路
46 DCオフセット判定回路
47 DCオフセット補正回路
101,141,201,401,501 高周波受信装置
102,103 電子チューナ
105,202,403 復調部
106,147 DCオフセット制御ループ
106a 電源入力端子
109,210 受信品質判定回路
111,145 駆動回路
Claims (26)
- デジタル放送信号を受信する電子チューナと、
前記電子チューナからの出力信号を復調する復調部と、を備えた
高周波受信装置であって、
前記電子チューナは、
前記デジタル放送信号が入力される入力端子と、
前記デジタル放送信号が一方の入力に供給されるとともに、他方の入力に発振器の発振信号が移相器を介して供給されて互いに位相が異なる出力信号を出力するダイレクトコンバージョン方式の第1および第2の混合器と、
前記第1および第2の混合器の出力がそれぞれ供給される第1および第2の出力端子と、
前記第1および第2の混合器の出力信号に含まれる第1および第2のDCオフセット電圧を検出するとともに、前記第1および第2のDCオフセット電圧をそれぞれ打ち消すための第1および第2のキャンセル信号をそれぞれ出力するDCオフセット制御ループと、
前記第1の混合器と前記第1の出力端子の間に接続されるとともに前記第1のキャンセル信号が入力される第1の合成器と、
前記第2の混合器と前記第2の出力端子の間に接続されるとともに前記第2のキャンセル信号が入力される第2の合成器と、を備え、
前記復調部は、
受信信号の品質を検出する受信品質検出回路と、
前記受信品質検出回路から出力される検出信号を第1の基準値と比較し判定する受信品質判定回路と、
前記受信品質判定回路から出力される判定信号が入力される駆動回路と、を備え、
前記受信品質判定回路において受信信号の品質が良好と判定された場合に、前記駆動回路により前記DCオフセット制御ループへの電源を停止することを特徴とする
高周波受信装置。 - 前記DCオフセット制御ループは、
前記第1および第2の混合器から出力される信号が供給されるとともに前記第1および第2のDCオフセット電圧をそれぞれ検出するDCオフセット検出回路と、
前記DCオフセット検出回路から出力される前記第1および第2のDCオフセット電圧を第2の基準値と比較判定するDCオフセット判定回路と、
前記DCオフセット判定回路の判定に基づいて前記第1および第2のDCオフセット電圧をそれぞれ打ち消すための第1および第2のキャンセル信号をそれぞれ出力するDCオフセット補正回路と、を備えた
請求項1に記載の高周波受信装置。 - 前記駆動回路が前記DCオフセット制御ループへの電源を停止する場合に、前記DCオフセット制御ループを構成する前記DCオフセット検出回路、前記DCオフセット判定回路、前記DCオフセット補正回路のうち少なくともひとつに対して電源を停止する
請求項2に記載の高周波受信装置。 - 前記受信品質判定回路には、前記第1の基準値を入力するための外部端子が設けられた
請求項1に記載の高周波受信装置。 - 前記受信品質判定回路の前記第1の基準値として、ビットエラーレートまたはC/Nが用いられる
請求項1に記載の高周波受信装置。 - 前記受信品質判定回路の前記第1の基準値として、パケットエラーレートが用いられる
請求項1に記載の高周波受信装置。 - 前記DCオフセット制御ループへの電源を供給する場合に、
前記受信品質判定回路への受信品質信号としてパケットエラーレート、ビットエラーレート、C/Nのうち少なくとも1つが用いられる
請求項1に記載の高周波受信装置。 - 前記DCオフセット検出回路、前記DCオフセット判定回路、前記DCオフセット補正回路のうち少なくともひとつに対して電源を停止する場合に、
前記受信品質判定回路への受信品質信号としてパケットエラーレートが用いられる
請求項2に記載の高周波受信装置。 - 前記DCオフセット判定回路において受信信号を判定する場合に、12セグメント受信時の前記第2の基準値は、1セグメント受信時の前記第2の基準値より大きく設定する
請求項2に記載の高周波受信装置。 - デジタル放送信号のうちの1セグメント受信時には、
前記DCオフセット検出回路、前記DCオフセット判定回路、前記DCオフセット補正回路に対して電源を供給し、
デジタル放送信号のうちの12セグメント受信時には、
前記DCオフセット検出回路、前記DCオフセット判定回路、前記DCオフセット補正回路のうちの少なくともひとつに対して電源を停止する
請求項2に記載の高周波受信装置。 - デジタル放送信号のうちの1セグメント受信の場合に、
前記第1および第2の混合器は、発振器の周波数が前記1セグメントの中心周波数より前記1セグメントの帯域の1/2以上離して設定されることにより、ヘテロダイン方式として用いられ、前記DCオフセット検出回路、前記DCオフセット判定回路、前記DCオフセット補正回路のうち少なくともひとつに対して電源を停止する
請求項2に記載の高周波受信装置。 - デジタル放送信号を受信する電子チューナと、
前記電子チューナからの出力信号を復調する復調部と、を備えた
高周波受信装置であって、
前記電子チューナは、
前記デジタル放送信号が入力される入力端子と、
前記デジタル放送信号が一方の入力に供給されるとともに、他方の入力に発振器の発振信号が移相器を介して供給されて互いに位相が異なる出力信号を出力するダイレクトコンバージョン方式の第1および第2の混合器と、
前記第1および第2の混合器の出力がそれぞれ供給される第1および第2の出力端子と、
前記第1および第2の混合器の出力信号に含まれる第1および第2のDCオフセット電圧を検出するとともに、前記第1および第2のDCオフセット電圧をそれぞれ打ち消すための第1および第2のキャンセル信号をそれぞれ出力するDCオフセット制御ループと、
前記第1の混合器と前記第1の出力端子の間に接続されるとともに前記第1のキャンセル信号が入力される第1の合成器と、
前記第2の混合器と前記第2の出力端子の間に接続されるとともに前記第2のキャンセル信号が入力される第2の合成器と、を備え、
前記復調部は、
受信信号の品質を検出する受信品質検出回路と、
移動によるフェージング周波数を検出する第1のフェージング検出回路と、
前記受信品質検出回路からの受信品質信号と前記第1のフェージング検出回路からのフェージング周波数とが入力される受信品質判定回路と、
前記受信品質判定回路から出力される受信品質判定信号が入力されるとともに前記DCオフセット制御ループへの電源を供給あるいは停止する駆動回路と、を備え、
前記第1のフェージング検出回路からのフェージング周波数に応じて前記受信品質判定回路の品質判定基準値を設定し、前記受信品質判定回路が受信信号の品質を良好と判定した場合に、前記駆動回路により前記DCオフセット制御ループへの電源を停止することを特徴とする
高周波受信装置。 - 前記復調部は、
入力端子から入力されたアナログ信号をデジタル信号に変換するA/Dコンバータと、
入力信号を高速フーリエ変換する高速フーリエ変換器と、
信号波形を元の信号に戻す波形等価回路と、
信号を検波する検波回路が接続され、前記高速フーリエ変換器の出力が入力されるとともにスキャタードパイロット信号を抽出するSP抽出回路と、
前記SP抽出回路からのSP信号を一方の入力に接続し他方の入力に基準パイロット信号を接続する比較回路と、を備え、
前記比較回路から出力される前記SP信号と前記基準パイロット信号とを比較することによって得られる波形等価信号が、前記波形等価回路の他方の入力に接続され、
前記波形等価信号が前記第1のフェージング検出回路に入力される
請求項12に記載の高周波受信装置。 - 前記高速フーリエ変換器の出力信号が入力されるとともに少なくとも2本のサブキャリアの時間による振幅の変化によりフェージング周波数を検出する第2のフェージング検出回路を第1のフェージング検出回路に代わって設け、
前記第2のフェージング検出回路の入力には、前記波形等価回路に入力される波形等価信号の代わりに前記高速フーリエ変換器の出力信号が入力される
請求項13に記載の高周波受信装置。 - 前記高速フーリエ変換器の出力信号が入力されるとともに少なくとも2本のサブキャリアの時間によるC/Nの変化によりフェージング周波数を検出する第3のフェージング検出回路が、前記第2のフェージング検出回路に代わって設けられる
請求項14に記載の高周波受信装置。 - 前記DCオフセット制御ループは、
前記第1および第2の混合器から出力される信号が供給されるとともに前記第1および第2のDCオフセット電圧をそれぞれ検出するDCオフセット検出回路と、
前記DCオフセット検出回路から出力される前記第1および第2のDCオフセット電圧をオフセット基準値と比較判定するDCオフセット判定回路と、
前記DCオフセット判定回路の判定に基づいて前記第1および第2のDCオフセット電圧をそれぞれ打ち消すための第1および第2のキャンセル信号をそれぞれ出力するDCオフセット補正回路と、を備えた
請求項12に記載の高周波受信装置。 - 前記駆動回路が前記DCオフセット制御ループへの電源を停止する場合に、
前記DCオフセット制御ループを構成する前記DCオフセット検出回路、前記DCオフセット判定回路、前記DCオフセット補正回路のうち少なくともひとつに対して電源を停止する
請求項16に記載の高周波受信装置。 - 前記受信品質判定回路には、前記品質判定基準値を入力するための外部端子が設けられた
請求項12に記載の高周波受信装置。 - 前記DCオフセット制御ループへの電源を供給する場合に、前記受信品質判定回路への前記受信品質信号としてパケットエラーレート、ビットエラーレート、C/Nのうち少なくとも1つが用いられる
請求項12に記載の高周波受信装置。 - 前記DCオフセット検出回路、前記DCオフセット判定回路、前記DCオフセット補正回路のうち少なくともひとつに対して電源を停止する場合に、
前記受信品質判定回路への前記受信品質信号としてパケットエラーレートが用いられる
請求項16に記載の高周波受信装置。 - 入力端子と、
前記入力端子からのデジタル放送信号が一方の入力に供給されるとともに、他方の入力に局部発振器の発振信号が移相器を介して供給されて互いに位相が異なる出力信号を出力するダイレクトコンバージョン方式の第1および第2の混合器と、
前記第1および第2の混合器の出力がそれぞれ供給される第1および第2の出力端子と、
前記第1および第2の混合器の出力信号が供給されるとともにDCオフセット電圧を検出するDCオフセット検出回路と、
前記DCオフセット検出回路から出力される第1および第2のDCオフセット電圧を基準値と比較判定するDCオフセット判定回路と、
前記DCオフセット判定回路の判定に基づいて前記第1および第2のDCオフセット電圧をそれぞれ打ち消すための第1および第2のキャンセル信号をそれぞれ出力するDCオフセット補正回路と、
前記第1の混合器と前記第1の出力端子の間に接続されるとともに前記第1のキャンセル信号が入力される第1の合成器と、
前記第2の混合器と前記第2の出力端子の間に接続されるとともに前記第2のキャンセル信号が入力される第2の合成器と、を有し、
前記DCオフセット判定回路から出力される第1の判定信号が入力される駆動回路を、さらに備え、
前記駆動回路から出力される第1の駆動電圧が前記DCオフセット補正回路に接続され、
前記DCオフセット判定回路において、前記第1および第2のDCオフセット電圧が前記基準値より小さい場合に、前記駆動回路により前記DCオフセット補正回路への電源を停止することを特徴とする
電子チューナ。 - 前記DCオフセット判定回路には、基準値を入力するための第1の外部端子が設けられた
請求項21に記載の電子チューナ。 - デジタル放送信号のうちの12セグメント受信時に、
前記基準値は、1セグメント受信時の基準値より大きく設定する
請求項22に記載の電子チューナ。 - デジタル放送信号のうちの1セグメント受信時には、
前記DCオフセット検出回路、前記DCオフセット判定回路、前記DCオフセット補正回路に対して電源を供給し、
デジタル放送信号のうちの12セグメント受信時には、
前記DCオフセット検出回路、前記DCオフセット判定回路、前記DCオフセット補正回路のうち少なくともひとつに対して電源を停止する
請求項21に記載の電子チューナ。 - デジタル放送信号のうちの1セグメント受信の場合に、
前記第1および第2の混合器は、局部発振器の周波数が前記1セグメントの中心周波数より前記1セグメントの帯域の1/2以上離して設定されることにより、ヘテロダイン方式として用いられ、前記DCオフセット検出回路、前記DCオフセット判定回路、前記DCオフセット補正回路のうち少なくともひとつに対して電源を停止する
請求項21に記載の電子チューナ。 - 請求項21に記載の電子チューナの第1および第2の出力端子に復調部が接続される高周波受信装置であって、
前記復調部は、
前記第1および第2の出力端子からの信号が供給されるとともにアナログ信号をデジタル信号にそれぞれ変換する第1および第2のA/Dコンバータを備え、
前記第1および第2のA/Dコンバータから出力される信号が前記DCオフセット検出回路にそれぞれ接続されることを特徴とする
高周波受信装置。
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US20080130607A1 (en) | Method and System for Multimode DC Offset Compensation |
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