JP5031847B2 - デジタル線形送信器アーキテクチャ - Google Patents
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Description
したがって、混合回路は、アナログ回路によってサイズが決定づけられ、不必要に装置の領域を増加させる傾向がある。
56 再構成フィルタ
100 送信器コア
104 ハイブリッドデジタル−アナログ変調器
106 一体型ミキサ
110 位相同期ループ
112 リングオシレータ
206,208 分周器
300 加重トランジスタDAC
302 ΔΣ DAC
clk クロック信号
VCO 電圧制御型オシレータ
Claims (9)
- 無線周波数(RF)出力信号を送信する無線装置送信器であって、
前記送信器は、
変調デジタル信号を受信する入力ステージと、
iビットのサイズのオーバーサンプリングされた信号を形成するように、前記変調デジタル信号の周波数を増加させるオーバーサンプリングステージと
を具備し、
前記iは、1より大きい整数値であり、
前記送信器は、
前記iビットのオーバーサンプリングされた信号を受信するデジタル−アナログ変換器(DAC)回路
を具備し、
前記DAC回路は、
オーバーサンプリングされた前記信号の下位jビットに対応する第1アナログ信号を生成するデルタシグマ(ΔΣ)変換器と、
前記オーバーサンプリングされた信号の上位i−jビットを受信するとともに、i−j個の対応するアナログ信号を生成する加重トランジスタ・デジタル−アナログ変換器と、
を具備し、
前記jは、1より大きく、かつ前記iよりも小さい整数値であり、
前記第1アナログ信号に対応する第1電流と、前記i−j個の対応するアナログ信号に対応するi−j個の対応する電流との総和に対応する最終電流を生成する電流加算エレメントと、
フィルタリングされた最終電流信号を供給するように、最終電流を受信する1次オーダーフィルタリング回路を有する電流ミラー回路と、
を具備することを特徴とする無線装置送信器。 - 前記オーバーサンプリングステージは、少なくともアップサンプリング回路、再構成フィルタ回路、および前記DAC回路を駆動する高周波数クロックを生成する、クロック変換器回路を具備することを特徴とする請求項1に記載の無線装置送信器。
- 前記高周波数クロックを生成する前記クロック変換器回路は、低周波数を有する入力クロック信号を前記高周波数クロックに変換するように動作可能に配置された、位相同期ループおよびリングオシレータを具備することを特徴とする請求項2に記載の無線装置送信器。
- 前記オーバーサンプリングステージは、電圧制御型オシレータ(VCO)によって形成されるアナログコンポーネントを具備し、
前記クロック変換器回路は、少なくとも2つのクロック分周器と、レート変換回路とによって形成され、
前記VCOと、前記クロック変換器回路とは、前記VCOの出力が前記高周波数クロックを形成するように動作可能に配置されることを特徴とする請求項2に記載の無線装置送信器。 - 前記入力ステージと、前記オーバーサンプリングステージとは、デジタル領域において動作することを特徴とする請求項1に記載の無線装置送信器。
- 前記DAC回路は、フィルタリングされた最終電流信号をアップ変換するミキサ回路を具備することを特徴とする請求項1に記載の無線装置送信器。
- 無線装置送信器において、無線周波数(RF)出力信号を処理する方法であって、
前記方法は、
変調デジタル信号を受信するステップと、
iビットのサイズのオーバーサンプリングされた信号を得るように、前記変調デジタル信号をオーバーサンプリングするステップと
を具備し、
前記iは、1よりも大きい整数値であり、
前記方法は、
デルタシグマ(ΔΣ)変換器を使用して、jビットのオーバーサンプリングされた信号を第1アナログ信号に変換するステップを具備し、
前記jは、1よりも大きく、かつ前記iよりも小さい整数値であり、
前記方法は、
電流加算エレメントを使用し、前記第1アナログ信号に対応する第1電流と、前記i−j個の対応するアナログ信号に対応するi−j個の対応する電流との総和に対応する最終電流を生成するステップと、
前記最終電流を受信する1次オーダーフィルタリング回路を有する電流ミラー回路を使用し、フィルタリングされた最終電流信号を供給するステップと、
を具備することを特徴とする方法。 - 前記オーバーサンプリングするステップは、低周波数を有する入力クロック信号を高周波数クロックに変換するように動作可能に配置された、位相同期ループおよびリングオシレータを使用して、前記クロック周波数を増加させることによって遂行されることを特徴とする請求項7に記載の方法。
- 前記オーバーサンプリングするステップは、電圧制御型オシレータ(VCO)によって形成されるアナログコンポーネントと、少なくとも2つのクロック分周器、およびレート変換回路によって形成されるクロック変換器回路とを使用して、前記クロック周波数を増加させることによって遂行され、
前記VCOと、前記クロック変換回路とは、前記VCOの出力が高周波数クロックを形成するように動作可能に配置されていることを特徴とする請求項7に記載の方法。
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