JP4998213B2 - 電気特性見積プログラム、電気特性見積装置および電気特性見積方法 - Google Patents
電気特性見積プログラム、電気特性見積装置および電気特性見積方法 Download PDFInfo
- Publication number
- JP4998213B2 JP4998213B2 JP2007285468A JP2007285468A JP4998213B2 JP 4998213 B2 JP4998213 B2 JP 4998213B2 JP 2007285468 A JP2007285468 A JP 2007285468A JP 2007285468 A JP2007285468 A JP 2007285468A JP 4998213 B2 JP4998213 B2 JP 4998213B2
- Authority
- JP
- Japan
- Prior art keywords
- semiconductor package
- specifying
- length information
- cost
- interposer
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Images
Description
本実施の形態にかかる電気特性見積処理の概要について説明する。図1は、本実施の形態にかかる電気特性見積処理の概要を示す説明図である。本実施の形態にかかる電気特性見積処理では、PKGをワイヤ部分と、インターポーザー部分との各パーツに分割し、各パーツの電気特性値をそれぞれ独立して見積もる。また、このとき、見積対象となるPKGのコスト算出を連動しておこなう。
つぎに、本実施の形態にかかる電気特性見積装置のハードウェア構成について説明する。図2は、本実施の形態にかかる電気特性見積装置のハードウェア構成を示す説明図である。
つぎに、電気特性見積装置の機能的構成について説明する。図3は、電気特性見積装置の機能的構成を示すブロック図である。図3において、電気特性見積装置200は、構成情報取得部301と、コスト算出部302と、ワイヤ長情報取得部303と、インターポーザー配線長情報取得部304と、特定部305と、出力部306とを備えている。また、電気特性見積装置200には、電磁界解析シミュレーションをおこなう電磁界解析シミュレータ320が接続されている。
つぎに、電気特性見積装置200による電気特性見積処理の手順について説明する。図4は、電気特性見積装置による電気特性見積処理の手順を示すフローチャートである。図4のフローチャートにおいて、まず、構成情報取得部301においてPKGの構成に関する情報を取得したか否かを判断する(ステップS401)。ここでPKGの構成に関する情報を取得するまで待ち(ステップS401:Noのループ)、取得すると(ステップS401:Yes)、コスト算出部302において取得したPKGの構成に関する情報からPKGコストの算出をおこなう(ステップS402)。
まず、ワイヤ部分の見積、すなわち、ワイヤ長に応じた電気特性の見積について説明する。図5は、3次元ワイヤモデルの一例を示す説明図である。図5には、LSIチップと、PKGの基板部分とを接続するワイヤの配線例が示されている。近年のLSIの高機能化、ピン数の増加に対応するためPKGの構成も多層化が進み、ワイヤも多段配線されることが多い。したがって、図5のように、3次元ワイヤモデルからチップ厚、引き上げ高さ、CADワイヤ長を考慮してワイヤ長を取得する必要がある。
つぎに、インターポーザー部分の見積、すなわち、インターポーザー配線長に応じた電気特性の見積について説明する。図7は、インターポーザー配線の2次元モデルの一例を示す説明図である。図7のインターポーザーモデル700のように、インターポーザー配線(ライン1〜ライン5)は、相互に作用し合うため、配置地点(ラインx)と、最小配線間隔Wごとにそれぞれ電気特性を算出する必要がある。ここでは、最小配線間隔Wは、インターポーザー配線幅を最小配線間隔Wとし、最小配線間隔Wの1倍から5倍までの配線間隔でパラメータを設定した。
つぎに、PKGコストの算出について説明する。図9は、PKGコストの算出例を示す図表である。図9の図表900のように、コスト算出部302では、各PKGの構成のバリエーションごとにコストデータを算出する。図表900に示した各コストデータは、PKGの種類に応じた各基板コストと、各組み立てコストとのデータから個別に算出した値である。なお、図表900には、サイズ10mm2、2層、デザインルールAのPKGのコストを基準「1.0」として定量的にコストをあらわしているが、具体的な単価(○○円など)を表示してもよい。
つぎに、上述した各見積とコスト算出を利用した、あるPKGの電気特性見積例を説明する。図10は、電気特性見積の一例を示すフローチャートである。また、図11は、見積対象PKGの一例を示す説明図である。以下、図10のフローチャートを用いて図11に示すPKG1100の電気特性見積の手順を説明する。
前記半導体パッケージの構成に関する情報を取得させる構成情報取得工程と、
前記構成情報取得工程によって取得させた半導体パッケージの構成に関する情報から基板コストと、組み立てコストとを特定させ、前記半導体パッケージのコストを算出させるコスト算出工程と、
前記LSIチップを前記半導体パッケージに接続するワイヤ長情報を前記設計情報から取得させるワイヤ長情報取得工程と、
前記ワイヤ長情報取得工程によって取得させたワイヤ長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのワイヤ部分の電気特性値として特定させる第1の特定工程と、
前記半導体パッケージのインターポーザー配線長情報を前記設計情報から取得させるインターポーザー配線長情報取得工程と、
前記インターポーザー配線長情報取得工程によって取得させたインターポーザー配線長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのインターポーザー部分の電気特性値として特定させる第2の特定工程と、
前記コスト算出工程によって算出させた前記半導体パッケージのコストと、前記第1の特定工程によって特定させたワイヤ部分の電気特性値と、前記第2の特定工程によって特定させたインターポーザー部分の電気特性値とを出力させる出力工程と、
を前記コンピュータに実行させることを特徴とする電気特性見積プログラム。
前記出力工程は、前記抵抗値算出工程によって抵抗値が算出された場合、前記抵抗値を出力させることを特徴とする付記1に記載の電気特性見積プログラム。
前記出力工程は、前記抵抗値算出工程によって抵抗値が算出された場合、前記抵抗値を出力させることを特徴とする付記1に記載の電気特性見積プログラム。
前記第2の特定工程によって前記インターポーザー部分の電気特性値として誘導係数と静電容量とが特定されると、前記半導体パッケージの動作周波数に応じた抵抗値を算出させる第2の抵抗値算出工程と、を前記コンピュータに実行させ、
前記出力工程は、前記第1の抵抗値算出工程および第2の抵抗値算出工程によって抵抗値が算出された場合、前記抵抗値を出力させることを特徴とする付記1に記載の電気特性見積プログラム。
前記第2の特定工程は、あらかじめインターポーザー配線長の変化ごとの電磁界解析シミュレーション結果を蓄積したライブラリを参照させて前記インターポーザー部分の電気特性値を特定させることを特徴とする付記1〜4のいずれか一つに記載の電気特性見積プログラム。
前記受付工程によって受け付けさせた変更指示に応じた設計情報を作成させる作成工程と、
前記作成工程によって設計情報が作成されると、当該設計情報を出力させる設計情報出力工程と、
を前記コンピュータに実行させることを特徴とする付記1〜5のいずれか一つに記載の電気特性見積プログラム。
前記半導体パッケージの構成に関する情報を取得する構成情報取得手段と、
前記構成情報取得手段によって取得された半導体パッケージの構成に関する情報から基板コストと、組み立てコストとを特定し、前記半導体パッケージのコストを算出するコスト算出手段と、
前記LSIチップを前記半導体パッケージに接続するワイヤ長情報を前記設計情報から取得するワイヤ長情報取得手段と、
前記半導体パッケージのインターポーザー配線長情報を前記設計情報から取得するインターポーザー配線長情報取得手段と、
前記ワイヤ長情報取得手段によって取得したワイヤ長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのワイヤ部分の電気特性値として特定し、前記インターポーザー配線長情報取得手段によって取得したインターポーザー配線長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのインターポーザー部分の電気特性値として特定する特定手段と、
前記コスト算出手段によって算出した前記半導体パッケージのコストと、前記特定手段によって特定したワイヤ部分の電気特性値と、インターポーザー部分の電気特性値とを出力する出力手段と、
を備えることを特徴とする電気特性見積装置。
前記出力手段は、前記抵抗値算出手段によって抵抗値が算出された場合、前記抵抗値を出力することを特徴とする付記7に記載の電気特性見積装置。
前記出力手段は、前記抵抗値算出手段によって抵抗値が算出された場合、前記抵抗値を出力することを特徴とする付記7に記載の電気特性見積装置。
前記出力手段は、前記抵抗値算出手段によって算出された抵抗値を出力することを特徴とする付記7記載の電気特性見積装置。
前記受付手段によって受け付けた変更指示に応じた設計情報を作成する作成手段と、を備え、
前記出力手段は、前記作成手段によって設計情報が作成されると、当該設計情報を出力することを特徴とする付記7〜11のいずれか一つに記載の電気特性見積装置。
前記半導体パッケージの構成に関する情報を取得する構成情報取得工程と、
前記構成情報取得工程によって取得された半導体パッケージの構成に関する情報から基板コストと、組み立てコストとを特定し、前記半導体パッケージのコストを算出するコスト算出工程と、
前記LSIチップを前記半導体パッケージに接続するワイヤ長情報を前記設計情報から取得するワイヤ長情報取得工程と、
前記ワイヤ長情報取得工程によって取得したワイヤ長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのワイヤ部分の電気特性値として特定する第1の特定工程と、
前記半導体パッケージのインターポーザー配線長情報を前記設計情報から取得するインターポーザー配線長情報取得工程と、
前記インターポーザー配線長情報取得工程によって取得したインターポーザー配線長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのインターポーザー部分の電気特性値として特定する第2の特定工程と、
前記コスト算出工程によって算出した前記半導体パッケージのコストと、前記第1の特定工程によって特定させたワイヤ部分の電気特性値と、前記第2の特定工程によって特定させたインターポーザー部分の電気特性値とを出力する出力工程と、
を含むことを特徴とする電気特性見積方法。
前記出力工程は、前記抵抗値算出工程によって抵抗値が算出された場合、前記抵抗値を出力することを特徴とする付記13に記載の電気特性見積方法。
前記出力工程は、前記抵抗値算出工程によって抵抗値が算出された場合、前記抵抗値を出力することを特徴とする付記13に記載の電気特性見積方法。
前記第2の特定工程によって前記インターポーザー部分の電気特性値として誘導係数と静電容量とが特定されると、前記半導体パッケージの動作周波数に応じた抵抗値を算出する第2の抵抗値算出工程と、を含み、
前記出力工程は、前記第1の抵抗値算出工程および第2の抵抗値算出工程によって抵抗値が算出された場合、前記抵抗値を出力することを特徴とする付記13に記載の電気特性見積方法。
前記第2の特定工程は、あらかじめインターポーザー配線長の変化ごとの電磁界解析シミュレーション結果を蓄積したライブラリを参照して前記インターポーザー部分の電気特性値を特定することを特徴とする付記13〜16のいずれか一つに記載の電気特性見積方法。
前記受付工程によって受け付けた変更指示に応じた設計情報を作成する作成工程と、
前記作成工程によって設計情報が作成されると、当該設計情報を出力する設計情報出力工程と、
を含むことを特徴とする付記13〜17のいずれか一つに記載の電気特性見積方法。
120 電気特性見積ツール
130 PKG製造装置
200 電気特性見積装置
210 コンピュータ本体
220 入力装置
230 出力装置
240 ネットワーク
Claims (9)
- LSIチップを搭載する半導体パッケージの設計情報から前記半導体パッケージの電気特性の見積処理をコンピュータに実行させる電気特性見積プログラムであって、
前記半導体パッケージの構成に関する情報を取得させる構成情報取得工程と、
前記構成情報取得工程によって取得させた半導体パッケージの構成に関する情報から基板コストと、組み立てコストとを特定させ、前記半導体パッケージのコストを算出させるコスト算出工程と、
前記LSIチップを前記半導体パッケージに接続するワイヤ長情報を前記設計情報から取得させるワイヤ長情報取得工程と、
前記ワイヤ長情報取得工程によって取得させたワイヤ長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのワイヤ部分の電気特性値として特定させる第1の特定工程と、
前記第1の特定工程によって前記ワイヤ部分の電気特性値として誘導係数と静電容量とが特定されると、前記半導体パッケージの動作周波数に応じた抵抗値を算出させる抵抗値算出工程と、
前記半導体パッケージのインターポーザー配線長情報を前記設計情報から取得させるインターポーザー配線長情報取得工程と、
前記インターポーザー配線長情報取得工程によって取得させたインターポーザー配線長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのインターポーザー部分の電気特性値として特定させる第2の特定工程と、
前記コスト算出工程によって算出させた前記半導体パッケージのコストと、前記第1の特定工程によって特定させたワイヤ部分の電気特性値と、前記抵抗値算出工程によって算出された抵抗値と、前記第2の特定工程によって特定させたインターポーザー部分の電気特性値とを出力させる出力工程と、
を前記コンピュータに実行させることを特徴とする電気特性見積プログラム。 - LSIチップを搭載する半導体パッケージの設計情報から前記半導体パッケージの電気特性の見積処理をコンピュータに実行させる電気特性見積プログラムであって、
前記半導体パッケージの構成に関する情報を取得させる構成情報取得工程と、
前記構成情報取得工程によって取得させた半導体パッケージの構成に関する情報から基板コストと、組み立てコストとを特定させ、前記半導体パッケージのコストを算出させるコスト算出工程と、
前記LSIチップを前記半導体パッケージに接続するワイヤ長情報を前記設計情報から取得させるワイヤ長情報取得工程と、
前記ワイヤ長情報取得工程によって取得させたワイヤ長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのワイヤ部分の電気特性値として特定させる第1の特定工程と、
前記半導体パッケージのインターポーザー配線長情報を前記設計情報から取得させるインターポーザー配線長情報取得工程と、
前記インターポーザー配線長情報取得工程によって取得させたインターポーザー配線長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのインターポーザー部分の電気特性値として特定させる第2の特定工程と、
前記第2の特定工程によって前記インターポーザー部分の電気特性値として誘導係数と静電容量とが特定されると、前記半導体パッケージの動作周波数に応じた抵抗値を算出させる抵抗値算出工程と、
前記コスト算出工程によって算出させた前記半導体パッケージのコストと、前記第1の特定工程によって特定させたワイヤ部分の電気特性値と、前記第2の特定工程によって特定させたインターポーザー部分の電気特性値と、前記抵抗値算出工程によって算出された抵抗値と、を出力させる出力工程と、
を前記コンピュータに実行させることを特徴とする電気特性見積プログラム。 - LSIチップを搭載する半導体パッケージの設計情報から前記半導体パッケージの電気特性の見積処理をコンピュータに実行させる電気特性見積プログラムであって、
前記半導体パッケージの構成に関する情報を取得させる構成情報取得工程と、
前記構成情報取得工程によって取得させた半導体パッケージの構成に関する情報から基板コストと、組み立てコストとを特定させ、前記半導体パッケージのコストを算出させるコスト算出工程と、
前記LSIチップを前記半導体パッケージに接続するワイヤ長情報を前記設計情報から取得させるワイヤ長情報取得工程と、
あらかじめワイヤ長の変化ごとの電磁界解析シミュレーション結果を蓄積したライブラリを参照させて、前記ワイヤ長情報取得工程によって取得させたワイヤ長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのワイヤ部分の電気特性値として特定させる第1の特定工程と、
前記半導体パッケージのインターポーザー配線長情報を前記設計情報から取得させるインターポーザー配線長情報取得工程と、
あらかじめインターポーザー配線長の変化ごとの電磁界解析シミュレーション結果を蓄積したライブラリを参照させて、前記インターポーザー配線長情報取得工程によって取得させたインターポーザー配線長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのインターポーザー部分の電気特性値として特定させる第2の特定工程と、
前記コスト算出工程によって算出させた前記半導体パッケージのコストと、前記第1の特定工程によって特定させたワイヤ部分の電気特性値と、前記第2の特定工程によって特定させたインターポーザー部分の電気特性値とを出力させる出力工程と、
を前記コンピュータに実行させることを特徴とする電気特性見積プログラム。 - LSIチップを搭載する半導体パッケージの設計情報から前記半導体パッケージの電気特性の見積処理をおこなう電気特性見積装置であって、
前記半導体パッケージの構成に関する情報を取得する構成情報取得手段と、
前記構成情報取得手段によって取得された半導体パッケージの構成に関する情報から基板コストと、組み立てコストとを特定し、前記半導体パッケージのコストを算出するコスト算出手段と、
前記LSIチップを前記半導体パッケージに接続するワイヤ長情報を前記設計情報から取得するワイヤ長情報取得手段と、
前記半導体パッケージのインターポーザー配線長情報を前記設計情報から取得するインターポーザー配線長情報取得手段と、
前記ワイヤ長情報取得手段によって取得したワイヤ長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのワイヤ部分の電気特性値として特定し、前記インターポーザー配線長情報取得手段によって取得したインターポーザー配線長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのインターポーザー部分の電気特性値として特定する特定手段と、
前記ワイヤ部分の電気特性値として誘導係数と静電容量とを特定すると、前記半導体パッケージの動作周波数に応じた抵抗値を算出する抵抗値算出手段と、
前記コスト算出手段によって算出した前記半導体パッケージのコストと、前記特定手段によって特定したワイヤ部分の電気特性値と、インターポーザー部分の電気特性値と、前記抵抗値算出手段によって算出された抵抗値と、を出力する出力手段と、
を備えることを特徴とする電気特性見積装置。 - LSIチップを搭載する半導体パッケージの設計情報から前記半導体パッケージの電気特性の見積処理をおこなう電気特性見積装置であって、
前記半導体パッケージの構成に関する情報を取得する構成情報取得手段と、
前記構成情報取得手段によって取得された半導体パッケージの構成に関する情報から基板コストと、組み立てコストとを特定し、前記半導体パッケージのコストを算出するコスト算出手段と、
前記LSIチップを前記半導体パッケージに接続するワイヤ長情報を前記設計情報から取得するワイヤ長情報取得手段と、
前記半導体パッケージのインターポーザー配線長情報を前記設計情報から取得するインターポーザー配線長情報取得手段と、
前記ワイヤ長情報取得手段によって取得したワイヤ長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのワイヤ部分の電気特性値として特定し、前記インターポーザー配線長情報取得手段によって取得したインターポーザー配線長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのインターポーザー部分の電気特性値として特定する特定手段と、
前記インターポーザー部分の電気特性値として誘導係数と静電容量とを特定すると、前記半導体パッケージの動作周波数に応じた抵抗値を算出する抵抗値算出手段と、
前記コスト算出手段によって算出した前記半導体パッケージのコストと、前記特定手段によって特定したワイヤ部分の電気特性値と、インターポーザー部分の電気特性値と、前記抵抗値算出手段によって算出された抵抗値と、を出力する出力手段と、
を備えることを特徴とする電気特性見積装置。 - LSIチップを搭載する半導体パッケージの設計情報から前記半導体パッケージの電気特性の見積処理をおこなう電気特性見積装置であって、
前記半導体パッケージの構成に関する情報を取得する構成情報取得手段と、
前記構成情報取得手段によって取得された半導体パッケージの構成に関する情報から基板コストと、組み立てコストとを特定し、前記半導体パッケージのコストを算出するコスト算出手段と、
前記LSIチップを前記半導体パッケージに接続するワイヤ長情報を前記設計情報から取得するワイヤ長情報取得手段と、
前記半導体パッケージのインターポーザー配線長情報を前記設計情報から取得するインターポーザー配線長情報取得手段と、
あらかじめワイヤ長の変化ごとの電磁界解析シミュレーション結果を蓄積したライブラリを参照して、前記ワイヤ長情報取得手段によって取得したワイヤ長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのワイヤ部分の電気特性値として特定し、あらかじめインターポーザー配線長の変化ごとの電磁界解析シミュレーション結果を蓄積したライブラリを参照して、前記インターポーザー配線長情報取得手段によって取得したインターポーザー配線長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのインターポーザー部分の電気特性値として特定する特定手段と、
前記コスト算出手段によって算出した前記半導体パッケージのコストと、前記特定手段によって特定したワイヤ部分の電気特性値と、インターポーザー部分の電気特性値とを出力する出力手段と、
を備えることを特徴とする電気特性見積装置。 - LSIチップを搭載する半導体パッケージの設計情報から前記半導体パッケージの電気特性の見積処理をコンピュータがおこなう電気特性見積方法であって、
前記コンピュータが有する構成情報取得手段により、前記半導体パッケージの構成に関する情報を取得する構成情報取得工程と、
前記コンピュータが有するコスト算出手段により、前記構成情報取得工程によって取得された半導体パッケージの構成に関する情報から基板コストと、組み立てコストとを特定し、前記半導体パッケージのコストを算出するコスト算出工程と、
前記コンピュータが有するワイヤ長情報取得手段により、前記LSIチップを前記半導体パッケージに接続するワイヤ長情報を前記設計情報から取得するワイヤ長情報取得工程と、
前記コンピュータが有する特定手段により、前記ワイヤ長情報取得工程によって取得したワイヤ長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのワイヤ部分の電気特性値として特定する第1の特定工程と、
前記コンピュータが有する抵抗値算出手段により、前記第1の特定工程によって前記ワイヤ部分の電気特性値として誘導係数と静電容量とが特定されると、前記半導体パッケージの動作周波数に応じた抵抗値を算出する抵抗値算出工程と、
前記コンピュータが有するインターポーザー配線長情報取得手段により、前記半導体パッケージのインターポーザー配線長情報を前記設計情報から取得するインターポーザー配線長情報取得工程と、
前記コンピュータが有する特定手段により、前記インターポーザー配線長情報取得工程によって取得したインターポーザー配線長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのインターポーザー部分の電気特性値として特定する第2の特定工程と、
前記コンピュータが有する出力手段により、前記コスト算出工程によって算出した前記半導体パッケージのコストと、前記第1の特定工程によって特定させたワイヤ部分の電気特性値と、前記抵抗値算出工程によって算出された抵抗値と、前記第2の特定工程によって特定させたインターポーザー部分の電気特性値とを出力する出力工程と、
を含むことを特徴とする電気特性見積方法。 - LSIチップを搭載する半導体パッケージの設計情報から前記半導体パッケージの電気特性の見積処理をコンピュータがおこなう電気特性見積方法であって、
前記コンピュータが有する構成情報取得手段により、前記半導体パッケージの構成に関する情報を取得する構成情報取得工程と、
前記コンピュータが有するコスト算出手段により、前記構成情報取得工程によって取得された半導体パッケージの構成に関する情報から基板コストと、組み立てコストとを特定し、前記半導体パッケージのコストを算出するコスト算出工程と、
前記コンピュータが有するワイヤ長情報取得手段により、前記LSIチップを前記半導体パッケージに接続するワイヤ長情報を前記設計情報から取得するワイヤ長情報取得工程と、
前記コンピュータが有する特定手段により、前記ワイヤ長情報取得工程によって取得したワイヤ長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのワイヤ部分の電気特性値として特定する第1の特定工程と、
前記コンピュータが有するインターポーザー配線長情報取得手段により、前記半導体パッケージのインターポーザー配線長情報を前記設計情報から取得するインターポーザー配線長情報取得工程と、
前記コンピュータが有する特定手段により、前記インターポーザー配線長情報取得工程によって取得したインターポーザー配線長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのインターポーザー部分の電気特性値として特定する第2の特定工程と、
前記コンピュータが有する抵抗値算出手段により、前記第2の特定工程によって前記インターポーザー部分の電気特性値として誘導係数と静電容量とが特定されると、前記半導体パッケージの動作周波数に応じた抵抗値を算出する抵抗値算出工程と、
前記コンピュータが有する出力手段により、前記コスト算出工程によって算出した前記半導体パッケージのコストと、前記第1の特定工程によって特定させたワイヤ部分の電気特性値と、前記第2の特定工程によって特定させたインターポーザー部分の電気特性値と、前記抵抗値算出工程によって算出された抵抗値と、を出力する出力工程と、
を含むことを特徴とする電気特性見積方法。 - LSIチップを搭載する半導体パッケージの設計情報から前記半導体パッケージの電気特性の見積処理をコンピュータがおこなう電気特性見積方法であって、
前記コンピュータが有する構成情報取得手段により、前記半導体パッケージの構成に関する情報を取得する構成情報取得工程と、
前記コンピュータが有するコスト算出手段により、前記構成情報取得工程によって取得された半導体パッケージの構成に関する情報から基板コストと、組み立てコストとを特定し、前記半導体パッケージのコストを算出するコスト算出工程と、
前記コンピュータが有するワイヤ長情報取得手段により、前記LSIチップを前記半導体パッケージに接続するワイヤ長情報を前記設計情報から取得するワイヤ長情報取得工程と、
前記コンピュータが有する特定手段により、あらかじめワイヤ長の変化ごとの電磁界解析シミュレーション結果を蓄積したライブラリを参照して、前記ワイヤ長情報取得工程によって取得したワイヤ長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのワイヤ部分の電気特性値として特定する第1の特定工程と、
前記コンピュータが有するインターポーザー配線長情報取得手段により、前記半導体パッケージのインターポーザー配線長情報を前記設計情報から取得するインターポーザー配線長情報取得工程と、
前記コンピュータが有する特定手段により、あらかじめインターポーザー配線長の変化ごとの電磁界解析シミュレーション結果を蓄積したライブラリを参照して、前記インターポーザー配線長情報取得工程によって取得したインターポーザー配線長情報に応じた電磁界解析シミュレーション結果を前記半導体パッケージのインターポーザー部分の電気特性値として特定する第2の特定工程と、
前記コンピュータが有する出力手段により、前記コスト算出工程によって算出した前記半導体パッケージのコストと、前記第1の特定工程によって特定させたワイヤ部分の電気特性値と、前記第2の特定工程によって特定させたインターポーザー部分の電気特性値とを出力する出力工程と、
を含むことを特徴とする電気特性見積方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2007285468A JP4998213B2 (ja) | 2007-11-01 | 2007-11-01 | 電気特性見積プログラム、電気特性見積装置および電気特性見積方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2007285468A JP4998213B2 (ja) | 2007-11-01 | 2007-11-01 | 電気特性見積プログラム、電気特性見積装置および電気特性見積方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2009116410A JP2009116410A (ja) | 2009-05-28 |
JP4998213B2 true JP4998213B2 (ja) | 2012-08-15 |
Family
ID=40783525
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2007285468A Expired - Fee Related JP4998213B2 (ja) | 2007-11-01 | 2007-11-01 | 電気特性見積プログラム、電気特性見積装置および電気特性見積方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP4998213B2 (ja) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP5928220B2 (ja) * | 2012-07-26 | 2016-06-01 | 株式会社ソシオネクスト | 電気特性抽出方法及び装置 |
US20160253448A1 (en) * | 2012-11-21 | 2016-09-01 | Nec Corporation | Circuit board design system, circuit board design method and program recording medium |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP4184590B2 (ja) * | 2000-12-04 | 2008-11-19 | 松下電器産業株式会社 | 回路基板の実装コスト評価方法及びその装置 |
JP3894535B2 (ja) * | 2001-07-13 | 2007-03-22 | 松下電器産業株式会社 | 不要輻射解析方法および不要輻射解析装置 |
JP4591693B2 (ja) * | 2005-06-24 | 2010-12-01 | 日本電気株式会社 | 解析方法、解析装置およびプログラム |
-
2007
- 2007-11-01 JP JP2007285468A patent/JP4998213B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JP2009116410A (ja) | 2009-05-28 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP4597691B2 (ja) | 有限要素法を用いた構造解析方法 | |
US8104003B2 (en) | Technique for creating analysis model and technique for creating circuit board model | |
JP4450751B2 (ja) | メッシュモデル作成方法、シミュレーション装置及びプログラム | |
US9348965B2 (en) | Parasitic component library and method for efficient circuit design and simulation using the same | |
JP6599057B1 (ja) | 設計支援装置、設計支援方法および機械学習装置 | |
US9372954B2 (en) | Semiconductor device design system and method | |
JP2010009179A (ja) | 半導体装置もしくはプリント配線基板の設計方法および設計支援システム | |
JP2008250630A (ja) | デカップリングセル配置方法及びデカップリングセル配置装置 | |
JP4411322B2 (ja) | 数値解析モデルデータ生成プログラム、数値解析モデルデータ生成方法、および数値解析モデルデータ生成装置 | |
JP4998213B2 (ja) | 電気特性見積プログラム、電気特性見積装置および電気特性見積方法 | |
JP5001304B2 (ja) | 回路装置の解析装置、回路装置の解析方法、回路装置の設計方法、回路装置の解析プログラムおよび記憶媒体 | |
JPWO2007086120A1 (ja) | 情報処理装置、シミュレーション方法、情報処理プログラム | |
KR100999016B1 (ko) | 반도체 장치에 대한 동시 동작 신호 노이즈에 기초하여 지터를 견적하는 방법, 그 견적에 사용하는 동시 동작 신호노이즈량 대 지터량 상관 관계를 산출하는 방법, 이들을 실현하는 프로그램을 기록한 기록매체, 및 반도체 장치 및 그것이 탑재된 프린트 회로 기판의 설계 방법 | |
JP4678027B2 (ja) | 集積回路装置の評価装置、評価方法及び評価プログラム | |
JP5429889B2 (ja) | 半導体集積回路の動作解析方法、動作解析装置、動作解析プログラム及び動作解析システム | |
KR101116786B1 (ko) | 반도체 장치의 설계 검증 장치 | |
JP4575326B2 (ja) | 基板レイアウトチェックシステムおよび方法 | |
JP2008071204A (ja) | 半導体チップを含む装置の設計方法、設計支援システム及びプログラム | |
JP2008287666A (ja) | 回路動作検証装置、半導体集積回路の製造方法、回路動作検証方法、制御プログラムおよび可読記録媒体 | |
JP4879163B2 (ja) | モデリング方法及び装置、プログラム及び記憶媒体 | |
JP7125208B2 (ja) | ノイズ解析装置及びノイズ解析方法 | |
JP4283647B2 (ja) | レイアウトチェックシステム | |
JP7059157B2 (ja) | レイアウト設計装置及びレイアウト設計用プログラム | |
JP4862899B2 (ja) | デバイスシミュレーションモデル生成装置およびデバイスシミュレーションモデル生成方法 | |
JP4668974B2 (ja) | 半導体装置の設計方法、半導体装置設計システム及びコンピュータプログラム |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20100727 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20120127 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20120207 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20120330 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20120417 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20120430 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20150525 Year of fee payment: 3 |
|
S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313111 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
LAPS | Cancellation because of no payment of annual fees |