JP4984697B2 - 半導体装置の製造方法 - Google Patents
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図10〜図15は、前記図9に示す半導体装置について、その製造方法を製造工程順の図面で示した半導体基板の要部断面図である。図10に示すように、p型シリコン基板101にTLPM部102のnウエル103およびプレーナMOSFET部104のpウエル105を形成した後、TLPM部102のチャネルとなるpベース領域106を形成する。
マスク酸化膜107を全面除去し、LOCOS酸化膜110などの素子分離用選択離酸化膜を形成した後に、図13に示すように、ゲート酸化膜111を例えばトレンチ側壁面での厚さ17nmで形成する。ゲート酸化膜111上に厚さ320nmのドープドポリシリコン112をCVD(Chemical Vapor Deposition)により形成する。このドープドポリシリコン112厚み320nmは、後工程であるTLPM部のソースおよびプレーナMOSFET104のその後のソース/ドレインのイオン注入工程において、マスクとして利用されるので、特にプレーナMOSFET104でのイオン種の突き抜けを防止するために必要な膜厚である。
特許請求の範囲の請求項3記載の発明によれば、前記ゲート酸化膜が前記チャネル部における厚さよりトレンチ底部角部における厚さが厚い特許請求の範囲の請求項1または2記載の半導体装置の製造方法とすることが好適である。
特許請求の範囲の請求項5記載の発明によれば、前記減厚工程において、ドープドポリシリコン層の厚さを320nm未満に減厚する特許請求の範囲の請求項1乃至4のいずれか一項に記載の半導体装置の製造方法とすることが望ましい。
図2に示すように、p型シリコン基板1にTLPM部2を構成するためのnウエル3およびプレーナMOSFET部4を構成するためのpウエル5をそれぞれイオン注入および熱拡散により形成した後、nウエル3表面にTLPM部2のチャネルとなるpベース領域6を形成する。
前述のように、この実施例ではゲート酸化膜厚の最大の場所はトレンチ側壁から約150nmのところにあるので、これから側壁の酸化膜厚分を差し引くと約133nmとなる。従って、ドープドポリシリコン電極12の厚さを133nmにすると、ゲート電極12の端部が最も厚い酸化膜に接することになるので耐圧の観点からは最も好ましい。
以上の実施例の説明ではトレンチ底部角部の丸みの曲率半径を約300nmとしたが、丸みの曲率半径は約200nm以上ならば、従来よりゲート電極幅を小さくできるので、本発明の効果を生じ得る。曲率半径を400nmの場合は耐圧の向上という点では最も好ましい。400nmを超える曲率半径の場合はチャネル領域のゲート酸化膜の厚さに影響が及ぶようになり、好ましくない。しかし、ゲート電極の厚さが320nmを超える場合はトレンチ幅縮小のメリットは得られない。
2… TLPM
3… nウエル
4… プレーナMOSFET
5… pウエル
6… pベース
8… トレンチ
9… nドレイン
10… LOCOS酸化膜
11… ゲート酸化膜
12… ドープドポリシリコンゲート電極
13… フォトレジスト
14… nソース領域
15、16… nソース/ドレイン領域
17… 層間絶縁膜
18… バリアメタル
19… 埋め込みプラグ
20… 金属電極配線。
Claims (5)
- 半導体基板に形成されるトレンチの側壁のチャネル部にゲート酸化膜を介してゲート電極膜が形成されるトレンチ横型MOSFET部と、素子分離用絶縁膜により分離されて形成されるプレーナMOSFET部とを同一半導体基板に形成した半導体装置の製造方法において、トレンチ横型MOSFET部に異方性エッチングによりトレンチを形成する工程、前記トレンチの底面角部の曲率半径を等方性エッチングにより大きくするトレンチ整形工程、前記半導体基板表面にゲート酸化膜を熱酸化法により形成し、プレーナMOSFET部のソース/ドレイン領域のイオン注入による形成の際にマスクとして用いることのできる厚さを有するドープドポリシリコン層を堆積させる工程、トレンチ横型MOSFET部のドープドポリシリコン層を等方性エッチングすることにより減厚する減厚工程と、減厚したドープドポリシリコン層をエッチングすることによりトレンチ側壁に第一ゲート電極を形成する工程と、プレーナMOSFET部の上に被覆されているドープドポリシリコン層を選択的にエッチングすることにより第二ゲート電極を形成する工程と、を含むことを特徴とする半導体装置の製造方法。
- 前記トレンチ整形工程において、前記トレンチの底面角部の曲率半径を200nm以上に大きくし、前記減厚工程おいて、前記ドープドポリシリコン層の厚さを200nm以上に減厚することを特徴とする請求項1記載の半導体装置の製造方法。
- 前記ゲート酸化膜が前記チャネル部における厚さよりトレンチ底部角部における厚さが厚いことを特徴とする請求項1または2記載の半導体装置の製造方法。
- 前記トレンチ底部角部の丸みの曲率半径を400nm以下にすることを特徴とする請求項1乃至3のいずれか一項に記載の半導体装置の製造方法。
- 前記減厚工程において、ドープドポリシリコン層の厚さを320nm未満に減厚することを特徴とする請求項1乃至4のいずれか一項に記載の半導体装置の製造方法。
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